JPH09200530A - 画像処理装置 - Google Patents
画像処理装置Info
- Publication number
- JPH09200530A JPH09200530A JP8021976A JP2197696A JPH09200530A JP H09200530 A JPH09200530 A JP H09200530A JP 8021976 A JP8021976 A JP 8021976A JP 2197696 A JP2197696 A JP 2197696A JP H09200530 A JPH09200530 A JP H09200530A
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Abstract
(57)【要約】
【課題】 滑らかなエッジ強調処理を可能とする画像処
理装置を得る。 【解決手段】 ラプラシアンフィルタＲａｐ．Ｆが入力
画像信号ＯＲＧのエッジ信号を強調化して検出する。強
調化されたエッジ信号のエッジ成分は平滑化回路で平滑
化される。この平滑化回路の出力信号と入力画像信号Ｏ
ＲＧとは、加算回路で加算され出力信号ＯＵＴ１とな
る。平滑化されたエッジ信号が入力信号ＯＲＧに加算さ
れるため、入力画像信号ＯＲＧの滑らかなエッジ強調化
の処理が可能となる。
理装置を得る。 【解決手段】 ラプラシアンフィルタＲａｐ．Ｆが入力
画像信号ＯＲＧのエッジ信号を強調化して検出する。強
調化されたエッジ信号のエッジ成分は平滑化回路で平滑
化される。この平滑化回路の出力信号と入力画像信号Ｏ
ＲＧとは、加算回路で加算され出力信号ＯＵＴ１とな
る。平滑化されたエッジ信号が入力信号ＯＲＧに加算さ
れるため、入力画像信号ＯＲＧの滑らかなエッジ強調化
の処理が可能となる。
Description
【０００１】
【発明の属する技術分野】本発明は、画像処理装置に関
し、特に、画像のエッジ強調処理を行う画像処理装置に
関する。
し、特に、画像のエッジ強調処理を行う画像処理装置に
関する。
【０００２】
【従来の技術】従来、画像処理装置は、画像の鮮明化の
ためにエッジ強調処理を一般的に施す。例えば、特開昭
６４−２４７４号「画像処理システム」がある。本従来
例では、文字や印刷による網点写真による原稿だけでな
く、風景や人物の写真などのように穏やかに明度や色彩
が変化する原稿においても階調再現性及び画質のよいプ
リンタ出力を得ることのできる画像処理システムを提供
する、としている。
ためにエッジ強調処理を一般的に施す。例えば、特開昭
６４−２４７４号「画像処理システム」がある。本従来
例では、文字や印刷による網点写真による原稿だけでな
く、風景や人物の写真などのように穏やかに明度や色彩
が変化する原稿においても階調再現性及び画質のよいプ
リンタ出力を得ることのできる画像処理システムを提供
する、としている。
【０００３】従来の信号処理の手順例を具体的に説明す
る。図１１は、従来の演算回路の回路構成例を示すブロ
ック図である。図１１に示す演算回路は、図１２により
構成されるラプラシアンフィルタであるＲａｐ．Ｆと、
信号の利得を１／２とする１／２演算部と、２つの入力
信号を加算して１つの信号とする加算器とにより構成さ
れる。なお、記号ＯＲＧは本回路へ入力されるオリジナ
ル信号であり、ＯＵＴは出力信号である。
る。図１１は、従来の演算回路の回路構成例を示すブロ
ック図である。図１１に示す演算回路は、図１２により
構成されるラプラシアンフィルタであるＲａｐ．Ｆと、
信号の利得を１／２とする１／２演算部と、２つの入力
信号を加算して１つの信号とする加算器とにより構成さ
れる。なお、記号ＯＲＧは本回路へ入力されるオリジナ
ル信号であり、ＯＵＴは出力信号である。
【０００４】上記により構成される演算回路において、
入力されるオリジナル信号（ＯＲＧ）は、Ｒａｐ．Ｆと
１／２演算部とにより処理された一方の信号と、無処理
の他方のＯＲＧ信号とが、加算器へ入力され加算され
る。
入力されるオリジナル信号（ＯＲＧ）は、Ｒａｐ．Ｆと
１／２演算部とにより処理された一方の信号と、無処理
の他方のＯＲＧ信号とが、加算器へ入力され加算され
る。
【０００５】ＯＲＧ信号は、例えば、図１３に示す信号
であり、このＯＲＧ信号はＲａｐ．Ｆでエッジ部が波形
処理され図１４の波形の信号、Ｅｄｇとなる。この信号
Ｅｄｇは１／２演算部で利得が１／２とされ、加算器に
おいて信号ＯＲＧと加算されてＯＵＴの信号が出力され
る。上記手順の演算式は下記の式（１）となる。また、
ＯＵＴの信号の波形の形態を図１５に示す。
であり、このＯＲＧ信号はＲａｐ．Ｆでエッジ部が波形
処理され図１４の波形の信号、Ｅｄｇとなる。この信号
Ｅｄｇは１／２演算部で利得が１／２とされ、加算器に
おいて信号ＯＲＧと加算されてＯＵＴの信号が出力され
る。上記手順の演算式は下記の式（１）となる。また、
ＯＵＴの信号の波形の形態を図１５に示す。
【０００６】 ＯＵＴ＝ＯＲＧ＋｛Ｅｄｇ×（１／２）｝ … （１）
【０００７】
【発明が解決しようとする課題】しかしながら、従来の
画像処理装置におけるラプラシアンフィルタ等でのエッ
ジ検出では、図１５からも解るように、エッジの１ライ
ン部分のみが強調されてしまう。その結果、段階的で滑
らかなエッジ強調効果が得られない問題を伴う。
画像処理装置におけるラプラシアンフィルタ等でのエッ
ジ検出では、図１５からも解るように、エッジの１ライ
ン部分のみが強調されてしまう。その結果、段階的で滑
らかなエッジ強調効果が得られない問題を伴う。
【０００８】本発明は、滑らかなエッジ強調処理を可能
とする画像処理装置を提供することを目的とする。
とする画像処理装置を提供することを目的とする。
【０００９】
【課題を解決するための手段】かかる目的を達成するた
め、本発明の画像処理装置は、入力画像信号のエッジ信
号を強調化して検出するラプラシアンフィルタと、強調
化したエッジ信号のエッジ成分を平滑化する平滑化回路
と、この平滑化回路の出力信号と入力画像信号とを加算
する加算回路とを有し、入力画像信号の滑らかなエッジ
強調化の処理を可能としたことを特徴としている。
め、本発明の画像処理装置は、入力画像信号のエッジ信
号を強調化して検出するラプラシアンフィルタと、強調
化したエッジ信号のエッジ成分を平滑化する平滑化回路
と、この平滑化回路の出力信号と入力画像信号とを加算
する加算回路とを有し、入力画像信号の滑らかなエッジ
強調化の処理を可能としたことを特徴としている。
【００１０】また、上記のラプラシアンフィルタと平滑
化回路とによる入力画像信号のエッジ信号の強調化の処
理を、入力画像信号の正のエッジ成分にのみ適用すると
よい。
化回路とによる入力画像信号のエッジ信号の強調化の処
理を、入力画像信号の正のエッジ成分にのみ適用すると
よい。
【００１１】さらに、画像処理装置は、強調化されたエ
ッジ信号の量および／または極性に応じて変換された信
号とするテーブルを有し、このテーブルにより変換され
た出力信号に基づき、強調化の処理を行うとよい。
ッジ信号の量および／または極性に応じて変換された信
号とするテーブルを有し、このテーブルにより変換され
た出力信号に基づき、強調化の処理を行うとよい。
【００１２】尚、ラプラシアンフィルタは少なくとも２
種類のフィルタにより構成され、この少なくとも２種類
のフィルタの各々の出力信号の絶対値の大小判定を行
い、判定結果に応じてエッジ量の出力を切替え、強調化
を行うとよい。
種類のフィルタにより構成され、この少なくとも２種類
のフィルタの各々の出力信号の絶対値の大小判定を行
い、判定結果に応じてエッジ量の出力を切替え、強調化
を行うとよい。
【００１３】
【発明の実施の形態】次に添付図面を参照して本発明に
よる画像処理装置の実施の形態を詳細に説明する。図１
〜図１０を参照すると本発明の画像処理装置の一実施形
態が示されている。これらの図のうち図１〜図４が４種
の演算回路の回路構成例、図５〜図７がフィルタ構成
例、図８〜図１０が処理後の波形をそれぞれ表してい
る。以下において、説明を解り易くするために信号処理
の過程は１次元として説明する。
よる画像処理装置の実施の形態を詳細に説明する。図１
〜図１０を参照すると本発明の画像処理装置の一実施形
態が示されている。これらの図のうち図１〜図４が４種
の演算回路の回路構成例、図５〜図７がフィルタ構成
例、図８〜図１０が処理後の波形をそれぞれ表してい
る。以下において、説明を解り易くするために信号処理
の過程は１次元として説明する。
【００１４】＜第１の演算回路＞図１は、本実施形態の
第１の演算回路の回路構成例を示すブロック図である。
図１に示す第１の演算回路は、図１２により構成される
フィルタであるＲａｐ．Ｆと、このＲａｐ．Ｆの出力信
号を平滑化する平滑化回路と、２つの入力信号を加算し
て１つの信号とする加算器とにより構成される。記号Ｏ
ＲＧは本回路へ入力されるオリジナル信号であり、ＯＵ
Ｔ１は出力信号である。
第１の演算回路の回路構成例を示すブロック図である。
図１に示す第１の演算回路は、図１２により構成される
フィルタであるＲａｐ．Ｆと、このＲａｐ．Ｆの出力信
号を平滑化する平滑化回路と、２つの入力信号を加算し
て１つの信号とする加算器とにより構成される。記号Ｏ
ＲＧは本回路へ入力されるオリジナル信号であり、ＯＵ
Ｔ１は出力信号である。
【００１５】上記により構成される第１の演算回路にお
いて、入力されるオリジナル信号（ＯＲＧ）は、Ｒａ
ｐ．Ｆと平滑化回路とにより処理された一方の信号と、
無処理の他方のＯＲＧ信号とが、加算器へ入力され加算
される。
いて、入力されるオリジナル信号（ＯＲＧ）は、Ｒａ
ｐ．Ｆと平滑化回路とにより処理された一方の信号と、
無処理の他方のＯＲＧ信号とが、加算器へ入力され加算
される。
【００１６】ＯＲＧ信号は図１３に示す信号である。こ
のＯＲＧ信号はＲａｐ．Ｆでエッジ部が波形処理され図
１４の波形の信号Ｅｄｇとなる。平滑化回路は、例え
ば、図５に示すフィルタにより構成される。このフィル
タにより信号Ｅｄｇは、図８に示す様にエッジ部が平滑
化されＥｄｇ１となる。平滑化された図８に示す信号Ｅ
ｄｇ１と、図１３に示す入力信号ＯＲＧとは、加算器に
より加算され図９に示す出力信号ＯＵＴ１となる。図９
の出力信号ＯＵＴ１は、平滑回路の効果により、図１５
に示す出力信号ＯＵＴより滑らかなエッジ強調となって
いることがわかる。図１の回路による信号処理の手順
は、下記の式（２）として表すことができる。 ＯＵＴ１＝ＯＲＧ＋Ｅｄｇ１ … （２）
のＯＲＧ信号はＲａｐ．Ｆでエッジ部が波形処理され図
１４の波形の信号Ｅｄｇとなる。平滑化回路は、例え
ば、図５に示すフィルタにより構成される。このフィル
タにより信号Ｅｄｇは、図８に示す様にエッジ部が平滑
化されＥｄｇ１となる。平滑化された図８に示す信号Ｅ
ｄｇ１と、図１３に示す入力信号ＯＲＧとは、加算器に
より加算され図９に示す出力信号ＯＵＴ１となる。図９
の出力信号ＯＵＴ１は、平滑回路の効果により、図１５
に示す出力信号ＯＵＴより滑らかなエッジ強調となって
いることがわかる。図１の回路による信号処理の手順
は、下記の式（２）として表すことができる。 ＯＵＴ１＝ＯＲＧ＋Ｅｄｇ１ … （２）
【００１７】＜第２の演算回路＞図２は、本実施形態の
第２の演算回路の回路構成例を示すブロック図である。
図２に示す第２の演算回路は、図１２により構成される
フィルタであるＲａｐ．Ｆと、このフィルタによって得
られた信号に基づき正領域を判定する正領域判定回路、
ゲインを１／２とする減衰回路並びに信号を平滑化する
平滑化回路と、上記の正領域判定回路の判定信号に基づ
き減衰回路の出力あるいは平滑化回路の出力のいずれか
１の出力信号を選択するセレクタと、入力信号ＯＲＧお
よびセレクタの出力信号を加算して１つの信号とする加
算器とにより構成される。加算器の出力信号が本演算回
路の出力信号ＯＵＴ２である。
第２の演算回路の回路構成例を示すブロック図である。
図２に示す第２の演算回路は、図１２により構成される
フィルタであるＲａｐ．Ｆと、このフィルタによって得
られた信号に基づき正領域を判定する正領域判定回路、
ゲインを１／２とする減衰回路並びに信号を平滑化する
平滑化回路と、上記の正領域判定回路の判定信号に基づ
き減衰回路の出力あるいは平滑化回路の出力のいずれか
１の出力信号を選択するセレクタと、入力信号ＯＲＧお
よびセレクタの出力信号を加算して１つの信号とする加
算器とにより構成される。加算器の出力信号が本演算回
路の出力信号ＯＵＴ２である。
【００１８】図１０は、図２に示す第２の演算回路によ
り処理した、入力信号ＯＲＧに対応する結果である。本
結果は図９の第１の結果よりもエッジの立ち上りがシャ
ープとなり、且つ画像部分のエッジ強調の滑らかさは維
持されているのが分かる。
り処理した、入力信号ＯＲＧに対応する結果である。本
結果は図９の第１の結果よりもエッジの立ち上りがシャ
ープとなり、且つ画像部分のエッジ強調の滑らかさは維
持されているのが分かる。
【００１９】＜第３の演算回路＞図３は、本実施形態の
第３の演算回路の回路構成例を示すブロック図である。
図３に示す第３の演算回路は、図１２により構成される
フィルタであるＲａｐ．Ｆと、このＲａｐ．Ｆの出力信
号を平滑化する平滑化回路と、平滑化回路の出力信号の
エッジ量を所定の係数に基づき変換するテーブルと、２
つの入力信号を加算して１つの信号とする加算器とによ
り構成される。加算器で加算された信号は出力信号ＯＵ
Ｔ３となる。尚、図３における回路構成において、平滑
化回路およびテーブルの後先は出力結果に影響しない。
第３の演算回路の回路構成例を示すブロック図である。
図３に示す第３の演算回路は、図１２により構成される
フィルタであるＲａｐ．Ｆと、このＲａｐ．Ｆの出力信
号を平滑化する平滑化回路と、平滑化回路の出力信号の
エッジ量を所定の係数に基づき変換するテーブルと、２
つの入力信号を加算して１つの信号とする加算器とによ
り構成される。加算器で加算された信号は出力信号ＯＵ
Ｔ３となる。尚、図３における回路構成において、平滑
化回路およびテーブルの後先は出力結果に影響しない。
【００２０】＜第４の演算回路＞図４は、本実施形態の
第４の演算回路の回路構成例を示すブロック図である。
図４に示す第４の演算回路は、図６により構成されるフ
ィルＲａｐ１と、図７により構成されるフィルＲａｐ２
と、これらの出力信号の絶対値の大小を比較する絶対値
大小比較回路に基づきＲａｐ１またはＲａｐ２の出力信
号を選択するセレクタと、平滑化する平滑化回路と、平
滑化回路の出力信号のエッジ量を所定の係数に基づき変
換するテーブルと、２つの入力信号を加算して１つの信
号とする加算器とにより構成される。加算器で加算され
た信号は出力信号ＯＵＴ４となる。
第４の演算回路の回路構成例を示すブロック図である。
図４に示す第４の演算回路は、図６により構成されるフ
ィルＲａｐ１と、図７により構成されるフィルＲａｐ２
と、これらの出力信号の絶対値の大小を比較する絶対値
大小比較回路に基づきＲａｐ１またはＲａｐ２の出力信
号を選択するセレクタと、平滑化する平滑化回路と、平
滑化回路の出力信号のエッジ量を所定の係数に基づき変
換するテーブルと、２つの入力信号を加算して１つの信
号とする加算器とにより構成される。加算器で加算され
た信号は出力信号ＯＵＴ４となる。
【００２１】図６および図７に示すラプラシアンフィル
タは、エッジの方向によって出力データが異なる。これ
らのラプラシアンフィルタで得られるエッジ量は、エッ
ジ方向によって違いがあるため、エッジ強調にムラの発
生を抑制することが容易となる。
タは、エッジの方向によって出力データが異なる。これ
らのラプラシアンフィルタで得られるエッジ量は、エッ
ジ方向によって違いがあるため、エッジ強調にムラの発
生を抑制することが容易となる。
【００２２】
【発明の効果】以上の説明より明かなように、本発明の
画像処理装置は、入力画像信号のエッジ信号を強調化し
て検出し、強調化したエッジ信号のエッジ成分を平滑化
し、平滑化された出力信号と入力画像信号とを加算す
る。よって、滑らかなエッジ強調化処理がされた入力画
像信号を得ることが可能となる。
画像処理装置は、入力画像信号のエッジ信号を強調化し
て検出し、強調化したエッジ信号のエッジ成分を平滑化
し、平滑化された出力信号と入力画像信号とを加算す
る。よって、滑らかなエッジ強調化処理がされた入力画
像信号を得ることが可能となる。
【図１】本発明の画像処理装置の実施形態である第１の
演算回路の構成例を示すブロック図である。
演算回路の構成例を示すブロック図である。
【図２】第２の演算回路の構成例を示すブロック図であ
る
る
【図３】第３の演算回路の構成例を示すブロック図であ
る
る
【図４】第４の演算回路の構成例を示すブロック図であ
る
る
【図５】平滑化回路の構成例を示す図である。
【図６】ラプラシアンフィルタＲａｐ１の構成例を示す
図である。
図である。
【図７】ラプラシアンフィルタＲａｐ２の構成例を示す
図である。
図である。
【図８】図５の平滑化回路の出力信号Ｅｄｇ１の波形例
を示す図である。
を示す図である。
【図９】第１の演算回路の出力信号ＯＵＴ１の波形例を
示す図である。
示す図である。
【図１０】第２の演算回路の出力信号ＯＵＴ２の波形例
を示す図である。
を示す図である。
【図１１】従来の画像処理装置の演算回路の構成例を示
すブロック図である。
すブロック図である。
【図１２】従来用いられているラプラシアンフィルタＲ
ａｐ．Ｆの構成例を示す図である。
ａｐ．Ｆの構成例を示す図である。
【図１３】入力画像信号ＯＲＧの形態例を示す図であ
る。
る。
【図１４】図１２のラプラシアンフィルタで処理された
エッジ信号Ｅｄｇの形態例を示す図である。
エッジ信号Ｅｄｇの形態例を示す図である。
【図１５】図１１の出力信号ＯＵＴを示す図である。
ＯＲＧ 入力画像信号 ＯＵＴ１，ＯＵＴ２，ＯＵＴ３ エッジ処理後の出力画
像信号
像信号
Claims (4)
- 【請求項１】 入力画像信号のエッジ信号を強調化して
検出するラプラシアンフィルタと、 前記強調化したエッジ信号のエッジ成分を平滑化する平
滑化回路と、 該平滑化回路の出力信号と前記入力画像信号とを加算す
る加算回路とを有し、 入力画像信号の滑らかなエッジ強調化の処理を可能とし
たことを特徴とする画像処理装置。 - 【請求項２】 前記ラプラシアンフィルタと平滑化回路
とによる前記入力画像信号のエッジ信号の強調化の処理
を、該入力画像信号の正のエッジ成分にのみ適用するこ
とを特徴とする請求項１記載の画像処理装置。 - 【請求項３】 前記画像処理装置は、さらに前記強調化
されたエッジ信号の量および／または極性に応じて変換
された信号とするテーブルを有し、該テーブルにより変
換された出力信号に基づき、前記強調化の処理を行うこ
とを特徴とする請求項１または２記載の画像処理装置。 - 【請求項４】 前記ラプラシアンフィルタは少なくとも
２種類のフィルタにより構成され、該少なくとも２種類
のフィルタの各々の出力信号の絶対値の大小判定を行
い、該判定結果に応じてエッジ量の出力を切替え、前記
強調化を行うことを特徴とする請求項１から３の何れか
１項に記載の画像処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP02197696A JP3477302B2 (ja) | 1996-01-12 | 1996-01-12 | 画像処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP02197696A JP3477302B2 (ja) | 1996-01-12 | 1996-01-12 | 画像処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH09200530A true JPH09200530A (ja) | 1997-07-31 |
| JP3477302B2 JP3477302B2 (ja) | 2003-12-10 |
Family
ID=12070068
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP02197696A Expired - Lifetime JP3477302B2 (ja) | 1996-01-12 | 1996-01-12 | 画像処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3477302B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8089639B2 (en) | 2006-05-31 | 2012-01-03 | Kyocera Mita Corporation | Image forming apparatus with image density change portion for gradually reducing image density from an outer periphery of a character toward an inside |
| US8594452B2 (en) | 2009-12-15 | 2013-11-26 | Ability Enterprise Co., Ltd. | System and method for processing an image edge |
-
1996
- 1996-01-12 JP JP02197696A patent/JP3477302B2/ja not_active Expired - Lifetime
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8089639B2 (en) | 2006-05-31 | 2012-01-03 | Kyocera Mita Corporation | Image forming apparatus with image density change portion for gradually reducing image density from an outer periphery of a character toward an inside |
| US8594452B2 (en) | 2009-12-15 | 2013-11-26 | Ability Enterprise Co., Ltd. | System and method for processing an image edge |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3477302B2 (ja) | 2003-12-10 |
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Legal Events
| Date | Code | Title | Description |
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