JPH09205766A - 力率補償回路 - Google Patents

力率補償回路

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JPH09205766A
JPH09205766A JP8349007A JP34900796A JPH09205766A JP H09205766 A JPH09205766 A JP H09205766A JP 8349007 A JP8349007 A JP 8349007A JP 34900796 A JP34900796 A JP 34900796A JP H09205766 A JPH09205766 A JP H09205766A
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control
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signal
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JP8349007A
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Hwan-Ho Seong
煥 浩 成
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Samsung Electronics Co Ltd
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Abstract

(57)【要約】 【課題】 最大限に外部ピン数を減少できる力率補償回
路を提供すること。 【解決手段】 力率改善用のブースト・コンバータ１０
０の出力電圧に比例する半波整流器３００の出力電圧と
基準電圧とを比較してセンス電界効果トランジスタ１１
０のターン・オン時間制御用電圧を発生する制御電圧発
生回路４００と、センス電界効果トランジスタ１１０の
ターン・オン時間一定保持用制御信号を発生するターン
・オン制御回路５００と、センス電界効果トランジスタ
１１０のミラー端子電流が一定以上時に出力して、過電
流から保護する過電流検出回路６００と、インダクタ電
流のゼロの時点を感知するゼロ電流検出回路２００の出
力と、過電流検出回路６００またはターン・オン制御回
路５００の出力を受け、センス電界効果トランジスタ１
１０を駆動する出力電流制御回路８００とで構成され
る。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、力率補償回路に係
り、より詳しくは、力率補償のためにブースト・コンバ
ータ(Boost Converter) の制御回路と電流感知が容易な
センス電界効果トランジスタ(Sense-FET) を一つのパッ
ケージに実装し、最大限に外部ピン数を減少するように
設計された力率補償回路に関する。
【０００２】
【従来の技術】現在、大部分の電気、電子機器等、例え
ば、ＳＭＰＳ(Switching Mode PowerSupply：スイッチ
ング・モード電源) 、電子式安定器、ＵＰＳ(Uninterru
pt Power Supply ：非遮断電源) などは交流電源を整流
器を用いて直流電源に変換した後、その直流電源をもっ
て必要とする異なる形態の電源を作っている。このよう
な場合、平滑キャパシタのリプル電圧を適正水準以下に
保持するためには平滑キャパシタを十分に大きくしなけ
ればならないし、このときの交流入力電流はパルス形態
に流れるようになり、そのときの交流入力電流の力率は
６０〜７０％になり、伝送線路の損失が増加し、同一の
設備容量の発電所において用いられる有効電力が減少す
るという問題がある。
【０００３】整流器の入力力率を大きくし、かつ整流器
の出力電圧のリプル電圧を小さくするためには、一般に
二つの方法を用いている。一番目は、整流器と平滑キャ
パシタとの間にチョーク・インダクタを挿入する方法で
あり、二番目はブースト・コンバータを用いて入力電流
を制御して力率を改善する方法である。
【０００４】ブースト・コンバータを用いて力率を改善
する方法には、連続電流制御、不連続電流制御、連続と
不連続との境界において制御する三つの方法があるが、
比較的小さい容量の電源装置においては三番目の方法が
力率、効率および原価面において比較的有利であると認
められている。三番目の方法を実現するための制御用集
積回路は各社で生産されているが、図４および図５にそ
の一部の応用回路が示されている。
【０００５】図４は従来の力率補償回路を示すものであ
って、モデルＵＣ３８５２の詳細回路図であり、図５は
従来の力率補償回路の他の例を示すものであって、モデ
ルＫＡ７５２４の詳細回路図である。
【０００６】
【発明が解決しようとする課題】しかしながら、図４お
よび図５に示す従来の応用回路は、集積回路とＭＯＳト
ランジスタとがそれぞれのパッケージに搭載されてお
り、多くの周辺部品を必要とするため、全システムが大
きくなり生産コストが上昇するという課題がある。
【０００７】したがって、本発明はこのような従来の課
題を解決するためになされたものであって、その目的
は、力率補償のためのブースト・コンバータを連続電流
と不連続電流との境界において制御する回路と電流感知
が容易なセンス電界効果トランジスタとを一つのパッケ
ージに実装し、最大限に外部のピン数を減少でき、周辺
部品の削減とコストの低減化とが可能となる力率補償回
路を提供することにある。
【０００８】
【課題を解決するための手段】前記目的を達成するため
に本発明の力率補償回路は、キャパシタ、インダクタ、
センス電界効果トランジスタおよびダイオードを含み、
整流手段から直流電源を入力され、入力電流を制御する
ことにより、力率を改善するためのブースト・コンバー
タと、前記インダクタを流れる電流がゼロになる時点を
感知して信号を出力するためのゼロ電流検出手段と、前
記センス電界効果トランジスタのターン・オフの際、前
記ブースト・コンバータの出力電圧に比例するインダク
タ巻線電圧を整流して出力電圧に比例する制御電源を供
給するための制御電源供給手段と、前記制御電源供給手
段の出力電圧が入力され、入力される電圧を基準電圧と
比較して前記センス電界効果トランジスタのターン・オ
ン時間を制御するための制御電圧を発生する制御電圧発
生手段と、スタート制御信号とストップ制御信号とによ
り一定の上昇時間を有するのこぎり波を発生し、発生し
たのこぎり波を前記制御電圧発生手段の出力信号と比較
することにより、前記センス電界効果トランジスタのタ
ーン・オン時間を常に一定に保持することができるよう
にするための制御信号を発生するターン・オン制御手段
と、前記センス電界効果トランジスタのミラー端子電流
を検出し、ミラー端子電流が一定の電流以上になると信
号を出力することにより、過電流から保護することがで
きるようにするための過電流検出手段と、前記ゼロ電流
検出手段の出力信号をセット入力に受け、前記過電流検
出手段またはターン・オン制御手段の出力信号をリセッ
ト入力に受け、前記センス電界効果トランジスタのゲー
ト駆動信号を発生するための出力電流制御手段とから構
成される。
【０００９】
【発明の実施の形態】以下、本発明の好ましい実施の形
態を添付図面に基づいて詳細に説明する。図１は本発明
の実施の形態に従う５ピン力率補償回路の詳細回路図で
ある。図１に示すように、本発明の実施の形態に従う５
ピン力率補償回路は以下のように構成されている。
【００１０】力率を改善するためのブースと・コンバー
タ１００は、キャパシタＣｆ、インダクタＬｆ、センス
電界効果トランジスタ１１０およびダイオードＤ２を含
んで構成されており、ブリッジ整流器１０から直流電源
を入力されて入力電流を制御することにより、力率を改
善するようにしている。ゼロ電流検出手段としてのゼロ
電流検出回路２００は、インダクタＬｆ電流がダイオー
ドＤ２を通じて負荷に流れることにより、ゼロになる時
点を感知して信号を出力するための回路である。
【００１１】制御電源供給手段としての半波整流器３０
０は、センス電界効果トランジスタ１１０のターン・オ
フの際、ブースト・コンバータ１００の出力電圧Ｖｏに
比例するインダクタ巻線ＷFB電圧を整流して出力電圧Ｖ
ｏに比例する制御電源Ｖｃｃを供給するための半波整流
器である。制御電圧発生手段としての制御電圧発生回路
４００は、半波整流器３００の出力電圧Ｖｃｃが入力さ
れ、入力される電圧を基準電圧Ｖref1と比較してセンス
電界効果トランジスタ１１０のターン・オン時間を制御
するための制御電圧Ｖｃｏｎを発生する回路である。
【００１２】ターン・オン制御手段としてのターン・オ
ン制御回路５００は、スタート端子START の制御信号と
ストップ端子STOPの制御信号により一定の上昇時間を有
するのこぎり波を発生し、発生したのこぎり波を制御電
圧発生回路４００の制御電圧Ｖｃｏｎと比較することに
より、センス電界効果トランジスタ１１０のターン・オ
ン時間を常に一定に保持することができるようにするた
めの制御信号を発生する回路である。
【００１３】過電流検出手段としての過電流検出回路６
００は、センス電界効果トランジスタ１１０のミラー端
子Ｍ電流Ｉsense を検出し、ミラー端子Ｍ電流Ｉsense
が一定の電流以上になると信号を出力することにより、
過電流から保護することができるようにするための回路
である。ＯＲゲート７００は、ターン・オン制御回路５
００と過電流検出回路６００の出力信号を論理和して出
力する。
【００１４】出力電流制御手段としての出力電流制御回
路８００は、ゼロ電流検出回路２００の出力信号をセッ
トＳ入力端子に受け、ＯＲゲート７００の出力信号をリ
セットＲ入力端子に受け、センス電界効果トランジスタ
１１０のゲート駆動信号を発生するための回路である。
また、半波整流器３００から出力される電源電圧が一定
の電圧以下であると全回路の消費電流を最小化し、電源
電圧が一定の電圧以上となると全回路を動作させる低電
圧保護回路ＵＶＬＯ９００とを含んでなる。
【００１５】ゼロ電流検出回路２００の構成は、インダ
クタＬｆ電流がゼロになる時点を感知するための抵抗Ｒ
ZCDCと、抵抗ＲZCDCを通じて流れる電流がゼロであると
き信号を発生させるインバータＺＣＤとからなる。
【００１６】制御電圧発生回路４００の構成は、半波整
流器３００の出力電圧Ｖｃｃを分圧するための分圧抵抗
Ｒ１、Ｒ２と、分圧抵抗Ｒ１、Ｒ２の接続点に印加され
る電圧を反転（−）入力端子に受け、基準電圧Ｖref1を
非反転（＋）入力端子に受け、入力された二つの信号を
比較してセンス電界効果トランジスタ１１０のターン・
オン時間を制御するための制御電圧Ｖｃｏｎを発生する
差動増幅器４１０と、差動増幅器４１０の出力信号をフ
ィルタリングするため抵抗ＲｃｏｎとキャパシタＣｃｏ
ｎとで構成された低域通過フィルタ４２０とからなる。
【００１７】ターン・オン制御回路５００の構成は、ス
タート制御信号とストップ制御信号とにより一定の上昇
時間を有するのこぎり波を発生するランプ発生器５１０
と、ランプ発生器５１０を通じて発生したのこぎり波Ｖ
RAMPを非反転（＋）入力端子に受け、制御電圧発生回路
４００の出力電圧Ｖｃｏｎを反転（−）入力端子に受
け、入力された二つの信号を比較することによりセンス
電界効果トランジスタ１１０のターン・オン時間を常に
一定に保持することができるようにするための制御信号
を発生すると同時にこの制御信号をランプ発生器５１０
のストップ端子STOP制御信号として供給する比較器５２
０とからなる。
【００１８】前記過電流検出回路６００の構成は、セン
ス電界効果トランジスタ１１０のミラー端子電流Ｉsens
e を検出するための抵抗Ｒｓと、抵抗Ｒｓの両端に印加
される電圧を非反転（＋）入力端子に受け、基準電圧Ｖ
ref2を反転（−）入力端子に受け、入力された二つの信
号を比較してミラー端子電流Ｉsense が一定の電流以上
になると信号を出力する比較器６１０と、センス電界効
果トランジスタ１１０のターン・オン時にドレイン電流
波形のリーディング・エッジ部分において発生するパル
ス性雑音信号を除去するためのリーディング・エッジ・
ブランキング回路６２０とからなる。
【００１９】出力電流制御回路８００の構成は、ゼロ電
流検出回路２００の出力信号をセットＳ入力端子に受
け、ＯＲゲート７００の出力信号をリセットＲ入力端子
に受け、ランプ発生器５１０のスタート端子START に制
御信号を供給するＲＳフリップ・フロップ８１０と、Ｒ
Ｓフリップ・フロップ８１０の出力信号を入力され、セ
ンス電界効果トランジスタ１１０のゲート端子を駆動す
るためのゲート駆動回路８２０とからなる。
【００２０】次に、前述の５ピン力率補償回路の動作に
ついて説明する。まず、ブースト・コンバータ１００で
用いられるセンス電界効果トランジスタ１１０は、ドレ
イン電流ＩDRAINに比例する小さい出力電流Ｉsense を
ミラー端子Ｍを通じて発生するトランジスタであって、
電力容量が小さい抵抗で大きいドレイン電流の感知を可
能にさせる。センス電界効果トランジスタ１１０はゲー
ト駆動回路８２０を通じて駆動されるが、ゲート駆動回
路８２０の入力が「ハイ」であると、センス電界効果ト
ランジスタ１１０はオンされ、「ロー」であると、セン
ス電界効果トランジスタ１１０はオフされる。
【００２１】また、ゲート駆動回路８２０はＲＳフリッ
プ・フロップ８１０の出力端子からＱ信号を入力される
が、ＲＳフリップ・フロップ８１０はゼロ電流検出回路
２００の出力信号が「ハイ」であると「ハイ」を出力
し、ＯＲゲート７００の出力信号が「ハイ」であると
「ロー」を出力する。
【００２２】センス電界効果トランジスタ１１０のミラ
ー端子Ｍから流れる電流は、抵抗Ｒｓを通じて電圧に変
換されて比較器６１０の非反転（＋）入力端子に入力さ
れ、反転（−）入力端子に入力された基準電圧Ｖref2よ
り大きくなると、比較器６１０は［ハイ］信号を出力す
る。比較器６１０の出力信号はセンス電界効果トランジ
スタ１１０のターン・オン初期に発生されるパルス性雑
音を除去するためのリーディング・エッジ・ブランキン
グ回路６２０を経てＯＲゲート７００の一方の入力に印
加される。前述した過程を通じて、センス電界効果トラ
ンジスタ１１０のドレイン電流が一定の電流以上になる
とセンス電界効果トランジスタ１１０をターン・オフす
るようにする過電流検出動作がなされる。
【００２３】ターン・オン制御回路５００にあるランプ
発生器５１０は、スタート端子START に「ハイ」信号が
印加されると図３に示すように、電圧ＶLOW から直線的
に増加するランプ電圧ＶRAMPを出力し、出力電圧が制御
電圧Ｖｃｏｎより大きくなるとランプ発生器５１０のス
トップ端子ＳＴＯＰとＯＲゲート７００の一方の入力端
子に連結された比較器５２０の出力電圧が「ハイ」にな
るので、ランプ発生器５１０の出力電圧ＶRAMPは電圧Ｖ
LOW になり、次のスタート端子ＳＴＡＲＴに「ハイ」信
号が印加されるまで電圧ＶLOW を保持するようになる。
【００２４】制御電圧Ｖｃｏｎのリプル成分がほとんど
ゼロであると仮定すると、図１に示す各ブロックの動作
でセンス電界効果トランジスタ１１０のターン・オン時
間は常に一定することになる。これは、ＲＳフリップ・
フロップ８１０の出力信号が「ハイ」になり、ランプ発
生器５１０の出力電圧ＶRAMPが直線的に増加して、制御
電圧Ｖｃｏｎまでに至る時間が一定であるためである。
【００２５】本発明の実施の形態にしたがう５ピン力率
補償回路の動作原理の核心は、ブースト・コンバータ１
００にあるインダクタＬｆと共に巻いた巻線ＷFB電圧が
出力電圧Ｖｏに比例するので、巻線電圧を整流した制御
電源Ｖｃｃも出力電圧Ｖｏに比例するため、制御電源Ｖ
ｃｃを一定に定電圧化すると出力電圧Ｖｏを一定に保持
することができる。このような原理を用い、出力電圧Ｖ
ｏの感知と制御電源Ｖｃｃ供給を一つのピンで解決する
ことにより外部の素子数を最小化することができる。
【００２６】ブースト・コンバータ１００において、セ
ンス電界効果トランジスタ１１０がターン・オンされる
と次のような（１）式が成立する。 ＶLf＝−Ｖｉ ・・・・・（１） ここで、ＶLfはインダクタＬｆ電圧、Ｖｉは入力電圧で
ある。
【００２７】しかしながら、センス電界効果トランジス
タ１１０がターン・オフされると、インダクタＬｆの電
流がダイオードＤ２を通じてフリーホィーリング(Freew
heeling)するので、次のような（２）式が成立する。 ＶLf＝Ｖｏ−Ｖｉ ・・・・・（２） 入力電圧Ｖｉがゼロであるとき、インダクタ電圧ＶLfと
出力電圧Ｖｏは同一であるので、インダクタ電圧ＶLfを
ダイオードＤ１に半波整流し、キャパシタＣｖｃｃで平
滑にすると、電圧Ｖｃｃは出力電圧Ｖｏに比例すること
になる。
【００２８】次に、制御電圧発生回路４００において差
動増幅器４１０は、分圧抵抗Ｒ１、Ｒ２の接続点に印加
される電圧Ｖｃｃ・Ｒ２／（Ｒ１＋Ｒ２）が基準電圧Ｖ
ref1より大きくなると、制御電圧Ｖｃｏｎを減少させて
センス−電界効果トランジスタ１１０のターン・オン時
間を減少させ、逆に、基準電圧Ｖref1より小さくなる
と、制御電圧Ｖｃｏｎを増加させて、センス電界効果ト
ランジスタ１１０のターン・オン時間を増加させる。低
域通過フィルタ４２０は差動増幅器４１０の出力信号に
生じるリプル電圧を十分に縮小させて交流入力電圧の１
周期の間前記制御電圧Ｖｃｏｎをほとんど直流に作るた
めのものである。このようにすることにより、交流入力
電流の歪曲が小さくなることになる。
【００２９】ゼロ電流検出回路２００において、抵抗Ｒ
ZCD は前記インダクタＬｆの電流が前記ダイオードＤ２
を通じて負荷に流れることにより、ゼロになる時点を感
知するための抵抗である。インダクタＬｆの電流がゼロ
になるとインダクタ電圧ＶLfは（２）式に示されている
ように、（Ｖｏ−Ｖｉ）からゼロになる。このとき、イ
ンバータＺＣＤの出力電圧は「ロー」から「ハイ」に変
更され、ＲＳフリップ・フロップ８１０の出力は「ハ
イ」になり、センス電界効果トランジスタ１１０をター
ン・オンさせる。
【００３０】図２は本発明の実施の形態に従う５ピン力
率補償回路において、インダクタ電圧ＶLfの波形を示す
ものである。したがって、図１に示すように、五つの外
部ピン＃１〜＃５であると力率補償のためのブースト・
コンバータ１００の入力力率をほとんど１００％に保持
して出力電圧を定電圧化することができる。
【００３１】
【発明の効果】以上のように、本発明の力率補償回路
は、力率補償のためのブースト・コンバータを連続電流
と不連続電流との境界において制御する回路と電流感知
が容易なセンス電界効果トランジスタを一つのパッケー
ジに実装し、最大限に外部ピン数を減少することがで
き、したがって、周辺部品の削減とコストの低減化が可
能になる。
【図面の簡単な説明】
【図１】本発明の力率補償回路の実施の形態の詳細回路
図。
【図２】本発明の力率補償回路の実施の形態におけるイ
ンダクタ電圧の波形図。
【図３】本発明の力率補償回路の実施の形態におけるラ
ンプ発生器の出力信号波形図。
【図４】従来の力率補償回路(Power Factor Correction
Circuit）の一例を示す応用回路図ＵＣ３８５２。
【図５】従来の力率補償回路の他の例を示す応用回路図
ＫＡ７５２４。
【符号の説明】
１０ ブリッジ整流器 １００ ブースト・コンバータ １１０ センス電界効果トランジスタ ２００ ゼロ電流検出回路 ３００ 半波整流器 ４００ 制御電圧発生回路 ４１０ 差動増幅器 ５００ ターン・オン制御回路 ５１０ ランプ発生器 ６００ 過電流検出回路 ６１０ 比較器 ６２０ リーディング・エッジ・ブランキング回路 ７００ ＯＲゲート ８００ 出力電流制御回路 ８１０ ＲＳフリップ・フロップ ８２０ ゲート駆動回路 ９００ 低電圧保護回路（ＵＶＬＯ）

Claims (8)

    【特許請求の範囲】
  1. 【請求項１】 キャパシタ、インダクタ、センス電界効
    果トランジスタおよびダイオードを含み、整流手段から
    直流電源を入力され、入力電流を制御することにより、
    力率を改善するためのブースト・コンバータと、 前記インダクタを流れる電流がゼロになる時点を感知し
    て信号を出力するためのゼロ電流検出手段と、 前記センス電界効果トランジスタのターン・オフの際、
    前記ブースト・コンバータの出力電圧に比例するインダ
    クタ巻線電圧を整流して出力電圧に比例する制御電源を
    供給するための制御電源供給手段と、 前記制御電源供給手段の出力電圧が入力され、入力され
    る電圧を基準電圧と比較して前記センス電界効果トラン
    ジスタのターン・オン時間を制御するための制御電圧を
    発生する制御電圧発生手段と、 スタート制御信号とストップ制御信号とにより一定の上
    昇時間を有するのこぎり波を発生し、発生したのこぎり
    波を前記制御電圧発生手段の出力信号と比較することに
    より、前記センス電界効果トランジスタのターン・オン
    時間を常に一定に保持することができるようにするため
    の制御信号を発生するターン・オン制御手段と、 前記センス電界効果トランジスタのミラー端子電流を検
    出し、ミラー端子電流が一定の電流以上になると信号を
    出力することにより、過電流から保護することができる
    ようにするための過電流検出手段と、 前記ゼロ電流検出手段の出力信号をセット入力に受け、
    前記過電流検出手段またはターン・オン制御手段の出力
    信号をリセット入力に受け、前記センス電界効果トラン
    ジスタのゲート駆動信号を発生するための出力電流制御
    手段とを含んでなることを特徴とする力率補償回路。
  2. 【請求項２】 請求項１記載の力率補償回路において、 前記ゼロ電流検出手段は、 前記インダクタ電流がゼロになる時点を感知するための
    抵抗と、 前記抵抗を通じて流れる電流がゼロであるとき信号を発
    生させるインバータと、を含んでなることを特徴とする
    力率補償回路。
  3. 【請求項３】 請求項１記載の力率補償回路において、 前記制御電圧発生手段は、 前記制御電源供給手段の出力電圧を分圧するための分圧
    抵抗と、 前記分圧抵抗の接続点に印加される電圧を反転入力端子
    に受け、基準電圧を非反転入力端子に受け、入力された
    二つの信号を比較して前記センス電界効果トランジスタ
    のターン・オン時間を制御するための制御電圧を発生す
    る差動増幅器と、 前記差動増幅器の出力信号をフィルタリングするため抵
    抗とキャパシタとで構成された低域通過フィルタと、を
    含んでなることを特徴とする力率補償回路。
  4. 【請求項４】 請求項１記載の力率補償回路において、 前記ターン・オン制御手段は、 スタート制御信号とストップ制御信号とにより一定の上
    昇時間を有するのこぎり波を発生するランプ発生器と、 前記ランプ発生器を通じてのこぎり波を非反転入力端子
    に受け、前記制御電圧発生手段の出力電圧を反転入力端
    子に受け、入力された二つの信号を比較することにより
    前記センス電界効果トランジスタのターン・オン時間を
    常に一定に保持することができるようにするための制御
    信号を発生すると同時に前記制御信号を前記ランプ発生
    器のストップ制御信号として供給する比較器と、を含ん
    でなることを特徴とする力率補償回路。
  5. 【請求項５】 請求項１記載の力率補償回路において、 前記過電流検出手段は、 前記センス電界効果トランジスタのミラー端子電流を検
    出するための抵抗と、 前記抵抗両端に印加される電圧を非反転入力端子に受
    け、基準電圧を反転入力端子に受け、入力された二つの
    信号を比較して前記ミラー端子電流が一定の電流以上に
    なると信号を出力する比較器と、 前記センス電界効果トランジスタのターン・オン時にド
    レイン電流波形のリーディング・エッジ部分において発
    生するパルス性雑音信号を除去するためのリーディング
    ・エッジ・ブランキング回路と、を含んでなることを特
    徴とする力率補償回路。
  6. 【請求項６】 請求項１または４記載の力率補償回路に
    おいて、 前記出力電流制御手段は、 前記ゼロ電流検出手段の出力信号をセット入力端子に受
    け、前記ターン・オン制御手段または過電流検出手段の
    出力信号をリセット入力端子に受け、前記ランプ発生器
    のスタート端子に制御信号を供給するＲＳフリップ・フ
    ロップと、 前記ＲＳフリップ・フロップの出力信号を入力され、前
    記センス電界効果トランジスタのゲート端子を駆動する
    ためのゲート駆動回路と、を含んでなることを特徴とす
    る力率補償回路。
  7. 【請求項７】 請求項１記載の力率補償回路において、 前記制御電源供給手段は半波整流器からなることを特徴
    とする力率補償回路。
  8. 【請求項８】 請求項７記載の力率補償回路において、 前記半波整流器の出力端子には、前記半波整流器の出力
    電圧が一定の電圧以上になると全体回路を動作させる低
    電圧保護回路をさらに含むことを特徴とする力率補償回
    路。
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