JPH09234667A - 半導体ウェハの研磨方法 - Google Patents

半導体ウェハの研磨方法

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JPH09234667A
JPH09234667A JP8445596A JP8445596A JPH09234667A JP H09234667 A JPH09234667 A JP H09234667A JP 8445596 A JP8445596 A JP 8445596A JP 8445596 A JP8445596 A JP 8445596A JP H09234667 A JPH09234667 A JP H09234667A
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JP
Japan
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polishing
semiconductor wafer
backing pad
compressibility
cloth
Prior art date
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Pending
Application number
JP8445596A
Other languages
English (en)
Inventor
Junichi Yamashita
純一 山下
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sumco Techxiv Corp
Original Assignee
Komatsu Electronic Metals Co Ltd
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Filing date
Publication date
Application filed by Komatsu Electronic Metals Co Ltd filed Critical Komatsu Electronic Metals Co Ltd
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Priority to TW085115126A priority patent/TW374042B/zh
Priority to US08/805,676 priority patent/US5814240A/en
Publication of JPH09234667A publication Critical patent/JPH09234667A/ja
Pending legal-status Critical Current

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    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10PGENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P90/00Preparation of wafers not covered by a single main group of this subclass, e.g. wafer reinforcement
    • H10P90/12Preparing bulk and homogeneous wafers
    • H10P90/129Preparing bulk and homogeneous wafers by polishing
    • BPERFORMING OPERATIONS; TRANSPORTING
    • B24GRINDING; POLISHING
    • B24BMACHINES, DEVICES, OR PROCESSES FOR GRINDING OR POLISHING; DRESSING OR CONDITIONING OF ABRADING SURFACES; FEEDING OF GRINDING, POLISHING, OR LAPPING AGENTS
    • B24B37/00Lapping machines or devices; Accessories
    • B24B37/04Lapping machines or devices; Accessories designed for working plane surfaces
    • B24B37/042Lapping machines or devices; Accessories designed for working plane surfaces operating processes therefor
    • BPERFORMING OPERATIONS; TRANSPORTING
    • B24GRINDING; POLISHING
    • B24BMACHINES, DEVICES, OR PROCESSES FOR GRINDING OR POLISHING; DRESSING OR CONDITIONING OF ABRADING SURFACES; FEEDING OF GRINDING, POLISHING, OR LAPPING AGENTS
    • B24B37/00Lapping machines or devices; Accessories
    • B24B37/27Work carriers
    • B24B37/30Work carriers for single side lapping of plane surfaces

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  • Engineering & Computer Science (AREA)
  • Mechanical Engineering (AREA)
  • Finish Polishing, Edge Sharpening, And Grinding By Specific Grinding Devices (AREA)
  • Mechanical Treatment Of Semiconductor (AREA)

Abstract

(57)【要約】 【目的】 半導体ウェハの外周部に生じる面だれを防止
し、高平坦度の半導体ウェハを研磨できる半導体ウェハ
の研磨方法を提供する。 【解決手段】 研磨ブロック1をセラミックプレート1
1とバッキングパッド12とテンプレート13とから構
成する。バッキングパッド12として研磨クロス2より
その圧縮率が大きいものを使用する。研磨ブロック1に
半導体ウェハ3を装着する。半導体ウェハ3を研磨クロ
ス2に押圧して研磨する。

Description

【発明の詳細な説明】
【0001】
【発明の属する分野】本発明は、表面を研磨して得られ
る半導体ウェハの研磨方法に関するものである。
【0002】
【従来の技術】従来、半導体ウェハの表面を研磨するに
当たっては、その裏面をワックスによりセラミック製の
貼付ブロックに貼り付け、研磨面を研磨クロスに当接さ
せ、これを研磨機により押圧して研磨していた。ところ
がこのワックスを使用した研磨では、その研磨工程の前
に半導体ウェハの貼り付け工程、研磨工程の後に半導体
ウェハの剥がし工程およびワックスの除去工程が必要と
なり効率が悪く、またワックスの剥離剤といった人体に
有害な溶解剤を使用する必要があった。
【0003】そこで、近年このワックスを使用しないワ
ックスレス研磨が多く用いられるようになってきてい
る。このワックスレス研磨の一つの方法としては、図3
(a)に示すようにセラミックプレート61と、バッキ
ングパッド62と、テンプレート63とからなる研磨ブ
ロック6を使用するものがある。これは、半導体ウェハ
7の周縁部をテンプレート63により位置決めして保持
し、その裏面7bをバッキングパッド62に当接させ、
図3(b)に示すように研磨面6aを研磨クロス8に押
圧して研磨するものである。したがって、ワックスを一
切使用せずに1度に複数の半導体ウェハを研磨できるた
め効率が良く、さらに溶解剤を使用する必要もない。
【0004】
【発明が解決しようとする課題】しかしながら、上記し
た研磨ブロック6による研磨では、下盤81の研磨クロ
ス8が弾性体であるために、図3(b)に示すように半
導体ウェハ7との当接面8aが凹み、押圧荷重が均一に
かからず外周部71に集中するため、図3(c)に示す
ように研磨された半導体ウェハ7の外周部71に面だれ
が生じるという問題点があった。本発明は、上記問題に
鑑みてなされたもので、半導体ウェハの外周部に生じる
面だれを防止し、高平坦度の半導体ウェハを研磨できる
半導体ウェハの研磨方法を提供することを目的とするも
のである。
【0005】
【課題を解決するための手段】このため本発明では、セ
ラミックプレートと、バッキングパッドと、テンプレー
トとからなる研磨ブロックにより半導体ウェハを保持
し、研磨クロスに半導体ウェハを押圧して研磨する半導
体ウェハの研磨方法において、バッキングパッドの圧縮
率を研磨クロスの圧縮率より大きくしたものである。
【0006】
【発明の実施の形態】以下、本発明の実施例を図面に基
づいて説明する。図1は本発明に係る研磨方法を示す側
断面図、図2は実施例におけるTTVを比較したグラフ
である。
【0007】図1(a)に示すように、本実施の形態の
研磨方法では、セラミックプレート11と、バッキング
パッド12と、テンプレート13とからなる研磨ブロッ
ク1に半導体ウェハ3を装着させ、研磨クロス2を固着
した下定盤4に押圧盤5により押圧して研磨する。バッ
キングパッド12には研磨クロス2よりその圧縮率の大
きいものが使用されている。
【0008】このため図1(b)に示すように、半導体
ウェハ3を研磨クロス2に押圧すると、半導体ウェハ3
と当接したバッキングパッド12のパッド当接面12a
が凹む。これにより従来技術で発生していた研磨クロス
2側の凹みが生じることはなく、半導体ウェハ3と当接
した研磨クロス2のクロス当接面2aは平坦に保たれ、
半導体ウェハ3の研磨面3aには均一な押圧荷重がかか
った状態で研磨される。
【0009】研磨を終了し研磨ブロック1を上げると、
図1(c)に示すように、半導体ウェハ3の外周部31
に面だれを生じることはなく、高い平坦度の研磨面3a
が得られる。
【0010】尚、本発明における研磨クロス2及びバッ
キングパッド12の圧縮率については、JIS規格L−
1096に基づく測定値により特定し、その単位を
「%」により表現する。
【0011】本発明の研磨方法では研磨クロス2より圧
縮率が大きいバッキングパッド12を使用することによ
り、平坦度の高い半導体ウェハ3を研磨しているが、バ
ッキングパッド12側が十分に凹まなくてはならないた
め、研磨クロス2とバッキングパッド12との圧縮率の
差は0.5%以上であることが望ましい。
【0012】また、その反面、バッキングパッド12の
圧縮率が大き過ぎると外周部31がかえって研磨されな
いことになるため、その圧縮率の差は3.0%以下とす
ることが望ましい。
【0013】さらに、製造効率と、研磨面3aにおける
マイクロラフネスなどの仕上げ状態を考慮すると、研磨
クロス2の圧縮率は2.0〜5.0%とするのが望まし
く。バッキングパッド12の圧縮率は3.0〜8.0%
とするのが望ましい。
【0014】
【実施例】本実施例は、圧縮率が3.0%の研磨クロス
に対して圧縮率が1.0%、3.0%、5.0%、8.
0%、10.0%のバッキングパッドをそれぞれ使用し
て研磨し、それぞれの平坦度を測定比較したものであ
る。その結果を示すグラフでは研磨を終了した半導体ウ
ェハのTTVを指数により表している。図2に示すよう
に、圧縮率が5.0%のバッキングパッドを使用した研
磨が最も平坦度が高く、圧縮率が1.0%、3.0%の
バッキングパッドを使用した研磨では面だれを生じ、そ
の反面、圧縮率が8.0%、10.0%のバッキングパ
ッドを使用した研磨では中凹となり、それぞれの圧縮率
の差が大きいほどその指数も大きくなることがわかる。
【0015】
【発明の効果】本発明では以上のように構成したので、
半導体ウェハの外周部に生じる面だれを防止し、高平坦
度の半導体ウェハを研磨できるという優れた効果があ
る。
【図面の簡単な説明】
【図1】本発明に係る研磨方法を示す側断面図ある。
【図2】実施例による面だれの量を比較したグラフであ
る。
【図3】従来技術の研磨方法を示す側断面図ある。
【符号の説明】
1‥‥‥研磨ブロック 11‥‥セラミックプレート 12‥‥バッキングパッド 12a‥パッド当接面 13‥‥テンプレート 2‥‥‥研磨クロス 2a‥‥クロス当接面 3‥‥‥半導体ウェハ 3a‥‥研磨面 31‥‥外周部 4‥‥‥下定盤

Claims (4)

    【特許請求の範囲】
  1. 【請求項1】 セラミックプレートと、バッキングパッ
    ドと、テンプレートとからなる研磨ブロックにより半導
    体ウェハを保持し、研磨クロスに半導体ウェハを押圧し
    て研磨する半導体ウェハの研磨方法において、バッキン
    グパッドの圧縮率を研磨クロスの圧縮率より大きくした
    ことを特徴とする半導体ウェハの研磨方法。
  2. 【請求項2】 研磨クロスとバッキングパッドとの圧縮
    率の差がJIS規格L−1096に基づく測定値で0.
    5〜3.0%であることを特徴とする請求項1記載の半
    導体ウェハの研磨方法。
  3. 【請求項3】 バッキングパッドのJIS規格L−10
    96に基づく圧縮率の測定値が3〜8%であることを特
    徴とする請求項1記載の半導体ウェハの研磨方法。
  4. 【請求項4】 研磨クロスのJIS規格L−1096に
    基づく圧縮率の測定値が2〜5%であことを特徴とする
    請求項1記載の半導体ウェハの研磨方法。
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