JPH0934647A - 磁気ディスク処理装置 - Google Patents

磁気ディスク処理装置

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Publication number
JPH0934647A
JPH0934647A JP7201682A JP20168295A JPH0934647A JP H0934647 A JPH0934647 A JP H0934647A JP 7201682 A JP7201682 A JP 7201682A JP 20168295 A JP20168295 A JP 20168295A JP H0934647 A JPH0934647 A JP H0934647A
Authority
JP
Japan
Prior art keywords
magnetic disk
host computer
cache memory
cache
input
Prior art date
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Pending
Application number
JP7201682A
Other languages
English (en)
Inventor
Yuji Ishikawa
優二 石川
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Publication date
Application filed by NEC Corp filed Critical NEC Corp
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Abstract

(57)【要約】 【課題】ホストコンピュータとディスクキャッシュとの
データ転送において効率の良いデータ転送を行う磁気デ
ィスク処理装置。 【解決手段】キャッシュメモリを複数の記憶領域に分割
し、ホストコンピュータからの入出力命令に応じて、既
記憶領域の一部分を他の入出力命令と排他的に利用する
ための排他的利用開始手続き手段と排他的利用終了手続
き手段を有する磁気ディスク処理装置にあって、ホスト
コンピュータとキャッシュメモリ上の第1の記憶領域と
のデータ転送中に、第2の記憶領域の排他的利用開始手
続き及び第3の記憶領域の排他的利用終了手続きを行
う。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は磁気ディスク処理装
置に関し、特にキャッシュシステムの改良によりホスト
コンピュータとディスクキャッシュ間のデータ転送効率
を改善する方法及び装置に関する。
【0002】
【従来の技術】外部記憶装置(磁気ディスク装置)を具
備するコンピュータシステムにおいて、キャッシュシス
テムはホストコンピュータと外部記憶装置との間の処理
速度の違いによるボトルネックを解消する有効な一手法
としての役割を担ってきた。
【0003】すなわち、通常「ディスクキャッシュ」と
呼ばれる高速アクセスメモリをホストコンピュータと外
部記憶装置の間に配設することにより、ホストコンピュ
ータは処理速度の遅い外部記憶装置へのアクセスを最小
限に抑えることができる。
【0004】キャッシュシステムにおける、データ転送
に関する従来のキャッシュ制御では、(a)キャッシュメ
モリ上の記憶領域の排他的利用開始手続きの「OPEN
処理」、(b)データ転送処理、(c)排他的利用終了手続き
の「CLOSE処理」がシリアル(順次的)に行われて
いた。
【0005】
【発明が解決しようとする課題】従来の技術では、デー
タ転送を行なう際に、データ転送は各ブロック毎に単独
で処理されるため、例えばキャッシュメモリにおいて複
数の記憶領域にまたがる広範囲のアクセスを行った場合
には、データ転送の効率が低下してしまうという問題が
生じる。
【0006】そこで、本発明は、上記問題点を解消し、
ホストコンピュータとディスクキャッシュとのデータ転
送において効率の良いデータ転送を行う磁気ディスク処
理装置を提供することを目的とする。
【0007】
【課題を解決するための手段】前記目的を達成するた
め、本発明は、ホストコンピュータに接続され、キャッ
シュメモリを備え、磁気ディスク装置に対して入出力を
制御する磁気ディスク処理装置であって、前記キャッシ
ュメモリを複数の記憶領域に分割し、前記ホストコンピ
ュータからの入出力命令に応じて前記記憶領域の一部を
他の入出力命令と排他的に利用するための排他的利用開
始手続きと、該排他的な利用の終了手続きと、をそれぞ
れ制御する手段を有し、前記ホストコンピュータと前記
キャッシュメモリ上の第1の記憶領域との間でデータ転
送中に、第2の記憶領域の排他的利用開始手続きと、さ
らに第3の記憶領域の排他的利用終了手続きと、を行う
ように構成したことを特徴とする磁気ディスク処理装置
を提供する。
【0008】本発明においては、ホストコンピュータか
らの入出力命令に応じて、オープン処理、データ転送、
クローズ処理を記憶領域単位にパイプライン処理するよ
うにしたことにより、各処理のオーバラップで従来のキ
ャッシュ制御方式に比べ、処理時間を大幅に短縮し、高
速化を達成し、キャッシュの有効性を高めている。
【0009】
【発明の実施の形態】本発明の実施の形態を図面を参照
して説明する。
【0010】図1は本発明の一実施形態の構成を示した
図である。
【0011】図1を参照して、ホストコンピュータ1
0、キャッシュメモリ(「ディスクキャッシュ」ともい
う)22を備えた磁気ディスク制御装置20、及び磁気
ディスク装置30からなる。
【0012】図1において、ホストコンピュータ10か
ら入出力命令が出されると、磁気ディスク制御装置20
内部のプログラム制御部21において、ホストコンピュ
ータ10からの入出力命令の解析が行われ、解析結果が
磁気ディスク装置30に送出られる。
【0013】キャッシュメモリを具備しない磁気ディス
ク制御装置であると、ホストコンピュータ10からの入
出力命令が発行される度に、磁気ディスク装置30の機
械的な動作を伴うことになり、その分処理時間がかるこ
とになるが、図1に示すようなキャッシュメモリ22を
備えた磁気ディスク制御装置20においては、キャッシ
ュメモリ22内に磁気ディスク装置30内の一部のデー
タを保持しておくことにより、ホストコンピュータ10
から入出力命令を受け取った場合に、入力対象のデータ
がキャッシュメモリ22内に存在する(キャッシュヒッ
ト時)等の場合キャッシュメモリ22からデータが転送
され、磁気ディスク装置30の機械的な動作を行うこと
なく処理することができる場合がある。
【0014】この場合、ホストコンピュータ10は高速
メモリであるキャッシュへのアクセスのみを行えば良い
ので、磁気ディスク装置30へアクセスする場合に比
べ、処理時間を小さく抑えることができる。
【0015】また、その際のホストコンピュータ10と
キャッシュメモリ22とのデータ転送において、本実施
形態の方式を実装することにより、従来よりも高速に処
理を行うことが可能である。
【0016】以下に、本発明の実施形態と従来方式の相
違点を図2を用いて説明する。
【0017】図2(A)は従来のキャッシュメモリ制御
方式の処理を説明する図である。図2(B)は、本実施
形態のキャッシュメモリ制御方式の処理を説明する図で
あり、転送ブロック(データ)群の状態遷移図を示して
いる。
【0018】図2において、符号、、は、ホスト
コンピュータ10−キャッシュメモリ22間でのデータ
転送処理の時に必要とする、OPEN処理、データ転送
処理(Xfer)、CLOSE処理の3つの手順をそれ
ぞれ示している。
【0019】LRU(Least Recently Used)管理され
たキャッシュメモリ22には、ブロック(データ)群が
不図示のLRUテーブルに各々リンク(連結)された状
態で管理されている。
【0020】データ転送の際には、転送ブロックをLR
Uテーブルからリンクをはずす(「アンリンク」す
る)。なお、転送ブロックは磁気ディスク装置上のアド
レスをマッピングするようにLRUテーブルにリンクさ
れており、データ転送時に転送ブロックをアンリンクし
た際該転送ブロックの排他的アクセスが保証される。
【0021】そして、データ転送されたブロックは、再
びLRUテーブルにエントリすべくリンクを行う必要が
ある。
【0022】また、ホストコンピュータ10からの入出
力命令(リード/ライト)によっては、データ転送方向
が異なるが、処理手順自体は同様とみなし得るので、こ
こではホストコンピュータ10からの入出力命令がリー
ド命令である場合を説明する。
【0023】図2(B)を参照して、まず、排他的利用
開始手続きであるOPEN処理を示す状態Iにおいて
は、キャッシュヒット/ミス判定が行われ、キャッシュ
ヒットしたとすると状態Iの第1のブロック(B1)
は、キャッシュメモリ22内のキャッシュブロック群を
管理するLRUテーブルからアンリンクされ、データ転
送の対象となる。
【0024】次に、状態IIに遷移し、第1のブロック
(B1)がホストコンピュータ10にデータ転送されて
いる間に、第2のブロック(B2)の排他的利用開始手
続きであるOPEN処理が行なわれ、キャッシュヒット
/ミス判定が行われる。
【0025】キャッシュヒットの時には、第2のブロッ
ク(B2)はLRUテーブルからアンリンクされ、次の
データ転送の対象となる。
【0026】キャッシュミスの時には磁気ディスク装置
30からのブロックデータのリードへの切り替え処理が
行われる。
【0027】状態IIIに遷移した時に、すでにホストコ
ンピュータ10へデータ転送済みである第1のブロック
(B1)はキャッシュメモリのLRUテーブルへリンク
され、第2のブロック(B2)がホストコンピュータ1
0へデータ転送されると共に、第3のブロック(B3)
の排他的利用開始手続きであるOPEN処理が行なわ
れ、新たにキャッシュヒット/ミス判定の対象となる。
【0028】一方、従来のディスクキャッシュ制御方式
では、各ブロックに毎単独で処理されるため、状態がI
〜IIIに遷移するまでに、一連の処理が終わっているの
は、第1のブロック(B1)のみであり、第2、3のブ
ロック(B2,B3)に対しても、再度I〜IIIの状態
遷移を必要とする。
【0029】このように、本実施形態によれば、従来の
ディスクキャッシュ制御方式に比べ、処理時間を大幅に
短縮し、高速化を達成している。なお、ホストコンピュ
ータ10からのブロックデータのライト処理についても
同様にして高速処理が達成される。なお、本実施形態に
おけるキャッシュメモリ22の転送ブロックの管理はL
RUアルゴリズム(最近最も少なく用いられたブロック
をリプレース対象とする)に限定されるものでないこと
は勿論である。
【0030】
【発明の効果】以上説明したように、本発明によれば、
従来のキャッシュ制御方式に比べ、処理時間を大幅に短
縮し、高速化を達成している。
【図面の簡単な説明】
【図1】本発明の一実施形態の概略構成を説明するため
の図である。
【図2】(A)従来方式による転送ブロック群の処理を
説明するための図である。(B)本発明の一実施例の転
送ブロック群の処理を説明するための図である。
【符号の説明】
10 ホストコンピュータ 20 磁気ディスク制御装置 21 プログラム制御部 22 キャッシュメモリ(ディスクキャッシュ) 30 磁気ディスク装置

Claims (3)

    【特許請求の範囲】
  1. 【請求項1】ホストコンピュータに接続され、キャッシ
    ュメモリを備え、磁気ディスク装置に対して入出力を制
    御する磁気ディスク処理装置であって、 前記キャッシュメモリを複数の記憶領域に分割し、 前記ホストコンピュータからの入出力命令に応じて前記
    記憶領域の一部を他の入出力命令と排他的に利用するた
    めの排他的利用開始手続きと、該排他的な利用の終了手
    続きと、をそれぞれ制御する手段を有し、 前記ホストコンピュータと前記キャッシュメモリ上の第
    1の記憶領域との間でデータ転送中に、第2の記憶領域
    の排他的利用開始手続きと、さらに第3の記憶領域の排
    他的利用終了手続きと、を行うように構成したことを特
    徴とする磁気ディスク処理装置。
  2. 【請求項2】前記キャッシュメモリでヒットしたデータ
    ブロックの転送中に、すでにデータ転送が終了したデー
    タブロックのキャッシュブロック群へのリンクと、及び
    /又は後に転送されるデータブロックのキャッシュヒッ
    ト/ミス判定と、を行なうように構成したことを特徴と
    する請求項1記載の磁気ディスク装置。
  3. 【請求項3】ホストコンピュータに接続され、キャッシ
    ュメモリを備え、磁気ディスク装置に対して入出力を制
    御する磁気ディスク処理装置であって、 前記ホストコンピュータからの入出力命令に応じて互い
    に異なる記憶領域についてオープン処理、データ転送、
    クローズ処理をそれぞれ所定の記憶領域単位にパイプラ
    イン制御するようにしたことを特徴とする磁気ディスク
    処理装置。
JP7201682A 1995-07-14 1995-07-14 磁気ディスク処理装置 Pending JPH0934647A (ja)

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JP7201682A JPH0934647A (ja) 1995-07-14 1995-07-14 磁気ディスク処理装置

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JP7201682A JPH0934647A (ja) 1995-07-14 1995-07-14 磁気ディスク処理装置

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JPH0934647A true JPH0934647A (ja) 1997-02-07

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ID=16445163

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JP7201682A Pending JPH0934647A (ja) 1995-07-14 1995-07-14 磁気ディスク処理装置

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Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS57185527A (en) * 1981-05-11 1982-11-15 Hitachi Ltd Input and output processing device
JPS6041145A (ja) * 1983-08-17 1985-03-04 Hitachi Ltd デイスクキヤツシユ装置

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS57185527A (en) * 1981-05-11 1982-11-15 Hitachi Ltd Input and output processing device
JPS6041145A (ja) * 1983-08-17 1985-03-04 Hitachi Ltd デイスクキヤツシユ装置

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Effective date: 20000606