JPH098509A - Lumped constant type isolator - Google Patents

Lumped constant type isolator

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Publication number
JPH098509A
JPH098509A JP15733395A JP15733395A JPH098509A JP H098509 A JPH098509 A JP H098509A JP 15733395 A JP15733395 A JP 15733395A JP 15733395 A JP15733395 A JP 15733395A JP H098509 A JPH098509 A JP H098509A
Authority
JP
Japan
Prior art keywords
resistor
pattern
chip resistor
case
isolator
Prior art date
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Pending
Application number
JP15733395A
Other languages
Japanese (ja)
Inventor
Manabu Yoshimoto
学 由本
Minoru Nozu
稔 野津
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Proterial Ltd
Original Assignee
Hitachi Metals Ltd
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Publication date
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Publication of JPH098509A publication Critical patent/JPH098509A/en
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  • Non-Reversible Transmitting Devices (AREA)

Abstract

PURPOSE: To attain miniaturization and to improve power resistance by arranging a dummy resistor onto a side face of a case inner face. CONSTITUTION: A chip resistor (dummy resistor) 17 is soldered to a side face of a lower case 12. Two patterns of the chip resistor 17 connecting to a center conductor 5 are formed in the middle and a resistor pattern is formed between the patterns and a ground pattern and insulated by an over-glass. Furthermore, the rear side of the chip resistor 17 is formed entirely to be a conductor pattern and connected to the ground pattern at both sides of a throughhole on the side face. A terminal 6a extended from the center conductor 5 is coupled with a static capacitance forming electrode 9a formed to a dielectric board 7 and with the pattern of the chip resistor 17. The chip resistor 17 is formed by connecting two resistors in parallel, and the resistance of each resistor is 100ohms, and the combined resistance of parallel connection is 50ohms. Furthermore, a printed circuit board 13 with a ground electrode 14 formed thereon is connected to a lower side of the lower case 12.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野】本発明は、VHF、UHF及びマ
イクロ波帯などにおいて使用される集中定数型アイソレ
ータに関するものである。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a lumped element isolator used in VHF, UHF, microwave bands and the like.

【0002】[0002]

【従来の技術】従来の集中定数型アイソレータの一例の
分解斜視図を図5に示す。この従来例は、下ケース65
上にパターン電極の形成された誘電体基板63を配置
し、ガーネット64と互いに絶縁状態で重ね合わされた
中心導体66とからなる中心導体部を誘電体基板に形成
された穴に配置し、各中心導体と誘電体基板上の所定の
パターン電極とを接続し、磁石67の装着された上ケー
ス68を被せて構成されている。この誘電体基板63の
69はダミー抵抗であり、70はアース電極である。こ
のアース電極に接続されたダミー抵抗により、中心導体
の一つの端子が終端されている。
2. Description of the Related Art FIG. 5 is an exploded perspective view of an example of a conventional lumped constant type isolator. In this conventional example, the lower case 65
A dielectric substrate 63 having a pattern electrode formed thereon is disposed, and a central conductor portion including a garnet 64 and a central conductor 66 superposed in an insulated state is disposed in a hole formed in the dielectric substrate. A conductor is connected to a predetermined pattern electrode on a dielectric substrate, and is configured to cover an upper case 68 on which a magnet 67 is mounted. Reference numeral 69 of the dielectric substrate 63 denotes a dummy resistor, and reference numeral 70 denotes a ground electrode. A dummy resistor connected to this ground electrode terminates one terminal of the central conductor.

【0003】[0003]

【発明が解決しようとする課題】従来の集中定数型アイ
ソレータでは、ダミー抵抗は、誘電体基板上に印刷され
た抵抗により形成されている。この誘電体基板では、放
熱性が良くなく、他の静電容量用及びアース用のパター
ン電極も形成されており、スペース的にも余裕がなく、
そのダミー抵抗部における耐電力が小さく、せいぜい1
W程度の耐電力しか実現出来なかった。従って、スペー
スを広げると小型化の流れに逆行し、耐電力の比較的小
さい用途では良いが、比較的大きな耐電力を必要とする
用途では、小型の集中定数型アイソレータを構成するこ
とが困難であった。本発明は、上記のことを鑑みて、小
型でしかも耐電力の大きい集中定数型アイソレータを提
供する事を目的とする。
In the conventional lumped constant isolator, the dummy resistor is formed by a resistor printed on the dielectric substrate. In this dielectric substrate, the heat dissipation is not good, other pattern electrodes for capacitance and ground are also formed, and there is no room in space,
The withstand power of the dummy resistor part is small and is at most 1
Only a power resistance of about W could be realized. Therefore, if the space is widened, it goes against the trend of miniaturization, which is good for applications with relatively low withstand power, but it is difficult to configure a small lumped constant isolator for applications with relatively high withstand power. there were. In view of the above, it is an object of the present invention to provide a lumped constant isolator that is small in size and has high withstand power.

【0004】[0004]

【課題を解決するための手段】本発明は、ダミー抵抗が
ケース内側の側面に配設されている集中定数型アイソレ
ータである。また本発明は、前記ダミー抵抗は、基板上
に印刷されたチップ抵抗であり、前記ケース側面に固定
されるとともにアース接続されている集中定数型アイソ
レータである。また本発明は、前記ダミー抵抗は、2つ
の抵抗を並列に接続して構成されている集中定数型アイ
ソレータである。また本発明の集中定数型アイソレータ
の好ましい構成は、ケース、誘電体基板、ガーネット、
中心導体、永久磁石、ダミー抵抗である。ケースは、ア
ース接続されるとともに、アイソレータ全体を包む様に
構成され、シールドケースとしての効果も有り、上下に
分割されている。誘電体基板は、静電容量を形成するも
のであり、ケース上に配置され、ガーネットが収納され
る穴を有している。中心導体は、ガーネット上に、互い
に絶縁された少なくとも3つの中心導体を有し、一端は
前記の静電容量に接続され、他端はアース接続される。
永久磁石は、ガーネットに直流磁界を印加するためのも
のである。そして、ダミー抵抗はケース側面に配置さ
れ、一つの中心導体が接続される。又、ケースと誘電体
基板の間にアース板を配置してもよく、ケースの下に、
実装用のプリント基板を配置しても良い。
SUMMARY OF THE INVENTION The present invention is a lumped constant isolator in which a dummy resistor is disposed on the side surface inside the case. Further, the present invention is the lumped constant isolator, wherein the dummy resistor is a chip resistor printed on a substrate, and is fixed to the side surface of the case and grounded. The present invention is also a lumped constant isolator in which the dummy resistor is configured by connecting two resistors in parallel. The preferred configuration of the lumped constant isolator of the present invention is a case, a dielectric substrate, a garnet,
They are the central conductor, permanent magnet, and dummy resistor. The case is connected to the ground and is configured to wrap the entire isolator, and has an effect as a shield case, and is divided into upper and lower parts. The dielectric substrate forms a capacitance, is disposed on a case, and has a hole for accommodating garnet. The center conductor has at least three center conductors insulated from each other on the garnet, one end of which is connected to the capacitance, and the other end of which is grounded.
The permanent magnet is for applying a DC magnetic field to the garnet. The dummy resistor is arranged on the side surface of the case, and one central conductor is connected to it. Also, a ground plate may be placed between the case and the dielectric substrate, and under the case,
A printed circuit board for mounting may be arranged.

【0005】[0005]

【作用】本発明は、ダミー抵抗を、ケース内面の側面に
配設することにより、静電容量を形成する誘電体基板を
大型にすることなく、更にスペースを有効利用して、耐
電力の大きなダミー抵抗を構成できる。また、基板上に
印刷したダミー抵抗を用いる事により、薄型に形成でき
るとともに、基板をケースに固定すると同時に、ダミー
抵抗の一端をアース接続する事ができる。このとき、基
板としては、アルミナ基板を用いる事が望ましく、この
アルミナ基板では、放熱性が高く、耐電力の大きいダミ
ー抵抗を構成できる。もちろん、このダミー抵抗の形成
される基板は、静電容量の形成される誘電体基板とは、
別のものである。また、ダミー抵抗を2つの抵抗を並列
に接続する構成とする事により、耐電力の大きいダミー
抵抗を構成できる。
According to the present invention, by arranging the dummy resistor on the side surface of the inner surface of the case, it is possible to effectively use the space without increasing the size of the dielectric substrate for forming the electrostatic capacity and to increase the withstand power. A dummy resistor can be configured. Further, by using the dummy resistor printed on the substrate, it is possible to form a thin type, and at the same time as fixing the substrate to the case, one end of the dummy resistor can be grounded. At this time, it is desirable to use an alumina substrate as the substrate, and this alumina substrate can form a dummy resistor having high heat dissipation and high power resistance. Of course, the substrate on which this dummy resistor is formed is the same as the dielectric substrate on which electrostatic capacitance is formed.
It's another. Further, by using a configuration in which two resistors are connected in parallel to each other, a dummy resistor having high power durability can be configured.

【0006】[0006]

【実施例】本発明に係る一実施例の構成分解斜視図を図
1に示す。この実施例の構造を説明する。まず、ニッケ
ルメッキが施された上ケース1と、永久磁石2と、中心
導体部3と、誘電体基板7と、アース板10と、ニッケ
ルメッキされた下ケース12と、プリント基板13とか
ら構成されている。この中心導体部3は、円板状のフェ
ライトコア(ガーネット)4を包むように中心導体5が
折り重ねられて、その先端が端子6a、6b、6cとし
て形成されている。そして、下ケース12の上にアース
板10、誘電体基板7を重ねて配置し、その誘電体基板
7の中央の穴8に中心導体部3のフェライトコア4が挿
入されるように配置される。この下ケースの側面には、
チップ抵抗17が半田付けされている。このチップ抵抗
17の正面図を図2に、裏面図を図3に示す。このチッ
プ抵抗17は、中心導体に接続されるパターン18が中
央に2つ形成されており、このパターン18とアースパ
ターン20との間に抵抗パターン19が形成され、オー
バーガラスにより絶縁されている。また、このチップ抵
抗17の裏面は、全面導体パターン21となっており、
側面のスルーホール22で両面のアースパターンは接続
されている。そして、中心導体5から伸びる端子6aを
誘電体基板7に形成されている静電容量形成用の電極9
aに接合させ、更にチップ抵抗17のパターン18に接
合する。このチップ抵抗は、2つの抵抗を並列に接続し
て構成されている。それぞれ100Ωであり、並列接続
で、50Ωとしている。また、下ケース12の下側に
は、アース電極14が形成されているプリント基板13
が接合される。そして、中心導体5から伸びる端子6
b、6cを誘電体基板7に形成されている静電容量形成
用の電極9b、9cに接合させ、更に折り曲げてプリン
ト基板13の裏側へ折り返されている。また、アース板
10にも突片11が形成されており、更に折り曲げてプ
リント基板13の裏側へ折り返されている。このプリン
ト基板13の裏面の平面図を図4に示す。このプリント
基板13の裏面には、各中心導体5から伸びる端子6
b、6cを接続する電極部15とアース用電極部16と
が形成されており、各端子の固定と面実装化を可能とし
ている。そして、永久磁石2が固定された上ケース1を
下ケース12にはめ込んで、集中定数型アイソレータを
構成している。この構成により、外形が7mm角の小型
のアイソレータを構成できた。
FIG. 1 is an exploded perspective view showing the construction of an embodiment according to the present invention. The structure of this embodiment will be described. First, a nickel-plated upper case 1, a permanent magnet 2, a center conductor 3, a dielectric substrate 7, a ground plate 10, a nickel-plated lower case 12, and a printed circuit board 13 Have been. The center conductor 3 is formed by folding a center conductor 5 so as to enclose a disk-shaped ferrite core (garnet) 4, and the ends of the center conductor 5 are formed as terminals 6a, 6b, and 6c. Then, the ground plate 10 and the dielectric substrate 7 are placed on the lower case 12 in an overlapping manner, and the ferrite core 4 of the central conductor portion 3 is placed in the central hole 8 of the dielectric substrate 7. . On the side of this lower case,
The chip resistor 17 is soldered. FIG. 2 is a front view of the chip resistor 17, and FIG. In the chip resistor 17, two patterns 18 connected to the central conductor are formed in the center, and a resistance pattern 19 is formed between the pattern 18 and the ground pattern 20 and is insulated by overglass. Further, the back surface of the chip resistor 17 is a full-surface conductor pattern 21,
The ground patterns on both sides are connected by the side through holes 22. A terminal 6a extending from the central conductor 5 is provided with an electrode 9 for forming a capacitance formed on the dielectric substrate 7.
It is bonded to a and further to the pattern 18 of the chip resistor 17. This chip resistor is configured by connecting two resistors in parallel. Each is 100Ω, and is 50Ω in parallel connection. A printed circuit board 13 having a ground electrode 14 is formed on the lower side of the lower case 12.
Are joined. The terminal 6 extending from the central conductor 5
b and 6c are joined to the capacitance forming electrodes 9b and 9c formed on the dielectric substrate 7, and are further bent and folded back to the back side of the printed circuit board 13. A protruding piece 11 is also formed on the ground plate 10, and is further bent and folded back to the back side of the printed circuit board 13. A plan view of the back surface of the printed circuit board 13 is shown in FIG. On the back surface of this printed circuit board 13, terminals 6 extending from each central conductor 5 are provided.
An electrode portion 15 for connecting b and 6c and an electrode portion 16 for grounding are formed to enable fixing of each terminal and surface mounting. Then, the upper case 1 to which the permanent magnets 2 are fixed is fitted into the lower case 12 to constitute a lumped constant type isolator. With this configuration, a small isolator having an outer shape of 7 mm square can be configured.

【0007】この実施例では、800MHz用の集中定
数型アイソレータであり、挿入損失が0.7dB、アイ
ソレーションが15dBで、耐電力2Wの特性を達成で
きた。また、本発明と同様の構成にて、7mm角の1.
9GHz用の集中定数型アイソレータであり、挿入損失
が0.6dB、アイソレーションが15dBで、耐電力
2Wの特性を達成できた。
In this embodiment, the lumped-constant type isolator for 800 MHz has an insertion loss of 0.7 dB, an isolation of 15 dB, and a power withstand capability of 2 W. Further, in the same configuration as the present invention, a 7 mm square 1.
This is a lumped-constant isolator for 9 GHz, with an insertion loss of 0.6 dB, an isolation of 15 dB, and a characteristic of withstand power of 2 W.

【0008】本発明では、チップ抵抗をケースに半田付
けで固定し、チップ抵抗を固定することと、ダミー抵抗
のアース接続を同時に行う事が出来る。また、従来使用
されていなかったケース側面を使用することにより、従
来よりも大きなダミー抵抗を集中定数型アイソレータ内
部に構成でき、しかも従来の誘電体基板上に形成するよ
りもはるかに放熱性の高いアルミナ基板上にチップ抵抗
を配設することにより、耐電力の大きいダミー抵抗を構
成できた。しかも集中定数型を小型のままで行なうこと
が出来た。また、上記実施例では、7mm角の集中定数
型アイソレータを構成したが、本発明では、特に小型
(10mm角以下)の集中定数型アイソレータにおいて
有効である。
In the present invention, the chip resistor can be fixed to the case by soldering, and the chip resistor can be fixed, and the dummy resistor can be grounded at the same time. In addition, by using the side of the case that has not been used in the past, it is possible to configure a larger dummy resistor inside the lumped-constant isolator than before, and it has much higher heat dissipation than that formed on a conventional dielectric substrate. By arranging the chip resistor on the alumina substrate, a dummy resistor with high power resistance could be constructed. In addition, the lumped constant type can be performed with a small size. Further, in the above embodiment, the lumped constant type isolator of 7 mm square is constructed, but the present invention is particularly effective for a small sized lumped constant type isolator (10 mm square or less).

【0009】[0009]

【発明の効果】本発明により、耐電力が大きく、小型の
集中定数型アイソレータを得ることができ、例えば携帯
電話等においてミスマッチングによる耐反射電力の増加
によるアンプの保護に、極めて有効なものである。
According to the present invention, it is possible to obtain a small lumped-constant type isolator having a large withstand power and a very effective protection for an amplifier, for example, in a cellular phone or the like by increasing the anti-reflection power due to mismatching. is there.

【図面の簡単な説明】[Brief description of drawings]

【図1】本発明に係る一実施例の構成分解斜視図であ
る。
FIG. 1 is a structural exploded perspective view of an embodiment according to the present invention.

【図2】本発明に係る一チップ抵抗の正面図である。FIG. 2 is a front view of a one-chip resistor according to the present invention.

【図3】本発明に係る一チップ抵抗の裏面図である。FIG. 3 is a rear view of the one-chip resistor according to the present invention.

【図4】本発明に係る一実施例のプリント基板の裏面の
平面図である。
FIG. 4 is a plan view of the back surface of the printed circuit board according to one embodiment of the present invention.

【図5】従来例の分解斜視図である。FIG. 5 is an exploded perspective view of a conventional example.

【符号の説明】[Explanation of symbols]

1 上ケース 2 永久磁石 3 中心導体部 4 フェライトコア 5 中心導体 6 端子 7 誘電体基板 9 静電容量形成用電極 10 アース板 12 下ケース 13 プリント基板 17 チップ抵抗 1 Upper Case 2 Permanent Magnet 3 Center Conductor 4 Ferrite Core 5 Center Conductor 6 Terminal 7 Dielectric Substrate 9 Capacitance Forming Electrode 10 Earth Plate 12 Lower Case 13 Printed Circuit Board 17 Chip Resistor

Claims (3)

【特許請求の範囲】[Claims] 【請求項1】 集中定数型アイソレータにおいて、ダミ
ー抵抗がケース内側の側面に配設されていることを特徴
とする集中定数型アイソレータ。
1. A lumped constant isolator, wherein a lumped constant isolator is provided with a dummy resistor on a side surface inside a case.
【請求項2】 請求項1において、前記ダミー抵抗は、
基板上に印刷されたチップ抵抗であり、前記ケース側面
に固定されるとともにアース接続されていることを特徴
とする集中定数型アイソレータ。
2. The dummy resistor according to claim 1,
A lumped-constant isolator, which is a chip resistor printed on a substrate and is fixed to the side surface of the case and grounded.
【請求項3】 請求項1又は2において、前記ダミー抵
抗は、2つの抵抗を並列に接続して構成されていること
を特徴とする集中定数型アイソレータ。
3. The lumped constant isolator according to claim 1, wherein the dummy resistor is configured by connecting two resistors in parallel.
JP15733395A 1995-06-23 1995-06-23 Lumped constant type isolator Pending JPH098509A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP15733395A JPH098509A (en) 1995-06-23 1995-06-23 Lumped constant type isolator

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JP09862198A Division JP3209418B2 (en) 1998-04-10 1998-04-10 Dummy resistor for lumped constant type isolator

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JPH098509A true JPH098509A (en) 1997-01-10

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JP15733395A Pending JPH098509A (en) 1995-06-23 1995-06-23 Lumped constant type isolator

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JP (1) JPH098509A (en)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6459980B1 (en) 1999-02-08 2002-10-01 Toyota Jidosha Kabushiki Kaisha Vehicle braked with motor torque and method of controlling the same

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6459980B1 (en) 1999-02-08 2002-10-01 Toyota Jidosha Kabushiki Kaisha Vehicle braked with motor torque and method of controlling the same

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