JPH1010546A - 表示装置およびその駆動方法 - Google Patents

表示装置およびその駆動方法

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JPH1010546A
JPH1010546A JP8158649A JP15864996A JPH1010546A JP H1010546 A JPH1010546 A JP H1010546A JP 8158649 A JP8158649 A JP 8158649A JP 15864996 A JP15864996 A JP 15864996A JP H1010546 A JPH1010546 A JP H1010546A
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JP
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display device
signal lines
lines
basic colors
scanning
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Hiroyuki Hebiguchi
広行 蛇口
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FURON TEC KK
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Abstract

(57)【要約】 【課題】 本発明は、表示装置に用いられる高価で消費
電力の大きなソースドライバの必要数を少なくして液晶
表示装置の低価格化、低消費電力化をなし得るようにし
た表示装置およびその駆動方法を提供することを目的と
する。 【解決手段】 本発明は、複数の基本色を組み合わせて
１つの色を表示する画素が多数配列され、多数の走査線
と多数の信号線とによって前記多数の画素がマトリクス
駆動されるとともに、各信号線方向に沿って前記複数の
基本色の組み合わせが繰り返し配列され、走査線の数
が、信号線に沿って並ぶ全画素数に対する前記基本色数
倍の数にされてなるものである。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は複数の基本色、例え
ば、Ｒ（赤色）、Ｇ（緑色）、Ｂ（青色）を組み合わせ
て１つの色を表示するマトリクス駆動の表示装置および
その駆動方法に関する。
【０００２】
【従来の技術】従来、液晶などの表示素子を利用してこ
れに光源とカラーフィルタを組み合わせ、カラー表示を
可能とした液晶表示装置が知られている。ここでカラー
フィルタとして、Ｒ、Ｇ、Ｂの３つの基本色をそれぞれ
ドットとして組み合わせて用いることで１つの色表示を
行う画素を構成し、この画素を表示領域に多数配列し、
更に、液晶を駆動するために信号線と走査線をマトリク
ス状に配線して信号線と走査線に区画された領域に画素
電極を配置し、画素電極に対するスイッチングの切り換
えを薄膜トランジスタにより行って各ドットに対応する
液晶に電界を印加し、液晶の透過率を変化させて表示、
非表示を切り換える薄膜トランジスタ駆動方式の液晶表
示装置を例にとって以下に説明する。
【０００３】この種の液晶表示装置が適用されるコンピ
ュータ用の表示装置において、６４０（横）×４８０
（縦）ドットの表示を行うＶＧＡにあっては、表示の単
位となる画素（Ｒ、Ｇ、Ｂ各１ドット一組で１画素を構
成）の数が、６４０×４８０＝３０７２００画素であ
り、信号線に沿ってＲＧＢに３分割されているために、
走査線、信号線の数は、走査線数４８０本、信号線数６
４０×３＝１９２０本である。従って総ドット数は、６
４０×３×４８０＝９２１６００ドットとされている。
【０００４】図９は、この種のカラー液晶表示装置の画
面に駆動用ＬＳＩを取り付けたカラー液晶駆動ユニット
を示すものである。この図において１は、２枚の対向配
置された透明基板間に液晶が封入され、一方の透明基板
に共通電極とカラーフィルタが備えられ、他方の透明基
板に縦方向に信号線が横方向に走査線がそれぞれ多数本
マトリックス状に配線され、信号線と走査線に囲まれて
区画された領域に画素電極と薄膜トランジスタが設けら
れた液晶表示素子であり、この例では液晶表示素子１の
左側部側に走査線駆動用の複数のゲートドライバＧｄ
が、上辺側と下辺側にそれぞれ信号線駆動用の複数のソ
ースドライバＳｄが取り付けられている。
【０００５】図９にこの例の液晶表示素子１の回路構成
を示すが、この例の回路において縦列の信号線Ｓ1、
Ｓ2、Ｓ3・・・と、横列の走査線Ｇ1、Ｇ2・・・が交差状態で
多数形成され、信号線と走査線による区画された領域に
それぞれ画素電極５と薄膜トランジスタ６が設けられ、
画素電極５を形成した１つの領域が１つのドットとさ
れ、このドットが３つ集合して１つの画素とされてい
る。従って図９に示す回路においては、図１０の鎖線で
囲まれたような画素７が構成されているので、前記ＶＧ
Ａの表示装置にあっては、この画素７が１画面上に３０
７２００個形成されていることになる。
【０００６】
【発明が解決しようとする課題】このようなドット数の
液晶表示装置１に対して設けられるソースドライバＳｄ
とゲートドライバＧｄは、通常、２４０本程度の出力ピ
ンを有する１個のＬＳＩから構成されるので、液晶表示
素子１の透明基板に実装されるのは、ポリイミドテープ
にＬＳＩが装着されたものを用いるＴＣＰ（テープキャ
リアパッケージ）の形態であるか、ＬＳＩを直接実装す
るＣＯＧ（チップオングラス）の形態とされるのが通常
である。従って、前記液晶表示装置１に用いられる信号
線１９２０本と走査線４８０本に対応するためには、図
９に示すように２４０ピンのソースドライバＳｄを８個
（２４０×８＝１９２０）、２４０ピンのゲートドライ
バＧｄを２個（２４０×２＝４８０）用いる必要があっ
た。なお、実際の液晶表示装置にあっては、これらの他
にもドライバに信号等を供給するための回路が別途必要
であるがここでの説明では省略してある。
【０００７】ここで前記ドライバの消費電力は、以下に
記載する如くソースドライバＳｄの方がゲートドライバ
Ｇｄより大きいとされている。 ドライバ消費電力（約８４０ｍＷ） ゲートドライバ 低い（約 ２０ｍＷ×２＝４０ ｍ
Ｗ：５％を占める。） ソースドライバ 高い（約１００ｍＷ×８＝８００ｍ
Ｗ：９５％を占める。） また、ソースドライバの方がゲートドライバよりも一般
に単価において倍程度高価であることも知られている。
【０００８】なお、上記のソースドライバの消費電力
は、現状においてカラー表示で６ｂｉｔ（階調数６４）
の代表的なものであり、８ｂｉｔの場合は、価格、消費
電力共により大きな値となり、ゲートドライバとソース
ドライバの価格差と消費電力差は更に広がる方向にな
る。以上の背景から、更なる大画面化、高階調化が進め
られている液晶表示装置の低コスト化、低消費電力化を
図るためには、これらの高価格なドライバの必要数を少
なくすることが望まれている。
【０００９】本発明は前記事情に鑑みてなされたもので
あり、本発明の目的は、複数の基本色を組み合わせて１
つの色を表示する画素を配列し、マトリクス駆動をする
表示装置において駆動回路系での消費電力を低減するこ
とにある。
【００１０】
【課題を解決するための手段】本発明は前記課題を解決
するために、複数の基本色を組み合わせて１つの色を表
示する画素が多数配列され、多数の走査線と多数の信号
線とによって前記多数の画素がマトリクス駆動されると
ともに、各信号線方向に沿って前記複数の基本色の組み
合わせが繰り返し配列され、走査線の数が、信号線に沿
って並ぶ全画素数に対する、前記基本色数倍にされてな
るものである。
【００１１】また、前記の基本構成を有し、各信号線に
沿って配列された基本色の順番が、信号線に沿って繰り
返し同じ順番とされ、走査線に沿って同じ基本色が配列
された構成でも良い。更に、前記の基本構成を有し、信
号線に沿って配列された基本色の順番が、信号線に沿っ
て繰り返し同じ順番とされ、信号線に沿って配列された
基本色の順番が、信号線に沿って繰り返し同じ順番とさ
れ、前記基本色のそれぞれが信号線に対して斜めに配列
され、かつ走査線に沿って互いに異なった基本色が隣接
配列されたものでも良い。
【００１２】次に、本発明の駆動方法は、先に記載の基
本構成の表示装置を駆動するにあたり１つのフレームの
間に全走査線を順次走査することを特徴とするものであ
る。また、本発明の駆動方法は、先に記載の基本構成の
表示装置を駆動するにあたり、１つのフレームを複数の
フィールドに分割し、所定のフィールドごとに飛び越し
走査するものである。前記所定のフィールド数は基本色
の数に応じた数が好ましい。例えば、３色の基本色の場
合は３つのフィールド数となる。
【００１３】また、先に記載の基本構成を有し、更に１
つのフレームの間に全走査線を順次駆動する駆動方法
と、１つのフレームを複数のフィールドに分割し、所定
のフィールドごとに飛び越し走査する駆動方法とを切換
手段により選択自在にした構成であっても良い。
【００１４】
【発明の実施の形態】以下、図面を参照して本発明の実
施の形態について説明する。図１は本発明を薄膜トラン
ジスタ駆動方式の液晶表示装置に適用した一形態を示す
もので、この形態において２枚の透明基板間に液晶が封
入されて液晶表示素子１０が構成され、この液晶表示素
子１０の透明基板の上縁部にソースドライバＳｄが３個
（Ｓｄ1〜Ｓｄ3）、液晶表示素子１０の透明基板の左側
部と右側部にそれぞれ３個、合計６個のゲートドライバ
Ｇｄ（Ｇｄ1〜Ｇｄ6）が設けられている。次に、前記液
晶表示素子１０を構成する２枚の透明基板のうち、一方
の基板には共通電極とカラーフィルタが設けられ、他方
の透明基板には薄膜トランジスタ回路が構成されてい
る。その回路構成のうちの１画素に相当する部分を図２
に拡大して示す。この形態における１つの画素１２は、
２本の縦列の信号線Ｓ1、Ｓ2と４本の横列のＧ1、Ｇ2、
Ｇ3、Ｇ4によって区画された領域で構成されている。そ
して、信号線Ｓ1、Ｓ2、と走査線Ｇ1、Ｇ2とにより囲ま
れた領域に１つの画素電極１１が設けられてこの領域が
１つのドットとされ、信号線Ｓ1、Ｓ2、と走査線Ｇ2、
Ｇ3とにより囲まれた領域に１つの画素電極１１が設け
られてこの領域が１つのドットとされ、信号線Ｓ1、
Ｓ2、と走査線Ｇ3、Ｇ4とにより囲まれた領域に１つの
画素電極１１が設けられてこの領域が１つのドットとさ
れ、これら３つのドットによって１つの画素１２が構成
されるとともに、各画素電極１１の側部側にそれぞれス
イッチ素子としての薄膜トランジスタＴが構成されてい
る。
【００１５】また、前記画素電極１１が構成された透明
基板に対向する他の基板にはカラーフィルタが設けられ
るが、この形態においては図２に示す１つの画素のう
ち、上段の画素電極１１に対向する位置に図３に示すよ
うにＲのカラーフィルタが、中段の画素電極１１に対向
する位置に図３に示すようにＧのカラーフィルタが、下
段の画素電極１１に対向する位置に図３に示すようにＢ
のカラーフィルタがそれぞれ配置される。また、他の複
数の画素も含めたカラーフィルタのＲＧＢの配置関係を
図３に示すが、この形態においては、各信号線の長さ方
向（図３の上下方向）に沿ってＲＧＢ、ＲＧＢの順序で
カラーフィルタが配列され、走査線Ｎｏ.１の方向には
Ｒ、Ｒ、Ｒ…、走査線Ｎｏ.２の方向にはＧ、Ｇ、Ｇ
…、信号線Ｎｏ.３の方向にはＢ、Ｂ、Ｂ…、走査線Ｎ
ｏ.４の方向にはＲ、Ｒ、Ｒ…、走査線Ｎｏ.５の方向に
はＧ、Ｇ、Ｇ…、走査線Ｎｏ.６の方向にはＢ、Ｂ、Ｂ
…の順にそれぞれカラーフィルタが走査線数に対応させ
て配置されている。
【００１６】また、この形態においては、ＶＧＡ表示を
行うために、信号線Ｓは６４０本設けられているが、走
査線Ｇが４８０×３＝１４４０本設けられている。従っ
てこの形態においては、画素数は６４０×４８０＝３０
７２００であって図９に示す従来構造と同等の画素数で
あるが、信号線本数が従来構造の１／３に減少してい
る。ただし、走査線数は図９に示す従来構造の３倍（基
本色数倍）となる。この構造により、従来と同等の２４
０ピンの駆動用ＬＳＩを用いるとすると、ソースドライ
バＳｄは３個で２４０×３＝７２０本まで対応可能とな
り、ＶＧＡで６４０本とすると８０本の余裕が生まれる
ので図１に示すように３個のソースドライバＳｄ1〜Ｓ
ｄ3が設けられ、実際には２個のソースドライバＳｄの
端子全部と３個目のソースドライバＳｄ3の１６０本程
度の端子が実際に信号線Ｓ・・・に接続されている。ま
た、ゲートドライバＧｄにおいては、走査線必要本数が
１４４０本であるために２４０ピンのＬＳＩを用いると
すると、６個必要になるので、図１に示すように６個の
ゲートドライバＧｄ1〜Ｇｄ6が設けられている。なお、
透明基板の左上側のゲートドライバＧｄ1と右上側のゲ
ートドライバＧｄ4に対する走査線Ｇ…の接続形態につ
いて説明すると、透明基板の左上側のゲートドライバＣ
ｄ1に対して走査線Ｇ…が１本おきに接続され、右上側
のゲートドライバＣｄ4に対して残りの１本おきの走査
線Ｇ…が接続されている。従って、左右に対向するゲー
トドライバＣｄ1とゲートドライバＣｄ4にＧ1〜Ｇ480の
合計４８０本のゲート線Ｇがそれぞれ１本おきに接続さ
れている。
【００１７】ここで、ソースドライバＳｄはゲートドラ
イバＧｄよりも倍程度高価であるがために、高価なソー
スドライバＳｄを従来の８個から３個に減少させること
で大幅なコストダウンをなし得る。また、ゲートドライ
バＧｄはソースドライバＳｄの単価において半額程度で
あるので、図９に示す従来構造で２個必要なものがこの
形態において６個必要になったとして必要コストが向上
しても、そのための必要コスト増加分は、ソースドライ
バＳｄの低減によるコスト安の分よりも少なくなる。従
って結果的に表示画素数を全く変えることなく高価なソ
ースドライバの削減による低コスト化を実現できたこと
になる。また、消費電力に関して見ると、消費電力約２
０ｍＷのゲートドライバが６個で１２０ｍＷ、消費電力
約１００ｍＷのソースドライバ３個で３００ｍＷとする
と、合計で約４２０ｍＷとなり、従来構造の約８４０ｍ
Ｗに対して約半分に抑えることができる。
【００１８】ところで、最近ではポリシリコンを用いて
薄膜トランジスタ回路を透明基板上に形成する際に同時
に薄膜トランジスタ駆動回路も形成して液晶用透明基板
に駆動回路を内蔵化する構造も見られるが、液晶表示用
の画素電極のオンオフ制御を行うための１ｂｉｔのゲー
トドライバＧｄに比べて６〜８ｂｉｔ程度の多階調の信
号を高速で処理しなくてはならないソースドライバＳｄ
の方が消費電力が大きく、ソースドライバＳｄのトラン
ジスタ数も多いために、歩留まりも悪い問題がある。従
って駆動回路を内蔵化した液晶表示装置であっても、信
号線数を減少させ、ソースドライバＳｄを削減すること
は、低消費電力化と歩留まりの向上化に大きく寄与す
る。
【００１９】また、この形態においては図３に示すよう
にカラーフィルタのＲＧＢ配置を行ったが、カラーフィ
ルタのＲＧＢ配置はこの形態のように限るものではな
く、図４に示すように、走査線Ｎｏ.１に沿ってＲ、
Ｂ、Ｇの繰り返し、走査線Ｎｏ.２に沿ってＧ、Ｒ、Ｂ
の繰り返し、走査線Ｎｏ.３に沿ってＢ、Ｇ、Ｒの繰り
返し、走査線Ｎｏ.４に沿ってＲ、Ｂ、Ｇの繰り返しの
ような配置を繰り返し走査線数に対応させて行ったもの
であっても良いのは勿論である。なお、この配列は、信
号線Ｓｄに沿って配列された基本色の順番が信号線に沿
って繰り返し同じ順番とされ、前記基本色のそれぞれが
信号線に対して斜めに配列され、かつ走査線に沿って互
いに異なった基本色が隣接配列された配列である。次
に、図３に示すパターンのＲ、Ｇ、Ｂ配置は、横ストラ
イプとも言える配置であるが、この形態の配置であるな
らば、信号を処理してパソコン上でデジタル画像を加工
する場合、特に隣接する画素の相関をとる誤差拡散のよ
うな処理を行う場合には、隣接する信号が同じなので処
理が容易でメモリー消費が少なくて済む効果を期待でき
る。また、図４に示すパターンのＲ、Ｇ、Ｂ配置は、モ
ザイク的な配置とも言えるが、この形態では風景のよう
な映像を見る場合に横縞を生じることがないので、より
自然な滑らかな画像を得ることができる。
【００２０】次に、図１〜図３を基に先に示した形態の
液晶表示装置において駆動回路を駆動する場合について
説明する。前記の形態の液晶表示装置の駆動方法を説明
するにあたり、図９と図１０に示す従来の液晶表示装置
の駆動方法と対比させて以下に説明する。図９と図１０
に示す従来の液晶表示装置においてＶＧＡで６４０×４
８０ドットの表示を行う場合、フレーム周波数は６０Ｈ
ｚ（１秒間に６０回画面を書き換える）とされるので、
１画面を書き換えるために、約１６ｍｓｅｃの時間を要
する。即ち、この１６ｍｓｅｃの間に、４８０本の走査
線をスキャンすることになる。従って、ゲートドライバ
Ｇｄが１本１本の走査線をスキャンしてゆく周波数は６
０Ｈｚ×４８０本で、約３０ｋＨｚ（１本あたり約３０
μｓｅｃ）となる。一方、信号線側については、ソース
ドライバＳｄには、信号線６４０×３＝１９２０本分の
信号が時系列に送られ、それを一時ため込んで１９２０
本分を一斉に吐き出すように構成されている。従って、
時系列に送られてくる信号を１ドット分ずつ読み取るた
めのドットクロックは、３０ｋＨｚ×１９２０本で約６
０ＭＨｚとなる。
【００２１】これに対して、図１と図２に示す構造の液
晶表示装置を用いてフレーム周波数を先の場合と同様に
６０Ｈｚとすると、走査線Ｇの本数を図９と図１０に示
す従来構造に比べてＲ、Ｇ、Ｂ用に図５に示すように３
倍としているので、走査速度を３倍として駆動する。具
体的には、走査線Ｇを４８０×３＝１４４０本、信号線
Ｓを６４０本としているので、ゲートドライバＧｄが走
査線Ｇをスキャンする場合の周波数は、６０Ｈｚ×４８
０×３本＝約９０ｋＨｚとなる。ここで通常使用されて
いるゲートドライバでは、約１００ｋＨｚまで動作可能
であり、この点からみれば、従来構造と同じゲートドラ
イバを用いることができる。一方、図１と図２に示す構
造では、信号線Ｓを図９と図１０に示す従来構造の１／
３の６４０本にできるために、ソースドライバＳｄのド
ットクロックは９０ｋＨｚ×６４０本＝約６０ＭＨｚと
なり従来構造の場合と変わらない。従って図１と図２に
示す構造であると、図９と図１０に示す従来構造と同じ
ゲートドライバＧｄおよびソースドライバＳｄをそのま
ま用いることができる。
【００２２】次に、図１と図２に示す構造であると、以
下の効果を奏することができる。 図１と図２に示す構造は、図９と図１０に示す従来構
造の液晶表示装置と比べて画質的な劣化を全く生じな
い。即ち、１画面を空間的に見ると、画素数は図１に示
す構造も図９に示す構造も３０７２００であり、解像度
の変化は生じない。また、時間的に見ても、図１に示す
構造も図９に示す構造もフレーム周波数は６０Ｈｚで同
じなので、動画表示の面でも全く問題ない。 図１と図２に示す構造は、図９と図１０に示す従来構
造の液晶表示装置と比べて同じゲートドライバと同じソ
ースドライバを使用することができ、しかも、安価なゲ
ートドライバを２個から６個に増やす必要があるもの
の、ゲートドライバの２倍程度高価なソースドライバを
８個から３個に減少させることができるので、全体とし
て低コスト化できる。
【００２３】消費電力を低減できる。ドライバ消費電
力については、ゲートドライバの約２０ｍＷの消費電力
のものを６個必要とするので１２０ｍＷであるが、ゲー
トドライバ１個あたりの消費電力は走査線をスキャンす
る場合の周波数が３倍になったために、３倍となり、合
計で３６０ｍＷとなり、ソースドライバの約１００ｍＷ
のものを３個必要とするので３００ｍＷとすると、全部
で合計６６０ｍＷ必要になるが、従来構造では約８４０
ｍＷ必要であったので、約４／５程度に削減できる。
【００２４】次に、図１と図２に示す構造を採用した場
合の駆動方法の他の形態について図６を基に以下に説明
する。この形態の駆動方法においては、図６に示すよう
に１つのフレームを３つのフィールドに分割してフィー
ルド間を２本飛ばした飛び越し走査を行うところに特徴
を有する。具体的には、１画面を３つのフィールドで書
き込み、フレーム周波数を２０Ｈｚ、フィールド周波数
を６０Ｈｚ（約１６ｍｓｅｃ）とし、１つのフィールド
（約１６ｍｓｅｃ）の間にスキャンする走査線を全走査
線数１４４０本の１／３の４８０本とする。従ってゲー
トドライバが走査線をスキャンする周波数は６０Ｈｚ×
４８０本となり、図９と図１０に示す従来構造の駆動の
場合と同じ約３０ｋＨｚとなり、本発明の先に記載した
形態の駆動方法の場合の１／３とすることができる。ま
た、それに伴って、ドットクロックも３０ｋＨｚ×６４
０本となり、図９と図１０に示す従来構造の駆動と同じ
約３０ｋＨｚ、即ち、本発明に係る先の形態の場合の１
／３となる。
【００２５】以上のような駆動方法を採用した場合、以
下に説明する効果を得ることができる。 図９と図１０に示す従来構造で用いたものと同等のゲ
ートドライバとソースドライバを用いることができ、し
かも、安価なゲートドライバを２個から６個に増やす必
要があるものの、高価なソースドライバを８個から３個
に減少させることができるので、低コストにすることが
できる。
【００２６】ドライバ消費電力については、走査線を
スキャンする周波数が従来と同じであるために従来構造
と同じように約２０ｍＷであり、約２０ｍＷの消費電力
のものを６個必要とするので１２０ｍＷとなり、ソース
ドライバの約１００ｍＷのものを３個必要とするが、そ
れらのドットクロックは、従来の１／３となるために、
ソースドライバの１個あたりの消費電力は１／３とな
り、結果的に１００／３ｍＷとなると、全部で合計約２
２０ｍＷ必要になるが、従来構造では約８４０ｍＷ必要
であったので、約１／４程度に削減できる。 回路の設計変更部を少なくして実現できる（先の形態
の場合よりも従来構造を流用できる）。特に、１つのフ
レームを基本色数のフィールド（この形態の場合はＲ、
Ｇ、Ｂの３フィールド）に分け、フィールド周波数を６
０Ｈｚとし、間を２本飛ばして走査することにより、ゲ
ートドライバの走査線をスキャンする周波数を従来と全
く同じ６４０×４８０本で約３０ｋＨｚとすることがで
き、ゲートドライバの周辺回路を従来構造と同じように
することができる。
【００２７】ところで、前記の各形態においては、薄膜
トランジスタを用いた液晶表示装置（ＴＦＴ-ＬＣＤ）
の場合を基に説明したが、複数の基本色（例えば、Ｒ、
Ｇ、Ｂ）を組み合わせて１つの色を表示する画素を配列
し、マトリクス駆動する表示装置においては、同様の効
果を期待できるので、単純マトリクス液晶表示装置、Ｆ
ＥＤ（フィールドエミッションディスプレイ）、強誘電
液晶表示装置、プラズマディスプレイ、ＥＬディスプレ
イ等に広く本発明を適用できるのは勿論である。 ま
た、１つの画素を基本色に分割する場合、２色分割ある
いは４色分割等も可能であるので、それらの分割の場合
は走査線数を従来の２倍あるいは４倍として対応し、カ
ラーフィルタの配置も２色あるいは４色を前述のような
横ストライプ配置あるいはモザイク配置とすれば良い。
【００２８】図７と図８は本発明を単純マトリクス式の
液晶表示装置に適用した例を示すもので、２枚の透明基
板間に液晶が封入され、一方の透明基板の液晶側にカラ
ーフィルタが設けられ、更に、この一方の透明基板に透
明導電層製の走査線Ｇ1、Ｇ2・・・が、他方の基板の液晶
側に透明導電層からなる信号線Ｓ1、Ｓ2・・・が交差する
ように対向配置されて液晶表示素子２０が構成されてい
る。なお、図８は図７に示す１つの画素２２のみを拡大
して示すもので、この形態においてもカラーフィルタ
は、Ｒ、Ｇ、Ｂに３分割され、Ｒ、Ｇ、Ｂで３分割され
た各領域毎に走査線Ｇが設けられている。また、透明基
板の上縁部にはセグメントドライバＳｇ1、Ｓｇ2、Ｓｇ
3が設けられ、各ドライバの端子がそれぞれ信号線Ｓに
接続されるとともに、透明基板の左右両縁部にはそれぞ
れ３個、合計６個のコモンドライバＣｄ（Ｃｄ1〜Ｃ
ｄ6）が設けられ、各ドライバの端子がそれぞれ走査線
Ｇに接続されている。なお、この例においても先の例の
場合と同様に、多数配列されたゲート線Ｇ…のうち、１
本おきのゲート線Ｇ…が左側のコモンドライバＣｄに、
残りの１本おきのゲート線Ｇ…が右側のコモンドライバ
に接続されている。この例においては信号線Ｓと３つの
走査線Ｇとが挟んで区画する領域に画素が構成され、そ
の画素が３つのドットに分割されて構成されることで目
的を達成している。このように単純マトリクス式の液晶
表示装置にあっては、対向して交差する信号線Ｓと走査
線Ｇの交差部分の間に存在する液晶に電界が印加されて
液晶が駆動されるのでこの信号線Ｓと走査線Ｇが交差す
る部分が１つのドットを構成する。
【００２９】なお、前述の各形態の説明においては、６
４０×４８０画素のＶＧＡの場合について説明したが、
この他にも画面の表示形態は種々のものがあり、走査線
数４８０本のＮＴＳＣ方式のテレビ画面、走査線数５７
０本のＰＡＬ方式のテレビ画面、走査線数１１２５本の
ＨＤＴＶ方式、走査線数６００本のＳＶＧＡ、走査線数
７６８本のＸＧＡ、走査線数１０２４本のＥＷＳ等の種
々の規格に合わせて本発明構造を適用できるのは勿論で
ある。
【００３０】また、前記図５を基に説明した駆動方法と
図６を基に説明した駆動方法を切り替えて使用する構造
とすることもできる。例えば、液晶表示装置がノートパ
ソコン用に用いられた場合は、ノートパソコンの表示装
置回りに切替用のスイッチを設けておき、このスイッチ
により図５を基に説明した駆動方法をなす駆動回路と図
６を基に説明した駆動方法をなす駆動回路を切り替えて
表示装置の表示状態を使用目的に合わせて変更できるよ
うに構成しても良い。
【００３１】
【発明の効果】以上説明したように本発明によれば、従
来構造の表示装置と比べて画質的な劣化を全く生じるこ
となく、従来構造の液晶表示装置と同じゲートドライバ
とソースドライバを使用することができ、しかも、高価
なソースドライバを大幅に削減することができる。ま
た、ソースドライバよりも安価なゲートドライバの必要
数は増加するが、ゲートドライバの増加によるコスト増
加分よりもソースドライバの削減によるコスト減の方を
大きくできるので、全体として低コストにすることがで
きる。ここで例えば、１つの画素を３つの基本色で構成
する場合は、走査線本数を従来の３倍、ゲートドライバ
数を従来の３倍とする必要があるが、信号線本数を従来
の１／３、ソースドライバ数を従来の１／３とすること
ができる。次に、ドライバの消費電力については、消費
電力の大きなソースドライバを大幅に削減できるので、
ゲートドライバの増加分を差し引いても全体として消費
電力を抑制することができる。
【００３２】一方、先に記載の構成において、１つのフ
レームを複数のフィールドに分割し、フィールド毎に走
査することで、従来構造の駆動の場合と同様に表示装置
を駆動することができる。また、先に記載の構成におい
て１つのフレームを複数のフィールドに分割し、所定の
フィールド毎に飛び越し走査することにより、走査線数
の増加に拘わらず走査する周波数を従来構造の駆動の場
合と同程度にできるので、ソースドライバ１個あたりの
消費電力を更に低減できて省電力化することができる。
また、表示装置においてこれらの駆動方法なす駆動回路
を切り替えできる構造とすることで種々の表示形態に合
わせた駆動方式を選択できる表示装置を提供できる。
【図面の簡単な説明】
【図１】 本発明に係る表示装置の第１の形態を示す平
面図。
【図２】 図１に示す表示装置の画素と薄膜トランジス
タ構造の関係を示す拡大図。
【図３】 図２に示す構造においてカラーフィルタのＲ
ＧＢ配置の一例を示す図。
【図４】 図２に示す構造においてカラーフィルタのＲ
ＧＢ配置の他の例を示す図。
【図５】 本発明に係る表示装置を駆動する場合のフレ
ーム周波数とフィールドの関係の一例を示す図。
【図６】 本発明に係る表示装置を駆動する場合のフレ
ーム周波数とフィールドの関係の他の例を示す図。
【図７】 本発明を単純マトリクス駆動の液晶表示装置
に適用した一形態を示す図。
【図８】 図７に示す液晶表示装置の１つの画素の拡大
図。
【図９】 従来の液晶表示装置の液晶表示装置の平面
図。
【図１０】 図９に示す液晶表示装置の１つの画素の拡
大図。
【符号の説明】 Ｓｄ ソースドライバ、 Ｇｄ ゲートドライバ、 Ｇ 走査線、 Ｓ 信号線、 Ｔ 薄膜トランジスタ、 １０、２０ 液晶表示素子、 １１ 画素電極、 １２ 画素、

Claims (6)

    【特許請求の範囲】
  1. 【請求項１】 複数の基本色を組み合わせて１つの色を
    表示する画素が多数配列され、多数の走査線と多数の信
    号線とによって前記多数の画素がマトリクス駆動される
    とともに、各信号線方向に沿って前記複数の基本色の組
    み合わせが繰り返し配列され、走査線の数が、信号線に
    沿って並ぶ全画素数に対する前記基本色数倍の数にされ
    てなることを特徴とする表示装置。
  2. 【請求項２】 各信号線に沿って配列された基本色の順
    番が、信号線に沿って繰り返し同じ順番とされ、走査線
    に沿って同じ基本色が配列されたことを特徴とする請求
    項１に記載の表示装置。
  3. 【請求項３】 信号線に沿って配列された基本色の順番
    が、信号線に沿って繰り返し同じ順番とされ、前記基本
    色のそれぞれが信号線に対して斜めに配列され、かつ走
    査線に沿って互いに異なった基本色が隣接配列されたこ
    とを特徴とする請求項１に記載の表示装置。
  4. 【請求項４】 請求項１記載の表示装置を駆動するにあ
    たり、１つのフレームの間に全走査線を順次走査するこ
    とを特徴とする表示装置の駆動方法。
  5. 【請求項５】 請求項１記載の表示装置を駆動するにあ
    たり、１つのフレームを複数のフィールドに分割し、所
    定のフィールドごとに飛び越し走査することを特徴とす
    る表示装置の駆動方法。
  6. 【請求項６】 請求項１記載の構成を有し、更に請求項
    ４記載の駆動方法と請求項５記載の駆動方法とを切換手
    段により選択自在にしたことを特徴とする表示装置。
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