JPH10189805A - 電子部品搭載用基板及びその製造方法 - Google Patents
電子部品搭載用基板及びその製造方法Info
- Publication number
- JPH10189805A JPH10189805A JP8327898A JP32789896A JPH10189805A JP H10189805 A JPH10189805 A JP H10189805A JP 8327898 A JP8327898 A JP 8327898A JP 32789896 A JP32789896 A JP 32789896A JP H10189805 A JPH10189805 A JP H10189805A
- Authority
- JP
- Japan
- Prior art keywords
- mounting opening
- mounting
- pattern
- wall surface
- electronic component
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Classifications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
- H10W70/01—Manufacture or treatment
- H10W70/05—Manufacture or treatment of insulating or insulated package substrates, or of interposers, or of redistribution layers
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
- H10W70/60—Insulating or insulated package substrates; Interposers; Redistribution layers
- H10W70/62—Insulating or insulated package substrates; Interposers; Redistribution layers characterised by their interconnections
- H10W70/65—Shapes or dispositions of interconnections
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
- H10W70/60—Insulating or insulated package substrates; Interposers; Redistribution layers
- H10W70/62—Insulating or insulated package substrates; Interposers; Redistribution layers characterised by their interconnections
- H10W70/65—Shapes or dispositions of interconnections
- H10W70/657—Shapes or dispositions of interconnections on sidewalls or bottom surfaces of the package substrates, interposers or redistribution layers
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/50—Bond wires
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W76/00—Containers; Fillings or auxiliary members therefor; Seals
- H10W76/10—Containers or parts thereof
- H10W76/12—Containers or parts thereof characterised by their shape
- H10W76/15—Containers comprising an insulating or insulated base
- H10W76/153—Containers comprising an insulating or insulated base having interconnections in passages through the insulating or insulated base
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
- H10W70/60—Insulating or insulated package substrates; Interposers; Redistribution layers
- H10W70/67—Insulating or insulated package substrates; Interposers; Redistribution layers characterised by their insulating layers or insulating parts
- H10W70/68—Shapes or dispositions thereof
- H10W70/682—Shapes or dispositions thereof comprising holes having chips therein
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
- H10W70/60—Insulating or insulated package substrates; Interposers; Redistribution layers
- H10W70/67—Insulating or insulated package substrates; Interposers; Redistribution layers characterised by their insulating layers or insulating parts
- H10W70/68—Shapes or dispositions thereof
- H10W70/685—Shapes or dispositions thereof comprising multiple insulating layers
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/751—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires
- H10W90/754—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires between a chip and a stacked insulating package substrate, interposer or RDL
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10T—TECHNICAL SUBJECTS COVERED BY FORMER US CLASSIFICATION
- Y10T29/00—Metal working
- Y10T29/49—Method of mechanical manufacture
- Y10T29/49002—Electrical device making
- Y10T29/49117—Conductor or circuit manufacturing
- Y10T29/49124—On flat or curved insulated base, e.g., printed circuit, etc.
- Y10T29/4913—Assembling to base an electrical component, e.g., capacitor, etc.
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10T—TECHNICAL SUBJECTS COVERED BY FORMER US CLASSIFICATION
- Y10T29/00—Metal working
- Y10T29/49—Method of mechanical manufacture
- Y10T29/49002—Electrical device making
- Y10T29/49117—Conductor or circuit manufacturing
- Y10T29/49124—On flat or curved insulated base, e.g., printed circuit, etc.
- Y10T29/4913—Assembling to base an electrical component, e.g., capacitor, etc.
- Y10T29/49133—Assembling to base an electrical component, e.g., capacitor, etc. with component orienting
- Y10T29/49135—Assembling to base an electrical component, e.g., capacitor, etc. with component orienting and shaping, e.g., cutting or bending, etc.
Landscapes
- Structure Of Printed Boards (AREA)
- Production Of Multi-Layered Print Wiring Board (AREA)
- Structures For Mounting Electric Components On Printed Circuit Boards (AREA)
- Printing Elements For Providing Electric Connections Between Printed Circuits (AREA)
Abstract
と共に,複数の電位を持つ側面パターンの形成が容易
な,電子部品搭載用基板及びその製造方法を提供する。 【解決手段】 電子部品搭載用の搭載用開口部2の壁面
には,複数の側面パターン11,12を設ける。搭載用
開口部には,その壁面からその内方へ向かって突出する
突出部21を設ける。突出部21の側面には,各側面パ
ターン11,12の端部を延設する。また,側面パター
ンは,搭載用開口部の壁面全体に形成した導体層を,ネ
ガ型感光性樹脂よりなる側面パターン用レジスト膜によ
り側面パターン形成部分を被覆した状態で側面パターン
非形成部分をエッチングすることにより,搭載用開口部
の壁面に複数設けることができる。
Description
用開口部の壁面に側面パターンを設けた電子部品搭載用
基板及びその製造方法に関する。
7に示すごとく,電子部品8を搭載するための搭載用開
口部95を有するものがある(特開平7−86752号
公報)。搭載用開口部95の壁面には,例えば,複数の
側面パターン901が設けられている。この側面パター
ン901は,電子部品搭載用基板9の内部に形成した配
線パターン53と接続している。
部95に搭載された電子部品8は,側面パターン901
の上方に設けた帯状の側面パッド903と,ボンディン
グワイヤー80を介して電気的に接続される。また,電
子部品搭載用基板9の上面には,先端にボンディングパ
ッド540を有する配線パターン54を設けている。配
線パターン54は,電子部品搭載用基板9の周囲に設け
たスルーホール99と接続している。スルーホール99
の内部には,例えばリードピン86が装着される。
っては,まず,図28に示すごとく,電子部品搭載用基
板の上層となる絶縁基板92に,側面パターン形成部分
を壁面とする4つの切断用穴90を穿設する。これらの
切断用穴90は,絶縁基板92の搭載用開口部形成部分
909に,その周縁を正方形状に囲むように配置する。
膜902を施すと共に,絶縁基板92の上面に帯状の側
面パッド903,配線パターン54,及びボンディング
パッド540を形成する。次に,図28に示す点線90
0に沿って,切断用穴90の壁面の間をルーター加工に
より切断して,搭載用開口部901を形成するととも
に,搭載用開口部901の壁面に複数の側面パターン9
01を形成する。
縁基板91を積層,圧着して,多層板98を得る。多層
板98の周縁部にスルーホール99を形成し,その内部
を金属めっき膜909により被覆する。その後,スルー
ホール99の内部にリードピン86を装着する。以上に
より,図27に示す電子部品搭載用基板9を得る。
子部品搭載用基板においては,図29に示すごとく,側
面パターン901の先端部の金属めっき膜902が,搭
載用開口部95の壁面919から剥離するおそれがあっ
た。即ち,ルーター加工の際に,搭載用開口部の壁面9
19を被覆する上記側面パターン901の先端部の金属
めっき膜902が,ルーター加工具の刃によって引き剥
がされることがある。金属めっき膜902が引き剥がさ
れると,熱衝撃の際にその部分から金属めっき膜902
が更に大きく剥離して,側面パターンの確実な電気導通
性を妨げるおそれがある。そのため,ルーター加工を精
度良く徐々に行う必要があり,ルーター加工速度を高め
ることができず,生産性が低い。
伴い,電子部品搭載用基板9には,多種類の電位を持つ
側面パターンを設けることが必要になってきた。そこ
で,図30に示すごとく,搭載用開口部95の壁面を所
定箇所で打ち抜くことにより打ち抜き部912を形成し
て,該打ち抜き部912の間に側面パターン901を形
成することが考えられる。これにより,電源回路P,接
地回路G,信号回路S等,多種類の電位を持つ側面パタ
ーン901を形成することができる。これらの側面パタ
ーン901は,電源回路P,接地回路G,又は信号回路
Sとして機能させることができる。しかし,この場合に
も,上記と同様に,搭載用開口部95の打ち抜きの際に
側面パターン901の端部902が剥離することがあ
る。
パターンの剥離を防止することができると共に複数の電
位を持つ側面パターンの形成が容易な,電子部品搭載用
基板及びその製造方法を提供しようとするものである。
手段は,請求項1の発明のように,電子部品を搭載する
ための搭載用開口部を設けた絶縁基板と,上記搭載用開
口部の壁面に設けた複数の側面パターンとを有する電子
部品搭載用基板において,上記搭載用開口部には,その
壁面から該搭載用開口部の内方へ向かって突出する突出
部を設けており,かつ該突出部の側面には各側面パター
ンの端部が延設されていることを特徴とする電子部品搭
載用基板である。
口部の壁面からその内方へ向かって突出する突出部を有
している。突出部の側面には,各側面パターンの端部が
延設されている。そのため,仮に側面パターンの端部が
剥離していたとしても,その剥離は,突出部側面を被覆
する側面パターンの端部だけに留まる。そのため,搭載
用開口部の壁面から側面パターンが剥離することを防止
することができる。また,熱衝撃によって側面パターン
が搭載用開口部の壁面から剥離するおそれもない。従っ
て,側面パターンの電気導通性を確実にすることができ
る。
部は,その根部からその内側先端までの長さが,0.1
〜0.5mmであることが好ましい。これにより,側面
パターンの剥離をより効果的に防止することができる。
また,突出部が電子部品搭載の際に障害物となるおそれ
もない。0.1mm未満の場合には,側面パターンが剥
離するおそれがある。一方,0.5mmを越える場合に
は,突出部が電子部品を搭載する際に障害となるおそれ
がある。
側面と搭載用開口部の壁面との境界である一対の角部を
直線で結んだ直線上の位置をいう。また,上記搭載用開
口部の内側先端とは,搭載用開口部の内方に面した搭載
用開口部の内側面をいい,この内側面には金属めっき膜
が被覆されていない。
第1の方法としては,例えば,請求項3の発明のよう
に,電子部品を搭載するための搭載用開口部を設けた絶
縁基板と,上記搭載用開口部の壁面に設けた複数の側面
パターンとを有する電子部品搭載用基板を製造するに当
たり,まず,絶縁基板の搭載用開口部形成部分に,側面
パターン形成部分を壁面の一部とする複数の区画穴を,
各区画穴間を隔壁により区画することにより形成し,次
いで,上記区画穴の壁面に金属めっき膜を施し,その
後,上記区画穴間の隔壁をルーター加工により切断して
搭載用開口部を形成すると共に該搭載用開口部の壁面に
複数の側面パターンを形成する電子部品搭載用基板の製
造方法であって,上記ルーター加工の際には,上記区画
穴を区画する隔壁の一部分を残して,上記搭載用開口部
の内方に突出した突出部を形成することを特徴とする電
子部品搭載用基板の製造方法がある。
壁をルーター加工する際に,上記隔壁の一部分を残し
て,搭載用開口部の内方に突出した突出部を形成してい
る。そのため,ルーター加工によって隔壁の金属めっき
膜が引き剥がされたとしても,その剥離は突出部側面を
被覆する金属めっき膜に留まり,搭載用開口部の壁面を
覆う金属めっき膜は剥離しない。それ故,搭載用開口部
の壁面に密着した側面パターンを形成することができ
る。
っき膜の剥離が生じたとしても,その剥離は突出部に留
まるので,ルーター加工の精度はさほど要求されない。
また,区画穴間の隔壁の一部分を残して,搭載用開口部
の壁面から離れた位置においてルーター加工をするた
め,ルーター加工具の刃が搭載用開口部の壁面を覆う金
属めっき膜を傷つけることなく,切断加工をすることが
でき,また,切断加工が容易である。従って,側面パタ
ーンに損傷を与えることなく,容易に形成することがで
きる。
同様の理由により,その根部からその内側先端までの長
さが0.1〜0.5mmであることが好ましい。
第2の方法としては,請求項4の発明のように,電子部
品を搭載するための搭載用開口部を設けた絶縁基板と,
上記搭載用開口部の壁面に設けた複数の側面パターンと
を有する電子部品搭載用基板を製造するに当たり,ま
ず,絶縁基板の搭載用開口部形成部分に,該搭載用開口
部形成部分の全体に開口してなり,且つその周囲に波状
の凹凸部を有する大穴を形成し,次いで,上記大穴の壁
面に金属めっき膜を施し,その後,上記凹凸部において
大穴の内方に突出した凸部をルーター加工により切断し
て,搭載用開口部を形成すると共に該搭載用開口部の壁
面に複数の側面パターンを形成する電子部品搭載用基板
の製造方法であって,上記ルーター加工の際には,上記
大穴の周囲に設けた凹凸部における凸部の一部分を残し
て,上記搭載用開口部の内方に突出した突出部を形成す
ることを特徴とする電子部品搭載用基板の製造方法があ
る。
をルーター加工する際に,上記凸部の一部分を残して,
上記搭載用開口部の内方に突出した突出部を形成してい
る。そのため,ルーター加工によって凸部の金属めっき
膜が引き剥がされたとしても,その剥離は突出部側面を
被覆する金属めっき膜に留まり,搭載用開口部の壁面を
被覆する金属めっき膜は剥離しない。それ故,搭載用開
口部の壁面に密着した側面パターンを形成することがで
きる。
ーター加工の精度はさほど要求されない。また,凸部の
一部分を残して,搭載用開口部から離れた位置において
ルーター加工をするため,搭載用開口部に損傷を与えず
に切断加工をすることができかつ,切断加工が容易であ
る。
ように,上記突出部は,上記と同様の理由により,その
根部からその内側先端までの長さが0.1〜0.5mm
であることが好ましい。
手段は,請求項6の発明のように,電子部品を搭載する
ための搭載用開口部を設けた絶縁基板と,上記搭載用開
口部の壁面に設けた複数の側面パターンとを有する電子
部品搭載用基板であって,上記側面パターンは,搭載用
開口部の壁面全体に形成した導体層を,側面パターン用
レジスト膜により側面パターン形成部分を被覆した状態
で側面パターン非形成部分をエッチングして形成したも
のであり,かつ,上記側面パターンの間は,上記エッチ
ングにより絶縁基板の一部が露出したパターン間の露出
面により絶縁されていることを特徴とする電子部品搭載
用基板である。
面パターンは,搭載用開口部の壁面全体に形成した導体
層を,側面パターン用レジスト膜により側面パターン形
成部分を被覆した状態で側面パターン非形成部分をエッ
チングして形成したものである。そのため,側面パター
ン用レジスト膜のパターン幅を狭くすることにより,側
面パターンの間の間隙を最小0.2mm程度まで狭める
ことができる。
は,従来のように突出部や打ち抜き部を設けて側面パタ
ーン間の絶縁を行う場合の最小間隙が1mm程度であっ
たのに比べて,格段に狭い。それ故,従来よりも多くの
側面パターンを形成することができる。従って,各絶縁
基板に側面パターンの数に対応した電位の異なる多種類
のパターンを形成することができ,電子部品搭載用基板
の薄層化を図ることができる。
面全体に形成した導体層をエッチングすることにより形
成されたものである。そのため,従来のような打ち抜き
加工による側面パターンの剥がれも生じない。また,複
数の側面パターンは,上記エッチングにより絶縁基板の
一部が露出したパターン間の露出面により絶縁されてい
る。このパターン間の露出面は,側面パターンとほぼ同
一平面に露出している。
の露出面とは,導体層からなる側面パターンの厚み分だ
けの段差しかなく,この厚みは10〜30μmにすぎな
い。そのため,側面パターンはパターン間の露出面とほ
ぼ同一平面上に位置しているといえる。それ故,搭載用
開口部の壁面には,電子部品搭載の際に障害となる突出
部がない。従って,電子部品の搭載をスムーズに行うこ
とができる。
パターンの上方又は下方の少なくともいずれかの端部
は,該端部に沿って側面パッドと接続していることが好
ましい。
沿って形成されているため,側面パターンとの接続面積
が大きい。そのため,側面パッドと側面パターンとの接
続信頼性を確保でき,側面パターンに伝えられた電流を
側面パッドに容易に導くことができる。また,通常,側
面パッドに,電子部品と電気的に接続するためのボンデ
ィングパッドを設ける。これにより,上記側面パッド及
びボンディングパッドを介して,側面パターンと電子部
品とを電気的に接続することができる。
するための搭載用開口部を設けた絶縁基板と,上記搭載
用開口部の壁面に設けた複数の側面パターンとを有する
電子部品搭載用基板を製造する方法において,まず,絶
縁基板に搭載用開口部を穴明けし,次いで,該搭載用開
口部の壁面を含めて,上記絶縁基板の全表面に導体層を
形成し,次いで,上記導体層の表面を,ネガ型感光性樹
脂からなる側面パターン用レジスト膜により被覆し,次
いで,上記絶縁基板の表面に,搭載用開口部の壁面にお
ける側面パターン非形成部分を露光するためのスリット
を有する側面パターン用マスクを載置し,次いで,散乱
光を,上記スリットを通過させることにより,上記側面
パターン非形成部分に照射して,上記側面パターン非形
成部分を被覆する側面パターン用レジスト膜を露光し,
次いで,上記側面パターン用レジスト膜を現像して,上
記側面パターン非形成部分を被覆する側面パターン用レ
ジスト膜を除去し,次いで,側面パターン用レジスト膜
から露出した導体層をエッチングにより除去して,搭載
用開口部の壁面における側面パターン非形成部分に,絶
縁基板の一部を露出させてなるパターン間の露出面を形
成し,その後,上記導体層の表面を覆う側面パターン用
レジスト膜のすべてを除去して,上記パターン間の露出
面により絶縁された複数の側面パターンを形成すること
を特徴とする電子部品搭載用基板の製造方法である。
面パターン用レジスト膜には散乱光を照射して側面パタ
ーン非形成部分に形成された導体層を露出させ,露出し
た導体層をエッチングにより除去することにより,パタ
ーン間の露出面を形成するとともに,該パターン間の露
出面により絶縁された側面パターンを形成することであ
る。
パターン用マスクを載置した状態で,露光している。側
面パターン用マスクは,搭載用開口部における側面パタ
ーン非形成部分を露光するためのスリットを有する。
の光を照射すると,光はスリットを透過して,側面パタ
ーン非形成部分を被覆する側面パターン用レジスト膜を
露光する。側面パターン用レジスト膜は,ネガ型感光性
樹脂からなる。ネガ型感光性樹脂は,現像によって,露
光しない部分を残して,露光した部分を溶解する性質を
有する。また,側面パターン用レジスト膜を露光するた
めの光は,四方八方に散乱する散乱光である。散乱光
は,スリットを透過した後,種々の角度で反射して,搭
載用開口部の上方端部から下方端部までの壁面に照射す
る。そのため,側面パターン用レジスト膜における側面
パターン非形成部分が,搭載用開口部の上方端部から下
方端部まで感光し,現像によって溶解除去可能な状態と
なる。
を現像することによって側面パターン用レジスト膜にお
ける側面パターン非形成部分が除去されて,除去された
部分からは導体層が露出する。露出した導体層をエッチ
ングすることにより,側面パターン非形成部分の導体層
が除去されて,搭載用開口部の壁面に,パターン間の露
出面が形成される。そして,その後残った側面パターン
用レジスト膜を除去することにより,搭載用開口部の上
記パターン間の露出面の間に,パターン間の露出面とほ
ぼ同一平面上に位置する複数の側面パターンを形成する
ことができる。
用開口部の壁面に形成した導体層を,側面パターン用レ
ジスト膜により側面パターン形成部分を被覆した状態で
エッチングして形成される。そのため,側面パターン用
レジスト膜のパターン幅を狭くすることにより,上記第
1の手段のように側面パターン間を突出部により絶縁す
る場合に比べて,側面パターンの間を狭めることができ
る。具体的には,側面パターン間を,最小0.2mm程
度まで狭くすることができる。それ故,第1の手段より
も多くの側面パターンを形成することができる。従っ
て,本発明によれば,各絶縁基板に側面パターンの数に
対応した電位の異なる多種類のパターンを形成すること
ができ,電子部品搭載用基板の薄層化を図ることができ
る。
面に形成した導体層をエッチングすることにより形成さ
れる。そのため,従来のような打ち抜き加工による側面
パターンの剥がれも生じない。また,上記第1の手段の
ように搭載用開口部の壁面に突出部を形成することな
く,搭載用開口部の壁面と同一平面上に複数の側面パタ
ーンを形成することができる。それ故,突出部により電
子部品の搭載が妨げられることなく,電子部品の搭載を
スムーズに行うことができる搭載用開口部を形成するこ
とができる。
パターン用レジスト膜のすべてを除去した後には,上記
絶縁基板の表面に配線パターンを形成するための配線パ
ターン用レジスト膜を被覆し,絶縁基板の表面を被覆す
る上記導体層をエッチングすることにより,絶縁基板の
表面に配線パターンを形成することが好ましい。これに
より,絶縁基板の上面又は下面に配線パターンを形成す
ることができる。
スリットは,搭載用開口部の壁面における側面パターン
非形成部分に散乱光を照射することができる形状であれ
ば,その形状は問わない。
スリットは,搭載用開口部の壁面における側面パターン
非形成部分を露光するための壁面露光部と,搭載用開口
部の縁部の近傍における側面パッド非形成部分を露光す
るための周縁露光部とからなることが好ましい。
パターン用レジスト膜における側面パターン非形成部分
だけでなく,搭載用開口部における側面パターン非形成
部分の縁部の近傍も露光される。そのため,その後上記
のごとく側面パターン用レジスト膜の現像及び導体層の
エッチングを行うことにより,側面パターン非形成部分
にパターン間の露出面が形成されるとともに,上記側面
パターン非形成部分の縁部の近傍に,上記パターン間の
露出面と連続した,パッド間の露出面が形成される。従
って,側面パターンの形成とともに,各側面パターンに
対応した側面パッドを形成できる。
て,図1〜図5を用いて説明する。本例の電子部品搭載
用基板3は,図1,図2に示すごとく,絶縁基板31,
32と,電子部品8を搭載するための搭載用開口部2
と,該搭載用開口部2の壁面に設けた複数の側面パター
ン11,12とを有している。
面から該搭載用開口部2の内方へ向かって突出する突出
部21を設けている。突出部21の側面には各側面パタ
ーン11,12の端部が延設されている。図5に示すご
とく,この突出部21における根部215から内側先端
212までの長さLは,0.5mmである。
は,図1に示すごとく,搭載用開口部2の壁面において
交互に配置されている。側面パターン11は電子部品に
電気を供給する電源回路であり,また側面パターン12
は電子部品を接地するための接地回路である。側面パタ
ーン11,12は,その上方において,搭載用開口部2
を囲む帯状の側面パッド71,72と接続している。
ターン12は,その下方において,絶縁基板31,32
の間に設けた接地用の配線パターン79と接続してい
る。電源用の側面パターン11は,絶縁基板31,32
の間に設けた電源用の配線パターン(図示略)と接続し
ている。
1に示すごとく,信号用の配線パターン76と,配線パ
ターン76の先端に設けたボンディングパッド760と
を有している。配線パターン76は,電子部品搭載用基
板3を貫通するスルーホール39と接続している。スル
ーホール39の内部には,図2に示すごとく,例えばリ
ードピン86が装着される。搭載用開口部2に搭載され
た電子部品8は,ボンディングワイヤー80を介して,
側面パッド71,72及びボンディングパッド760と
電気的に接続される。
について説明する。まず,2枚の絶縁基板を準備する。
この絶縁基板としては,ガラスエポキシ樹脂基板,ガラ
スポリイミド樹脂基板,又はガラスビスマレイミドトリ
アジン樹脂基板等を用いる。
はパンチング加工により,上層となるべき絶縁基板32
の搭載用開口部形成部分に,側面パターン形成部分を壁
面の一部とする複数の区画穴201を,各区画穴201
間を隔壁210により区画することにより形成する。
横断する十字形の隔壁210により4つに区画されてい
る。各区画穴201は,側面パターン形成部分を一辺と
する三角形であり,その一角を隔壁210の中心部21
9に向けて互いに向かい合っている。次いで,上記区画
穴201の壁面に,銅からなる金属めっき膜10を施
す。
って,区画穴201の隔壁210をルーター加工により
切断する。このとき,図5に示すごとく,隔壁210の
一部分を残して,搭載用開口部2の内方に突出した突出
部21を形成する。これにより,図1に示すごとく,搭
載用開口部2が形成されると共に,その壁面に複数の側
面パターン11,12が形成される。
本例の電子部品搭載用基板3は,図1,図5に示すごと
く,側面パターン11,12の両端に,搭載用開口部2
の内方に突出した突出部21を設けている。突出部21
の側面には,各側面パターン11,12の端部である金
属めっき膜10が延設されている。そのため,仮に側面
パターン1の端部が剥離していたとしても,その剥離
は,突出部21の側面を被覆する側面パターン11,1
2の端部だけに留まる。そのため,側面パターン11,
12が搭載用開口部2の壁面から剥離することはない。
更に,熱衝撃を受けても側面パターン11,12は,搭
載用開口部2の壁面から剥離しない。従って,側面パタ
ーンの電気導通性を確実にすることができる。
図5に示すごとく,区画穴201の隔壁210をルータ
ー加工する際に,隔壁210の一部分を残して,搭載用
開口部2の内方に突出した突出部21を形成している。
そのため,ルーター加工によって隔壁210の金属めっ
き膜10が剥離したとしても,その剥離は突出部21の
側面を被覆する金属めっき膜10に留まり,搭載用開口
部2の壁面を覆う金属めっき膜10は剥離しない。それ
故,搭載用開口部2の壁面に密着した複数の側面パター
ン11,12を形成することができる。
っき膜10の剥離が生じたとしても,その剥離は突出部
21で阻止されるので,ルーター加工の精度はさほど要
求されない。また,区画穴201間の隔壁の一部分を残
して,搭載用開口部2の壁面から離れた位置においてル
ーター加工をするため,ルーター加工具の刃が搭載用開
口部の壁面を覆う金属めっき膜10を傷つけることな
く,切断加工をすることができる。また,図4,図5に
示すごとく,区画穴201の隔壁210の一部を残して
切断加工するため,切断加工が特に困難である搭載用開
口部の角部218においても,容易に切断加工して,側
面パターン11,12を形成することができる。
用開口部2の角部218から突出する突出部21だけで
なく,搭載用開口部2の平面部29から直角方向に突出
する突出部22をも有している。
面パターン11と,接地用の側面パターン12とが互い
違いに設けられている。各側面パターン11,12の上
方に位置する絶縁基板32の上面には帯状の側面パッド
71,72が,またその下方に位置する絶縁基板32の
下面には配線パターンが設けられている。
たっては,図7に示すごとく,ルーター加工又はパンチ
ング加工により,上層となるべき絶縁基板32の搭載用
開口部形成部分に,側面パターン形成部分を壁面の一部
とする複数の区画穴202,203を穿設する。
部分の周辺部に形成されている。一方の区画穴202は
三角形状であり,搭載用開口部形成部分の四隅に,隔壁
211を挟んで2個ずつ形成されている。他方の区画穴
203は四角形状であり,搭載用開口部形成部分の平面
部29に,隔壁213を挟んで2個ずつ形成されてい
る。隔壁211,213は,搭載用開口部形成部分の中
央部230と連結している。
膜10を施した後,図7に示す点線200に沿って,上
記区画穴の隔壁211,213をルーター加工により切
断する。このとき,隔壁211,213の一部分を残し
て,搭載用開口部2の内方に突出した突出部21,22
を形成する。
側先端までの長さが,それぞれ0.5mm,0.3mm
である。これにより,図6に示すごとく,搭載用開口部
2が形成されると共に,両端に突出部21,22を有す
る複数の側面パターン11,12が形成される。その他
は,実施形態例1と同様である。本例においても,実施
形態例1と同様の効果を得ることができる。
用開口部2の壁面における平面部29から直角方向に突
出した複数の突出部22を有している。
ーン11と,接地用の側面パターン12とが互い違いに
設けられている。各側面パターン11,12の上方に位
置する絶縁基板32の上面には帯状の側面パッド71,
72が,またその下方に位置する絶縁基板32の下面に
は配線パターンが設けられている。
たっては,図9に示すごとく,ルーター加工又はパンチ
ング加工により,上層となるべき絶縁基板32の搭載用
開口部形成部分に,該搭載用開口部形成部分の全体に開
口している大穴205を形成する。この大穴205は,
その周囲に波状の凹凸部207を有している。凹凸部2
07には,絶縁基板32が複数の凸部222が直角方向
に突出している。
した後,図9に示す点線200に沿って,凸部222を
ルーター加工により切断する。このとき,凸部222の
一部分を残して,搭載用開口部2の内方に突出した突出
部22を形成する。これにより,図8に示すごとく,搭
載用開口部2が形成されると共に,複数の側面パターン
11,12が形成される。その他は,実施形態例1と同
様である。本例においても,実施形態例1と同様の効果
を得ることができる。
て,図10〜図25を用いて説明する。本例の電子部品
搭載用基板30は,図10に示すごとく,電子部品を搭
載するための搭載用開口部73を設けた絶縁基板7と,
搭載用開口部73の壁面に設けた複数の側面パターン5
1とを有する。
壁面に形成した導体層5を,側面パターン形成部分を被
覆した状態で側面パターン非形成部分をエッチングして
形成したものである。側面パターン51の間は,エッチ
ングにより絶縁基板7の一部が露出したパターン間の露
出面731により絶縁されている。側面パターン51
は,パターン間の露出面731とほぼ同一平面上に設け
られている。
11は,該端部に沿って,側面パッド52と接続してい
る。各側面パッド52の側端部は,搭載用開口部73の
縁部730から搭載用開口部73の外方に向かって拡大
するテーパー部521を有する。各側面パッド52の間
は,上記テーパー部521を一辺とする略三角形状のパ
ッド間の露出面732により絶縁されている。
ン51のピッチAは,0.54mmである。隣接する側
面パターン51の間の間隙Bは,0.2mmである。側
面パッド52の幅Cは,100〜150μmである。な
お,この幅Cが100μm未満の場合には,側面パッド
の形成が困難となるおそれがある。150μmを越える
場合には,配線パターン55のボンディングパッド55
0が欠損するおそれがある。
基板7の上面及び下面には,それぞれ配線パターン5
5,56が形成されている。図12に示すごとく,絶縁
基板7の上面に形成された配線パターン55は,搭載用
開口部73の周囲にボンディングパッド550を有す
る。図13に示すごとく,絶縁基板7の下面に形成され
た配線パターン56は幅広のベタ層であり,図10に示
す側面パターン51と接続されている。側面パターン5
1は,絶縁基板7の上面に設けた側面パッド52及びボ
ンディングパッド520と接続している。
上面に形成された配線パターン55及びボンディングパ
ッド550は,電位の異なる信号回路S1,S2,・・
Sx(xは,信号回路の数を示す。以下,同様)からな
る。
形成された配線パターン56は,電位の異なる電源回路
P1,P2・・Py(yは,電源回路の数を示す。以
下,同様),及び接地回路G1,G2・・Gz(zは,
接地回路の数を示す。以下,同様)からなる。これらの
配線パターン56と接続する側面パターン51は,各配
線パターンに対応する電源回路P1,P2・・Py,及
び接地回路G1,G2・・Gzからなる。また,各側面
パターンと接続する側面パッド52及びボンディングパ
ッド520も,同種の回路からなる。図14に示すごと
く,上記絶縁基板7は,その複数枚が積層されて多層構
造の電子部品搭載用基板30を形成している。
について説明する。まず,ガラスビスマレイミドトリア
ジン基板からなる絶縁基板を準備する。図15に示すご
とく,ルーター加工により,絶縁基板7に搭載用開口部
73を穴明けする。また,図12,図13に示すごと
く,絶縁基板7の周縁付近に,スルーホール78を穴明
けする。
に無電解銅めっき処理を行うことにより,搭載用開口部
73の内部を含めて,絶縁基板7の全表面に導体層5を
形成する。次いで,電着塗膜法により,導体層5の表面
全体を,ネガ型感光性樹脂からなる側面パターン用レジ
スト膜6により被覆する。
縁基板7の上面及び下面に,側面パターン用マスク40
を載置する。側面パターン用マスク40は,絶縁基板7
の搭載用開口部73を被覆する部分に,側面パターン非
形成部分を露光するためのスリット41を有する。スリ
ット41は,図18に示すごとく,側面パターン非形成
部分を露光するための壁面露光部411と,側面パッド
非形成部分を露光するための周縁露光部412とからな
る。
上方の縁部730から下方の縁部730まで露光用の光
が到達するように,搭載用開口部73の内部に開口して
いる。周縁露光部412は,搭載用開口部73の縁部7
30の近傍における側面パッド非形成部分に開口してい
る。また,周縁露光部412は,搭載用開口部73の縁
部730と,縁部730から搭載用開口部73の外方に
向かって縮小する斜辺とにより囲まれた部分であり,三
角形状をしている。
ン用レジスト膜6における側面パターン非形成部分を,
四方八方に散乱する散乱光4により露光する。散乱光4
は,スリット41を透過した後,絶縁基板表面の側面パ
ターン用レジスト膜6によって種々の角度で反射して,
搭載用開口部73の壁面及びその周囲に照射する。
における側面パターン非形成部分に,搭載用開口部73
の上方の縁部730から下方の縁部730まで散乱光4
が均一に照射する。また,側面パターン用レジスト膜6
における搭載用開口部73の縁部730の近傍にも,散
乱光4が均一に照射される。これにより,側面パターン
用レジスト膜6における散乱光4が照射した部分が感光
して,現像により溶解除去可能な状態となる。次いで,
側面パターン用マスク40を取り去る。
ン用レジスト膜6を現像して,その側面パターン非形成
部分及び側面パッド非形成部分を除去する。次いで,図
21に示すごとく,側面パターン用レジスト膜6から露
出した導体層5をエッチングにより除去する。これによ
り,搭載用開口部73の壁面には,絶縁基板7の一部が
露出したパターン間の露出面731が形成される。ま
た,搭載用開口部73の開口部730の近傍には,搭載
用開口部73の外方に向かって縮小する三角形状のパッ
ド間の露出面732が,上記パターン間の露出面731
と連続して形成される。
ーン用レジスト膜6を,アルカリ溶液により除去する。
これにより,図22〜図24に示すごとく,搭載用開口
部73のパターン間の露出面731により絶縁された側
面パターン51が,パターン間の露出面731とほぼ同
一平面上に形成される。このとき,絶縁基板7の上面及
び下面において,側面パッドの側端部となるべきテーパ
ー部521により囲まれた部分が露出する。そして,テ
ーパー部521の間に形成されたパッド間の露出面73
2を除いて,絶縁基板7の上面及び下面の全面は,導体
層5が被覆されたままである。
上面及び下面に配線パターン及び側面パッドを形成する
ための配線パターン用マスク31,32を載置して,配
線パターン形成部分及び搭載用開口部73を被覆する。
マスク31,32から露出した部分をエッチングにより
除去する。次いで,配線パターン用マスク31,32を
取り去る。これにより,図10〜図13に示すごとく,
絶縁基板7の上面及び下面に,上記側面パターン51の
上方及び下方の端部511と連続した側面パッド52
と,配線パターン55,56とが形成される。その後,
図14に示すごとく,上記絶縁基板7を複数枚積層,圧
着して,多層の電子部品搭載用基板30を得る。
る。側面パターンは,図21に示すごとく,搭載用開口
部73の壁面に形成した導体層5を,側面パターン用レ
ジスト膜6により側面パターン形成部分を被覆した状態
で側面パターン非形成部分をエッチングして形成され
る。そのため,側面パターン用レジスト膜6のパターン
幅を狭くすることにより,側面パターンの間を最小0.
2mm程度まで狭めることができる。それ故,図10に
示すごとく,実施形態例1よりも多くの側面パターン5
1を形成することができる。
の上面,下面に設けた配線パターン55,56の数に対
応した,電位の異なる多種類の配線パターン51を形成
することができる。それ故,絶縁基板7の上面と下面と
の間で多種類の電位の回路を形成することができる。従
って,電子部品搭載用基板30の高密度実装化及び薄層
化を図ることができる。また,側面パターン間を突出部
により絶縁した実施形態例1の電子部品搭載用基板(図
1参照)では,9層の絶縁基板が必要であった回路機能
が,本例によれば側面パターンを高密度に実装できるた
め,6層の絶縁基板で足りる。
73の壁面に形成した導体層5をエッチングすることに
より形成されたものである。そのため,従来のように打
ち抜き加工による側面パターンの剥がれも生じない。ま
た,図10に示すごとく,側面パターン51は,側面パ
ターン51とほぼ同一平面に露出した搭載用開口部73
のパターン間の露出面731により絶縁されている。そ
のため,搭載用開口部73の壁面には,突出部がない。
従って,電子部品の搭載をスムーズに行うことができ
る。
1の上方及び下方の端部511に沿って形成されている
ため,側面パターン51との接続面積が大きく,両者の
接続信頼性が高い。そのため,側面パッド52は,側面
パターン51に伝えられた電流をボンディングパッド5
20に容易に導くことができる。
ディングパッド520とを直接接続している点が実施形
態例4と相違する。本例においても,実施形態例4と同
様に側面パターン51の剥離がなく,電子部品の搭載操
作が容易で,電子部品搭載用基板30の高密度実装化及
び薄層化を図ることができる。
防止することができると共に,複数の電位を持つ側面パ
ターンの形成が容易な,電子部品搭載用基板及びその製
造方法を提供することができる。
側面スルーホールを形成する方法を説明するための絶縁
基板の斜視図。
断位置を示す説明図。
要部平面図。
側面スルーホールを形成する方法を説明するための絶縁
基板の平面図。
側面スルーホールを形成する方法を説明するための絶縁
基板の平面図。
に形成された側面パターンを示す,電子部品搭載用基板
の部分斜視図。
部周縁を示す,絶縁基板の部分平面図。
用基板の断面図。
けした絶縁基板の平面図。
ーン用レジスト膜を被覆した絶縁基板の断面図。
クの平面図。
クにより被覆された絶縁基板の搭載用開口部付近の斜視
図。
スト膜の露光方法を示す,絶縁基板の断面図。
スト膜における側面パターン非形成部分を除去した,絶
縁基板の断面図。
にパターン間の露出面を形成した絶縁基板の断面図。
した絶縁基板の断面図。
した絶縁基板の平面図。
した搭載用開口部の内部を示す絶縁基板の斜視図。
方法を示す,搭載用開口部付近の絶縁基板の斜視図。
を示す,電子部品搭載用基板の部分斜視図。
図。
パターンを形成する方法を説明するための絶縁基板の斜
視図。
部分斜視図。
Claims (10)
- 【請求項1】 電子部品を搭載するための搭載用開口部
を設けた絶縁基板と,上記搭載用開口部の壁面に設けた
複数の側面パターンとを有する電子部品搭載用基板にお
いて,上記搭載用開口部には,その壁面から該搭載用開
口部の内方へ向かって突出する突出部を設けており,か
つ該突出部の側面には各側面パターンの端部が延設され
ていることを特徴とする電子部品搭載用基板。 - 【請求項2】 請求項1において,上記突出部は,その
根部から内側先端までの長さが,0.1〜0.5mmで
あることを特徴とする電子部品搭載用基板。 - 【請求項3】 電子部品を搭載するための搭載用開口部
を設けた絶縁基板と,上記搭載用開口部の壁面に設けた
複数の側面パターンとを有する電子部品搭載用基板を製
造するに当たり,まず,絶縁基板の搭載用開口部形成部
分に,側面パターン形成部分を壁面の一部とする複数の
区画穴を,各区画穴間を隔壁により区画することにより
形成し,次いで,上記区画穴の壁面に金属めっき膜を施
し,その後,上記区画穴間の隔壁をルーター加工により
切断して搭載用開口部を形成すると共に該搭載用開口部
の壁面に複数の側面パターンを形成する電子部品搭載用
基板の製造方法であって,上記ルーター加工の際には,
上記区画穴を区画する隔壁の一部分を残して,上記搭載
用開口部の内方に突出した突出部を形成することを特徴
とする電子部品搭載用基板の製造方法。 - 【請求項4】 電子部品を搭載するための搭載用開口部
を設けた絶縁基板と,上記搭載用開口部の壁面に設けた
複数の側面パターンとを有する電子部品搭載用基板を製
造するに当たり,まず,絶縁基板の搭載用開口部形成部
分に,該搭載用開口部形成部分の全体に開口してなり,
且つその周囲に波状の凹凸部を有する大穴を形成し,次
いで,上記大穴の壁面に金属めっき膜を施し,その後,
上記凹凸部において大穴の内方に突出した凸部をルータ
ー加工により切断して,搭載用開口部を形成すると共に
該搭載用開口部の壁面に複数の側面パターンを形成する
電子部品搭載用基板の製造方法であって,上記ルーター
加工の際には,上記大穴の周囲に設けた凹凸部における
凸部の一部分を残して,上記搭載用開口部の内方に突出
した突出部を形成することを特徴とする電子部品搭載用
基板の製造方法。 - 【請求項5】 請求項3又は4において,上記突出部
は,その根部からその内側先端までの長さが0.1〜
0.5mmであることを特徴とする電子部品搭載用基板
の製造方法。 - 【請求項6】 電子部品を搭載するための搭載用開口部
を設けた絶縁基板と,上記搭載用開口部の壁面に設けた
複数の側面パターンとを有する電子部品搭載用基板であ
って,上記側面パターンは,搭載用開口部の壁面全体に
形成した導体層を,側面パターン用レジスト膜により側
面パターン形成部分を被覆した状態で側面パターン非形
成部分をエッチングして形成したものであり,かつ,上
記側面パターンの間は,上記エッチングにより絶縁基板
の一部が露出した,パターン間の露出面により絶縁され
ていることを特徴とする電子部品搭載用基板。 - 【請求項7】 請求項6において,上記側面パターンの
上方又は下方の少なくともいずれかの端部は,該端部に
沿って側面パッドと接続していることを特徴とする電子
部品搭載用基板。 - 【請求項8】 電子部品を搭載するための搭載用開口部
を設けた絶縁基板と,上記搭載用開口部の壁面に設けた
複数の側面パターンとを有する電子部品搭載用基板を製
造する方法において,まず,絶縁基板に搭載用開口部を
穴明けし,次いで,該搭載用開口部の壁面を含めて,上
記絶縁基板の全表面に導体層を形成し,次いで,上記導
体層の表面を,ネガ型感光性樹脂からなる側面パターン
用レジスト膜により被覆し,次いで,上記絶縁基板の表
面に,搭載用開口部の壁面における側面パターン非形成
部分を露光するためのスリットを有する側面パターン用
マスクを載置し,次いで,散乱光を,上記スリットを通
過させることにより,上記側面パターン非形成部分に照
射して,上記側面パターン非形成部分を被覆する側面パ
ターン用レジスト膜を露光し,次いで,上記側面パター
ン用レジスト膜を現像して,上記側面パターン非形成部
分を被覆する側面パターン用レジスト膜を除去し,次い
で,側面パターン用レジスト膜から露出した導体層をエ
ッチングにより除去して,搭載用開口部の壁面における
側面パターン非形成部分に,絶縁基板の一部を露出させ
てなるパターン間の露出面を形成し,その後,上記導体
層の表面を覆う側面パターン用レジスト膜のすべてを除
去して,上記パターン間の露出面により絶縁された複数
の側面パターンを形成することを特徴とする電子部品搭
載用基板の製造方法。 - 【請求項9】 請求項8において,上記側面パターン用
レジスト膜のすべてを除去した後には,上記絶縁基板の
表面に配線パターンを形成するための配線パターン用レ
ジスト膜を被覆し,絶縁基板の表面を被覆する上記導体
層をエッチングすることにより,絶縁基板の表面に配線
パターンを形成することを特徴とする電子部品搭載用基
板の製造方法。 - 【請求項10】 請求項8又は9において,上記スリッ
トは,搭載用開口部の壁面における側面パターン非形成
部分を露光するための壁面露光部と,搭載用開口部の縁
部の近傍における側面パッド非形成部分を露光するため
の周縁露光部とからなることを特徴とする電子部品搭載
用基板の製造方法。
Priority Applications (6)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP32789896A JP4000609B2 (ja) | 1995-12-22 | 1996-11-21 | 電子部品搭載用基板及びその製造方法 |
| KR1019980704835A KR100300624B1 (ko) | 1995-12-22 | 1996-12-16 | 전자부품탑재용기판및그의제조방법 |
| EP03010873A EP1351296B1 (en) | 1995-12-22 | 1996-12-16 | Electronic parts mounting substrate and process for manufacturing the same |
| EP96941888A EP0932328B1 (en) | 1995-12-22 | 1996-12-16 | Substrate for mounting electronic part and process for manufacturing the same |
| PCT/JP1996/003672 WO1997024021A1 (fr) | 1995-12-22 | 1996-12-16 | Substrat pour monter un element electronique et procede pour le fabriquer |
| US09/091,505 US6201185B1 (en) | 1995-12-22 | 1996-12-16 | Substrate for mounting electronic part having conductive projections and process for manufacturing the same |
Applications Claiming Priority (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP35032395 | 1995-12-22 | ||
| JP8-307402 | 1996-11-01 | ||
| JP7-350323 | 1996-11-01 | ||
| JP30740296 | 1996-11-01 | ||
| JP32789896A JP4000609B2 (ja) | 1995-12-22 | 1996-11-21 | 電子部品搭載用基板及びその製造方法 |
Related Child Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2007091122A Division JP2007180592A (ja) | 1995-12-22 | 2007-03-30 | 電子部品搭載用基板及びその製造方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH10189805A true JPH10189805A (ja) | 1998-07-21 |
| JP4000609B2 JP4000609B2 (ja) | 2007-10-31 |
Family
ID=27338901
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP32789896A Expired - Fee Related JP4000609B2 (ja) | 1995-12-22 | 1996-11-21 | 電子部品搭載用基板及びその製造方法 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US6201185B1 (ja) |
| EP (2) | EP1351296B1 (ja) |
| JP (1) | JP4000609B2 (ja) |
| KR (1) | KR100300624B1 (ja) |
| WO (1) | WO1997024021A1 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2014192235A (ja) * | 2013-03-26 | 2014-10-06 | Dainippon Printing Co Ltd | 部品内蔵配線板、部品内蔵配線板の製造方法 |
Families Citing this family (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1999026458A1 (en) * | 1997-11-19 | 1999-05-27 | Ibiden Co., Ltd. | Multilayer printed wiring board and method for manufacturing the same |
| US6545227B2 (en) * | 2001-07-11 | 2003-04-08 | Mce/Kdi Corporation | Pocket mounted chip having microstrip line |
| US6879039B2 (en) | 2001-12-18 | 2005-04-12 | Broadcom Corporation | Ball grid array package substrates and method of making the same |
| US7258549B2 (en) * | 2004-02-20 | 2007-08-21 | Matsushita Electric Industrial Co., Ltd. | Connection member and mount assembly and production method of the same |
| US7839657B2 (en) * | 2006-04-28 | 2010-11-23 | Continental Automotive Systems Us, Inc. | Position adjustable printed circuit board |
| WO2008096450A1 (ja) * | 2007-02-09 | 2008-08-14 | Panasonic Corporation | 回路基板、積層回路基板および電子機器 |
Family Cites Families (14)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| GB1339660A (en) * | 1971-11-20 | 1973-12-05 | Ferranti Ltd | Supports for semiconductor devices |
| JPS5626487A (en) | 1980-01-21 | 1981-03-14 | Futaba Denshi Kogyo Kk | Bothhside wiring board |
| JPS57115850A (en) * | 1981-01-10 | 1982-07-19 | Nec Corp | Chip carrier for semiconductor ic |
| US4547795A (en) | 1983-03-24 | 1985-10-15 | Bourns, Inc. | Leadless chip carrier with frangible shorting bars |
| FR2590051B1 (fr) * | 1985-11-08 | 1991-05-17 | Eurotechnique Sa | Carte comportant un composant et micromodule a contacts de flanc |
| FR2603739B1 (fr) * | 1986-09-05 | 1988-12-09 | Cimsa Sintra | Boitier de composant electronique muni de broches de connexion comportant un micro-boitier amovible |
| US5107586A (en) * | 1988-09-27 | 1992-04-28 | General Electric Company | Method for interconnecting a stack of integrated circuits at a very high density |
| JPH02232986A (ja) * | 1989-03-07 | 1990-09-14 | Sony Corp | 基板及びその製造法 |
| WO1991011824A1 (en) * | 1990-01-24 | 1991-08-08 | Nauchno-Proizvodstvenny Tsentr Elektronnoi Mikrotekhnologii Akademii Nauk Sssr | Three-dimensional electronic unit and method of construction |
| US5235211A (en) * | 1990-06-22 | 1993-08-10 | Digital Equipment Corporation | Semiconductor package having wraparound metallization |
| US5279706A (en) * | 1992-10-13 | 1994-01-18 | General Electric Company | Method and apparatus for fabricating a metal interconnection pattern for an integrated circuit module |
| JPH06188534A (ja) * | 1992-12-17 | 1994-07-08 | Ibiden Co Ltd | 電子部品搭載用基板及びその製造方法 |
| JPH0786752A (ja) * | 1993-06-30 | 1995-03-31 | Ibiden Co Ltd | 電子部品搭載用基板 |
| IL106892A0 (en) * | 1993-09-02 | 1993-12-28 | Pierre Badehi | Methods and apparatus for producing integrated circuit devices |
-
1996
- 1996-11-21 JP JP32789896A patent/JP4000609B2/ja not_active Expired - Fee Related
- 1996-12-16 EP EP03010873A patent/EP1351296B1/en not_active Expired - Lifetime
- 1996-12-16 US US09/091,505 patent/US6201185B1/en not_active Expired - Lifetime
- 1996-12-16 KR KR1019980704835A patent/KR100300624B1/ko not_active Expired - Fee Related
- 1996-12-16 WO PCT/JP1996/003672 patent/WO1997024021A1/ja not_active Ceased
- 1996-12-16 EP EP96941888A patent/EP0932328B1/en not_active Expired - Lifetime
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2014192235A (ja) * | 2013-03-26 | 2014-10-06 | Dainippon Printing Co Ltd | 部品内蔵配線板、部品内蔵配線板の製造方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| WO1997024021A1 (fr) | 1997-07-03 |
| EP1351296A1 (en) | 2003-10-08 |
| KR100300624B1 (ko) | 2001-09-29 |
| US6201185B1 (en) | 2001-03-13 |
| EP1351296B1 (en) | 2011-06-01 |
| KR19990076719A (ko) | 1999-10-15 |
| EP0932328A4 (en) | 1999-10-27 |
| EP0932328A1 (en) | 1999-07-28 |
| JP4000609B2 (ja) | 2007-10-31 |
| EP0932328B1 (en) | 2005-03-16 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JP2000165049A (ja) | 多層回路基板の製造方法 | |
| JP4000609B2 (ja) | 電子部品搭載用基板及びその製造方法 | |
| TWI408775B (zh) | 用於形成與積體電路之接觸墊之連接之方法 | |
| JP2003198085A (ja) | 回路基板およびその製造方法 | |
| EP1951012B1 (en) | Method of manufacturing a wiring board including electroplating | |
| CN115190701A (zh) | 一种埋入式线路封装基板及其加工方法 | |
| CN115881546A (zh) | 芯片互联的封装结构及其封装方法 | |
| JP2000114715A (ja) | 汚染の低減された周辺低インダクタンス相互接続部の製作方法 | |
| KR20040023773A (ko) | 도체 배선 패턴의 형성 방법 | |
| TWI429348B (zh) | 側邊具有導電接觸件的積層印刷電路板模組及其製造方法 | |
| JP2006100300A (ja) | プリント配線板の製造方法、およびプリント配線板 | |
| JP2000091722A (ja) | プリント配線板及びその製造方法 | |
| JPH10209612A (ja) | 回路基板およびその製造方法 | |
| JP2007180592A (ja) | 電子部品搭載用基板及びその製造方法 | |
| JP2000114412A (ja) | 回路基板の製造方法 | |
| JPH07235621A (ja) | リードレスチップキャリア及びその製造方法 | |
| TW202314878A (zh) | 晶片互聯的封裝結構及其封裝方法 | |
| KR100601899B1 (ko) | 반도체 소자를 탑재하는 중공을 갖는 기판을 제조하는 방법 | |
| JP3812006B2 (ja) | 多層プリント配線板の製造方法 | |
| JP4150464B2 (ja) | 2メタルテープキャリアパッケージとその製造方法 | |
| JP3965553B2 (ja) | Tabテープの製造方法 | |
| JP2001068807A (ja) | 配線基板及び配線基板の製造方法 | |
| JPH06188534A (ja) | 電子部品搭載用基板及びその製造方法 | |
| JP2022108487A (ja) | 配線基板 | |
| JPS6235654A (ja) | プリント基板用素子部品およびその製造方法 |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20070130 |
|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20070330 |
|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20070424 |
|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20070621 |
|
| TRDD | Decision of grant or rejection written | ||
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20070724 |
|
| A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20070806 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100824 Year of fee payment: 3 |
|
| R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100824 Year of fee payment: 3 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110824 Year of fee payment: 4 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120824 Year of fee payment: 5 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120824 Year of fee payment: 5 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130824 Year of fee payment: 6 |
|
| LAPS | Cancellation because of no payment of annual fees |