JPH10198568A - フラッシュメモリ書き込み装置及びその方法 - Google Patents
フラッシュメモリ書き込み装置及びその方法Info
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- JPH10198568A JPH10198568A JP9004308A JP430897A JPH10198568A JP H10198568 A JPH10198568 A JP H10198568A JP 9004308 A JP9004308 A JP 9004308A JP 430897 A JP430897 A JP 430897A JP H10198568 A JPH10198568 A JP H10198568A
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- JP
- Japan
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- flash memory
- loader
- system unit
- ram
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Abstract
(57)【要約】
【課題】 低コストで多種多様なフラッシュメモリに対
応できるフラッシュメモリ書き込み装置及びその方法を
提供するものである。 【解決手段】 フラッシュメモリ１１に書き込むべきデ
ータと前記フラッシュメモリ１１の消去及び書き込みを
実行するローダプログラムを保持するホストシステム２
と、ターゲットシステム１にフラッシュメモリ１１とそ
のフラッシュメモリ１１へのデータ更新のためのホスト
システムより供給される所定のデータを記憶するＲＡＭ
１３を有し、前記フラッシュメモリ１１のタイプを識別
し、識別されたタイプに応じたローダプログラムを前記
ホストシステム２より前記ＲＡＭ１３に転送し、転送さ
れたローダプログラムに応じて前記フラッシュメモリ１
１の消去及び書き込みを行う。
応できるフラッシュメモリ書き込み装置及びその方法を
提供するものである。 【解決手段】 フラッシュメモリ１１に書き込むべきデ
ータと前記フラッシュメモリ１１の消去及び書き込みを
実行するローダプログラムを保持するホストシステム２
と、ターゲットシステム１にフラッシュメモリ１１とそ
のフラッシュメモリ１１へのデータ更新のためのホスト
システムより供給される所定のデータを記憶するＲＡＭ
１３を有し、前記フラッシュメモリ１１のタイプを識別
し、識別されたタイプに応じたローダプログラムを前記
ホストシステム２より前記ＲＡＭ１３に転送し、転送さ
れたローダプログラムに応じて前記フラッシュメモリ１
１の消去及び書き込みを行う。
Description
【０００１】
【発明の属する技術分野】本発明はターゲットシステム
上のフラッシュメモリの更新をホストシステムから制御
するフラシュメモリ書き換えに関するものである。
上のフラッシュメモリの更新をホストシステムから制御
するフラシュメモリ書き換えに関するものである。
【０００２】
【従来の技術】従来、フラッシュメモリ書き換え回路は
特開平５−２３３４７８号公報に記載されたものが知ら
れている。図３に従来のフラッシュメモリ書き込みシス
テムの構成を示しており、１はターゲットシステム、１
１はフラッシュメモリ、１３はＲＡＭ、１２はターゲッ
トシステム全体を制御するＣＰＵ、１４はホストシステ
ムとの通信を行う外部通信Ｉ／Ｆ、１５はフラッシュメ
モリ１１の消去／書き込みを実行するためのプログラム
を格納するローダＲＯＭ、２はホストシステム、２２は
フラッシュメモリ１１に書き込むデータを保持するＲＯ
Ｍデータ記憶装置、３はターゲットシステム１とホスト
システム２の間で通信を実行する媒体である通信媒体で
ある。
特開平５−２３３４７８号公報に記載されたものが知ら
れている。図３に従来のフラッシュメモリ書き込みシス
テムの構成を示しており、１はターゲットシステム、１
１はフラッシュメモリ、１３はＲＡＭ、１２はターゲッ
トシステム全体を制御するＣＰＵ、１４はホストシステ
ムとの通信を行う外部通信Ｉ／Ｆ、１５はフラッシュメ
モリ１１の消去／書き込みを実行するためのプログラム
を格納するローダＲＯＭ、２はホストシステム、２２は
フラッシュメモリ１１に書き込むデータを保持するＲＯ
Ｍデータ記憶装置、３はターゲットシステム１とホスト
システム２の間で通信を実行する媒体である通信媒体で
ある。
【０００３】図４は図３で構成されたシステムでのフラ
ッシュメモリ１１への消去／書き込み動作を説明するた
めのフローチャートである。以下、図３と図４のフロー
チャートを用いて、フラッシュメモリ１１への消去／書
き込み動作を説明する。まず、ステップ（ａ）のリセッ
トによりターゲットシステム１は初期化される。次に、
ステップ（ｂ）でフラッシュメモリ１１の内容を更新
（ローダプログラムを実行）するかどうかを判定する。
ローダプログラムを実行しない場合は、ステップ（ｃ）
にて通常のプログラムを実行する。ローダプログラムを
実行する場合は以下のルーチンを実行する。
ッシュメモリ１１への消去／書き込み動作を説明するた
めのフローチャートである。以下、図３と図４のフロー
チャートを用いて、フラッシュメモリ１１への消去／書
き込み動作を説明する。まず、ステップ（ａ）のリセッ
トによりターゲットシステム１は初期化される。次に、
ステップ（ｂ）でフラッシュメモリ１１の内容を更新
（ローダプログラムを実行）するかどうかを判定する。
ローダプログラムを実行しない場合は、ステップ（ｃ）
にて通常のプログラムを実行する。ローダプログラムを
実行する場合は以下のルーチンを実行する。
【０００４】すなわち、ステップ（ｄ）でフラッシュメ
モリ１１のタイプを識別する。具体的には、フラッシュ
メモリ１１に対してタイプ識別のコマンドをホストシス
テム２が発行してフラッシュメモリの所定のアドレスを
アクセスするとフラッシュメモリからタイプが出力され
ることにより、タイプを識別する。ステップ（ｅ）によ
り判明したフラッシュメモリ１１のタイプから、これに
対応するローダプログラムのアドレス（ローダＲＯＭ１
５）へ分岐し、ステップ（ｆ）にてフラッシュメモリ１
１の内容を消去し、ステップ（ｇ）でホストシステム２
と外部通信Ｉ／Ｆ１４を介して、ＲＯＭデータ記憶装置
２２の内容を、ＲＡＭ１３に転送し、ステップ（ｈ）に
てＲＡＭ１３の内容をフラッシュメモリ１１に書き込
む。そして、ステップ（ｉ）にて、フラッシュメモリ１
１で書き込みの対象となる全アドレスに対してデータを
書き込み、同時にその内容をリードして元データ（ＲＡ
Ｍ１３の内容）と比較（ベリファイ処理）して一致して
いれば書き込みは完了する。フラッシュメモリ１１に書
き込むデータの容量がＲＡＭ１３の容量よりも大きい場
合は上記のステップ（ｇ）、（ｈ）を繰り返し実行する
ことで、フラッシュメモリ１１の内容を更新することが
できる。以上の操作により、フラッシュメモリ１１の内
容を消去して、ＲＯＭデータ記憶装置２２の内容をフラ
ッシュメモリ１１に書き込むことができる。
モリ１１のタイプを識別する。具体的には、フラッシュ
メモリ１１に対してタイプ識別のコマンドをホストシス
テム２が発行してフラッシュメモリの所定のアドレスを
アクセスするとフラッシュメモリからタイプが出力され
ることにより、タイプを識別する。ステップ（ｅ）によ
り判明したフラッシュメモリ１１のタイプから、これに
対応するローダプログラムのアドレス（ローダＲＯＭ１
５）へ分岐し、ステップ（ｆ）にてフラッシュメモリ１
１の内容を消去し、ステップ（ｇ）でホストシステム２
と外部通信Ｉ／Ｆ１４を介して、ＲＯＭデータ記憶装置
２２の内容を、ＲＡＭ１３に転送し、ステップ（ｈ）に
てＲＡＭ１３の内容をフラッシュメモリ１１に書き込
む。そして、ステップ（ｉ）にて、フラッシュメモリ１
１で書き込みの対象となる全アドレスに対してデータを
書き込み、同時にその内容をリードして元データ（ＲＡ
Ｍ１３の内容）と比較（ベリファイ処理）して一致して
いれば書き込みは完了する。フラッシュメモリ１１に書
き込むデータの容量がＲＡＭ１３の容量よりも大きい場
合は上記のステップ（ｇ）、（ｈ）を繰り返し実行する
ことで、フラッシュメモリ１１の内容を更新することが
できる。以上の操作により、フラッシュメモリ１１の内
容を消去して、ＲＯＭデータ記憶装置２２の内容をフラ
ッシュメモリ１１に書き込むことができる。
【０００５】
【発明が解決しようとする課題】このように従来のフラ
ッシュメモリ書き込み方法においては、ターゲットシス
テム部にフラッシュメモリの消去／書き込みを実行する
ローダプログラムを格納するローダＲＯＭが必要であ
り、タイプの異なるフラッシュメモリに対応する場合に
は前記ローダプログラムもタイプ別に複数種類必要とな
るため、ローダＲＯＭの容量が大きくなり、ターゲット
システム部の規模とコストが大きくなるという問題があ
った。
ッシュメモリ書き込み方法においては、ターゲットシス
テム部にフラッシュメモリの消去／書き込みを実行する
ローダプログラムを格納するローダＲＯＭが必要であ
り、タイプの異なるフラッシュメモリに対応する場合に
は前記ローダプログラムもタイプ別に複数種類必要とな
るため、ローダＲＯＭの容量が大きくなり、ターゲット
システム部の規模とコストが大きくなるという問題があ
った。
【０００６】
【課題を解決するための手段】前記課題を解決するため
に、本発明は、フラッシュメモリ消去／書き込みを実行
するローダプログラムを格納するローダＲＯＭをターゲ
ットシステムから除去して、ホストシステムにローダ記
憶装置をもたせ、このローダ記憶装置の内容をターゲッ
トシステム内のＲＡＭに転送しＲＡＭ上でプログラムを
実行できるように構成したものである。
に、本発明は、フラッシュメモリ消去／書き込みを実行
するローダプログラムを格納するローダＲＯＭをターゲ
ットシステムから除去して、ホストシステムにローダ記
憶装置をもたせ、このローダ記憶装置の内容をターゲッ
トシステム内のＲＡＭに転送しＲＡＭ上でプログラムを
実行できるように構成したものである。
【０００７】本発明によれば、ターゲットシステムにお
いてローダＲＯＭを不要とするため、ターゲットシステ
ムの規模とコストが低減出来、また多種多様なフラッシ
ュメモリに対するローダプログラムをホストシステムで
対応できるフラッシュメモリ書き込み装置を提供でき
る。
いてローダＲＯＭを不要とするため、ターゲットシステ
ムの規模とコストが低減出来、また多種多様なフラッシ
ュメモリに対するローダプログラムをホストシステムで
対応できるフラッシュメモリ書き込み装置を提供でき
る。
【０００８】
【発明の実施の形態】本発明の請求項１に記載のフラッ
シュメモリ書き込む装置は、フラッシュメモリに書き込
むべきデータと前記フラッシュメモリの消去及び書き込
みを実行するローダプログラムを保持するホストシステ
ム部と、ターゲットシステム部にフラッシュメモリとそ
のフラッシュメモリへのデータ更新のためのホストシス
テム部より供給される所定のデータを記憶するＲＡＭを
有し、前記フラッシュメモリのタイプを識別し、識別さ
れたタイプに応じたローダプログラムを前記ホストシス
テム部より前記ＲＡＭに転送し、転送されたローダプロ
グラムに応じて前記フラッシュメモリの消去及び書き込
みを行うことを特徴としたものであり、多種多様なフラ
ッシュメモリに対するローダプログラムをホストシステ
ム部で対応でき、ターゲットシステム部ではローダＲＯ
Ｍが不要となるため、ターゲットシステム部の規模とコ
ストを低減出来る。
シュメモリ書き込む装置は、フラッシュメモリに書き込
むべきデータと前記フラッシュメモリの消去及び書き込
みを実行するローダプログラムを保持するホストシステ
ム部と、ターゲットシステム部にフラッシュメモリとそ
のフラッシュメモリへのデータ更新のためのホストシス
テム部より供給される所定のデータを記憶するＲＡＭを
有し、前記フラッシュメモリのタイプを識別し、識別さ
れたタイプに応じたローダプログラムを前記ホストシス
テム部より前記ＲＡＭに転送し、転送されたローダプロ
グラムに応じて前記フラッシュメモリの消去及び書き込
みを行うことを特徴としたものであり、多種多様なフラ
ッシュメモリに対するローダプログラムをホストシステ
ム部で対応でき、ターゲットシステム部ではローダＲＯ
Ｍが不要となるため、ターゲットシステム部の規模とコ
ストを低減出来る。
【０００９】本発明の請求項２に記載されたフラッシュ
メモリ書き込み装置は、請求項１において、フラッシュ
メモリのタイプの識別と、識別されたタイプに応じたロ
ーダプログラムをホストシステム部からターゲットシス
テム部のＲＡＭへの転送と、ＲＡＭ上の転送されたロー
ダプログラムへのアドレスへの分岐を処理するローダ制
御ＲＯＭをターゲットシステム部に有することを特徴と
したものであり、ホストシステム部のローダプログラム
を変更するだけで異なるタイプのフラッシュメモリに対
応出来るため、ターゲットシステム部を変更することな
く異なるタイプのフラッシュメモリへの書き込みが可能
となる。
メモリ書き込み装置は、請求項１において、フラッシュ
メモリのタイプの識別と、識別されたタイプに応じたロ
ーダプログラムをホストシステム部からターゲットシス
テム部のＲＡＭへの転送と、ＲＡＭ上の転送されたロー
ダプログラムへのアドレスへの分岐を処理するローダ制
御ＲＯＭをターゲットシステム部に有することを特徴と
したものであり、ホストシステム部のローダプログラム
を変更するだけで異なるタイプのフラッシュメモリに対
応出来るため、ターゲットシステム部を変更することな
く異なるタイプのフラッシュメモリへの書き込みが可能
となる。
【００１０】本発明の請求項３に記載されたフラッシュ
メモリ書き込み方法は、フラッシュメモリに書き込むべ
きデータと前記フラッシュメモリの消去及び書き込みを
実行するローダプログラムを保持するホストシステム部
と、ターゲットシステム部とを備えており、前記ターゲ
ットシステム部にフラッシュメモリとそのフラッシュメ
モリへのデータ更新のためのホストシステム部より供給
される所定のデータを記憶するＲＡＭと、前記フラッシ
ュメモリのタイプの識別と識別されたタイプに応じたロ
ーダプログラムをホストシステム部からターゲットシス
テム部のＲＡＭへの転送とＲＡＭ上の転送されたローダ
プログラムへのアドレスへの分岐を処理するローダ制御
ＲＯＭを有し、前記ホストシステム部とターゲットシス
テム部は通信媒体で接続されるものであり、前記フラッ
シュメモリのタイプを識別し、識別されたタイプに応じ
たローダプログラムを前記ホストシステム部より前記通
信媒体を通して前記ＲＡＭに転送し、転送されたローダ
プログラムの開始アドレスに分岐し、前記ローダプログ
ラムに応じて前記フラッシュメモリを消去し、そして、
ＲＯＭデータをホストシステムより前記通信媒体を通し
て転送してフラッシュメモリに所定のデータ書き込みを
行うことを特徴としたものであり、多種多様なフラッシ
ュメモリに対するローダプログラムをホストシステム部
で対応でき、ターゲットシステム部ではローダＲＯＭが
不要となるため、ターゲットシステム部の規模とコスト
を低減出来る。
メモリ書き込み方法は、フラッシュメモリに書き込むべ
きデータと前記フラッシュメモリの消去及び書き込みを
実行するローダプログラムを保持するホストシステム部
と、ターゲットシステム部とを備えており、前記ターゲ
ットシステム部にフラッシュメモリとそのフラッシュメ
モリへのデータ更新のためのホストシステム部より供給
される所定のデータを記憶するＲＡＭと、前記フラッシ
ュメモリのタイプの識別と識別されたタイプに応じたロ
ーダプログラムをホストシステム部からターゲットシス
テム部のＲＡＭへの転送とＲＡＭ上の転送されたローダ
プログラムへのアドレスへの分岐を処理するローダ制御
ＲＯＭを有し、前記ホストシステム部とターゲットシス
テム部は通信媒体で接続されるものであり、前記フラッ
シュメモリのタイプを識別し、識別されたタイプに応じ
たローダプログラムを前記ホストシステム部より前記通
信媒体を通して前記ＲＡＭに転送し、転送されたローダ
プログラムの開始アドレスに分岐し、前記ローダプログ
ラムに応じて前記フラッシュメモリを消去し、そして、
ＲＯＭデータをホストシステムより前記通信媒体を通し
て転送してフラッシュメモリに所定のデータ書き込みを
行うことを特徴としたものであり、多種多様なフラッシ
ュメモリに対するローダプログラムをホストシステム部
で対応でき、ターゲットシステム部ではローダＲＯＭが
不要となるため、ターゲットシステム部の規模とコスト
を低減出来る。
【００１１】（実施の形態１）以下に、本発明の請求項
１及び請求項２及び請求項３に記載された発明の実施の
形態について、図１及び図２を用いて説明する。図１は
フラッシュメモリ書き込みシステムの構成を示し、１は
ターゲットシステム、１１はフラッシュメモリ、１３は
ＲＡＭ、１２はターゲットシステム全体を制御するＣＰ
Ｕ、１４はホストシステムとの通信を行う外部通信Ｉ／
Ｆ、１６はローダー制御ＲＯＭ、２はホストシステム、
２１はフラッシュメモリ１１の消去／書き込みを実行す
るためのプログラムを格納するローダー記憶装置、２２
はフラッシュメモリ１１に書き込むデータを保持するＲ
ＯＭデータ記憶装置、３はターゲットシステム１とホス
トシステム３の間で通信を実行する媒体である通信媒体
である。
１及び請求項２及び請求項３に記載された発明の実施の
形態について、図１及び図２を用いて説明する。図１は
フラッシュメモリ書き込みシステムの構成を示し、１は
ターゲットシステム、１１はフラッシュメモリ、１３は
ＲＡＭ、１２はターゲットシステム全体を制御するＣＰ
Ｕ、１４はホストシステムとの通信を行う外部通信Ｉ／
Ｆ、１６はローダー制御ＲＯＭ、２はホストシステム、
２１はフラッシュメモリ１１の消去／書き込みを実行す
るためのプログラムを格納するローダー記憶装置、２２
はフラッシュメモリ１１に書き込むデータを保持するＲ
ＯＭデータ記憶装置、３はターゲットシステム１とホス
トシステム３の間で通信を実行する媒体である通信媒体
である。
【００１２】図２は図１で構成されたシステムでのフラ
ッシュメモリ１１への消去／書き込み動作を説明するフ
ローチャートである。以下、図１及び図２を用いて、フ
ラッシュメモリ１１への消去／書き込み方法を説明す
る。まず、ステップ（ａ）のリセットによりターゲット
システム１は初期化される。次に、ステップ（ｂ）にて
フラッシュメモリ１１の内容を更新（ローダプログラム
を実行）するかどうかを判定する。ローダを実行しない
場合は、ステップ（ｃ）にて通常のプログラムを実行す
る。ローダを実行する場合は以下のルーチンを実行す
る。
ッシュメモリ１１への消去／書き込み動作を説明するフ
ローチャートである。以下、図１及び図２を用いて、フ
ラッシュメモリ１１への消去／書き込み方法を説明す
る。まず、ステップ（ａ）のリセットによりターゲット
システム１は初期化される。次に、ステップ（ｂ）にて
フラッシュメモリ１１の内容を更新（ローダプログラム
を実行）するかどうかを判定する。ローダを実行しない
場合は、ステップ（ｃ）にて通常のプログラムを実行す
る。ローダを実行する場合は以下のルーチンを実行す
る。
【００１３】すなわち、ステップ（ｄ）にてフラッシュ
メモリ１１のタイプを識別する。具体的にはフラッシュ
メモリ１１に対してタイプ識別のコマンドを発行（所定
のアドレスに対してタイプが出力されるデータを書き込
む）して、タイプを識別する。次にステップ（ｅ）にて
判明したフラッシュメモリ１１のタイプから、これに対
応するローダプログラムをローダ記憶装置２１から、外
部通信Ｉ／Ｆ１４を介して、ＲＡＭ１３に転送し、ステ
ップ（ｆ）にて、ＲＡＭ１３に存在するローダプログラ
ムの開始アドレスへ分岐する。上記の（ｄ）、（ｅ）、
（ｆ）の処理はローダ制御ＲＯＭ１６内のプログラムで
実行される。
メモリ１１のタイプを識別する。具体的にはフラッシュ
メモリ１１に対してタイプ識別のコマンドを発行（所定
のアドレスに対してタイプが出力されるデータを書き込
む）して、タイプを識別する。次にステップ（ｅ）にて
判明したフラッシュメモリ１１のタイプから、これに対
応するローダプログラムをローダ記憶装置２１から、外
部通信Ｉ／Ｆ１４を介して、ＲＡＭ１３に転送し、ステ
ップ（ｆ）にて、ＲＡＭ１３に存在するローダプログラ
ムの開始アドレスへ分岐する。上記の（ｄ）、（ｅ）、
（ｆ）の処理はローダ制御ＲＯＭ１６内のプログラムで
実行される。
【００１４】そして、次のステップ（ｇ）以降の処理は
ＲＡＭ１３上でプログラムは実行される。ステップ
（ｇ）にてフラッシュメモリ１１の内容を消去し、ステ
ップ（ｈ）にてホストシステム２と外部通信Ｉ／Ｆ１４
を介して、ＲＯＭデータ記憶装置２２の内容を、ＲＡＭ
１３に転送し、ステップ（ｉ）にてＲＡＭ１３の内容を
フラッシュメモリ１１に書き込む。そしてステップ
（ｊ）にてフラッシュメモリ１１で書き込みの対象とな
る全アドレスに対してデータを書き込み、同時にその内
容をリードして元データ（ＲＡＭ１３の内容）と比較
（ベリファイ処理）して一致していれば書き込みは完了
する。フラッシュメモリ１１に書き込むデータの容量が
ＲＡＭ１３の容量よりも大きい場合は上記のステップ
（ｈ）、（ｉ）を繰り返し実行することで、フラッシュ
メモリ１１の内容を更新することができる。
ＲＡＭ１３上でプログラムは実行される。ステップ
（ｇ）にてフラッシュメモリ１１の内容を消去し、ステ
ップ（ｈ）にてホストシステム２と外部通信Ｉ／Ｆ１４
を介して、ＲＯＭデータ記憶装置２２の内容を、ＲＡＭ
１３に転送し、ステップ（ｉ）にてＲＡＭ１３の内容を
フラッシュメモリ１１に書き込む。そしてステップ
（ｊ）にてフラッシュメモリ１１で書き込みの対象とな
る全アドレスに対してデータを書き込み、同時にその内
容をリードして元データ（ＲＡＭ１３の内容）と比較
（ベリファイ処理）して一致していれば書き込みは完了
する。フラッシュメモリ１１に書き込むデータの容量が
ＲＡＭ１３の容量よりも大きい場合は上記のステップ
（ｈ）、（ｉ）を繰り返し実行することで、フラッシュ
メモリ１１の内容を更新することができる。
【００１５】以上の操作により、フラッシュメモリ１１
の内容を消去して、ＲＯＭデータ記憶装置２２の内容を
書き込むことができる。また、ターゲットシステム１に
実装するフラッシュメモリ１１を別タイプのものを使用
した場合には、従来はターゲットシステム１で対応する
必要がありローダＲＯＭの容量が大きくなっていたが、
本発明では上記ステップ（ｄ）、（ｅ）、（ｆ）の処理
をするだけの小容量のローダ制御ＲＯＭ１６をターゲッ
トシステム１に搭載しておくことで、ホストシステム２
のローダ記憶装置２１の内容を変更するだけで別のタイ
プのフラッシュメモリに対応出来るため、ターゲットシ
ステム１は変更する必要はなくなる。
の内容を消去して、ＲＯＭデータ記憶装置２２の内容を
書き込むことができる。また、ターゲットシステム１に
実装するフラッシュメモリ１１を別タイプのものを使用
した場合には、従来はターゲットシステム１で対応する
必要がありローダＲＯＭの容量が大きくなっていたが、
本発明では上記ステップ（ｄ）、（ｅ）、（ｆ）の処理
をするだけの小容量のローダ制御ＲＯＭ１６をターゲッ
トシステム１に搭載しておくことで、ホストシステム２
のローダ記憶装置２１の内容を変更するだけで別のタイ
プのフラッシュメモリに対応出来るため、ターゲットシ
ステム１は変更する必要はなくなる。
【００１６】なお、以上の説明では、ローダ制御ＲＯＭ
１６がローダプログラムの転送およびＲＡＭ１３への分
岐を実行しているが、ローダ制御ＲＯＭ１６はフラッシ
ュメモリ１１内に予め格納されている場合でも、ＣＰＵ
１２の中に存在する場合でも実施可能なことはもちろん
である。なお、フラッシュメモリを一括消去する場合に
ついても、前述したようにローダ制御ＲＯＭ１６が前述
のローダ制御動作を制御し、ＲＡＭ１３でローダプログ
ラムは実行されるので同様に実施可能である。
１６がローダプログラムの転送およびＲＡＭ１３への分
岐を実行しているが、ローダ制御ＲＯＭ１６はフラッシ
ュメモリ１１内に予め格納されている場合でも、ＣＰＵ
１２の中に存在する場合でも実施可能なことはもちろん
である。なお、フラッシュメモリを一括消去する場合に
ついても、前述したようにローダ制御ＲＯＭ１６が前述
のローダ制御動作を制御し、ＲＡＭ１３でローダプログ
ラムは実行されるので同様に実施可能である。
【００１７】
【発明の効果】以上のように本発明によれば、ターゲッ
トシステムではローダＲＯＭが不要となり、規模とコス
トが低減することが出来、また、多種多様なフラッシュ
メモリに対するローダをターゲットシステムを変更する
ことなく、ホストシステムで対応することが出来るた
め、ターゲットシステムを大量生産する（フラッシュメ
モリを書き換える）場合にはコスト低減とともに製造工
程が簡略化されるフラッシュメモリ書き込み装置を提供
することが可能となる。
トシステムではローダＲＯＭが不要となり、規模とコス
トが低減することが出来、また、多種多様なフラッシュ
メモリに対するローダをターゲットシステムを変更する
ことなく、ホストシステムで対応することが出来るた
め、ターゲットシステムを大量生産する（フラッシュメ
モリを書き換える）場合にはコスト低減とともに製造工
程が簡略化されるフラッシュメモリ書き込み装置を提供
することが可能となる。
【図１】本発明の実施の形態におけるフラッシュメモリ
書き込み装置のブロック図
書き込み装置のブロック図
【図２】本発明の実施の形態におけるフラッシュメモリ
書き込み方法のフローチャート
書き込み方法のフローチャート
【図３】従来のフラッシュメモリ書き込み装置のシステ
ム構成図
ム構成図
【図４】従来のフラッシュメモリ書き込み方法のフロー
チャート
チャート
１ ターゲットシステム ２ ホストシステム １１ フラッシュメモリ １２ ＣＰＵ １３ ＲＡＭ １４ 外部通信Ｉ／Ｆ １５ ローダＲＯＭ １６ ローダ制御ＲＯＭ ２１ ローダ記憶装置 ２２ ＲＯＭデータ記憶装置
Claims (3)
- 【請求項１】 フラッシュメモリに書き込むべきデータ
と前記フラッシュメモリの消去及び書き込みを実行する
ローダプログラムを保持するホストシステム部と、フラ
ッシュメモリとそのフラッシュメモリへのデータ更新の
ためのホストシステム部より供給される所定のデータを
記憶するＲＡＭを備えたターゲットシステム部とを有
し、前記フラッシュメモリのタイプを識別し、識別され
たタイプに応じたローダプログラムを前記ホストシステ
ム部より前記ＲＡＭに転送し、転送されたローダプログ
ラムに応じて前記フラッシュメモリの消去及び書き込み
を行うことを特徴とするフラッシュメモリ書き込み装
置。 - 【請求項２】 フラッシュメモリのタイプの識別と、識
別されたタイプに応じたローダプログラムをホストシス
テム部からターゲットシステム部のＲＡＭへの転送と、
ＲＡＭ上の転送されたローダプログラムへのアドレスへ
の分岐を処理するローダ制御ＲＯＭをターゲットシステ
ム部に有することを特徴とする請求項１に記載されたフ
ラッシュメモリ書き込み装置。 - 【請求項３】 フラッシュメモリに書き込むべきデータ
と前記フラッシュメモリの消去及び書き込みを実行する
ローダプログラムを保持するホストシステム部と、ター
ゲットシステム部とを備えており、前記ターゲットシス
テム部にフラッシュメモリとそのフラッシュメモリへの
データ更新のためのホストシステム部より供給される所
定のデータを記憶するＲＡＭと、前記フラッシュメモリ
のタイプの識別と識別されたタイプに応じたローダプロ
グラムをホストシステム部からターゲットシステム部の
ＲＡＭへの転送とＲＡＭ上の転送されたローダプログラ
ムへのアドレスへの分岐を処理するローダ制御ＲＯＭを
有し、前記ホストシステム部とターゲットシステム部は
通信媒体で接続されるものであり、 前記フラッシュメモリのタイプを識別し、識別されたタ
イプに応じたローダプログラムを前記ホストシステム部
より前記通信媒体を通して前記ＲＡＭに転送し、転送さ
れたローダプログラムの開始アドレスに分岐し、前記ロ
ーダプログラムに応じて前記フラッシュメモリを消去
し、そして、書き込むべき情報データをホストシステム
部より前記通信媒体を通して転送してフラッシュメモリ
に所定のデータ書き込みを行うことを特徴とするフラッ
シュメモリ書き込み方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9004308A JPH10198568A (ja) | 1997-01-14 | 1997-01-14 | フラッシュメモリ書き込み装置及びその方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9004308A JPH10198568A (ja) | 1997-01-14 | 1997-01-14 | フラッシュメモリ書き込み装置及びその方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH10198568A true JPH10198568A (ja) | 1998-07-31 |
Family
ID=11580872
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9004308A Pending JPH10198568A (ja) | 1997-01-14 | 1997-01-14 | フラッシュメモリ書き込み装置及びその方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH10198568A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100578642B1 (ko) * | 1998-10-09 | 2006-07-25 | 주식회사 현대오토넷 | 부트 스트랩 로더가 없는 cpu에서 플레쉬 이이피롬을 갱신하는 장치 및 방법 |
| CN110955387A (zh) * | 2019-10-25 | 2020-04-03 | 合肥沛睿微电子股份有限公司 | 自适应识别闪存类型方法及计算机可读取存储介质及装置 |
| TWI740268B (zh) * | 2019-11-08 | 2021-09-21 | 大陸商合肥沛睿微電子股份有限公司 | 自我調整識別快閃記憶體類型方法及裝置 |
| TWI780654B (zh) * | 2019-11-08 | 2022-10-11 | 大陸商合肥沛睿微電子股份有限公司 | 調整識別快閃記憶體類型的裝置及其方法 |
-
1997
- 1997-01-14 JP JP9004308A patent/JPH10198568A/ja active Pending
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100578642B1 (ko) * | 1998-10-09 | 2006-07-25 | 주식회사 현대오토넷 | 부트 스트랩 로더가 없는 cpu에서 플레쉬 이이피롬을 갱신하는 장치 및 방법 |
| CN110955387A (zh) * | 2019-10-25 | 2020-04-03 | 合肥沛睿微电子股份有限公司 | 自适应识别闪存类型方法及计算机可读取存储介质及装置 |
| US11061567B2 (en) | 2019-10-25 | 2021-07-13 | RayMX Microelectronics, Corp. | Method and device for adaptively identifying type of flash memory |
| CN110955387B (zh) * | 2019-10-25 | 2023-10-24 | 合肥沛睿微电子股份有限公司 | 自适应识别闪存类型方法及计算机可读取存储介质及装置 |
| TWI740268B (zh) * | 2019-11-08 | 2021-09-21 | 大陸商合肥沛睿微電子股份有限公司 | 自我調整識別快閃記憶體類型方法及裝置 |
| TWI780654B (zh) * | 2019-11-08 | 2022-10-11 | 大陸商合肥沛睿微電子股份有限公司 | 調整識別快閃記憶體類型的裝置及其方法 |
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