JPH10247641A - ゲートスタックのエッチング方法 - Google Patents
ゲートスタックのエッチング方法Info
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- JPH10247641A JPH10247641A JP10021286A JP2128698A JPH10247641A JP H10247641 A JPH10247641 A JP H10247641A JP 10021286 A JP10021286 A JP 10021286A JP 2128698 A JP2128698 A JP 2128698A JP H10247641 A JPH10247641 A JP H10247641A
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- etch
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- H10D64/66—Electrodes having a conductor capacitively coupled to a semiconductor by an insulator, e.g. MIS electrodes
- H10D64/661—Electrodes having a conductor capacitively coupled to a semiconductor by an insulator, e.g. MIS electrodes the conductor comprising a layer of silicon contacting the insulator, e.g. polysilicon having vertical doping variation
- H10D64/662—Electrodes having a conductor capacitively coupled to a semiconductor by an insulator, e.g. MIS electrodes the conductor comprising a layer of silicon contacting the insulator, e.g. polysilicon having vertical doping variation the conductor further comprising additional layers, e.g. multiple silicon layers having different crystal structures
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- H10P50/267—Dry etching; Plasma etching; Reactive-ion etching of conductive or resistive materials by chemical means by vapour etching only using plasmas
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- Drying Of Semiconductors (AREA)
- ing And Chemical Polishing (AREA)
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
Abstract
(57)【要約】 (修正有)
【課題】 複雑な形状を有するゲートスタックを高い内
部層選択性でエッチングすること。 【解決手段】 窒化珪素310、タングステン320、
窒化チタン330および多結晶珪素340の層で構成さ
れたスタックのエッチングを、低圧、高密度プラズマの
条件を組み換えて実施する。各々のエッチングは多重チ
ャンバーを備えたクラスタツールプラットフォーム内の
チャンバーの中で行なわれるので、除去された物質によ
る汚染を最少に出来る。
部層選択性でエッチングすること。 【解決手段】 窒化珪素310、タングステン320、
窒化チタン330および多結晶珪素340の層で構成さ
れたスタックのエッチングを、低圧、高密度プラズマの
条件を組み換えて実施する。各々のエッチングは多重チ
ャンバーを備えたクラスタツールプラットフォーム内の
チャンバーの中で行なわれるので、除去された物質によ
る汚染を最少に出来る。
Description
【0001】
【発明の属する技術分野】本発明は非反応金属を含む集
積回路ゲート構造並びにその様な構造を製造するための
方法に関する。
積回路ゲート構造並びにその様な構造を製造するための
方法に関する。
【0002】
【従来の技術】集積回路形状を小さくさせようとして駆
り立てている力の1つは、信号線の分布抵抗と寄生キャ
パシタンスであり、これらは信号の伝搬速度を遅くす
る。この様に遅延が追加されると、チップの潜在能力速
度を減じてしまう。
り立てている力の1つは、信号線の分布抵抗と寄生キャ
パシタンスであり、これらは信号の伝搬速度を遅くす
る。この様に遅延が追加されると、チップの潜在能力速
度を減じてしまう。
【0003】これはDRAMに対して特に問題であり、
それはワードラインが互いに密に詰められており、また
隣接するライン間の容量結合が非常に重大な問題となる
からである。更に、ラインのシート抵抗をそのラインの
高さを増やすことで効果的に改善することも出来無い
が、それはこれもまた隣接するラインの間での容量結合
を増やすからである。従って、従来からの多結晶珪素/
珪素化合物ラインと置き換えるための、低抵抗物質を探
すことが大いに必要である。このため金属をゲートライ
ン構造の中に設計する努力がなされている。この1つの
例はゲートスタック構造であり、これは多結晶珪素を覆
う窒化金属を覆うタングステンを含むものであるが、そ
の他の多くのゲートスタック構造も提案されている。
それはワードラインが互いに密に詰められており、また
隣接するライン間の容量結合が非常に重大な問題となる
からである。更に、ラインのシート抵抗をそのラインの
高さを増やすことで効果的に改善することも出来無い
が、それはこれもまた隣接するラインの間での容量結合
を増やすからである。従って、従来からの多結晶珪素/
珪素化合物ラインと置き換えるための、低抵抗物質を探
すことが大いに必要である。このため金属をゲートライ
ン構造の中に設計する努力がなされている。この1つの
例はゲートスタック構造であり、これは多結晶珪素を覆
う窒化金属を覆うタングステンを含むものであるが、そ
の他の多くのゲートスタック構造も提案されている。
【0004】ゲートスタックエッチングに関しては更に
別の難しさがあって、それはいくつかの起伏形状が存在
するため従来型の絶縁技術ではゲートスタックが活性
(環状凹地)領域の上よりも高い頂上酸化物となってし
まうことである。従ってエッチング対象領域からゲート
スタックを完全に消去するためにはかなりの量の過剰エ
ッチングが必要とされる。
別の難しさがあって、それはいくつかの起伏形状が存在
するため従来型の絶縁技術ではゲートスタックが活性
(環状凹地)領域の上よりも高い頂上酸化物となってし
まうことである。従ってエッチング対象領域からゲート
スタックを完全に消去するためにはかなりの量の過剰エ
ッチングが必要とされる。
【0005】しかしながら、複雑なDRAMトランジス
タゲートスタックをエッチングする事が難しいことは既
に証明済みである。従前のエッチングでは内部層選択性
が低くまたエッチングの均一性も低い。これらのエッチ
ングは厚い多結晶珪素層を具備しかつウェファの起伏形
状が最小で、従ってゲート酸化物が露出して除去される
前に多結晶珪素層の中で停止し、続いて多結晶珪素エッ
チングステップに移ることが出来るようなスタックの上
にのみ作用する。従前のエッチングはまた、0.25ミ
クロン以下の長さのゲートをエッチングするために必要
な形状制御は出来ない。スタックエッチング工程
タゲートスタックをエッチングする事が難しいことは既
に証明済みである。従前のエッチングでは内部層選択性
が低くまたエッチングの均一性も低い。これらのエッチ
ングは厚い多結晶珪素層を具備しかつウェファの起伏形
状が最小で、従ってゲート酸化物が露出して除去される
前に多結晶珪素層の中で停止し、続いて多結晶珪素エッ
チングステップに移ることが出来るようなスタックの上
にのみ作用する。従前のエッチングはまた、0.25ミ
クロン以下の長さのゲートをエッチングするために必要
な形状制御は出来ない。スタックエッチング工程
【0006】提案されているエッチング工程は上記の困
難さを、高い内部層選択性を具備した低圧、高密度プラ
ズマ処理条件を統合したセットを使用することで解決し
ている。提案されている高い選択性で均一なエッチング
工程は、薄い(100ナノメートル以下)の多結晶珪素
層の中で停止することが可能であり、これは環状凹地境
界部分の線条残部を消去するためにDRAMスタック内
で各々の層を100パーセント完全にエッチングするこ
とが必要なLOCOS起伏形状に於いても可能である。
難さを、高い内部層選択性を具備した低圧、高密度プラ
ズマ処理条件を統合したセットを使用することで解決し
ている。提案されている高い選択性で均一なエッチング
工程は、薄い(100ナノメートル以下)の多結晶珪素
層の中で停止することが可能であり、これは環状凹地境
界部分の線条残部を消去するためにDRAMスタック内
で各々の層を100パーセント完全にエッチングするこ
とが必要なLOCOS起伏形状に於いても可能である。
【0007】提案されたエッチング工程の特長には以下
が含まれる: ・ウェファ全体に渡っての非常に優れたエッチングの均
一性(典型的な非均一性は、3パーセント以下); ・ゲートスタック層の間の高いエッチング選択性(窒化
珪素:タングステン 2.4:1,タングステン:窒化
チタン 5.5:1,多結晶珪素:酸化物 420:
1); ・過酷なウェファ起伏形状で要求される、個別層の長い
過剰エッチング(100パーセント)を実行することが
可能; ・0.25ミクロンゲート上でゲート形状は90度に近
い; ・ゲート酸化物損失が最小(典型的に2ナノメートル未
満); ・ゲート長がウェファ表面に渡って非常に均一;そして ・クラスタプラットフォーム上で実施される場合は高い
生産性の工程。
が含まれる: ・ウェファ全体に渡っての非常に優れたエッチングの均
一性(典型的な非均一性は、3パーセント以下); ・ゲートスタック層の間の高いエッチング選択性(窒化
珪素:タングステン 2.4:1,タングステン:窒化
チタン 5.5:1,多結晶珪素:酸化物 420:
1); ・過酷なウェファ起伏形状で要求される、個別層の長い
過剰エッチング(100パーセント)を実行することが
可能; ・0.25ミクロンゲート上でゲート形状は90度に近
い; ・ゲート酸化物損失が最小(典型的に2ナノメートル未
満); ・ゲート長がウェファ表面に渡って非常に均一;そして ・クラスタプラットフォーム上で実施される場合は高い
生産性の工程。
【0008】開示された発明を添付図を参照して説明す
る、これらの図は本発明の重要な実施例を図示してお
り、ここに示すことで仕様として組み込む。
る、これらの図は本発明の重要な実施例を図示してお
り、ここに示すことで仕様として組み込む。
【0009】
【提出された実施例の詳細な説明】本出願の多数の革新
的な知見を、今回提出された実施例を特に参照して説明
する。しかしながら、このクラスの実施例は此処に示す
革新的な知見の多数の特長的な使用例の内の極いくつか
を提供するに過ぎないことを理解されたい。一般的に本
出願の仕様の中で言及される事は、種々の特許請求の全
てに対して必ずしも範囲を定めるものでは無い。更に、
いくつかの記述はいくつかの発明的特徴に適合するが、
その他に適合するものでは無い。
的な知見を、今回提出された実施例を特に参照して説明
する。しかしながら、このクラスの実施例は此処に示す
革新的な知見の多数の特長的な使用例の内の極いくつか
を提供するに過ぎないことを理解されたい。一般的に本
出願の仕様の中で言及される事は、種々の特許請求の全
てに対して必ずしも範囲を定めるものでは無い。更に、
いくつかの記述はいくつかの発明的特徴に適合するが、
その他に適合するものでは無い。
【0010】提案された処理工程は好適に複雑なDRA
Mトランジスタゲートスタックをエッチングするために
使用される。一例としてこの様なスタックは下記の層で
構成される:窒化珪素、タングステン、窒化チタン、お
よび多結晶珪素。これらのゲートスタックは256メガ
ビットまたはそれ以上の製品で応用される能力を有し、
これらは低い抵抗のワードラインを必要とする。典型的
な256メガビットゲートスタックの材質の厚さは:窒
化珪素150ナノメートル、タングステン60ナノメー
トル、窒化チタン20ナノメートル、多結晶珪素90ナ
ノメートル、そしてゲート二酸化珪素8ナノメートルで
ある。本発明に基づく革新的なエッチング工程は0.2
5ミクロンおよびそれ以下の長さを具備したゲートを、
優れた形状、ウェファ全体に渡って優れた均一性のライ
ン幅、そして最少のゲート酸化物損失で製造する。
Mトランジスタゲートスタックをエッチングするために
使用される。一例としてこの様なスタックは下記の層で
構成される:窒化珪素、タングステン、窒化チタン、お
よび多結晶珪素。これらのゲートスタックは256メガ
ビットまたはそれ以上の製品で応用される能力を有し、
これらは低い抵抗のワードラインを必要とする。典型的
な256メガビットゲートスタックの材質の厚さは:窒
化珪素150ナノメートル、タングステン60ナノメー
トル、窒化チタン20ナノメートル、多結晶珪素90ナ
ノメートル、そしてゲート二酸化珪素8ナノメートルで
ある。本発明に基づく革新的なエッチング工程は0.2
5ミクロンおよびそれ以下の長さを具備したゲートを、
優れた形状、ウェファ全体に渡って優れた均一性のライ
ン幅、そして最少のゲート酸化物損失で製造する。
【0011】提案されているエッチング工程は上記の困
難さを、高い内部層選択性を具備した低圧、高密度プラ
ズマ処理条件を統合したセットを使用することで解決し
ている。提案されている高い選択性で均一なエッチング
工程は、90ナノメートルの多結晶珪素層の中で停止す
ることが可能であり、これは環状凹地境界部分の線条残
部を消去するためにDRAMスタック内で各々の層を1
00パーセント完全にエッチングすることが必要な20
0ナノメートルのLOCOS起伏形状に於いても可能で
ある。
難さを、高い内部層選択性を具備した低圧、高密度プラ
ズマ処理条件を統合したセットを使用することで解決し
ている。提案されている高い選択性で均一なエッチング
工程は、90ナノメートルの多結晶珪素層の中で停止す
ることが可能であり、これは環状凹地境界部分の線条残
部を消去するためにDRAMスタック内で各々の層を1
00パーセント完全にエッチングすることが必要な20
0ナノメートルのLOCOS起伏形状に於いても可能で
ある。
【0012】図1に示されるように、本発明の革新的な
処理工程は5つのステップの低圧、高密度プラズマエッ
チング処理工程を使用しており、ゲートスタック内の4
つの層をエッチングするための1つのステップと、フォ
トレジストを焼却する1つのステップとを含む。これら
5つの処理ステップは好適にクラスタツールプラットフ
ォーム上の3つの個別のチャンバー内で実行される。
処理工程は5つのステップの低圧、高密度プラズマエッ
チング処理工程を使用しており、ゲートスタック内の4
つの層をエッチングするための1つのステップと、フォ
トレジストを焼却する1つのステップとを含む。これら
5つの処理ステップは好適にクラスタツールプラットフ
ォーム上の3つの個別のチャンバー内で実行される。
【0013】第一チャンバー内で、スタックの窒化珪素
部分がエッチングされる(ステップ100)。第二チャ
ンバー内で、タングステン(ステップ110)および窒
化チタン(ステップ120)がエッチングされる。第三
チャンバー内で、多結晶珪素がエッチングされる(ステ
ップ130)。第四チャンバー内でフォトレジストが焼
却され(ステップ140)て、処理工程が完了する。
部分がエッチングされる(ステップ100)。第二チャ
ンバー内で、タングステン(ステップ110)および窒
化チタン(ステップ120)がエッチングされる。第三
チャンバー内で、多結晶珪素がエッチングされる(ステ
ップ130)。第四チャンバー内でフォトレジストが焼
却され(ステップ140)て、処理工程が完了する。
【0014】本発明の革新的な処理工程で採用する事の
出来る典型的なクラスターツールの上面図を図2に図示
する。4つの個別のチャンバーC1,C2,C3、およ
びC4が示されており、ウェファを処理するためのもの
である。2つの積載固定器LL1およびLL2が図示さ
れており、ウェファ(210)がLL1の中に図示され
ている。クラスタツールの中心にはウェファ取り扱い機
器(220)が図示されている。
出来る典型的なクラスターツールの上面図を図2に図示
する。4つの個別のチャンバーC1,C2,C3、およ
びC4が示されており、ウェファを処理するためのもの
である。2つの積載固定器LL1およびLL2が図示さ
れており、ウェファ(210)がLL1の中に図示され
ている。クラスタツールの中心にはウェファ取り扱い機
器(220)が図示されている。
【0015】多重チャンバークラスタ手法は高い生産性
を可能とするが、それはウェファがエッチング処理工程
を通して真空下に保持されるためである。この処理工程
はより安定しており、それは各々のチャンバーが1種類
または2種類の化学物質およびエッチング材しか許さな
いからである。ゲート酸化物の金属汚染もまた最少にな
るが、それはウェファが多結晶珪素エッチングチャンバ
ーに行く前にタングステンおよび窒化チタンが取り除か
れるからである。
を可能とするが、それはウェファがエッチング処理工程
を通して真空下に保持されるためである。この処理工程
はより安定しており、それは各々のチャンバーが1種類
または2種類の化学物質およびエッチング材しか許さな
いからである。ゲート酸化物の金属汚染もまた最少にな
るが、それはウェファが多結晶珪素エッチングチャンバ
ーに行く前にタングステンおよび窒化チタンが取り除か
れるからである。
【0016】本発明のスタックエッチング処理工程の提
出された実施例が図3Aから図3Fに図示されている。
図から解るように、フォトレジスト300は第一エッチ
ングに対してその下側のSiN層310をマスクしてい
る。
出された実施例が図3Aから図3Fに図示されている。
図から解るように、フォトレジスト300は第一エッチ
ングに対してその下側のSiN層310をマスクしてい
る。
【0017】以下の表は、今回提出された実施例の特定
の情況の中で、此処に説明する革新的な処理工程の実施
例を使用した実際の特定の試験結果を示す。これらの特
定の値は単に提出された実施例に関する詳細を提供し、
図3A−図3Fの理解を助けるためのものであって、本
発明の必要な特徴の範囲を定めるもので無いことを理解
されたい。
の情況の中で、此処に説明する革新的な処理工程の実施
例を使用した実際の特定の試験結果を示す。これらの特
定の値は単に提出された実施例に関する詳細を提供し、
図3A−図3Fの理解を助けるためのものであって、本
発明の必要な特徴の範囲を定めるもので無いことを理解
されたい。
【0018】以下のサンプルパラメータは15センチ
(6インチ)ウェファーに対するものである:エッチングチャンバー#1 ステップ#1窒化珪素エッチング 電源電力: 2000ワット バイアス電力:100ワット 圧力: 6ミリトール ウェファHe背圧: 10トール ウェファ温度: 23度C CF4流量: 50sccm Si3N4エッチング速度: 4.6ナノメートル/秒 Si3N4エッチング速度均一性: 2パーセント、1シ
グマ Wエッチング速度: 1.9ナノメートル/秒 Si3N4のWに対する選択性: 2.4:1 Si3N4エッチング速度:Wエッチング速度S i3N4過剰エッチング:元膜の50パーセント
(6インチ)ウェファーに対するものである:エッチングチャンバー#1 ステップ#1窒化珪素エッチング 電源電力: 2000ワット バイアス電力:100ワット 圧力: 6ミリトール ウェファHe背圧: 10トール ウェファ温度: 23度C CF4流量: 50sccm Si3N4エッチング速度: 4.6ナノメートル/秒 Si3N4エッチング速度均一性: 2パーセント、1シ
グマ Wエッチング速度: 1.9ナノメートル/秒 Si3N4のWに対する選択性: 2.4:1 Si3N4エッチング速度:Wエッチング速度S i3N4過剰エッチング:元膜の50パーセント
【0019】エッチングチャンバー#2 ステップ#2タングステンエッチング 電源電力: 1700ワット バイアス電力: 23ワット 圧力: 6ミリトール ウェファHe背圧: 10トール ウェファ温度: 23度C SF4流量: 93sccm N2流量: 14sccm Wエッチング速度: 5ナノメートル/秒 Wエッチング速度均一性: 3パーセント、1シグマ TiNエッチング速度: 0.9ナノメートル/秒 WのTiNに対する選択性: 5.5:1 Wエッチング速度:TiNエッチング速度 W過剰エッチング:100パーセントまたはそれ以上ステップ#3窒化チタンエッチング 電源電力: 1500ワット バイアス電力: 20ワット 圧力: 6ミリトール ウェファHe背圧: 10トール ウェファ温度: 23度C Ar流量: 150sccm Cl2流量: 30sccm TiNエッチング速度: 3ナノメートル/秒 多結晶珪素エッチング速度: 3ナノメートル/秒 TiNの多結晶珪素に対する選択性: 1:1 TiNエッチング速度:多結晶珪素エッチング速度 TiN過剰エッチング:元膜の100パーセント
【0020】エッチングチャンバー#3 ステップ#4多結晶珪素エッチング 電源電力: 1000ワット バイアス電力: 28ワット 圧力: 6ミリトール ウェファHe背圧: 10トール ウェファ温度: 23度C HBr流量: 10sccm Cl2流量: 30sccm 80パーセントHe/20パーセントO2流量: 35
sccm 多結晶珪素エッチング速度: 210ナノメートル/秒 多結晶珪素エッチング速度均一性: 3パーセント、1
シグマ 酸化物エッチング速度: 0.5ナノメートル/秒 酸化物エッチング速度均一性: 7.5パーセント、1
シグマ 多結晶珪素の酸化物に対する選択性: 420:1 多結晶珪素エッチング速度:酸化物エッチング速度 多結晶珪素過剰エッチング:元膜の100パーセント
sccm 多結晶珪素エッチング速度: 210ナノメートル/秒 多結晶珪素エッチング速度均一性: 3パーセント、1
シグマ 酸化物エッチング速度: 0.5ナノメートル/秒 酸化物エッチング速度均一性: 7.5パーセント、1
シグマ 多結晶珪素の酸化物に対する選択性: 420:1 多結晶珪素エッチング速度:酸化物エッチング速度 多結晶珪素過剰エッチング:元膜の100パーセント
【0021】エッチングチャンバー#4 ステップ#5フォトレジスト焼却 電源電力: 2750ワット バイアス電力: 0ワット 圧力: 6ミリトール ウェファHe背圧: 10トール ウェファ温度: 23度C O2流量: 100sccm フォトレジストエッチング速度: 1000ナノメート
ル/秒 フォトレジストエッチング速度均一性: 2パーセン
ト、1シグマ フォトレジスト過剰エッチング:元膜の100パーセン
ト
ル/秒 フォトレジストエッチング速度均一性: 2パーセン
ト、1シグマ フォトレジスト過剰エッチング:元膜の100パーセン
ト
【0022】これらのいくつかの段階でのバイアス電力
レベルが非常に低いことに注意されたい。上記の例の中
では、電源電力のバイアス電力に対する比率は、タング
ステンエッチング中は74:1、そして窒化チタンエッ
チング中は75:1である。これらは低バイアスエッチ
ング条件の例に過ぎないが、本出願の中では電源電力と
バイアス電力の比率が30:1を超えるものは低バイア
スエッチング条件と呼んでいる。
レベルが非常に低いことに注意されたい。上記の例の中
では、電源電力のバイアス電力に対する比率は、タング
ステンエッチング中は74:1、そして窒化チタンエッ
チング中は75:1である。これらは低バイアスエッチ
ング条件の例に過ぎないが、本出願の中では電源電力と
バイアス電力の比率が30:1を超えるものは低バイア
スエッチング条件と呼んでいる。
【0023】勿論、特定のエッチング化学物質が使用さ
れているがこれに限定するものでは無い。上記のステッ
プ1−2に対して、その他のフッ素を基本とする化学物
質を選択的に代用することが可能であるし、一方ステッ
プ3および4に対して、その他の塩素源ガスを選択的に
Cl2と置き換えることが可能である。代替実施例
れているがこれに限定するものでは無い。上記のステッ
プ1−2に対して、その他のフッ素を基本とする化学物
質を選択的に代用することが可能であるし、一方ステッ
プ3および4に対して、その他の塩素源ガスを選択的に
Cl2と置き換えることが可能である。代替実施例
【0024】この代替実施例の条件は上記のパラメータ
に類似しているが、窒化珪素エッチングに於いてCF4
がBF3と置き換えられている。更に加えて、窒化チタ
ンエッチングと多結晶珪素エッチングの両方に於いて、
BCl3が塩素源として使用される。窒化チタンエッチ
ング及び多結晶珪素エッチングは共に低バイアスエッチ
ングである。更に別の代替実施例
に類似しているが、窒化珪素エッチングに於いてCF4
がBF3と置き換えられている。更に加えて、窒化チタ
ンエッチングと多結晶珪素エッチングの両方に於いて、
BCl3が塩素源として使用される。窒化チタンエッチ
ング及び多結晶珪素エッチングは共に低バイアスエッチ
ングである。更に別の代替実施例
【0025】この代替実施例の条件は上記の第一代替実
施例のパラメータに類似しているが、窒化珪素エッチン
グに於いてBF3がNF3と置き換えられている。更に別の代替実施例
施例のパラメータに類似しているが、窒化珪素エッチン
グに於いてBF3がNF3と置き換えられている。更に別の代替実施例
【0026】この更に別の代替実施例に於いて、スタッ
ク内でTiAlNがTiNの代わりに使用されている。
この実施例の中でエッチング化学物質は上記の詳細な実
施例と基本的に同じのままである。
ク内でTiAlNがTiNの代わりに使用されている。
この実施例の中でエッチング化学物質は上記の詳細な実
施例と基本的に同じのままである。
【0027】高密度および単離ゲート長はウェファ表面
全体に渡って非常に均一である。以下の表は前後の結果
を示す。
全体に渡って非常に均一である。以下の表は前後の結果
を示す。
【0028】高密度ライン エッチング前平均:0.270ミクロンライン、0.2
30ミクロン間隔; エッチング後平均:0.262ミクロンライン。 エッチング前3シグマ範囲:0.019ミクロン; エッチング後3シグマ範囲:0.016ミクロン
30ミクロン間隔; エッチング後平均:0.262ミクロンライン。 エッチング前3シグマ範囲:0.019ミクロン; エッチング後3シグマ範囲:0.016ミクロン
【0029】単離ライン エッチング前平均:0.228ミクロンライン; エッチング後平均:0.197ミクロンライン。 エッチング前3シグマ範囲:0.014ミクロン; エッチング後3シグマ範囲:0.012ミクロン
【0030】従来型ステップによる処理を継続して製造
を完了する、例えば更に別の内部誘電体の蒸着および平
板化、経路パターン化、第二金属蒸着およびエッチン
グ、保護被覆蒸着、エッチング接点開口などである。
を完了する、例えば更に別の内部誘電体の蒸着および平
板化、経路パターン化、第二金属蒸着およびエッチン
グ、保護被覆蒸着、エッチング接点開口などである。
【0031】革新的実施例の開示されたクラスに基づけ
ば:支配的に珪素を含む多結晶材の層と、その上を覆う
導電性窒化金属層と、その上を覆う金属層とを含むゲー
トスタックのエッチング方法が提供されており、該方法
は以下のステップ:a)前記金属層を前記窒化金属層に
対して5:1以上の選択性を具備した低バイアスプラズ
マエッチング条件の下でパターン取りおよびエッチング
を行い;b)前記ステップ(a)の後に、前記金属層で
露出された前記窒化金属層のエッチングを低圧高密度プ
ラズマ条件の下に行い;c)前記(b)の後に前記窒化
金属層で露出された前記多結晶材を低圧高密度プラズマ
条件の下に行うステップを含む前記方法が提供されてい
る。
ば:支配的に珪素を含む多結晶材の層と、その上を覆う
導電性窒化金属層と、その上を覆う金属層とを含むゲー
トスタックのエッチング方法が提供されており、該方法
は以下のステップ:a)前記金属層を前記窒化金属層に
対して5:1以上の選択性を具備した低バイアスプラズ
マエッチング条件の下でパターン取りおよびエッチング
を行い;b)前記ステップ(a)の後に、前記金属層で
露出された前記窒化金属層のエッチングを低圧高密度プ
ラズマ条件の下に行い;c)前記(b)の後に前記窒化
金属層で露出された前記多結晶材を低圧高密度プラズマ
条件の下に行うステップを含む前記方法が提供されてい
る。
【0032】革新的実施例の別の開示されたクラスに基
づけば:支配的に珪素を含む多結晶材の層と、その上を
覆うチタンを含む窒化金属層と、その上を覆うタングス
テンを含む金属層と、その上を覆う珪素と窒素とを含む
層とを含むDRAMスタックのエッチング方法であっ
て、該方法は以下のステップ:a)前記珪素および窒素
層をパターン取りされたフォトレジスト層を使用して多
重チャンバークラスタツールの第一チャンバー内でエッ
チングし;b)前記パターン取りされたフォトレジスト
層で露出された前記金属層を、低バイアス条件の下、前
記多重チャンバークラスタツールの第二チャンバー内で
フッ素エッチングし;そしてc)前記パターン取りされ
たフォトレジスト層で露出された前記窒化金属層を低バ
イアス条件の下、前記多重チャンバークラスタツールの
第二チャンバー内でエッチングし;そしてd)前記ステ
ップcの後、前記パターン取りされたフォトレジスト層
で露出された前記多結晶材を、前記多重チャンバークラ
スタツールの第三チャンバー内でエッチングするステッ
プを含む前記方法が提供されている。
づけば:支配的に珪素を含む多結晶材の層と、その上を
覆うチタンを含む窒化金属層と、その上を覆うタングス
テンを含む金属層と、その上を覆う珪素と窒素とを含む
層とを含むDRAMスタックのエッチング方法であっ
て、該方法は以下のステップ:a)前記珪素および窒素
層をパターン取りされたフォトレジスト層を使用して多
重チャンバークラスタツールの第一チャンバー内でエッ
チングし;b)前記パターン取りされたフォトレジスト
層で露出された前記金属層を、低バイアス条件の下、前
記多重チャンバークラスタツールの第二チャンバー内で
フッ素エッチングし;そしてc)前記パターン取りされ
たフォトレジスト層で露出された前記窒化金属層を低バ
イアス条件の下、前記多重チャンバークラスタツールの
第二チャンバー内でエッチングし;そしてd)前記ステ
ップcの後、前記パターン取りされたフォトレジスト層
で露出された前記多結晶材を、前記多重チャンバークラ
スタツールの第三チャンバー内でエッチングするステッ
プを含む前記方法が提供されている。
【0033】修正および変化 当業者には理解されるであろうが、本出願の中で説明さ
れた革新的概念は、多くの応用分野に於いて修正並びに
変更する事が可能である、従って特許請求の範囲は此処
に例示された特定の知見で制限されるものでは無い。
れた革新的概念は、多くの応用分野に於いて修正並びに
変更する事が可能である、従って特許請求の範囲は此処
に例示された特定の知見で制限されるものでは無い。
【0034】勿論、種々の材料および材料の組み合わせ
を用いて金属層を実現することが可能である。更に、此
処に示された特定のエッチング化学物質、層構成、およ
び層の厚さは単に図示を目的としたものであって、請求
された特許の範囲を定める意味合いは無い。
を用いて金属層を実現することが可能である。更に、此
処に示された特定のエッチング化学物質、層構成、およ
び層の厚さは単に図示を目的としたものであって、請求
された特許の範囲を定める意味合いは無い。
【0035】この革新的な処理工程の知見は1ギガバイ
ト(0.18ミクロン)にも応用出来る。更に加えて、
この処理工程はバイポーラまたはその他の素子技術に於
ける接点形成にも適用出来る。
ト(0.18ミクロン)にも応用出来る。更に加えて、
この処理工程はバイポーラまたはその他の素子技術に於
ける接点形成にも適用出来る。
【0036】勿論、此処に示された特定のエッチング化
学物質、層構成、及び層の厚さは単に図示を目的とした
ものであって、請求された特許の範囲を定める意味合い
は無い。
学物質、層構成、及び層の厚さは単に図示を目的とした
ものであって、請求された特許の範囲を定める意味合い
は無い。
【0037】以上の説明に関して更に以下の項を開示す
る。 1.支配的に珪素を含む多結晶材の層と、その上を覆う
導電性窒化金属層と、その上を覆う金属層とを含むゲー
トスタックのエッチング方法であって: (a)前記金属層を前記窒化金属層に対して5:1以上
の選択性を具備した低バイアスプラズマエッチング条件
の下でパターン取りおよびエッチングを行い; (b)前記ステップ(a)の後に、前記金属層で露出さ
れた前記窒化金属層のエッチングを低圧高密度プラズマ
条件の下に行い; (c)前記ステップ(b)の後に前記窒化金属層で露出
された前記多結晶材を低圧高密度プラズマ条件の下に行
う、以上のステップを含む前記方法
る。 1.支配的に珪素を含む多結晶材の層と、その上を覆う
導電性窒化金属層と、その上を覆う金属層とを含むゲー
トスタックのエッチング方法であって: (a)前記金属層を前記窒化金属層に対して5:1以上
の選択性を具備した低バイアスプラズマエッチング条件
の下でパターン取りおよびエッチングを行い; (b)前記ステップ(a)の後に、前記金属層で露出さ
れた前記窒化金属層のエッチングを低圧高密度プラズマ
条件の下に行い; (c)前記ステップ(b)の後に前記窒化金属層で露出
された前記多結晶材を低圧高密度プラズマ条件の下に行
う、以上のステップを含む前記方法
【0038】2.第1項記載の方法に於いて、前記金属
層がタングステンを含む前記方法。
層がタングステンを含む前記方法。
【0039】3.第1項記載の方法に於いて、前記窒化
金属層がTiNで構成された前記方法。
金属層がTiNで構成された前記方法。
【0040】4.第1項記載の方法に於いて、前記多結
晶材が珪化金属と組み合わされた珪素を含む、前記方
法。
晶材が珪化金属と組み合わされた珪素を含む、前記方
法。
【0041】5.支配的に珪素を含む多結晶材の層と、
その上を覆うチタンを含む窒化金属層と、その上を覆う
タングステンを含む金属層と、その上を覆う珪素と窒素
とを含む層とを含むDRAMスタックのエッチング方法
であって: (a)前記珪素および窒素の層をパターン取りされたフ
ォトレジスト層を使用して多重チャンバークラスタツー
ルの第一チャンバー内でエッチングし; (b)前記パターン取りされたフォトレジスト層で露出
された前記金属層を、低バイアス条件の下、前記多重チ
ャンバークラスタツールの第二チャンバー内でフッ素エ
ッチングし;そして (c)前記パターン取りされたフォトレジスト層で露出
された前記窒化金属層を低バイアス条件の下、前記多重
チャンバークラスタツールの第二チャンバー内でエッチ
ングし;そして (d)前記ステップcの後、前記パターン取りされたフ
ォトレジスト層で露出された前記多結晶材を、前記多重
チャンバークラスタツールの第三チャンバー内でエッチ
ングする、以上のステップを含む前記方法
その上を覆うチタンを含む窒化金属層と、その上を覆う
タングステンを含む金属層と、その上を覆う珪素と窒素
とを含む層とを含むDRAMスタックのエッチング方法
であって: (a)前記珪素および窒素の層をパターン取りされたフ
ォトレジスト層を使用して多重チャンバークラスタツー
ルの第一チャンバー内でエッチングし; (b)前記パターン取りされたフォトレジスト層で露出
された前記金属層を、低バイアス条件の下、前記多重チ
ャンバークラスタツールの第二チャンバー内でフッ素エ
ッチングし;そして (c)前記パターン取りされたフォトレジスト層で露出
された前記窒化金属層を低バイアス条件の下、前記多重
チャンバークラスタツールの第二チャンバー内でエッチ
ングし;そして (d)前記ステップcの後、前記パターン取りされたフ
ォトレジスト層で露出された前記多結晶材を、前記多重
チャンバークラスタツールの第三チャンバー内でエッチ
ングする、以上のステップを含む前記方法
【0042】6.第5項記載の方法に於いて、前記珪素
および窒素の層が窒化珪素から成る前記方法。
および窒素の層が窒化珪素から成る前記方法。
【0043】7.第5項記載の方法に於いて、前記窒化
金属層がTiNから成る前記方法。
金属層がTiNから成る前記方法。
【0044】8.第5項記載の方法に於いて、前記多結
晶材が珪化金属と組み合わされた珪素を含む、前記方
法。
晶材が珪化金属と組み合わされた珪素を含む、前記方
法。
【0045】9.第5項記載の方法に於いて、前記スタ
ックが低圧、高密度プラズマエッチングを使用してエッ
チングされる、前記方法。
ックが低圧、高密度プラズマエッチングを使用してエッ
チングされる、前記方法。
【0046】10.5つのステップの低圧、高密度プラズ
マエッチング処理工程が、高い内部層選択性を具備した
複雑なDRAMトランジスタゲートスタックをエッチン
グするために使用されている。この様なスタックは典型
的に以下の層を含む:窒化珪素310、タングステン3
20、窒化チタン330、及び多結晶珪素340。この
処理工程はゲートスタック内の4層の各々に対する1つ
のステップと、フォトレジストを焼却するための1つの
ステップを含む。これらの5つの処理ステップは好適に
クラスタツールプラットフォーム上の4つの個別のチャ
ンバー内で実行される。本発明の革新的なエッチング処
理工程は、0.25ミクロン以下の長さのゲートを、優
れた形状、ウェファ全体に渡っての優れたライン幅均一
性を備え、そして最少のゲート酸化物損失で製造する。
マエッチング処理工程が、高い内部層選択性を具備した
複雑なDRAMトランジスタゲートスタックをエッチン
グするために使用されている。この様なスタックは典型
的に以下の層を含む:窒化珪素310、タングステン3
20、窒化チタン330、及び多結晶珪素340。この
処理工程はゲートスタック内の4層の各々に対する1つ
のステップと、フォトレジストを焼却するための1つの
ステップを含む。これらの5つの処理ステップは好適に
クラスタツールプラットフォーム上の4つの個別のチャ
ンバー内で実行される。本発明の革新的なエッチング処
理工程は、0.25ミクロン以下の長さのゲートを、優
れた形状、ウェファ全体に渡っての優れたライン幅均一
性を備え、そして最少のゲート酸化物損失で製造する。
【図1】図1は複雑なゲートスタックをエッチングする
ための革新的な処理工程フローを示す。
ための革新的な処理工程フローを示す。
【図2】図2はクラスターツールの上面図を示す。
【図3】図3は本発明の提出された実施例に基づくスタ
ックエッチングを示し、Aはフォトレジスト層で露出さ
れた窒化珪素層の状態、Bは窒化珪素層がエッチングさ
れた状態、Cはタングステン層がエッチングされた状
態、Dは窒化チタンがエッチングされた状態、Eは多結
晶珪素がエッチングされた状態、そしてFはフォトレジ
スト層が焼却された状態を示す。
ックエッチングを示し、Aはフォトレジスト層で露出さ
れた窒化珪素層の状態、Bは窒化珪素層がエッチングさ
れた状態、Cはタングステン層がエッチングされた状
態、Dは窒化チタンがエッチングされた状態、Eは多結
晶珪素がエッチングされた状態、そしてFはフォトレジ
スト層が焼却された状態を示す。
210 ウェファ 300 フォトレジスタ層 310 窒化珪素層 320 タングステン層 330 窒化チタン層 340 多結晶珪素層
フロントページの続き (51)Int.Cl.6 識別記号 FI // C23F 4/00
Claims (1)
- 【請求項1】 支配的に珪素を含む多結晶材の層と、そ
の上を覆う導電性窒化金属層と、その上を覆う金属層と
を含むゲートスタックのエッチング方法であって: (a)前記金属層を前記窒化金属層に対して5:1以上
の選択性を具備した低バイアスプラズマエッチング条件
の下でパターン取りおよびエッチングを行い; (b)前記ステップ(a)の後に、前記金属層で露出さ
れた前記窒化金属層のエッチングを低圧高密度プラズマ
条件の下に行い; (c)前記ステップ(b)の後に前記窒化金属層で露出
された前記多結晶材を低圧高密度プラズマ条件の下に行
う、以上のステップを含む前記方法。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US3679997P | 1997-01-31 | 1997-01-31 | |
| US036799 | 1997-01-31 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH10247641A true JPH10247641A (ja) | 1998-09-14 |
Family
ID=21890724
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10021286A Pending JPH10247641A (ja) | 1997-01-31 | 1998-02-02 | ゲートスタックのエッチング方法 |
Country Status (3)
| Country | Link |
|---|---|
| US (1) | US6607985B1 (ja) |
| EP (1) | EP0856877A1 (ja) |
| JP (1) | JPH10247641A (ja) |
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7371692B2 (en) | 2004-04-07 | 2008-05-13 | Elpida Memory, Inc. | Method for manufacturing a semiconductor device having a W/WN/polysilicon layered film |
| US9397140B2 (en) | 2013-07-30 | 2016-07-19 | Kabushiki Kaisha Toshiba | Method of manufacturing semiconductor device |
Also Published As
| Publication number | Publication date |
|---|---|
| US6607985B1 (en) | 2003-08-19 |
| EP0856877A1 (en) | 1998-08-05 |
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