JPH10270603A - 半導体装置およびその製法 - Google Patents
半導体装置およびその製法Info
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- H10W74/00—Encapsulations, e.g. protective coatings
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- Encapsulation Of And Coatings For Semiconductor Or Solid State Devices (AREA)
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Abstract
態で何枚も重ねて搬送しても外部電極や樹脂パッケージ
に傷がつかないようなエリアパッケージ型の半導体装置
およびその製法を提供する。 【解決手段】 基板2の表面に半導体チップがマウント
され、該基板の裏面にエリア状にならんで外部電極5が
設けられ、前記基板表面の半導体チップ側に樹脂パッケ
ージ3が設けられるエリアパッケージ型の半導体装置で
あって、前記樹脂パッケージの少なくとも2隅の前記基
板上に該樹脂パッケージの高さより高い突起部3aが設
けられている。
Description
リッドアレイ半導体装置のように基板の表面に半導体チ
ップがマウントされ、基板の裏面に格子状に外部電極が
設けられるエリアパッケージ型の半導体装置およびその
製法に関する。さらに詳しくは、基板に複数個のエリア
パッケージ型の半導体装置が形成された状態で搬送など
のため積み重ねられても電極に傷などが付かないように
し、包装前の製造工程で半導体装置に損傷を与えない半
導体装置およびその製法に関する。
機器の組立工数の短縮化に伴い、基板の表面に半導体チ
ップがマウントされ、その裏面に外部電極が格子状に設
けられるエリアパッケージ型の半導体装置が多く用いら
れる傾向にある。このようなエリアパッケージ型の半導
体装置は、たとえば図4(a)〜(b)に平面説明図お
よび側面説明図が示されるように、ガラスエポキシ樹脂
などからなる樹脂基板2の表面側に半導体チップがマウ
ントされ、基板表面に設けられる銅箔などからなる配線
パターンと半導体チップの各電極が接続されると共に、
樹脂基板2に設けられるスルーホールを介して樹脂基板
2の裏面に設けられる配線パターンと電気的に接続され
て樹脂基板2の裏面にハンダバンプなどからなる外部電
極5が設けられている。そして、その表面側は不透明な
エポキシ樹脂などによりモールドされて樹脂パッケージ
3が形成されている。
装置が1枚の樹脂基板2に複数個形成され、その後の製
造工程での搬送の際には、この半導体装置が複数個形成
された基板の状態で図5に示されるように基板を複数枚
重ねて搬送される。そしてユーザへの出荷の前に基板2
を切断して1個1個の半導体装置として包装用のトレイ
に入れて出荷される。
ジ型の半導体装置は、前述のように、樹脂基板の表面に
半導体チップがマウントされて樹脂パッケージで被覆さ
れ、その裏面には格子状にハンダバンプからなる外部電
極が形成されている。このハンダバンプは柔らかく、樹
脂パッケージは硬いため、図5に示されるように何個も
積み重ねて搬送されると、外部電極に傷がつく。外部電
極に傷がつくと、実装上問題になる。
になされたもので、エリアパッケージ型の半導体装置を
基板の状態で何枚も重ねて搬送しても電極や樹脂パッケ
ージに傷がつかないようなエリアパッケージ型の半導体
装置およびその製法を提供することを目的とする。
ケージ型の半導体装置は、基板の表面に半導体チップが
マウントされ、該基板の裏面にエリア状(格子状)にな
らんで外部電極が設けられ、前記基板表面の半導体チッ
プ側に樹脂パッケージが設けられ、前記樹脂パッケージ
の少なくとも2隅の前記基板上に該樹脂パッケージの高
さより高い突起部が設けられている。
の基板を積み重ねて搬送しても、樹脂パッケージの少な
くとも2隅に設けられる突起部により上部の基板が支え
られ、上部の基板の外部電極が下部の基板に設けられる
半導体装置の樹脂パッケージには当たらない。その結
果、半導体装置の電極にもパッケージにも傷がつかず、
実装する場合のハンダ付けのトラブルや、外観上の問題
はなくなる。一方、突起部は半導体装置を出荷のために
基板から切り離す前に、僅かな力を加えることにより簡
単に折れて除去されるため、製造上の問題はなく包装時
や使用時にも何等の不都合は生じない。
金メッキが予め施されていることにより、金は樹脂パッ
ケージの樹脂との密着性が悪く、より一層簡単に突起部
を除去することができるため好ましい。
に配線パターンが形成された基板の表面に半導体チップ
をマウントして該半導体チップの各電極と前記配線パタ
ーンとを電気的に接続し、(b)前記基板の半導体チッ
プが設けられた側を樹脂で被覆して樹脂パッケージを形
成すると共に、該樹脂パッケージの隅部に突起部を同時
に形成し、(c)前記基板の裏面に外部電極を形成し、
(d)前記半導体装置を包装する前に前記突起部を除去
することを特徴とする。
型を有するトランスファモールド装置で行い、該トラン
スファモールド装置のエアベントに溜り部を設けること
により、トランスファモールド装置に僅かな変形を施す
だけで樹脂パッケージと同じ樹脂で簡単に突起部を形成
することができる。
明のエリアパッケージ型の半導体装置およびその製法に
ついての説明をする。
導体装置10がガラスエポキシ樹脂などの樹脂製の基板
2に形成された状態の平面説明図および側面説明図であ
る。図1に示されるように、本発明の半導体装置10
は、基板2の表面にマウントされた半導体チップを被覆
する樹脂パッケージ3が形成される際に、その樹脂パッ
ケージ3の少なくとも2つの隅(図1に示される例では
3つの隅)に突起部3aが設けられていることに特徴が
ある。この突起部3aを有する半導体装置10が1枚の
基板2に複数個設けられており、その後の製造工程の際
はこの基板2に複数個の半導体装置10が設けられたま
まの状態で搬送され、ユーザへの出荷のための包装前に
突起部3aは除去されると共に、基板2を切断すること
により1個1個の半導体装置に分離して包装用のトレイ
に収納される。包装用トレイは、通常個々の半導体装置
間で外部電極5と樹脂パッケージ3とが接触しないよう
に形成されている。
時に形成されるもので、樹脂パッケージ3用の樹脂で形
成される。突起部3aの形状はとくに限定されないが、
樹脂パッケージ3の高さHより外部電極5の高さ以上高
くなるように形成され、幅は半導体装置10が形成され
た基板2が複数枚積み重ねられても機械的強度に絶えら
れる程度の断面積があればよい。この突起部3aは、後
述するように、樹脂パッケージ3を形成する際のトラン
スファモールドの金型のエアベントに溜りを設けておく
ことにより、容易に形成される。
半導体チップ1がマウントされる構造は、たとえばボー
ルグリッドアレイ(以下、BGAという)の例が図2に
断面説明図で示されるような構造になっている。すなわ
ち、ガラスエポキシ樹脂などからなる樹脂基板21とそ
の表面に形成される銅箔の配線22とによりチップキャ
リアである基板2が形成されており、基板2上に半導体
チップ1がマウントされている。そして、半導体チップ
1上に形成されたバンプが配線22と接続されるように
ボンディングされている。樹脂基板21の表面に形成さ
れた配線22は、スルーホール23を介して基板裏面の
配線24に接続されており、基板21の裏面の配線24
上には外部端子となるハンダバンプ(外部電極)5が形
成されている。このようにして、半導体チップ1の電極
はたとえばハンダバンプからなる外部電極5に接続され
ると共に、基板2の表面に形成された樹脂パッケージ3
によって封止されている。
ージの周囲の少なくとも2か所に樹脂パッケージの高さ
より高い突起部が基板上に設けられている。そのため、
製造工程中の工程間の搬送のため、図3に示されるよう
に、何枚もの基板2を積み重ねても、各基板2は突起部
3aにより支えられ、上下の基板2の外部電極5と樹脂
パッケージ3とが接触することがない。そのため、外部
電極5と樹脂パッケージ3とが擦れていずれかに傷がつ
くことがなく、実装段階でのハンダ付けに支障を来した
り、樹脂パッケージ3に傷がついて半導体装置の外観を
損ねることがない。一方、出荷などのための個々の単品
に分離して包装する前には、僅かの力を印加することに
より突起部3aは折れて簡単に除去されるため、包装時
には突起部はなく、邪魔になることはない。
突起部が形成される部分の基板上に予め金メッキが施さ
れていることにより、その突起部をより簡単に除去する
ことができる。すなわち、樹脂パッケージに用いられる
エポキシ樹脂などは、金との密着性が悪く、接着力が殆
どない。そのため、突起部は樹脂パッケージと連結して
形成されているため、金メッキの上に立っているが、除
去する場合には突起部の横から力を加えて樹脂パッケー
ジとの連結部を断つことにより、基板とは接着されてい
ないため、容易に除去される。
の半導体装置の製法について図1〜2を参照しながら説
明をする。まず、ガラスエポキシ樹脂またはポリイミド
樹脂などの樹脂性基板にスルーホール23を設けてお
き、銅箔を貼着しパターニングすることにより配線2
2、24のパターンを形成しておく。そして基板2の表
面に半導体チップ1をマウントし、半導体チップ1のバ
ンプと基板2の表面側の配線22とが接続されるよう
に、半導体チップ1をボンディングする。
れた基板2をトランスファモールド装置の金型内に配置
する。すなわち、上金型と下金型の間に基板2を配置
し、クランプする。この上金型のキャビティの角部で、
ゲート(樹脂注入口)以外のところに設けられるエアベ
ントを少し大きくして溜り部を形成しておく。この状態
で金型キャビティ内に溶融樹脂を流し込み樹脂封止を行
う。この際エアベントの溜り部にも樹脂が流れ込み、樹
脂パッケージ3と共に突起部3aが同時に形成される。
板2を取り出し、基板2の裏面の配線24にハンダバン
プなどを設けることにより、外部電極5を形成する。こ
の1枚の基板2にたくさんの半導体装置10が形成され
た状態で、何枚もの基板2が積み重ねられ、つぎの試験
などの工程に搬送される。そしてユーザへの出荷のた
め、突起部3aを除去し、基板を切断して各半導体装置
に分離し、包装用のトレイに収納される。そして、セッ
トの回路基板などに組み込まれる。
ファモールドの金型のエアベントに溜り部を設けておく
だけでモールド工程で樹脂パッケージと同時に突起部を
形成することができ、工数増などを招くことがない。し
かも積み重ねても相互に傷がつかないエリアパッケージ
型の半導体装置が得られる。
半導体装置が何個も基板に形成された状態で、搬送など
のため基板が積み重ねられても、外部電極と樹脂パッケ
ージとが接触せず、相互に傷がつくことがない。その結
果、製造工程での取扱が容易になると共に、製品価値を
低下させることがない。
実施形態の説明図である。
断面説明図である。
た状態の説明図である。
図である。
ある。
Claims (4)
- 【請求項1】 基板の表面に半導体チップがマウントさ
れ、該基板の裏面にエリア状にならんで外部電極が設け
られ、前記基板表面の半導体チップ側に樹脂パッケージ
が設けられるエリアパッケージ型の半導体装置であっ
て、前記樹脂パッケージの少なくとも2隅の前記基板上
に該樹脂パッケージの高さより高い突起部が設けられて
なる半導体装置。 - 【請求項2】 前記基板の前記突起部が設けられる部分
に金メッキが予め施されてなる請求項1記載の半導体装
置。 - 【請求項3】 (a)表裏に配線パターンが形成された
基板の表面に半導体チップをマウントして該半導体チッ
プの各電極と前記配線パターンとを電気的に接続し、
(b)前記基板の半導体チップが設けられた側を樹脂で
被覆して樹脂パッケージを形成すると共に、該樹脂パッ
ケージの隅部に突起部を同時に形成し、(c)前記基板
の裏面に外部電極を形成し、(d)前記半導体装置を包
装する前に前記突起部を除去することを特徴とする半導
体装置の製法。 - 【請求項4】 前記樹脂パッケージの形成を上金型と下
金型を有するトランスファモールド装置で行い、該トラ
ンスファモールド装置のエアベントに溜り部を設けるこ
とにより、樹脂パッケージと同じ樹脂で前記突起部を形
成する請求項3記載の半導体装置の製法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP07146197A JP3713123B2 (ja) | 1997-03-25 | 1997-03-25 | 半導体装置およびその製法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP07146197A JP3713123B2 (ja) | 1997-03-25 | 1997-03-25 | 半導体装置およびその製法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH10270603A true JPH10270603A (ja) | 1998-10-09 |
| JP3713123B2 JP3713123B2 (ja) | 2005-11-02 |
Family
ID=13461259
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP07146197A Expired - Fee Related JP3713123B2 (ja) | 1997-03-25 | 1997-03-25 | 半導体装置およびその製法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3713123B2 (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6670220B2 (en) | 2000-08-31 | 2003-12-30 | Hitachi, Ltd. | Semiconductor device and manufacture method of that |
| JP2009164358A (ja) * | 2008-01-08 | 2009-07-23 | Fujitsu Microelectronics Ltd | 半導体装置及び半導体装置の製造方法 |
| JP2014160767A (ja) * | 2013-02-20 | 2014-09-04 | Dainippon Printing Co Ltd | 樹脂付きリードフレームの多面付け体、光半導体装置の多面付け体 |
-
1997
- 1997-03-25 JP JP07146197A patent/JP3713123B2/ja not_active Expired - Fee Related
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
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| US6670220B2 (en) | 2000-08-31 | 2003-12-30 | Hitachi, Ltd. | Semiconductor device and manufacture method of that |
| KR100829278B1 (ko) * | 2000-08-31 | 2008-05-13 | 엘피다 메모리 가부시키가이샤 | 반도체장치 및 그 제조방법 |
| JP2009164358A (ja) * | 2008-01-08 | 2009-07-23 | Fujitsu Microelectronics Ltd | 半導体装置及び半導体装置の製造方法 |
| JP2014160767A (ja) * | 2013-02-20 | 2014-09-04 | Dainippon Printing Co Ltd | 樹脂付きリードフレームの多面付け体、光半導体装置の多面付け体 |
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| Publication number | Publication date |
|---|---|
| JP3713123B2 (ja) | 2005-11-02 |
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