JPH10290164A5 - - Google Patents

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JPH10290164A5
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Description

【００１６】
【課題を解決するための手段】
上記目的を達成するため、本発明はクロック信号に応じてディジタル信号をアナログ信号に変換するディジタル／アナログ変換回路であって、上記クロック信号を所定の分周比で分周した分周クロック信号に応じて、入力したディジタル信号を保持し、さらに、上記クロック信号に応じて、保持したディジタル信号を所定の順にアナログ信号に変換する少なくとも二つの変換回路と、上記分周クロック信号に応じて、上記所定の分周比に応じた数のディジタル信号を、並列に各変換回路に供給するデータ供給手段とを有し、上記各変換回路は、共通の起動信号、例えば、システムのリセット信号に同期して上記クロック信号を分周する。
【００１８】
さらに、好適には、上記各変換回路は、並列に入力したディジタル信号を一時的に記憶し、上記分周クロック信号に応じて、一時的に記憶したディジタル信号を順に出力するマルチプレクサを有する。

Claims (4)

  1. クロック信号に応じてディジタル信号をアナログ信号に変換するディジタル／アナログ変換回路であって、
    上記クロック信号を所定の分周比で分周した分周クロック信号に応じて、入力したディジタル信号を保持し、さらに、上記クロック信号に応じて、保持したディジタル信号を所定の順にアナログ信号に変換する少なくとも二つの変換回路と、
    上記分周クロック信号に応じて、上記所定の分周比に応じた数のディジタル信号を、並列に各変換回路に供給するデータ供給手段と
    を有し、
    上記各変換回路は、共通の起動信号に同期して上記クロック信号を分周する
    ディジタル／アナログ変換回路。
  2. 上記共通の起動信号は、リセット信号である
    請求項１記載のディジタル／アナログ変換回路。
  3. 上記データ供給手段は、上記分周クロック信号に応じて記憶データを読み出し、上記各変換回路に出力するメモリ装置により構成されている
    請求項１記載のディジタル／アナログ変換回路。
  4. 上記各変換回路は、並列に入力したディジタル信号を一時的に記憶し、上記分周クロック信号に応じて、一時的に記憶したディジタル信号を順に出力するマルチプレクサを有する
    請求項１記載のディジタル／アナログ変換回路。
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