JPH10326437A - 記録担体 - Google Patents

記録担体

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JPH10326437A
JPH10326437A JP10042805A JP4280598A JPH10326437A JP H10326437 A JPH10326437 A JP H10326437A JP 10042805 A JP10042805 A JP 10042805A JP 4280598 A JP4280598 A JP 4280598A JP H10326437 A JPH10326437 A JP H10326437A
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Johannes J Mons
ヨハネス・ヤン・モンス
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Abstract

(57)【要約】 【目的】 種別の異なった記録層を有する記録担体に、
その記録層の種別に合った書き込み信号波形により書き
込むことを可能とする記録システムに使用される記録担
体を提供すること。 【構成】 光学的に書き込み可能な記録担体(32)には、
情報信号（Vi）を記録担体(32)に記録するために必要な
書き込み信号波形（Vs）を示す適合化情報が設けられて
いる。記録システムは、情報信号(Vi)から書き込み信号
(Vs)を導出するための制御回路(62)を有する記録装置を
備えている。記録装置は、記録前のある時間間隔の間に
適合化情報を読み出す読み出し部(30、38、39、40)を備え
ている。制御回路(62)は、記録時に使用される書き込み
信号波形を読み出された適合化情報に適合化させる適合
化回路(66)を備えている。

Description

【発明の詳細な説明】
【０００１】本発明は、光学特性を変更させた記録用マ
ークのパターンを有する記録担体であって、そのパター
ンが2進ビットセルからなる情報信号を表示し、記録用
マークが、前記情報信号を適合化可能な対応関係の基に
連続する書き込み信号のシークエンスに変換させる制御
回路を有している記録装置によって記録され、前記書き
込み信号に必要な適合化を示す読み取り可能な適合化情
報が設けられている記録担体に関する。
【０００２】米国特許明細書第4,473,829号により開示
されている既知のシステムの場合、記録用マークは、光
学書き込みヘッドにより形成される。この書き込みヘッ
ドは、レーザービームを発生させて、放射線に反応する
物質からなる記録担体上の記録層にそれを走査する。記
録用マークを形成する際、レーザービームは、形成され
る記録用マークの寸法と物性に応じた信号波形を有する
書き込み信号により変調される。この既知のシステムの
欠点は、その書き込み信号が、レーザービームの放射線
エネルギーにより記録担体から記録用材料が除去される
「アブラティブ」型の材料からなる記録層に記録する場
合にしか適合しないことである。しかしながら、別のタ
イプの放射線反応型記録層に記録を行う場合には、別の
書き込み信号波形を使用する事が望ましい。特開昭63ー1
53726号に記載されているように、「相変化」型及び
「熱−光反応」型材料に記録を行うために必要な書き込
み信号波形は、書き込み中に記録層に生じる特有な熱効
果の結果、「アブラティブ」型材料に記録する場合のそ
れとは完全に異なったものとなる。更に、同一型であっ
ても材料毎に熱の影響も又互いに相違するので、同一型
であっても材料毎に書き込み信号が異なる事も有り得
る。
【０００３】ヨーロッパ特許出願第0,144,436号には、
レーザービームの照射により、周囲よりも反射率が高い
記録用マークを形成する事が可能な正方向書き込み信号
型記録担体と、周囲よりも反射率が低い記録用マークを
レーザービームの照射により形成する事が可能な負方向
書き込み信号型記録担体の両方に、2進情報信号を記録
することが可能な記録システムが記載されている。この
記録装置は、当該記録担体の書き込み方向を決める記録
担体上のマークを検知するディテクタを備えている。
【０００４】その検知結果に応じて、情報信号は反転型
又は非反転型のどちらかの型で書き込みヘッドに与えら
れる。正方向書き込み信号型記録担体には情報信号のHI
GH信号に対応する部分が高反射率の記録用マークとして
記録され、負方向書き込み信号型記録担体には情報信号
のLOW信号に対応する部分が低反射率の記録用マークと
して記録される。その結果、どちらの記録担体の型に対
しても、記録担体に形成される記録波形は実質的に同じ
になる。この既知のヨーロッパ特許出願第0,144,436号
の記録システムの場合、正方向書き込み信号型記録担体
に反射率の高い記録用マークを記録するための書き込み
信号の波形は、負方向書き込み信号を有する記録担体に
同一寸法の低反射率の記録用マークを形成する際の書き
込み信号波形と同一である。このことは、特定の寸法の
高反射率の記録用マークを形成するための書き込み信号
波形が、同一寸法の低反射率の記録用マークを形成する
書き込み信号波形と同一であることを意味する。
【０００５】本発明の目的は、書き込み形式に適合化さ
せてありかつEFM信号を記録するのに特に適している記
録信号波形により、書き込み形式が異なる記録層を有す
る記録担体への書込みを可能にするシステムを提供する
事である。
【０００６】本発明の第一観点によると、この目的は、
前記制御回路が、同一の前記第一論理値のビットセルの
シークエンスを検知しかつ検知された前記シークエンス
のビットセルの数を表示する検知信号を供給する検知回
路と、前記検知信号に応じて前記書き込み信号と前記検
知信号との間の特定関係の基に前記書き込み信号を発生
させる書き込み信号発生器とを有していることを特徴と
する記録装置により達成される。この実施例の場合、書
き込み信号は、情報信号から二段階、つまり記録材料と
は無関係な第一段階と、記録材料の型に依存しかつ書き
込み信号波形が検知信号に応じて確立される第二段階と
から得られる。この事は、情報信号と書き込み信号との
間の関係を、記録担体の記録材料に極めて簡単に適合化
させる事が出来ると言う利点を有している。
【０００７】この記録装置の別の実施例が特徴とする点
は、前記書き込み信号が、一連の重なった記録用サブマ
ークからなる記録用マークを形成するパルス列を有し、
かつ前記書き込み信号発生器が、パルスの配置が検知さ
れた前記シークエンスのビットセルの数に基づいてパタ
ーン内にパルス列を発生させるように構成されている点
である。書き込み信号として使用されるパルス列を適切
に選択する事により、例えば、前述の特開昭63-153726
号に記載されているように、どの様な記録担体について
も熱効果の影響を効果的に補償する事が可能になる。こ
の様な書き込み信号波形の利点は、その発生が極めて容
易である事である。更に、その様な信号波形の特性は、
2値コードで簡単に表示する事が出来、それらをメモリ
に記憶させたり、ディジタル電子回路により処理する事
が可能である。
【０００８】記録装置の他の実施例が特徴とする点は、
前記記録担体に、当該記録担体に必要とされる前記書き
込み信号波形を示す読出し可能な適合化情報が設けられ
ていて、かつ前記記録装置が、記録開始前一定期間内に
前記記録担体上の前記適合化情報を読出す読出し部と、
前記書き込み信号と前記情報信号との間の前記関係を適
応させる事により読出された前記適合化情報に応じて前
記書き込み信号波形を適合化する適合化回路とを有して
いる様に構成されている前記記録装置に於いて、前記記
録担体が、当該記録担体に必要とされる前記書き込み信
号と前記検知信号との前記関係を表示する適合化情報を
有していて、かつ前記適合化回路が、読出された前記適
合化情報に応じて前記関係を確立するように構成されて
いる点である。これは、記録する前に、リーダパルスの
数と他のパルスに対するリーダパルスの位置が、記録装
置内にその時に存在している記録担体に対し常に自動的
に適合化されると言う利点を有している。
【０００９】記録装置の別の実施例が特徴とする点は、
前記記録装置が、前記書き込み信号のパルス列のパルス
に応答して記録用サブマークを形成する放射線パルスを
発生させる光学書き込みヘッドを有し、そのパルス列が
前記記録担体内の熱効果を補償するための予備加熱放射
線パルスを発生させる少なくとも1個のリーダーパルス
を有し、前記適合化回路が、前記リーダーパルスの数と
他のパルスに対する前記リーダーパルスの位置とを、読
み出される前記適合化情報に応じて、適合化させる点で
ある。これは、記録する前に、リーダパルスの数と他の
パルスに対するリーダパルスの位置が、記録装置内にそ
の時に存在している記録担体に対し常に自動的に適合化
されると言う利点を有している。
【００１０】この書き込み装置の他の魅力的な実施例の
特徴は、書き込み信号発生器が、型の異なる書き込み信
号を記憶するメモリと、検知信号に応じて記憶されてい
る書き込み信号のうちの一つの信号を供給する手段を備
え、さらに適合化回路が読み出された適合化情報に応じ
て書き込み信号をメモリにロードさせる回路を有してい
る点である。
【００１１】メモリの使用により、制御回路がいかなる
寸法のマークの記録にも適する書き込み信号波形を発生
させることが可能になる。
【００１２】この書き込み装置の別の適切な実施例の特
徴は、記録担体上の適合化情報が当該記録担体に必要な
書き込み信号を含み、その適合化情報を含む書き込み信
号がその適合化回路によりメモリに記憶されるように構
成されている点にある。
【００１３】この実施例には、未知の書き込み信号波形
により書き込まれる新規な記録材料を有する記録担体で
あってもこのシステムに容易に使用することが出来ると
いう効果がある。これにより、新規な記録材料を有する
記録担体に関しては、それに必要とされる新規な書き込
み信号波形さえ記録しておけば良いことになる。
【００１４】本発明の第二観点によると、本発明の目的
は、適合化に必要な前記書き込み信号波形を示す読出し
可能な適合化情報が設けられている記録担体に於いて、
前記記録担体が、前記検知信号と前記当該関連する担体
に必要な前記書き込み信号との間の前記関係を示す情報
を有していることを特徴とする、前記記録装置に使用さ
れる、記録担体により達成される。これは、記録する前
に、如何なる記録装置の書き込み信号波形も自動的に記
録担体に適合化させる事が出来ると言う利点を有してい
る。CDオーディオまたはCD-ROM基準に基いてEFM信号を
記録する場合には、例えばリードイントラックまたはリ
ードアウトトラックの様な予め決められているトラック
部分に、予め形成されている情報構造の手段によって記
録されているEFM信号のサブコードQチャンネル信号に、
適合化信号を含ませておくのが有利である。リードイン
トラックにおいて、Qチャンネル信号は、特定なトラッ
ク部分がスタートする位置、トラック番号を示す8ビッ
トコード“ポイント”及びそのトラック番号によって決
められているそのトラック部分の開始点又は終了点を示
すアドレスコード(PMIN,PSEC,PFRAME)を示す。トラック
番号に使用できる8ビットコードの数は、必要なコード
の数よりも小さい。従って、アドレス情報に代えて適合
化情報が当該8ビットコード“POINT”内の特異なビット
コンビネーションによって記録されていることを示すこ
とが可能に成る。
【００１５】適合化情報がこの様に記録されている場合
には、その適合化情報もまた単純な方法で読み出すこと
が出来る。その方法とは、EFMサブコード復調器によっ
てEFM信号からサブコードQチャンネル信号を復元し、続
いて特異なビットコンビネーションを検知してQチャン
ネル信号からその適合化信号を抽出する方法である。
【００１６】サブコードQチャンネル内のアドレス情報
は、記録されている標準CD信号の読み出し制御のために
用いることが出来る点に注意されたい。これを用いるこ
とによって、CD信号の書き込み／読み出し兼用装置に於
いては、同一のEFMサブコード復調器を、書き込み中の
適合化信号を読み出す為と読み出しプロセスを制御する
アドレス情報を読み出す為との両方に使用することが出
来る。その結果、この電子回路を効率良く使用すること
が出来る。
【００１７】本発明の実施例とそれによる上述以外の効
果を、さらに詳細に、第1〜18図を参照して説明する。
【００１８】第16図は、例えば米国特許明細書第4,473,
829号に示されているような情報信号Viを記録する従来
のシステムを示す。このシステムは放射線反応記録層2
を備えた記録担体1を有する。記録担体1は、駆動手段5
によって軸7を中心にしてヘッド4に対して回転する。書
き込みヘッド4により記録層2に充分なエネルギーの放射
線が与えられ、そのビームが照射される場所の記録層2
の光学特性が変更する事が可能となるように構成されて
いる。放射線ビーム3は、書き込み信号Vsにより変調さ
せることが出来る。その書き込み信号Vsは、記録される
べき情報信号Viから特定な対応関係の下に制御回路6に
より得られる。
【００１９】第17図は、「アブラティブ」型記録材料の
記録層に記録を行う場合の情報信号Vi、書き込み信号Vs
及び記録用マーク10を示している。情報信号Viは、例え
ば、CDオーディオ又はCD-ROMスタンダードに準拠したEF
M変調信号である。この様な信号は一定時間Tの2進ビッ
トセル11からなる。EFM変調信号に於ては、同じ論理値
が連続するビットセルの数は最小3、最大11である。論
理値“1”のビットセルが連続するグループ12a、12b及
び12cの各々に対し、制御回路6は、書き込み信号Vsa、V
sb及びVscを発生させる。各書き込み信号は、1個以上の
書き込みパルス13からなる。1個の書き込みパルス13毎
に、書き込みヘッド4は1個の放射線パルスを発生させ
る。各放射線パルス13毎に、放射線ビーム3が入射した
記録層2の位置にあるアブラティブ型記録材料が除去さ
れる。この結果、記録層2内に光学特性が変更したサブ
マークsが形成される。第17図の例では、サブマークsの
寸法はビットセル3個の前述の最小長さに対応する。論
理値“1”を示す3個のビットセルから構成される最小数
に対応した記録用マーク10を記録する書き込み信号Vsa
は、1個の書き込み信号13のみからなる。ビットセルが
これより多い場合の記録用マーク10は、サブマークsを
数多く重ねることにより形成され、これはビットセル長
さTの時間間隔だけ相互にずれている一連の書き込みパ
ルス13からなる書き込み信号により構成されている。
【００２０】第18図は、例えば特開昭63-153726号に記
載されているような「相変化」型記録材料に記録する際
の情報信号Viと書き込み信号Vsa、Vsb及びVscとの間の
適格な対応関係を示している。このような材料に書き込
みを行う場合には、書き込み中に発生する記録層内の熱
の影響を考慮して、記録用マーク10を形成するために別
の書き込み信号波形を使用することが望ましい。つまり
第一番目のサブマークsを形成する前に、予備加熱パル
ス20a及び拡張パルス20bをリーダーパルスとして追加発
生させる様な書き込み信号波形が望ましい。リーダーパ
ルスの位置と数は、使用される「相変化」型記録材料に
依存することに注意されたい。
【００２１】第1図は、本発明の記録システムの第1実施
例を示す。この記録システムは、書き込み可能な記録担
体32に放射線ビームを走査させる光学書き込み／読み出
しヘッド30を備えている。モータ32aにより、記録担体
は、書き込み／読み出しヘッド30に対し実質的に一定の
接線速度で回転する。この書き込み／読み出しヘッド30
は、通常のタイプのもので、読み出しモードに於ては、
放射線ビーム31が、記録担体32の記録層に光学特性の変
化を生じさせない程度の強度を有するように構成されて
いる。書き込みモードに於ては、放射線ビームは書き込
み信号Vsに応じて変調され、その変調された放射線ビー
ム31の強度が、記録担体32の記録層に光学特性の変化を
発生させるのに充分なものとなる様に構成されている。
モータ33とスピンドル34によって、書き込み／読み出し
ヘッド33が記録担体32の半径方向に移動することが可能
となる。モータ33はモータ制御回路41により制御され
る。第一制御回路35により、情報信号Viが、アブラティ
ブ型記録材料に書き込むための一連の書き込み信号Vs′
に変換される。このような制御回路35は、アブラティブ
記録用に第17図に示される対応関係に基づいて情報信号
を書き込み信号Vs′に変換させるが、その詳細は前述の
米国特許明細書第4,473,829号に記載されている。第二
制御回路36により、情報信号Viは「相変化」型記録材料
用の書き込み信号Vs″に変換される。第18図の対応関係
に基づいて情報信号を「相変化」型記録材料用の書き込
み信号に変換させる制御回路36は、特開昭63-153726号
に概括的に示されている。書き込みモードに於ける書き
込みビーム31を変調するために、電子的に作動されるス
イッチ32bによって、書き込み信号Vs′又は書き込み信
号Vs″の何れか一方が選択される。書き込み信号の選択
を制御するために記録担体には適合化情報が付与されて
いる。この適合化情報は、当該記録担体32が書き込み信
号Vs′と書き込み信号Vs″の内の何れの信号により書き
込まれるべきかを示す。この適合化情報は、記録担体上
の予め決められた位置に情報構造として予め記録されて
いる。
【００２２】第2a,b,c,d図は、適合化情報が予め決めら
れた位置に記録されている記録担体32の実施例を示す。
第2a図は平面図で、第2b図は線b−bに関する断面図の一
部を示す。記録担体32は、例えば予め形成された溝や凸
部により予め形成されたトラック37を備えている。記録
する目的のために記録担体32には、透明基板95上にデポ
ジットされ、保護層97により被履された記録層96が設け
られている。記録層96は、適切な放射線が照射されると
光学的に検知可能な変化が生じる材料からなる。このよ
うな材料についての研究は、Adam Higlar Ltd. 発行の
Bristol 及び Boston 著“Principles of optical disc
systems”の P.210〜227 に記載されている。
【００２３】参照番号37aは、記録用の部分37bの開始点
に先行するリードイントラックを示す。記録担体32のこ
の実施例に於いては、適合化情報は予め形成されたピッ
ト98の波形として形成されている。このようなピットに
より形成されたリードイントラック37aの一部分92が、
第2c図に、拡大されたスールで示されている。
【００２４】第2d図は、線d−dについての断面図に於け
る部分92を示す。説明の都合上、螺旋トラックのターン
間の距離は極端に誇張されている。記録担体32の実際の
例に於いては、0.4〜1.3μmのトラック幅に対してトラ
ック間の距離は1〜2μm である。
【００２５】新しい記録担体32が載置されると、読み出
し／書き込みヘッド30はリードイントラック37aに対面
する位置に移動し、適合化情報を読み取る。この適合化
情報は、例えば、リードイントラック37aにCD-ROMフォ
ーマットに基づいて記録しておくことが出来る。このCD
-ROMフォーマットに従って、ディジタルデータがブロッ
ク50に記録される（第3図参照）。各ブロックは、各々8
ビットバイト52を4個有する588個の列51からなる。各ブ
ロック50の最初の3列には特定な12バイトの同期信号が
記録されている。4番目の列は、4バイトのブロックアド
レスコード用である。これ以外の列はデータ記録用であ
る。適合化情報は、特異なブロックアドレスを用いてブ
ロック内に設けることが出来る。このリーダトラック37
に保持された適合化情報を読み出すために、記録システ
ムには、書き込み／読み出しヘッド30に接続された読み
出し回路38が設けられている。この読み出し回路によっ
て、読み出しモード時に光学読み出し／書き込みヘッド
30から得られた読み出し信号Viが、ブロック50の連続す
るバイトからなるディジタル情報信号Vldに変換され
る。この読み出し回路38は、コンパクトディスクROMシ
ステム CM100/25、CM100/30、CM110/25 又は CM100/30
に採用されている様な通常のタイプのものである。この
ような読み出し回路によって、読み出しデータバイト
が、読み出し回路から供給されるクロック信号CLdに同
期したシリアルなビット列の形態で得られる。読み出し
回路から得られたデータバイトは、通常のインターフェ
ース回路39を介してマイクロコンピュータシステム40に
与えられる。
【００２６】書き込み信号波形の適合化は次のように実
行される。新しい記録担体32が記録システムに載置され
ると、マイクロコンピュータシステム40により開始プロ
グラムが実行される。開始プログラムの実行中、読み出
し／書き込みヘッド30は、インターフェース回路39によ
って読み出しモードにセットされる。更に、マイクロコ
ンピュータシステム40の制御によって、読み出し／書き
込みヘッド30はリードイントラック37aの位置に置かれ
る。リードイントラック37の読み出し中、適合化情報を
有するブロックが特異なブロックアドレスコードにより
検知され、次いで読み出される。この後、マイクロコン
ピュータシステム40によって、電子的に作動するスイッ
チ32bが、読み出された適合化情報に応じてセットされ
る。開始プログラムの終了後、読み出し／書き込みヘッ
ド30は書き込みモードにセットされ、このような順序に
よって選択された書き込み信号波形によって情報信号Vi
がトラック部分37bに書き込まれる。
【００２７】第4図は本発明の記録システムの別の実施
例である。第1図に示された部分と同一の部分には同じ
参照番号が付されている。この記録システムは、第一番
目のクロックCL1とこれの8倍の周波数を持つ第二番目の
クロック信号CL2とを発生させる発振システムを備えて
いる。記録されるべきEFM変調情報信号は、信号発生器6
1から、第一クロック信号CL1に同期して制御回路62に与
えられ、そこで、情報信号Viは、光学読み取り／書き込
みヘッド30に供給される書き込み信号Vsに変換される。
制御回路62は、論理値“1”が連続するビットセルのシ
リーズを検知する検知回路63を有している。検知回路63
は、検知されたシリーズ内のビットセルの数を示すコー
ドの形で検知信号を発生させる。前述したように、この
数はEFM変調信号の場合には、最小3、最大11である。検
知信号は、信号ライン64を介して書き込み信号発生器65
に送られる。この書き込み信号発生器は、当該検知信号
によって表されるビットセルの数に対応した長さを有す
る記録用マークを書き込むために、各検知信号毎に書き
込み信号Vsを発生させる。これ以降、3,…,11個の連続
するビットセルからなるシリーズを示す記録用マークを
形成するための書き込み信号を、各々、Vs3,…,Vs11と
記すことにする。これらの記録用マークは、簡単にI3マ
ーク,…, I11マークと記載される。3,…,11と記載され
る各数字はこれらのマークによって表されるビットセル
の数を示している。マイクロコンピュータシステム40に
接続されている適合化回路66によって、開始フェーズの
間に、検知信号と書き込み信号Vsとの間の対応関係が、
記録担体32のリードイントラック37aから読み出された
適合化情報に応じて、選択される。
【００２８】第5図は、制御回路62の例を詳細に示した
ものである。制御回路62に使用されている検知回路63
は、12ビットシフトレジスタ70を備えている。このレジ
スタ70にはシーリアルデータ入力端子71を介して記録さ
れるべき情報信号Viが加えられる。クロック信号CL1の
クロックパルスに同期して、情報信号Viがシフトレジス
タ70に読み込まれ、1,…,12クロックパルス分遅延され
た情報信号が各々シフトレジスタ70の出力端子Q1,…,Q
12に現れる。シフトレジスタ70のQ11の出力は、2入力NA
NDゲート72に入力される。シフトレジスタ70のQ1,…,Q8
の出力はエンコーディング回路74に加えられる。これに
よりシフトレジスタ70の出力端子の信号値は、第6図の
対応関係に基づいて、検知信号D0，D1，D2及びD3に変換
される。このようなエンコーディング回路には、例えば
74LSI48型のICを用いることが出来る。検知信号は、書
き込み信号発生器65の一部である並列入出力レジスタ75
に加えられる。クロック信号CL1のクロックパルスの数
をカウントするカウンタ76と、レジスタ75とが、例えば
2K×8ビットのRAM型メモリであるメモリ78のアドレス発
生器77を構成している。カウンタ76はカウントをゼロに
するリセット入力を有し、予め設定したファイナルカウ
ント「15」に到達するとカウントを停止する。カウンタ
76のリセット入力端子はNANDゲート72の出力端子に接続
されている。アドレス発生器77の出力信号のアドレス
は、トリステートバッファ79とアドレスバス80を介して
メモリ78のアドレス入力に与えられる。メモリ78の8個
のデータ出力はデータバス81を介して並列・直列コンバ
ータ82に送られる。コンバータ82は、そのクロック入力
端子に加えられて直列データ出力を制御するクロック信
号CL2と、そのロードイネーブル入力端子に加えられて
バス81を介して加えられるデータの並列入力を制御する
クロック信号CL1とによって制御される。コンバータ82
の直列出力は書き込み信号Vsの出力を構成する。
【００２９】情報信号Viは次のようにして書き込み信号
Vsに変換される。インバータ回路73とNANDゲート72によ
って、論理値“1”のビットセルが連続するシリーズの
先頭が検知される（第10図参照）。そのようなシリーズ
の先頭がシフトレジスタ70の出力端子Q11に到達する
と、NANDゲート72の出力信号Vnは瞬時に“0"となる。NA
NDゲート72の出力信号が1−0に遷移した際に、この時点
で検知されたシリーズの長さを示す検知信号D0,…,D
3が、バッファ75にロードされる。（以下の点に注意さ
れたい。つまり、シリーズは少なくとも3ビットセルの
長さを持つので、検知信号D0,…,D3を決定する上でレジ
スタ70の出力端子のQ9とQ10の信号値は無関係である。
何故ならば、このシリーズの先頭が出力端子Q11に到達
する時点で、Q9とQ10の信号値は常に“1"であるからで
ある。）カウンタ76も、NANDゲートの出力が1−0と遷移
する際にゼロにセットされる。このようにして、論理値
“1”のビットセルの検知に応答して、アドレス発生器7
7は、検知されたナある。記録担体32が載置されると、マ
イクロコンピュータシステム40は開始プログラムを実行
する。この間、読み出し／書き込みヘッド30がリーダー
トラック37aに対面する位置に移動し、リーダートラッ
ク37aに記録されている情報を読み出す。次に、ブロッ
クアドレスによって、マイクロコンピュータシステム40
は書き込み信号Vsが記録されているブロック50のブロッ
クアドレスを検知し、続いて適合化回路66を介して検知
されたデータブロック50内に記録されている書き込み信
号Vsをメモリ78にロードする。この目的のために、適合
化回路66は、マイクロコンピュータシステム40のアドレ
スバス入力をアドレスバス80を介してメモリ78のアドレ
ス入力端子に接続させるトリステートバッファ83と、マ
イクロコンピュータシステム40のデータバスをバス81を
介してメモリ78のデータ入力端子に接続させるトリステ
ートバッファ84とを備えている。メモリ78がロードされ
ている間、バッファ83と84はコンピュータシステムから
の選択信号Ssによって動作可能となっている。この選択
信号Ssはインバータ回路85を介してバッファ79にも加え
られ、トリステートバッファ79の出力端子を高インピー
ダンス状態にする。更に、マイクロコンピュータシステ
ム40から書き込み信号Swがメモリ78に送られて、そのロ
ーディング動作が制御される。ゲート回路86がロード信
号Swを与えるラインに配置されているので、メモリ78の
ローディングプロセスの終了後、バッファ83と84が選択
信号Ssによって動作しなくなると、直ちにロード信号Sw
が停止する。
【００３０】ここまでに述べた実施例の場合、適合化情
報はリードイントラック37a内に記録されているEFMデー
タブロック50に格納されている。しかしながら、CD基準
に基づいたEFM信号のサブコードQチャンネル信号も又、
適合化情報を記録するのに非常に適している。Qチャン
ネル信号は、各EFMサブコードフレーム内でその情報の
残りの部分とインターリーブされた98のビットから構成
されている。
【００３１】第11図は、サブコードフレームの98個のQ
チャンネルビットのフォーマットを示す。その98ビット
は、1個の2ビットグループ100、2個の4ビットグループ1
01と102、2個の8ビットグループ103と104、56ビットグ
ループ105及び1個の16ビットグループ106からなる。グ
ループ100のビットは同期を取るためのものである。リ
ードイントラック37aに於いて、グループ102と103とが
特異なビットコンビネーション“100”（16進数）を構
成している。この数字は当該トラック部分がリードイン
トラック37aの部分を形成していることを示す。
【００３２】グループ104の8ビットによって、グループ
105に記録されている情報のタイプの特性が決められて
いる。これは一般的には特定のトラック部分を示すトラ
ック番号であり、その部分のアドレスはグループ105内
で規定されている。
【００３３】しかしながら、例えばＦＦ（16進数）の様
な特異なビットコンビネーションは、グループ105のビ
ットが記録担体のパラメータに関する情報を表している
ことを示す。例えば、サブグループ105fの最上位の3個
の数字の様な、これらのビットのうちのいくつかのビッ
トが、書き込み信号波形を決める適合化情報の記録に使
用される。グループ105fの他のビットは、例えば必要と
される書き込み強度と言った他のパラメータの規定に使
用することが出来る。
【００３４】記録担体のパラメータに関する制御情報
は、リードイントラック37aを走査している間、通常の
サブコード復調器によってEFMサブコードから復元され
たQチャンネルビットから簡単に得られる。
【００３５】第12図は、サブコードQチャンネル信号か
ら適合化信号を復元する本発明のシステムの実施例を示
す。データ信号Vldの代わりに、読み出し回路38内の通
常のタイプのサブコード復調器38aによって読み出し信
号Vlから導出されたサブコードQチャンネル信号が、イ
ンターフェース回路39に供給される。
【００３６】第13図は、Qチャンネル信号から制御信号
を導出するフローチャートである。このプログラムは、
記録システムが記録担体の取り替え後動作状態に移る度
毎に実行される。ステップS71で書き込み／読み出しヘ
ッド30は、マイクロコンピュータシステム40の制御の基
に、モータ33とスピンドル34によってリードイントラッ
ク37aに向かい合うように配置される。続いて、リード
イントラック37aに記録されている情報の読み出しがス
タートする。
【００３７】ステップS72に於いて、対応するQチャンネ
ルビットが読み込まれる。ステップS73に於いて、適合
化情報がグループ105fに記憶されているか否かが、グル
ープ102、103及び104のビットにより確認される。もし
記憶されている場合には、グループ105fのビットによっ
て示される情報が、ステップS75でマイクロコンピュー
タシステムのメモリに記憶される。その後、プログラム
はステップS72に進み、次のブロックの98個のQチャンネ
ルビットが読み込まれる。もしステップS73の間、ブロ
ック105fが何のパラメータ情報も含んでいなかった場合
には、ステップS73からステップS74に進む。ここでは読
み出されたQチャンネルビットのブロックを用いてリー
ドイントラック37aの終端に到着したかどうかが確認さ
れる。もし到達していない場合には、プログラムはステ
ップS72に進み、到達している場合には、プログラムは
終了する。
【００３８】書き込み信号波形の適合化の為に、第12図
に示されたシステムは、制御回路110を備えている。こ
の制御回路は、EFM変調された信号Viを適合化情報によ
り書き込み信号波形Vsに変換する。この適合化のため
に、制御回路110はバス111とインターフェース回路39を
介してマイクロコンピュータ40に接続されている。これ
以降詳細に説明される制御回路110は、マルチプライア
回路112に送られるパルス型の書き込み信号Vsを発生さ
せる。ここで書き込み信号には、ビーム31が必要な書き
込み強度を得るように、デジタル・アナログコンバータ
の出力端に現れる信号が乗算される。デジタル・アナロ
グコンバータ113のデジタル入力端は、バス114とインタ
ーフェース回路39を介してマイクロコンピュータ40に接
続されている。
【００３９】マルチプライア回路112の出力信号Vs′
は、書き込み／読み出しヘッド30に与えられる。このヘ
ッドは、マルチプライアの出力信号のパルスに応答し
て、与えられたパルスの大きさに比例した強度の放射線
パルスを発生させる。
【００４０】第14図は、信号Viを書き込み信号Vsに変換
させる制御回路110の一例を示す。この制御回路110は、
2個の3ビット並列・直列コンバータ120と121を備えてい
る。コンバータ120の並列入力端子は3チャンネルマルチ
プレックス回路122の出力端子に接続されている。ビッ
トコンビネーション“000"がマルチプレックス回路122
の入力端子aに与えられ、ビットコンビネーション“00
1",“010"は、各々、入力端子bとcに与えられる。マル
チプレックス回路122の制御入力端子はバス111に接続さ
れている。バス111を介して与えられる適合化情報に応
じて、ビットコンビネーション“000",“001"又は“01
0"が、並列・直列コンバータ120の並列入力端子に与え
られる。
【００４１】ビットコンビネーション“010”は、並列
・直列コンバータ121の並列入力端子に与えられる。コ
ンバータ120と121からなる並列ロード入力端子は、その
周波数がEFM変調された信号Viのビット周波数に等しい
クロック信号CL1により制御されている。コンバータに
於けるビットコンビネーションからなる直列出力信号に
対するクロック入力信号は、信号Viのビット周波数の3
倍の周波数のクロック信号CL3により制御されている。
コンバータ120と121の直列出力信号は、各々、3チャン
ネルマルチプレックス回路123の第一入力端子と第二入
力端子とに与えられる。論理値“0”の信号はマルチプ
レックス回路123の第三入力端子に与えられる。マルチ
プレックス回路123は、マルチプレックス回路123の出力
端子124を、デコーダ回路128から与えられる制御信号に
応じてその入力端子のうちの一つに接続させる。
【００４２】デコーダ回路128の入力信号は、信号Viか
ら導出される。この目的のために、制御回路110は、例
えばクロック信号CL1により制御されたフリップフロッ
プの様な遅延回路125を有している。この際フリップフ
ロップは1ビットの長さに対応した1個の時間間隔だけ信
号Viを遅延させる。遅延された信号はVi′と記すことに
する。遅延された信号Vi′は、インバータ回路126を介
して2入力ANDゲート127の一方の入力端子に加えられ
る。また、信号ViがこのANDゲート127の他方の入力端子
に加えられる。従って、ANDゲート127の出力信号によっ
て、信号Viのビットが、論理値“1”のビットからなる
シークエンスの第一番目の論理値“1”のビットである
か否かが判る。
【００４３】ANDゲート127の出力信号と信号Viはデコー
ダ回路128の入力端子に与えられる。与えられた信号に
よって表されたビットコンビネーションに応じて、この
デコーダ回路128はマルチプレックス回路123を次の条件
で制御する。その条件とは、ANDゲート127の出力信号が
論理値“1”である場合には、コンバータ120の出力端子
を出力端子124に接続し、ANDゲート127の出力信号が論
理値“0”でありかつ信号Viの論理値が“1”である場合
には、コンバータ121の出力端子を出力端子124に接続
し、また信号Viが論理値“0”の場合には出力端子124を
論理値“0”信号を示す入力端子に接続するというもの
である。
【００４４】第14図に示されるシステムは次のように動
作する。信号Viが記録される場合、読み出し／書き込み
ヘッド30が、記録されるトラック部分に対向するように
配置される。
【００４５】さらに、書き込み強度は、適合化情報をリ
ードイントラック37aから読み出した後、必要とされる
書き込み強度に対応してマイクロコンピュータ40のメモ
リに記憶されている値をデジタル・アナログコンバータ
113にロードすることにより、マイクロコンピュータシ
ステム40により必要とされる値に適合化させることが出
来る。さらに、制御回路110は、このようにして読み出
されてメモリに記憶されている適合化情報に対応する様
にセットされる。最後に、読み出し／書き込みヘッド30
が書き込みモードにセットされ、その後記録が開始され
る。
【００４６】記録が行われている間、信号Viは信号Vsに
変換される。クロック信号CL1のクロックパルスに対応
して、並列入力端子のビットコンビネーションは信号Vi
のビット周波数でもって並列・直列コンバータ120と121
とにロードされ、続いてコンバータ120と121の内容は3
倍の周波数を持つクロック周波数CL3によりシリアルに
読み出される。信号Viの論理値“1”のシークエンスの
うちの第一番目の論理値“1”が制御回路110に与えられ
ると、並列・直列コンバータ120にロードされたビット
パターンは、マルチプレックス回路123を介して書き込
み信号Vsとして転送される。これは、制御回路のセッテ
ィング“000”（第15a図参照）、“001”（第15b図参
照）、又は“010”（第15c図参照）に依存する。二番目
以降の論理値“1”のビット及び信号Viの論理値“1”の
ビットに対しては、直列−並列コンバータ121からビッ
トパターン“010”が、マルチプレックス回路123を介し
て書き込み信号として転送される。信号Viの各“0”ビ
ットに対しては、論理値“0”の信号がマルチプレック
ス回路123の入力端子に転送される。
【００４７】第15図は、制御回路110の3種類のセッティ
ングの書き込み信号波形を示す。信号Vsaは、マルチプ
レックス回路122の“a”入力が選択された場合の書き込
み信号である。信号Vsbは、マルチプレックス回路122の
“b”入力が選択された場合の書き込み信号で、信号Vsc
は、“c”入力が選択された場合の書き込み信号であ
る。パルス20aと20bはこの場合にも制御システムに於け
る熱効果の発生を補償するリーダーパルスである。
【００４８】書き込み強度を正当な値にすることが出来
ることと第15図に示された3種類の波形を選択すること
ができることから、非常に多くの記録担体の型に対して
記録中に発生する熱効果を補償することが出来る。
【００４９】本明細書に於いては、本発明をEFM信号の
記録について説明した。しかしながら、本発明の範囲は
この例に限定されることはない。本発明はまた他のタイ
プの情報信号を記録する場合にも適用することが出来る
ことは当業者には明らかであろう。この場合、記録担体
のタイプに応じて別の書き込み信号波形が必要となる。
【００５０】最後に、光学記録システムに関して本発明
の説明を行ったが、例えば磁気及び磁気・光学記録シス
テムのような他の記録システムにも本発明を用いること
ができることに注意されたい。この場合、必要とされる
書き込み信号波形は使用される記録担体に依存する。
【図面の簡単な説明】 【図１】本発明の記録装置の第1実施例を示す。 【 図２】本発明の記録装置に使用される記録担体を示
す。 【図３】記録担体上の適合化情報の記憶に適したフォー
マットを示す。 【図４】本発明の記録装置の別の実施例を示す。 【図５】第4図に示された記録装置に使用される制御回
路の例を示す。 【図６】同制御回路に使用されるエンコーディング回路
の入力信号と出力信号の対応関係を示す。 【図７】同制御回路のメモリに記憶された書き込み信号
のアドレスを示す。 【図８】いくつかの書き込み信号を示す。 【図９】記録担体に記憶されているデータブロック内に
所望の書き込み信号がどの様に配置されているかを示
す。 【図１０】前記制御回路に発生するいくつかの信号を時
間の函数として示している。 【図１１】CD基準に基づいたEFM信号のサブコードQチャ
ンネル信号のフォーマットを示す。 【図１２】CD基準に基づいてEFM信号を記録するのに非
常に適している本発明の記録装置の実施例を示す。 【図１３】同装置に用いられるマイクロコンピュータシ
ステムのプログラムのフローチャートである。 【図１４】第12図に示された記録装置に使用される制御
回路の一例を示し、 【図１５】同制御回路の異なったセッティングに対し
て、第14図の制御回路が発生させるいくつかの書き込み
信号の波形の一例を示す。 【図１６】従来技術の記録システムを示す。 【図１７】「アブラティブ」型の記録材料に記録するた
めの書き込み信号と情報信号との間の望ましい適切な対
応関係を示す。 【図１８】「相変化」型の記録材料に記録するための書
き込み信号と情報信号との間の望ましい適切な対応関係
を示す。 【符号の説明】 1…記録担体、 2…記録層、 3，31…
放射線ビーム、4…書き込みヘッド、 5…駆動手
段、 6…制御回路 7…軸、 10…記録用マーク 11…
2進ビットセル、12a,b,c…ビットセルグループ、 13
…放射線パルス、 20a…予備加熱パルス、20b…拡張パ
ルス、 30…光学書き込み／読み出しヘッド、32
…記録担体、 32a,33…モータ、 32b
…スイッチ、34…スピンドル、 35…第一制御回
路、 36…第二制御回路、37a…リードイントラッ
ク、 38…読み出し回路、39…インターフェース
回路、 40…マイクロコンピュータシステム、50…
データブロック、52…ビットバイト、61…信号発生器、
62…制御回路、63…検知回路、 64…信号ライ
ン、 65…書き込み信号発生器、66…適合化回路、
70…シフトレジスタ、 72…NANDゲート、73…
インバータ回路、74…エンコーディング回路、 75…バ
ッファレジスタ、76…カウンタ、 77…アドレス発
生器、 78…メモリ、79，83，84…トリステート
バッファ、 80…アドレスバス、 81…データバス、82
…コンバータ、 85…インバータ回路、 86…
ゲート回路 100…2ビットグループ、 101，102…4ビットグルー
プ、103，104…8ビットグループ、 105…56ビットグル
ープ、106…16ビットグループ、 110… 制御回路、
111，114…バス、112…マルチプライア回路、 11
3…デジタル・アナログコンバータ、120，121…並列・
直列コンバータ、 122，123…マルチプレックス回
路、124…出力端子、 125…遅延回路、 126…イ
ンバータ回路、127…ANDゲート。
───────────────────────────────────────────────────── フロントページの続き (72)発明者 ヘンリカス・テオドラス・レオナルドス・ ペトロネーラ・ストックス オランダ国 ソメーレン ウィンガード 10 (72)発明者 ヨハネス・ヤン・モンス オランダ国 アインドーフェン オンゼン オート ２ (72)発明者 ウィルヘルムス・ペトラス・マリア・レー イメーカーズ オランダ国 スヘルトゲンボッシュ ロン パートパーク 160 (72)発明者 フランシスカス・ランバートス・ヨハネ ス・マリア・キュイペルス オランダ国 アインドーフェン ペータ ー・ブイ・アンローイラーン ９

Claims (5)

    【特許請求の範囲】
  1. 【請求項１】光学特性を変更させた記録用マークのパタ
    ーンを有する記録担体であって、そのパターンが2進ビ
    ットセルからなる情報信号を表示し、記録用マークが、
    前記情報信号を適合化可能な対応関係の基に連続する書
    き込み信号のシークエンスに変換させる制御回路を有し
    ている記録装置によって記録され、前記書き込み信号に
    必要な適合化を示す読み取り可能な適合化情報が設けら
    れている記録担体において、前記制御回路が、同一の第
    一論理値のビットセルのシークエンスを検知しかつ検知
    された前記シークエンスのビットセルの数を表示する検
    知信号を供給する検知回路を有し、前記適合化可能な対
    応関係が、前記検知信号と前記書き込み信号との対応関
    係を有し、前記記録担体上の前記適合化情報が、前記記
    録担体の記録に必要な前記検知信号と前記書き込み信号
    との間の前記対応関係を示す情報を有していることを特
    徴とする記録担体。
  2. 【請求項２】前記記録担体の前記適合化情報が、前記記
    録担体の記録に必要な前記検知信号に対する書き込み信
    号波形を有していることを特徴とする請求項第１項記載
    の記録担体。
  3. 【請求項３】前記書き込み信号が、一連の重なり合う記
    録用サブマークを有するマークを形成するパルス列を有
    し、前記適合化情報が、パルスの配置が前記記録担体の
    記録に必要な前記検知信号に依存するパルス列パターン
    を有していることを特徴とする請求項第１項又は第２項
    記載の記録担体。
  4. 【請求項４】前記パルス列が、前記記録担体内の熱効果
    を補償するプリヒーティング放射パルスを発生させる少
    なくとも１個のリーダーパルスを有していて、前記パル
    ス列パターンが複数のリーダーパルスを有し、かつ前記
    他のパルスに対する前記リーダーパルスの位置が前記検
    知信号に依存することを特徴とする請求項第３項記載の
    記録担体。
  5. 【請求項５】前記適合化情報が、前記記録担体の記録に
    必要な放射ビームの書き込みビームの強度を示している
    ことを特徴とする請求項第１〜４項の何れかに記載の記
    録担体。
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