JPH1049644A - Ｉｃメモリーカードにおける保護装置 - Google Patents
Ｉｃメモリーカードにおける保護装置Info
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- JPH1049644A JPH1049644A JP8204509A JP20450996A JPH1049644A JP H1049644 A JPH1049644 A JP H1049644A JP 8204509 A JP8204509 A JP 8204509A JP 20450996 A JP20450996 A JP 20450996A JP H1049644 A JPH1049644 A JP H1049644A
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- card
- signal
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- Coupling Device And Connection With Printed Circuit (AREA)
- Techniques For Improving Reliability Of Storages (AREA)
Abstract
(57)【要約】
【課題】ＩＣメモリーカードを電子機器内に挿入し、情
報の授受を行なう場合における、カードを挿抜する際の
カード内蔵のメモリー用ＩＣの保護、該ＩＣへの誤書き
込み又は誤消去を確実に防止し、又カード挿抜時におけ
る誤動作を的確に防止する。 【解決手段】ＩＣメモリーカード１は表面に多数の信号
用パッド２，３が前後段に並列して配置され、前段信号
用パッド２の列と後段信号用パッド３の列間に電源ライ
ン４と接地ライン５とが前後段に並行に延在し、前段電
源ライン４の端部に電源用パッド６が、後段接地ライン
の端部に接地用パッド７が夫々設けられ、カード挿入時
に各パッドをコンタクトを介して電子機器へ接続するよ
うにしている。上記ＩＣメモリーカード１における保護
装置として、上記後段信号用パッド３に対する後段信号
用コンタクト１０の接触位置から同パッド前端縁までの
摺動寸法Ｓ１と上記電源用パッド６に対する電源用コン
タクト１１の接触位置から同パッド前端縁までの摺動寸
法Ｓ２とをＳ１＞Ｓ２の関係となるように設定した。
報の授受を行なう場合における、カードを挿抜する際の
カード内蔵のメモリー用ＩＣの保護、該ＩＣへの誤書き
込み又は誤消去を確実に防止し、又カード挿抜時におけ
る誤動作を的確に防止する。 【解決手段】ＩＣメモリーカード１は表面に多数の信号
用パッド２，３が前後段に並列して配置され、前段信号
用パッド２の列と後段信号用パッド３の列間に電源ライ
ン４と接地ライン５とが前後段に並行に延在し、前段電
源ライン４の端部に電源用パッド６が、後段接地ライン
の端部に接地用パッド７が夫々設けられ、カード挿入時
に各パッドをコンタクトを介して電子機器へ接続するよ
うにしている。上記ＩＣメモリーカード１における保護
装置として、上記後段信号用パッド３に対する後段信号
用コンタクト１０の接触位置から同パッド前端縁までの
摺動寸法Ｓ１と上記電源用パッド６に対する電源用コン
タクト１１の接触位置から同パッド前端縁までの摺動寸
法Ｓ２とをＳ１＞Ｓ２の関係となるように設定した。
Description
【０００１】
【発明の属する技術分野】この発明はメモリー用ＩＣを
内蔵するカードを電子機器から挿抜する際におけるカー
ド内ＩＣ又は機器内ＩＣの保護と、カードに書込みされ
たメモリー情報の保護を図る装置に関する。
内蔵するカードを電子機器から挿抜する際におけるカー
ド内ＩＣ又は機器内ＩＣの保護と、カードに書込みされ
たメモリー情報の保護を図る装置に関する。
【０００２】
【従来の技術】近年市場に展開されている図１に示すＩ
Ｃメモリーカード１は表面に多数の信号用パッド２，３
が前後段に並列して配置されており、更に前段信号用パ
ッド２の列と後段信号用パッド３の列間に電源ライン４
と接地ライン５とが前後段に並列に延在し、この前段電
源ライン４の両端に電源用パッド６を設け、この電源用
パッド６を上記前段信号用パッド２の左右列端に配する
と共に、上記接地ライン５の両端に接地用パッド７を設
け、この接地用パッド７を上記後段信号用パッド３の左
右列端に配している。
Ｃメモリーカード１は表面に多数の信号用パッド２，３
が前後段に並列して配置されており、更に前段信号用パ
ッド２の列と後段信号用パッド３の列間に電源ライン４
と接地ライン５とが前後段に並列に延在し、この前段電
源ライン４の両端に電源用パッド６を設け、この電源用
パッド６を上記前段信号用パッド２の左右列端に配する
と共に、上記接地ライン５の両端に接地用パッド７を設
け、この接地用パッド７を上記後段信号用パッド３の左
右列端に配している。
【０００３】上記各パッド２，３，６，７と各ライン
４，５はメモリー用ＩＣとの関係から相互に非常に接近
して配され細い絶縁ライン８を介し隔絶されている。そ
してカードの挿入時に各パッド２，３，６，７の表面に
カード挿抜方向に延在するバネ性を有する前段信号用コ
ンタクト９と後段信号用コンタクト１０と電源用コンタ
クト１１と接地用コンタクト１２が弾力的に加圧接触を
開始し、この加圧接触後カードが更に若干量挿入されて
各パッドがコンタクトの上記加圧接触を保ちつつ若干量
摺動し電子機器内情報処理回路と電源回路と接地回路に
接続されるようになっている。
４，５はメモリー用ＩＣとの関係から相互に非常に接近
して配され細い絶縁ライン８を介し隔絶されている。そ
してカードの挿入時に各パッド２，３，６，７の表面に
カード挿抜方向に延在するバネ性を有する前段信号用コ
ンタクト９と後段信号用コンタクト１０と電源用コンタ
クト１１と接地用コンタクト１２が弾力的に加圧接触を
開始し、この加圧接触後カードが更に若干量挿入されて
各パッドがコンタクトの上記加圧接触を保ちつつ若干量
摺動し電子機器内情報処理回路と電源回路と接地回路に
接続されるようになっている。
【０００４】同様にカード１の抜去時においても、各パ
ッドは上記各コンタクト９乃至１２との加圧接触を保ち
ながら上記カード挿入時とは逆方向に摺動し、パッド及
びカードから離間する。
ッドは上記各コンタクト９乃至１２との加圧接触を保ち
ながら上記カード挿入時とは逆方向に摺動し、パッド及
びカードから離間する。
【０００５】
【発明が解決しようとする課題】而して、図２に示すよ
うに上記パッド配置のメモリーカードにおいては、カー
ド１の例えば抜去時に後段信号用コンタクト１０が後段
信号用パッド３の表面を相対的に摺動する過程で、電源
用パッド６に電源用コンタクト１１がまだ接している状
態で、前段又は後段信号用パッド２，３から各信号用コ
ンタクト９又は１０が外れるから、ＩＣメモリーカード
１内のＩＣ或いは電子機器内ＩＣの破損と、カード内メ
モリー用ＩＣにおける誤書き込みや誤消去の誤動作が生
ずる可能性がある。即ち、電源が供給されている状態
で、メモリーの制御信号ピンの入力レベルが不定となる
ので、バスライン上でのデータの衝突や、ノイズによっ
て所望でないコマンドが取り込まれる等の原因により誤
書き込みや誤消去の誤動作が生ずる可能性がある。
うに上記パッド配置のメモリーカードにおいては、カー
ド１の例えば抜去時に後段信号用コンタクト１０が後段
信号用パッド３の表面を相対的に摺動する過程で、電源
用パッド６に電源用コンタクト１１がまだ接している状
態で、前段又は後段信号用パッド２，３から各信号用コ
ンタクト９又は１０が外れるから、ＩＣメモリーカード
１内のＩＣ或いは電子機器内ＩＣの破損と、カード内メ
モリー用ＩＣにおける誤書き込みや誤消去の誤動作が生
ずる可能性がある。即ち、電源が供給されている状態
で、メモリーの制御信号ピンの入力レベルが不定となる
ので、バスライン上でのデータの衝突や、ノイズによっ
て所望でないコマンドが取り込まれる等の原因により誤
書き込みや誤消去の誤動作が生ずる可能性がある。
【０００６】更に、ＩＣメモリーカードを挿入して使用
している時に、誤って抜去してしまった場合、カード内
ＩＣに書込みされたメモリー情報も消去してしまう問題
を生ずる。
している時に、誤って抜去してしまった場合、カード内
ＩＣに書込みされたメモリー情報も消去してしまう問題
を生ずる。
【０００７】本発明は上記ＩＣメモリーカードにおける
上記問題を有効に解消し、同カードを適切に使用できる
ようにしたものである。
上記問題を有効に解消し、同カードを適切に使用できる
ようにしたものである。
【０００８】
【課題を解決するための手段】本発明は上記目的を達成
する手段として、上記した構造のメモリーカードにおい
て、上記後段信号用パッドに対する後段信号用コンタク
トの接触位置から同パッド前端までの摺動寸法Ｓ１と上
記電源用パッドに対する電源用コンタクトの接触位置か
ら同パッド前端までの摺動寸法Ｓ２とをＳ１＞Ｓ２の関
係となるように設定し、カード挿抜時に上記ＩＣ破壊と
誤動作を生ずる問題を有効に防止する構成としたもので
ある。
する手段として、上記した構造のメモリーカードにおい
て、上記後段信号用パッドに対する後段信号用コンタク
トの接触位置から同パッド前端までの摺動寸法Ｓ１と上
記電源用パッドに対する電源用コンタクトの接触位置か
ら同パッド前端までの摺動寸法Ｓ２とをＳ１＞Ｓ２の関
係となるように設定し、カード挿抜時に上記ＩＣ破壊と
誤動作を生ずる問題を有効に防止する構成としたもので
ある。
【０００９】同様に、上記摺動寸法Ｓ２と上記前段信号
用パッドに対する前段信号用コンタクトの接触位置から
同パッド前端までの摺動寸法Ｓ３とをＳ２＜Ｓ３の関係
となるよう設定し、前段信号用コンタクトが電源用コン
タクトより遅れて開となることにより、上記電子機器内
情報処理回路の誤動作を適切に防止するようにしたもの
である。
用パッドに対する前段信号用コンタクトの接触位置から
同パッド前端までの摺動寸法Ｓ３とをＳ２＜Ｓ３の関係
となるよう設定し、前段信号用コンタクトが電源用コン
タクトより遅れて開となることにより、上記電子機器内
情報処理回路の誤動作を適切に防止するようにしたもの
である。
【００１０】更に本発明は上記カードの挿抜と連動して
開又は閉状態となるメモリー保存用スイッチを設け、該
メモリー保存用スイッチを上記電源用パッドと電源用コ
ンタクトの接触解除より先行して開又は閉となる関係に
配置し、該メモリー保存用スイッチの開又は閉の信号を
トリガーとして電子機器内の情報処理回路がカードに書
き込みされたメモリー情報の保存動作を実行する構成と
して、不用意なカード抜去に伴なうカード内メモリー情
報の消去を適切に防止するようにしたものである。
開又は閉状態となるメモリー保存用スイッチを設け、該
メモリー保存用スイッチを上記電源用パッドと電源用コ
ンタクトの接触解除より先行して開又は閉となる関係に
配置し、該メモリー保存用スイッチの開又は閉の信号を
トリガーとして電子機器内の情報処理回路がカードに書
き込みされたメモリー情報の保存動作を実行する構成と
して、不用意なカード抜去に伴なうカード内メモリー情
報の消去を適切に防止するようにしたものである。
【００１１】
【発明の実施の形態】ＩＣメモリーカードは図３に示す
通り、図１において説明したと同様のカード１内にメモ
リー用ＩＣを内蔵し、該ＩＣの外部接点としてカード１
の表面に図１に基づいて説明した配置の前後信号用パッ
ド２と後段信号用パッド３と電源ライン４と接地ライン
５と電源用パッド６と接地用パッド７とを有し、各パッ
ド間と各ライン間、並びに前後段信号用パッド２，３と
各ライン間は細い絶縁ライン８によって隔絶されてい
る。
通り、図１において説明したと同様のカード１内にメモ
リー用ＩＣを内蔵し、該ＩＣの外部接点としてカード１
の表面に図１に基づいて説明した配置の前後信号用パッ
ド２と後段信号用パッド３と電源ライン４と接地ライン
５と電源用パッド６と接地用パッド７とを有し、各パッ
ド間と各ライン間、並びに前後段信号用パッド２，３と
各ライン間は細い絶縁ライン８によって隔絶されてい
る。
【００１２】上記ＩＣメモリーカード１は図７に示すよ
うに電子機器の受口内に直に挿入されて、機器内に設け
られた前記各パッドに対応する前段信号用コンタクト９
と後段信号用コンタクト１０と電源用コンタクト１１と
接地用コンタクト１２を介して電子機器内情報処理回路
に接続されるか、又はカード挿入用受口を持った図８に
示す如き専用の薄平形ケース（カードコネクタ１９）内
に挿入されて該ケース内に設けられた各コンタクト９乃
至１２と接触し、このケースを電子機器の受口に挿入す
ることによって上記コンタクト９乃至１２を機器内コネ
クタに接続し、同機器内情報処理回路と接続される。
うに電子機器の受口内に直に挿入されて、機器内に設け
られた前記各パッドに対応する前段信号用コンタクト９
と後段信号用コンタクト１０と電源用コンタクト１１と
接地用コンタクト１２を介して電子機器内情報処理回路
に接続されるか、又はカード挿入用受口を持った図８に
示す如き専用の薄平形ケース（カードコネクタ１９）内
に挿入されて該ケース内に設けられた各コンタクト９乃
至１２と接触し、このケースを電子機器の受口に挿入す
ることによって上記コンタクト９乃至１２を機器内コネ
クタに接続し、同機器内情報処理回路と接続される。
【００１３】即ち、何れの場合も、カードを電子機器に
挿入した時に上記各パッド２，３，６，７に前記各コン
タクト９乃至１２を加圧接触させることにより、カード
内蔵のメモリー用ＩＣをこれら電子機器内情報処理回路
に接続し、カード内メモリー用ＩＣが保有する情報を電
子機器内情報処理回路に与え、又は電子機器内情報処理
回路が保有する情報をカード内蔵のメモリー用ＩＣに記
録する方法が行なわれている。
挿入した時に上記各パッド２，３，６，７に前記各コン
タクト９乃至１２を加圧接触させることにより、カード
内蔵のメモリー用ＩＣをこれら電子機器内情報処理回路
に接続し、カード内メモリー用ＩＣが保有する情報を電
子機器内情報処理回路に与え、又は電子機器内情報処理
回路が保有する情報をカード内蔵のメモリー用ＩＣに記
録する方法が行なわれている。
【００１４】コンタクト９乃至１２は金属板から打抜き
曲げ加工された導電条片から成り、その一端側に弾性条
片を有し、該弾性条片の自由端に上記カード１のパッド
２，３，６，７へ弾接する接触突部１３を有し、更に他
端側に情報処理回路の一部又は全部を形成する配線基板
とハンダ付け等にて接続される端子片を有する。該コン
タクト９乃至１２を上記カード１の往復動方向に延在し
且つ該往復動方向と直交する方向に多数並設する。
曲げ加工された導電条片から成り、その一端側に弾性条
片を有し、該弾性条片の自由端に上記カード１のパッド
２，３，６，７へ弾接する接触突部１３を有し、更に他
端側に情報処理回路の一部又は全部を形成する配線基板
とハンダ付け等にて接続される端子片を有する。該コン
タクト９乃至１２を上記カード１の往復動方向に延在し
且つ該往復動方向と直交する方向に多数並設する。
【００１５】上記カード１は図７Ａ、Ｂ、Ｃに示すよう
に電子機器内の受口へ挿入すると、該受口に設けられた
コンタクト９，１０，１１，１２の接触突部１３がカー
ド前縁からパッドに至るカード表面を摺動しつつ挿入端
において該パッド２，３，６，７と加圧接触する。
に電子機器内の受口へ挿入すると、該受口に設けられた
コンタクト９，１０，１１，１２の接触突部１３がカー
ド前縁からパッドに至るカード表面を摺動しつつ挿入端
において該パッド２，３，６，７と加圧接触する。
【００１６】又図８に示す如きコンタクトの開閉を制御
するスライダー１８を用いる場合について説明すると、
上記スライダー１８はそのコンタクトと対向する裏面側
に往復動方向に延在し且つ往復動方向と直交する方向に
多数並設されたコンタクトガイド溝１４を有し、該コン
タクトガイド溝１４内に上記接触突部１３を受け入れて
位置を規制しつつ往復動し、往動の終端付近に設けた上
記貫通孔１５において、接触突部１３を解放しコンタク
トの弾性条片の復元力にて上記カード１の各パッドへ弾
接せしめる。
するスライダー１８を用いる場合について説明すると、
上記スライダー１８はそのコンタクトと対向する裏面側
に往復動方向に延在し且つ往復動方向と直交する方向に
多数並設されたコンタクトガイド溝１４を有し、該コン
タクトガイド溝１４内に上記接触突部１３を受け入れて
位置を規制しつつ往復動し、往動の終端付近に設けた上
記貫通孔１５において、接触突部１３を解放しコンタク
トの弾性条片の復元力にて上記カード１の各パッドへ弾
接せしめる。
【００１７】上記スライダー１８はカード１を受け入れ
て位置規制するカードトレーとして兼用され、カード１
の側縁を規制する脇定規１６とカード１の前端が当接す
る前当て１７を有し、該脇定規１６と前当て１７にて画
成されたスペース内にカード１を挿入し、カード前縁を
上記前当て１７に当接してカード挿入に追随するスライ
ダー１８の往動を得るようにし、又逆にスライダー１８
の復動によってカード１の抜去を行なうようにしてい
る。
て位置規制するカードトレーとして兼用され、カード１
の側縁を規制する脇定規１６とカード１の前端が当接す
る前当て１７を有し、該脇定規１６と前当て１７にて画
成されたスペース内にカード１を挿入し、カード前縁を
上記前当て１７に当接してカード挿入に追随するスライ
ダー１８の往動を得るようにし、又逆にスライダー１８
の復動によってカード１の抜去を行なうようにしてい
る。
【００１８】上記スライダー１８の復動はバネ手段にて
行なうか、又はイジェクト操作機構にて復動し上記カー
ド抜去と接触解除とを行なうようにする。
行なうか、又はイジェクト操作機構にて復動し上記カー
ド抜去と接触解除とを行なうようにする。
【００１９】而して図８Ａに示すように、カード１を挿
入するとカード前端が前当て１７を押しスライダー１８
を共に往動せしめる。この往動によりコンタクト９乃至
１１の接触突部１３がコンタクトガイド溝１４の底面に
弾接しつつ摺動し、図８Ｂに示すように、往動端の貫通
孔１５において弾性復元しカード１のパッド２，３，
６，７に加圧接触を開始し、図８Ｃに示すように、カー
ド１及びスライダー１８はこの加圧接触開始位置から更
に若干量往動されて、パッド２，３，６，７は上記加圧
接触状態を保ちながら若干量摺動する。
入するとカード前端が前当て１７を押しスライダー１８
を共に往動せしめる。この往動によりコンタクト９乃至
１１の接触突部１３がコンタクトガイド溝１４の底面に
弾接しつつ摺動し、図８Ｂに示すように、往動端の貫通
孔１５において弾性復元しカード１のパッド２，３，
６，７に加圧接触を開始し、図８Ｃに示すように、カー
ド１及びスライダー１８はこの加圧接触開始位置から更
に若干量往動されて、パッド２，３，６，７は上記加圧
接触状態を保ちながら若干量摺動する。
【００２０】同様にカード１を抜去すべくスライダー１
８を復動すると、コンタクトの接触突部１３は上記とは
逆の経過をたどり、各パッドは上記各コンタクト９乃至
１２との加圧接触を保ちながら上記カード挿入時とは逆
方向に摺動し、摺動端（カード挿入時における上記加圧
接触開始点）にてパッド及びカードから弾力に抗して離
間し、再びコンタクトガイド溝１４の底面に弾接しつつ
摺動するように制御される。
８を復動すると、コンタクトの接触突部１３は上記とは
逆の経過をたどり、各パッドは上記各コンタクト９乃至
１２との加圧接触を保ちながら上記カード挿入時とは逆
方向に摺動し、摺動端（カード挿入時における上記加圧
接触開始点）にてパッド及びカードから弾力に抗して離
間し、再びコンタクトガイド溝１４の底面に弾接しつつ
摺動するように制御される。
【００２１】而して、本発明においては以上説明したカ
ードとコンタクトの接触構造において、図３に示すよう
に、前記後段信号用パッド３に対する後段信号用コンタ
クト１０の接触位置から同パッド前端縁までの摺動寸法
Ｓ１と、上記電源用パッド６に対する電源用コンタクト
１１の接触位置から同パッド前端縁までの摺動寸法Ｓ２
とをＳ１＞Ｓ２の関係となるように設定したＩＣメモリ
ーカードにおける保護装置を構成したものである。Ｓ１
＞Ｓ２の関係は全ての後段信号用パッド３について成り
立つ。
ードとコンタクトの接触構造において、図３に示すよう
に、前記後段信号用パッド３に対する後段信号用コンタ
クト１０の接触位置から同パッド前端縁までの摺動寸法
Ｓ１と、上記電源用パッド６に対する電源用コンタクト
１１の接触位置から同パッド前端縁までの摺動寸法Ｓ２
とをＳ１＞Ｓ２の関係となるように設定したＩＣメモリ
ーカードにおける保護装置を構成したものである。Ｓ１
＞Ｓ２の関係は全ての後段信号用パッド３について成り
立つ。
【００２２】又上記摺動寸法Ｓ２と上記前段信号用パッ
ド２に対する前段信号用コンタクト９の接触位置から同
パッド前端縁までの摺動寸法Ｓ３とを、Ｓ２＜Ｓ３の関
係となるように設定したＩＣメモリーカードにおける保
護装置を構成したものである。
ド２に対する前段信号用コンタクト９の接触位置から同
パッド前端縁までの摺動寸法Ｓ３とを、Ｓ２＜Ｓ３の関
係となるように設定したＩＣメモリーカードにおける保
護装置を構成したものである。
【００２３】上記保護装置はＳ１，Ｓ３＞Ｓ２の関係を
有している。上記構成により、カード抜去時には電源用
コンタクト１１が電源用パッド１６から離脱しても、信
号用コンタクト９，１０が信号用パッド２，３に接触し
ているので、又カード挿入時には電源用コンタクト１１
が電源用パッド６に接触する前に、信号用コンタクト
９，１０が信号用パッド２，３に接触するので、メモリ
ー用ＩＣの制御信号入力パッド２又は３が非活性な状態
に保たれメモリー用ＩＣの誤動作を防止し、更にＩＣ損
傷を未然に防止する。
有している。上記構成により、カード抜去時には電源用
コンタクト１１が電源用パッド１６から離脱しても、信
号用コンタクト９，１０が信号用パッド２，３に接触し
ているので、又カード挿入時には電源用コンタクト１１
が電源用パッド６に接触する前に、信号用コンタクト
９，１０が信号用パッド２，３に接触するので、メモリ
ー用ＩＣの制御信号入力パッド２又は３が非活性な状態
に保たれメモリー用ＩＣの誤動作を防止し、更にＩＣ損
傷を未然に防止する。
【００２４】即ち、メモリーに電源が供給されている間
は、必らず制御信号ピンが接触していることが保証され
るので、この制御信号ピンを非活性状態に保つことによ
りバスライン上でのデータの衝突や、ノイズによって所
望でないコマンドが取り込まれる等の現象が完全に防止
できるため、誤動作を有効に解消できる。
は、必らず制御信号ピンが接触していることが保証され
るので、この制御信号ピンを非活性状態に保つことによ
りバスライン上でのデータの衝突や、ノイズによって所
望でないコマンドが取り込まれる等の現象が完全に防止
できるため、誤動作を有効に解消できる。
【００２５】又前段と後段の信号用コンタクト９，１０
とパッド２，３との接触を解除する前に、電源用コンタ
クト１１とパッド６との接触を先行して解除し、これを
トリガーとして機器内保護回路を起動しカード内蔵メモ
リー用ＩＣと情報の保護を図る手段とすることができ
る。又はこれにより電子機器内情報処理回路の誤動作を
適切に防止する手段とする。
とパッド２，３との接触を解除する前に、電源用コンタ
クト１１とパッド６との接触を先行して解除し、これを
トリガーとして機器内保護回路を起動しカード内蔵メモ
リー用ＩＣと情報の保護を図る手段とすることができ
る。又はこれにより電子機器内情報処理回路の誤動作を
適切に防止する手段とする。
【００２６】又他例として、図５、図６に示すように、
上記後段信号用パッド３に対する後段信号用コンタクト
１０の接触位置から同パッド前端縁までの摺動寸法Ｓ１
と、上記電源用パッド６に対する電源用コンタクト１１
の接触位置から同パッド前端縁までの摺動寸法Ｓ２と
を、Ｓ１＞Ｓ２の関係となるように設定し、又は上記摺
動寸法Ｓ２と上記前段信号用パッド２に対する前段信号
用コンタクト９の接触位置から同パッド前端縁までの摺
動寸法Ｓ３とをＳ２＜Ｓ３の関係となるようにして、Ｓ
１，Ｓ３＞Ｓ２の関係に設定すると共に、上記カード１
の挿抜と連動して開又は閉状態となるメモリー保存用ス
イッチ２０を設け、該メモリー保存用スイッチ２０を上
記電源用パッド６と電源用コンタクト１１の接触解除よ
り先行して開又は閉となる関係に配置し、該メモリー保
存用スイッチ２０の開又は閉の信号をトリガーとしてカ
ード１が挿入された電子機器内の情報処理回路がカード
に書き込みされたメモリー情報の保存動作を実行する構
成としたＩＣメモリーカードにおける保護装置を構成し
たものである。
上記後段信号用パッド３に対する後段信号用コンタクト
１０の接触位置から同パッド前端縁までの摺動寸法Ｓ１
と、上記電源用パッド６に対する電源用コンタクト１１
の接触位置から同パッド前端縁までの摺動寸法Ｓ２と
を、Ｓ１＞Ｓ２の関係となるように設定し、又は上記摺
動寸法Ｓ２と上記前段信号用パッド２に対する前段信号
用コンタクト９の接触位置から同パッド前端縁までの摺
動寸法Ｓ３とをＳ２＜Ｓ３の関係となるようにして、Ｓ
１，Ｓ３＞Ｓ２の関係に設定すると共に、上記カード１
の挿抜と連動して開又は閉状態となるメモリー保存用ス
イッチ２０を設け、該メモリー保存用スイッチ２０を上
記電源用パッド６と電源用コンタクト１１の接触解除よ
り先行して開又は閉となる関係に配置し、該メモリー保
存用スイッチ２０の開又は閉の信号をトリガーとしてカ
ード１が挿入された電子機器内の情報処理回路がカード
に書き込みされたメモリー情報の保存動作を実行する構
成としたＩＣメモリーカードにおける保護装置を構成し
たものである。
【００２７】上記メモリー保存用スイッチ２０はカード
前縁への当接によって開閉が制御され、カード挿入時に
はカード挿入を検出して機器内情報処理回路（ＣＰＵ）
へのアクセス可能な状態を形成するスイッチとして兼用
している。
前縁への当接によって開閉が制御され、カード挿入時に
はカード挿入を検出して機器内情報処理回路（ＣＰＵ）
へのアクセス可能な状態を形成するスイッチとして兼用
している。
【００２８】この例においては、前記図３、図４に示す
作用効果を得ながら、ＩＣメモリーカード１を使用中に
抜去した場合の、カード内蔵メモリー用ＩＣにおける記
録情報が誤消去されたり誤書き込みされる事態を有効に
防止することができる。
作用効果を得ながら、ＩＣメモリーカード１を使用中に
抜去した場合の、カード内蔵メモリー用ＩＣにおける記
録情報が誤消去されたり誤書き込みされる事態を有効に
防止することができる。
【００２９】
【発明の効果】本発明によれば、ＩＣメモリーカードを
電子機器内に挿入し、情報の授受を行なう場合におけ
る、カードを挿抜する際のカード内蔵のメモリー用ＩＣ
の保護、該ＩＣへの誤書き込み又は誤消去が確実に防止
され、又カード挿抜時における誤動作が的確に防止でき
る。
電子機器内に挿入し、情報の授受を行なう場合におけ
る、カードを挿抜する際のカード内蔵のメモリー用ＩＣ
の保護、該ＩＣへの誤書き込み又は誤消去が確実に防止
され、又カード挿抜時における誤動作が的確に防止でき
る。
【００３０】又上記目的が信号用と電源用パッドと各コ
ンタクトの接触解除タイミングを設定する簡素な構成に
て有効に達成でき、高密度配置されたパッドとコンタク
トにおける保護装置として極めて有用である。
ンタクトの接触解除タイミングを設定する簡素な構成に
て有効に達成でき、高密度配置されたパッドとコンタク
トにおける保護装置として極めて有用である。
【図１】本発明の改善対象となるＩＣメモリーカードと
コンタクトの接触構造を、カード完挿状態を以って示す
概略平面図である。
コンタクトの接触構造を、カード完挿状態を以って示す
概略平面図である。
【図２】同接触構造を、カード抜去過程を以って示す概
略平面図である。
略平面図である。
【図３】本発明を例示するＩＣメモリーカードとコンタ
クトの接触構造を、カード完挿状態を以って示す概略平
面図である。
クトの接触構造を、カード完挿状態を以って示す概略平
面図である。
【図４】同接触構造を、カード抜去過程を以って示す概
略平面図である。
略平面図である。
【図５】本発明の他例を示すＩＣメモリーカードとコン
タクトの接触構造を、カード完挿状態を以って示す概略
平面図である。
タクトの接触構造を、カード完挿状態を以って示す概略
平面図である。
【図６】同接触構造を、カード抜去過程を以って示す概
略平面図である。
略平面図である。
【図７】Ａ，Ｂ，ＣはＩＣメモリーカードとコンタクト
の接触動作をカード挿入の進行に従い分説する断面図で
ある。
の接触動作をカード挿入の進行に従い分説する断面図で
ある。
【図８】Ａ，Ｂ，ＣはＩＣメモリーカードとコンタクト
とをスライダーを用いて開閉する例をカード挿入動作の
進行に従い分説する断面図である。
とをスライダーを用いて開閉する例をカード挿入動作の
進行に従い分説する断面図である。
１ ＩＣメモリーカード ２ 前段信号用パッド ３ 後段信号用パッド ４ 電源ライン ５ 接地ライン ６ 電源用パッド ７ 接地用パッド ８ 絶縁ライン ９ 前段信号用コンタクト １０ 後段信号用コンタクト １１ 電源用コンタクト １２ 接地用コンタクト ２０ メモリー保存用スイッチ Ｓ１，Ｓ２，Ｓ３ 開閉タイミングを示す寸法
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.6 識別記号 庁内整理番号 ＦＩ 技術表示箇所 Ｈ０１Ｒ 23/68 Ｇ０６Ｋ 19/00 Ｍ (72)発明者 田中 義幸 神奈川県横浜市栄区笠間町1000−１ 株式 会社東芝半導体システム技術センター（大 船分室内) (72)発明者 西村 武士 東京都大田区中馬込３丁目28番７号 山一 電機株式会社内
Claims (3)
- 【請求項１】ＩＣメモリーカードの表面に多数の信号用
パッドが前後段に並列して配置され、前段信号用パッド
の列と後段信号用パッドの列間に電源ラインと接地ライ
ンとが前後段に並行に延在し、前段電源ラインの端部に
電源用パッドが、後段接地ラインの端部に接地用パッド
が夫々設けられ、カード挿入時に各パッドをコンタクト
を介して電子機器へ接続するようにしたＩＣメモリーカ
ードにおいて、上記後段信号用パッドに対する後段信号
用コンタクトの接触位置から同パッド前端縁までの摺動
寸法Ｓ１と上記電源用パッドに対する電源用コンタクト
の接触位置から同パッド前端縁までの摺動寸法Ｓ２とを
Ｓ１＞Ｓ２の関係となるように設定したことを特徴とす
るＩＣメモリーカードにおける保護装置。 - 【請求項２】上記摺動寸法Ｓ２と上記前段信号用パッド
に対する前段信号用コンタクトの接触位置から同パッド
前端縁までの摺動寸法Ｓ３とをＳ２＜Ｓ３の関係となる
ように設定したことを特徴とする請求項１記載のＩＣメ
モリーカードにおける保護装置。 - 【請求項３】ＩＣメモリーカードの表面に多数の信号用
パッドが前後段に並列して配置され、前段信号用パッド
の列と後段信号用パッドの列間に電源ラインと接地ライ
ンとが前後段に並行に延在し、前段電源ラインの端部に
電源用パッドが、後段接地ラインの端部に接地用パッド
が夫々設けられ、カード挿入時に各パッドをコンタクト
を介して電子機器へ接続するようにしたＩＣメモリーカ
ードにおいて、上記後段信号用パッドに対する後段信号
用コンタクトの接触位置から同パッド前端縁までの摺動
寸法Ｓ１と上記電源用パッドに対する電源用コンタクト
の接触位置から同パッド前端縁までの摺動寸法Ｓ２とを
Ｓ１＞Ｓ２の関係となるように設定し、更に上記カード
の挿抜と連動して開又は閉状態となるメモリー保存用ス
イッチを設け、該メモリー保存用スイッチを上記電源用
パッドと電源用コンタクトの接触解除より先行して開又
は閉となる関係に配置し、該メモリー保存用スイッチの
開又は閉の信号をトリガーとしてカードが挿入された電
子機器内の情報処理回路がカードに書き込みされたメモ
リー情報の保存動作を実行する構成としたことを特徴と
するＩＣメモリーカードにおける保護装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8204509A JP2843306B2 (ja) | 1996-08-02 | 1996-08-02 | Ｉｃメモリーカードにおける保護装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8204509A JP2843306B2 (ja) | 1996-08-02 | 1996-08-02 | Ｉｃメモリーカードにおける保護装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH1049644A true JPH1049644A (ja) | 1998-02-20 |
| JP2843306B2 JP2843306B2 (ja) | 1999-01-06 |
Family
ID=16491713
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8204509A Expired - Fee Related JP2843306B2 (ja) | 1996-08-02 | 1996-08-02 | Ｉｃメモリーカードにおける保護装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2843306B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0896280A3 (en) * | 1997-08-08 | 2004-05-12 | Kabushiki Kaisha Toshiba | Method for controlling nonvolatile semiconductor memory system |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP5533028B2 (ja) | 2009-04-01 | 2014-06-25 | 山一電機株式会社 | Ｉｃカード用コネクタ |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5261761A (en) * | 1975-11-17 | 1977-05-21 | Yokogawa Electric Works Ltd | Printed circuit board unit |
| JPH0458480A (ja) * | 1990-06-25 | 1992-02-25 | Oki Electric Ind Co Ltd | 活線挿抜装置 |
| JPH0890969A (ja) * | 1994-09-22 | 1996-04-09 | Yamaichi Electron Co Ltd | メモリカード |
-
1996
- 1996-08-02 JP JP8204509A patent/JP2843306B2/ja not_active Expired - Fee Related
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5261761A (en) * | 1975-11-17 | 1977-05-21 | Yokogawa Electric Works Ltd | Printed circuit board unit |
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| JPH0890969A (ja) * | 1994-09-22 | 1996-04-09 | Yamaichi Electron Co Ltd | メモリカード |
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0896280A3 (en) * | 1997-08-08 | 2004-05-12 | Kabushiki Kaisha Toshiba | Method for controlling nonvolatile semiconductor memory system |
| US8230156B2 (en) | 1997-08-08 | 2012-07-24 | Kabushiki Kaisha Toshiba | Method for controlling non-volatile semiconductor memory system |
| US8756401B2 (en) | 1997-08-08 | 2014-06-17 | Kabushiki Kaisha Toshiba | Method for controlling non-volatile semiconductor memory system |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2843306B2 (ja) | 1999-01-06 |
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