JPH1097111A - Registration clutch control device - Google Patents
Registration clutch control deviceInfo
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- JPH1097111A JPH1097111A JP8269295A JP26929596A JPH1097111A JP H1097111 A JPH1097111 A JP H1097111A JP 8269295 A JP8269295 A JP 8269295A JP 26929596 A JP26929596 A JP 26929596A JP H1097111 A JPH1097111 A JP H1097111A
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- clutch
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- registration clutch
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Abstract
(57)【要約】
【課題】 制御用マイコンの処理時間の影響なしに、レ
ジストクラッチの0N−OFF制御を行なうレジストク
ラッチ制御装置を提供する。
【解決手段】 予めマイコンでオフセットレジスタ9
a、9bに、遷移検出器6の原稿先端信号の検出からレ
ジストクラッチのONまでの時間、レジストクラッチの
ONからOFFまでの時間がそれぞれ記録され、遷移検
出器6の検出でキャプチャレジスタ13がタイマカウン
トレジスタ8の出力値を取込み、モード設定器12で制
御モードが設定され、オフセット選択器10が、設定モ
ードでオフセットレジスタ9a、9bの記録時間の何れ
かを選択し、出力ラッチ回路17が、キャプチャレジス
タ13、オフセット選択器10、タイマカウントレジス
タ8の出力値で、クラッチ制御信号を出力し、モード検
出ラッチ回路19がモードをマイコンに通報し、レジス
トクラッチの0N−0FFがマイコンの処理の影響なし
に高精度で行なわれる。
(57) Abstract: Provided is a registration clutch control device that performs 0N-OFF control of a registration clutch without affecting processing time of a control microcomputer. SOLUTION: An offset register 9 is previously set by a microcomputer.
The time from the detection of the leading edge signal of the transition detector 6 to the ON of the registration clutch and the time from the ON to the OFF of the registration clutch are recorded in a and 9b, respectively. The output value of the count register 8 is fetched, the control mode is set by the mode setting device 12, the offset selector 10 selects one of the recording times of the offset registers 9a and 9b in the setting mode, and the output latch circuit 17 A clutch control signal is output based on the output values of the capture register 13, the offset selector 10, and the timer count register 8, the mode detection latch circuit 19 notifies the microcomputer of the mode, and the register clutch 0N-0FF influences the processing of the microcomputer. Done with high precision without.
Description
【0001】[0001]
【発明の属する技術分野】本発明は、画像形成装置に組
込み使用され、レジストクラッチをON−OFFして転
写紙の搬送を制御するレジストクラッチ制御装置に関す
る。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a registration clutch control device which is incorporated in an image forming apparatus and controls the transfer of a transfer sheet by turning a registration clutch on and off.
【0002】[0002]
【従来の技術】複写機などの画像形成装置には、転写紙
の画像形成ユニットへの搬送を行なうレジストローラを
駆動するレジストクラッチをON−OFF制御するレジ
ストクラッチ制御装置が組み込まれており、制御用のマ
イコンの割り込みによって、ワンショツトタイマがセッ
トされ、検知センサが原稿を検知後第1の所定時間の経
過で、レジストクラッチ制御装置が、レジストクラッチ
をON制御してレジストローラが駆動され、転写紙の画
像形成ユニットへの搬送が開始され、検知センサの原稿
の検知後第2の所定時間の経過で、レジストクラッチ制
御装置が、レジストクラッチをOFF制御してレジスト
ローラが次の転写紙に対応して停止する。2. Description of the Related Art An image forming apparatus such as a copying machine has a built-in registration clutch control device for ON / OFF controlling a registration clutch for driving a registration roller for conveying a transfer sheet to an image forming unit. A one-shot timer is set by an interrupt of the microcomputer for use, and after a first predetermined time elapses after the detection sensor detects the document, the registration clutch control device controls the registration clutch to ON to drive the registration roller and transfer the image. The conveyance of the paper to the image forming unit is started, and after a lapse of a second predetermined time after the detection of the document by the detection sensor, the registration clutch control device controls the registration clutch to be turned OFF, and the registration roller corresponds to the next transfer paper And stop.
【0003】[0003]
【発明が解決しようとする課題】しかし、レジストクラ
ッチ制御装置を制御しているマイコンは、画像形成装置
全体の制御を行なっているので、マイコン側での処理が
錯綜して、原稿の検知信号を受信してからワンショット
タイマをセットするまでに時間がかかったり、ワンショ
ットタイマからの割込み信号を受信してからレジストク
ラッチを0FF制御するまでに時間がかかり、レジスト
クラッチのOFF制御のタイミングが遅延することがあ
る。However, since the microcomputer that controls the registration clutch control device controls the entire image forming apparatus, the processing on the microcomputer side is complicated, and the detection signal of the original is generated. It takes time to set the one-shot timer after receiving, or it takes time to control the registration clutch to 0FF after receiving the interrupt signal from the one-shot timer, delaying the registration clutch OFF control timing. May be.
【0004】このように、マイコン側での処理の錯綜に
より、ワンショットタイマのセット時間や、ワンショッ
トタイマからの割込み信号の受信からレジストクラッチ
の制御までの時間が遅延すると、画像形成ユニットでの
作像動作と転写紙の搬入との同期が取れず、位置ずれの
ある画像が形成されることがある。As described above, if the setting time of the one-shot timer or the time from the reception of the interrupt signal from the one-shot timer to the control of the registration clutch is delayed due to the complicated processing on the microcomputer side, the image forming unit will Synchronization between the image forming operation and transfer-in of the transfer paper may not be achieved, and an image with a positional shift may be formed.
【0005】本発明は、前述したような画像形成装置で
のレジストクラッチ制御の現状に鑑みてなされたもので
あり、その目的は、制御用マイコンの処理時間の影響を
受けずに、レジストクラッチの0N−OFF制御を行な
うことが可能なレジストクラッチ制御装置を提供するこ
とにある。The present invention has been made in view of the current state of registration clutch control in an image forming apparatus as described above, and has as its object the purpose of controlling the registration clutch without being affected by the processing time of a control microcomputer. An object of the present invention is to provide a registration clutch control device capable of performing 0N-OFF control.
【0006】[0006]
【課題を解決するための手段】前記目的を達成するため
に、請求項1記載の発明は、画像形成装置に組込み使用
され、マイコンからの信号に基づいて、クラッチ制御信
号を出力し、レジストクラッチをON−OFFすること
により転写紙の画像形成ユニットへの搬送を制御するレ
ジストクラッチ制御装置であり、基準クロックをカウン
トするタイマカウントレジスタと、原稿読取りユニット
からの原稿先端信号を検出する遷移検出器と、該遷移検
出器による前記原稿先端信号の検出から、前記レジスト
クラッチをONするまでの時間が記録される第1のオフ
セットレジスタと、前記レジストクラッチをONしてか
らOFFするまでの時間が記録される第2のオフセット
レジスタと、前記遷移検出器による前記原稿先端信号の
検出に基づいて、前記タイマカウントレジスタの出力値
を取込むキャプチャレジスタと、前記レジストクラッチ
の制御過程のモードを設定するモード設定器と、該モー
ド設定器が設定したモードに基づいて、前記第1のオフ
セットレジスタの記録時間と前記第2のオフセットレジ
スタの記録時間との何れかを選択出力するオフセット選
択器と前記キャプチャレジスタの出力値、前記オフセッ
ト選択器の出力値及び前記タイマカウントレジスタの出
力値に基づいて、前記レジストクラッチをON−OFF
する制御信号を保持出力するラッチ回路とを有すること
を特徴とするものである。According to a first aspect of the present invention, there is provided an image forming apparatus which is incorporated in an image forming apparatus and outputs a clutch control signal based on a signal from a microcomputer. Is a register clutch control device that controls the transfer of the transfer paper to the image forming unit by turning ON and OFF the timer, a timer count register that counts a reference clock, and a transition detector that detects a document leading edge signal from a document reading unit. A first offset register in which the time from the detection of the document leading edge signal by the transition detector until the registration clutch is turned on is recorded; and a time from the time the registration clutch is turned on to the time it is turned off is recorded. Based on the second offset register, based on the detection of the document leading edge signal by the transition detector, A capture register for capturing an output value of the timer count register, a mode setting device for setting a mode of the control process of the registration clutch, and recording of the first offset register based on the mode set by the mode setting device. An offset selector for selecting and outputting one of a time and a recording time of the second offset register, an output value of the capture register, an output value of the offset selector, and an output value of the timer count register. ON-OFF the resist clutch
And a latch circuit for holding and outputting a control signal to be output.
【0007】同様に前記目的を達成するために、請求項
2記載の発明は、請求項1記載の発明に対して、前記モ
ート設定器が設定するモードを検出するモード検出ラッ
チ回路が設けられていることを特徴とするものである。Similarly, in order to achieve the above object, a second aspect of the present invention is the same as the first aspect, except that a mode detection latch circuit for detecting a mode set by the mote setting device is provided. It is characterized by having.
【0008】[0008]
【発明の実施の形態】本発明の一実施の形態を、図1な
いし図4を参照して説明する。図1は本実施の形態の要
部の構成を示すブロック図、図2は図1のレジストクラ
ッチ制御装置の構成を示すブロック図、図3は本実施の
形態の前半動作を示すタイムチャート、図4は本実施の
形態の後半動作を示すタイムチャートである。DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS One embodiment of the present invention will be described with reference to FIGS. FIG. 1 is a block diagram showing a configuration of a main part of the present embodiment, FIG. 2 is a block diagram showing a configuration of a registration clutch control device of FIG. 1, and FIG. 3 is a time chart showing a first half operation of the present embodiment. 4 is a time chart showing the latter half operation of the present embodiment.
【0009】本実施の形態が組み込まれる画像形成装置
には、画像形成装置全体の制御を行なう制御用マイコン
1、原稿の読取りを行なう原稿読取り装置2、転写紙の
画像形成ユニットへの搬入を行なうレジストローラを駆
動するレジストクラッチの0N−0FF制御を行なうレ
ジストクラッチ制御装置3が設けられ、図1に示すよう
に、制御用マイコン1には、原稿読取り装置2とレジス
トクラッチ制御装置3とが接続され、原稿読取り装置2
の出力端子がレジストクラッチ制御装置3に接続され、
レジストクラッチ制御装置3には、レジストクラッチを
ON−OFF制御するドライバ4が接続され、ドライバ
4にはレジストクラッチ5が接続されている。An image forming apparatus incorporating this embodiment includes a control microcomputer 1 for controlling the entire image forming apparatus, a document reading device 2 for reading a document, and carrying a transfer sheet into the image forming unit. A registration clutch control device 3 for performing 0N-0FF control of a registration clutch for driving a registration roller is provided. As shown in FIG. 1, the control microcomputer 1 is connected to the document reading device 2 and the registration clutch control device 3. Document reading device 2
Is connected to the registration clutch control device 3,
A driver 4 that controls ON / OFF of the registration clutch is connected to the registration clutch control device 3, and a registration clutch 5 is connected to the driver 4.
【0010】レジストクラッチ制御装置3は、図2に示
すような構成を有し、制御用マイコン1からの初期化信
号に基づいて、セット/リセットのための信号を出力す
る初期化信号デコーダ11が、原稿読取り装置2からの
原稿先端信号を検出する遷移検出器6、レジストクラッ
チの制御過程のモードを設定するモード設定器12、及
びクラッチ制御信号を出力する出力ラッチ回路17に接
続されており、遷移検出器6にはOR回路7の一方の入
力端子と、遷移検知信号を出力する遷移検出ラッチ回路
18とが接続され、モード設定器12には、モード設定
器12で設定されるモードを検出するモード検出ラッチ
回路19が接続されている。The registration clutch control device 3 has a configuration as shown in FIG. 2, and an initialization signal decoder 11 for outputting a signal for set / reset based on an initialization signal from the control microcomputer 1. A transition detector 6 for detecting a leading edge signal from the document reader 2, a mode setting unit 12 for setting a mode of a control process of the registration clutch, and an output latch circuit 17 for outputting a clutch control signal. The transition detector 6 is connected to one input terminal of an OR circuit 7 and a transition detection latch circuit 18 for outputting a transition detection signal, and the mode setter 12 detects a mode set by the mode setter 12. Mode detection latch circuit 19 is connected.
【0011】また、制御用マイコン1からのオフセット
データが入力され、遷移検出器6の原稿先端信号の検出
からレジストクラッチをONするまでの時間が記録され
るオフセットレジスタ9aと、レジストクラッチをON
してからOFFするまでの時間が記録されるオフセット
レジスタ9bとからなるオフセットレジスタ9が設けら
れ、このオフセットレジスタ9の出力端子には、オフセ
ットレジスタ9a、9bの選択を行なうオフセット選択
器10が接続されている。An offset register 9a which receives offset data from the control microcomputer 1 and records the time from when the transition detector 6 detects the leading edge signal of the document to when the registration clutch is turned on, and when the registration clutch is turned on.
An offset register 9 comprising an offset register 9b for recording the time from the start to the OFF is provided. An output terminal of the offset register 9 is connected to an offset selector 10 for selecting the offset registers 9a and 9b. Have been.
【0012】一方、基準クロックをカウントするタイマ
カウントレジスタ8が設けられ、このタイマカウントレ
ジスタ8は、遷移検出器6の原稿先端信号の検出に基づ
いて、タイマカウントレジスタ8の出力値を取込むキャ
プチャレジスタ13に接続され、キャプチャレジスタ1
3には、オフセット選択器10の出力値と、キャプチャ
レジスタ13の出力値とを加算する加算器14が接続さ
れている。On the other hand, a timer count register 8 for counting the reference clock is provided. The timer count register 8 captures the output value of the timer count register 8 based on the detection of the leading edge signal of the document by the transition detector 6. Connected to register 13, capture register 1
3 is connected to an adder 14 that adds the output value of the offset selector 10 and the output value of the capture register 13.
【0013】また、加算器14には、加算器14の加算
値を記録する一致レジスタ15が接続され、一致レジス
タ15とタイマカウントレジスタ8の出力端子には、一
致レジスタ15の記録値とタイマカウントレジスタ8の
記録値とを比較する比較器16が接続され、比較器16
の出力端子には、クラッチ制御信号を出力する出力ラッ
チ回路17と、OR回路7の他方の入力端子とが接続さ
れている。さらに、OR回路7の出力端子には、キャプ
チャレジスタ13、加算器14及び一致レジスタ15が
接続されている。A match register 15 for recording the added value of the adder 14 is connected to the adder 14, and the output terminals of the match register 15 and the timer count register 8 have the recorded value of the match register 15 and the timer count register 8 connected thereto. A comparator 16 for comparing the recorded value of the register 8 with the comparator 16 is connected.
Is connected to an output latch circuit 17 for outputting a clutch control signal and the other input terminal of the OR circuit 7. Further, an output terminal of the OR circuit 7 is connected to a capture register 13, an adder 14, and a coincidence register 15.
【0014】このような構成の本実施の形態の動作を説
明する。タイマカウントレジスタ8は、16bitのフ
リーランニングカウンタで、32μsec周期の基準ク
ロックをカウントしており、制御用マイコン1は、オフ
セットデータによって、予めオフセットレジスタ9a
に、図3(g)に示すように、レジストON時間を基準
クロックの周期の32μsecで除した値、例えばレジ
ストON時間が23msecであると、718(16進
で2CFh)を書き込む。同様にして、制御用マイコン
1は、予めオフセットレジスタ9Bに、同図(h)に示
すように、レジストOFF時間を基準クロックの周期の
32μsecで除した値、例えばレジストOFF時間が
1secであると、31250(16進で7A12h)
を書込む。The operation of this embodiment having such a configuration will be described. The timer count register 8 is a 16-bit free-running counter that counts a reference clock having a period of 32 μsec.
As shown in FIG. 3 (g), when the resist ON time is divided by 32 μsec of the reference clock cycle, for example, when the resist ON time is 23 msec, 718 (2CFh in hexadecimal) is written. Similarly, the control microcomputer 1 sets in advance in the offset register 9B a value obtained by dividing the resist OFF time by 32 μsec of the reference clock cycle, for example, the resist OFF time is 1 sec as shown in FIG. , 31250 (7A12h in hexadecimal)
Write.
【0015】次に、制御用マイコン1によって、初期化
信号デコーダ11に、初期化信号bit1=1、bit
0=0が書き込まれ、bit1=1の書込により初期化
信号デコーダ11からクリア信号が出力され、このクリ
ア信号によって、遷移検出器6とモード設定器12とが
初期化され、図3(m)に示すように、モード設定器1
2によって「モード0」が設定され、bit=0の書込
により初期化信号デコーダ11からリセット信号が出力
され、このリセット信号にによって、出力ラッチ回路1
7がリセットされ、同図(k)に示すように、クラッチ
制御信号がlowレベルとなる。また、制御用マイコン
1からの遷移検知クリア信号によって、遷移検出ラッチ
回路18がクリアされる。Next, the control microcomputer 1 supplies an initialization signal bit1 = 1, bit
0 = 0 is written, and a clear signal is output from the initialization signal decoder 11 by writing bit1 = 1. The clear signal initializes the transition detector 6 and the mode setter 12, and FIG. ), The mode setting device 1
2, "mode 0" is set, and a reset signal is output from the initialization signal decoder 11 by writing bit = 0, and the output latch circuit 1
7 is reset, and the clutch control signal goes low as shown in FIG. The transition detection latch circuit 18 is cleared by a transition detection clear signal from the control microcomputer 1.
【0016】この状態で、制御用マイコン1から原稿読
取り装置2にスタート信号が出力され、原稿の読取動作
が開始され、同時に図示せぬ給紙部より転写紙がレジス
トローラに搬送される。この場合、出力ラッチ回路17
から出力されるクラッチ制御信号はlowレベルなの
で、ドライバ4はレジストクラッチ5を駆動せず、レジ
ストクラッチはOFFとなっていて、転写紙の先端はレ
ジストローラ位置で停止する。In this state, a start signal is output from the control microcomputer 1 to the document reading device 2 to start the reading operation of the document, and at the same time, the transfer paper is conveyed to the registration rollers from a paper feeding unit (not shown). In this case, the output latch circuit 17
Is low, the driver 4 does not drive the registration clutch 5, the registration clutch is OFF, and the leading end of the transfer paper stops at the registration roller position.
【0017】この場合、原稿の読取動作の開始によっ
て、スキャナが起動され、原稿読取り装置2からは、図
3(a)に示すように、lowレベルの原稿先端信号が
出力され、レジストクラッチ制御装置3の遷移検出器6
に入力され、遷移検出器6からは、同図(b)に示すよ
うに検知信号が出力され、この検知信号によって、遷移
検出ラッチ回路18からは、同図(c)に示すように、
highレベルの遷移検知信号が出力される。In this case, when the document reading operation is started, the scanner is activated, and the document reading device 2 outputs a low level document leading edge signal as shown in FIG. 3 transition detector 6
, And the transition detector 6 outputs a detection signal as shown in FIG. 6B. With this detection signal, the transition detection latch circuit 18 outputs the detection signal as shown in FIG.
A high level transition detection signal is output.
【0018】この際、遷移検出器6によって、原稿先端
信号の立ち下がりエッジが検出されると、初期化信号デ
コーダ11からクリア信号が入力されるまで、仮に再度
原稿先端信号が立ち下がっても、遷移検出器6からは検
知信号は出力されない。At this time, when the transition detector 6 detects the falling edge of the document leading edge signal, even if the document leading edge signal falls again until the clear signal is input from the initialization signal decoder 11, No detection signal is output from the transition detector 6.
【0019】遷移検出器6からの検知信号によって、キ
ャプチャレジスタ13は、図3(e)に示すタイマカウ
ントレジスタ8の記録値(この場合は1000h)を、
同図(f)に示すように取込んで基準時間が設定され、
この時「モード0」なので、オフセット選択器10によ
って、オフセットレジスタ9aが選択され、加算器14
によって、基準時間にレジストクラッチON時間に対応
する値02CFhが加算され、同図(i)に示すよう
に、一致レジスタ15には加算値12CFhが取込まれ
る。In response to the detection signal from the transition detector 6, the capture register 13 changes the recorded value (1000h in this case) of the timer count register 8 shown in FIG.
The reference time is set by taking in the data as shown in FIG.
At this time, since the mode is “mode 0”, the offset register 9a is selected by the offset selector 10, and the adder 14
As a result, the value 02CFh corresponding to the registration clutch ON time is added to the reference time, and the added value 12CFh is taken into the coincidence register 15 as shown in FIG.
【0020】また、遷移検出器6からの検知信号によっ
て、遷移検出ラッチ回路18がセットされ、遷移検出ラ
ッチ回路18から遷移検知信号が制御用マイコン1に入
力され、原稿読取り装置2による原稿の読み始めが、制
御用マイコン1によって検知される。The transition detection latch circuit 18 is set by the detection signal from the transition detector 6, and the transition detection signal is input from the transition detection latch circuit 18 to the control microcomputer 1, and the original is read by the original reading device 2. The beginning is detected by the control microcomputer 1.
【0021】制御用マイコン1が原稿の読み始めを検知
すると、遷移検出ラッチ回路18に遷移検知クリア信号
が入力され、レジストクラッチ5の制御動作への影響を
避けるために、遷移検知信号の論理値がlowレベルに
設定される。When the control microcomputer 1 detects the start of reading of the original, a transition detection clear signal is input to the transition detection latch circuit 18, and the logical value of the transition detection signal is set in order to avoid affecting the control operation of the registration clutch 5. Is set to the low level.
【0022】また、遷移検出器6により原稿先端信号が
検知されてから、レジストクラッチ5のON時間に達す
ると、タイマカウントレジスタ8の出力値と、一致レジ
スタ15の出力値とが等しくなるので、比較器16から
一致信号が出力され、この一致信号によって出力ラッチ
回路17からのクラッチ制御信号がhighレベルとな
り、ドライバ4がレジストクラッチ5を駆動して、レジ
ストクラッチ5がON状態となる。When the ON time of the registration clutch 5 is reached after the leading edge signal of the document is detected by the transition detector 6, the output value of the timer count register 8 and the output value of the coincidence register 15 become equal. The comparator 16 outputs a coincidence signal, and the coincidence signal causes the clutch control signal from the output latch circuit 17 to go high, the driver 4 drives the registration clutch 5 and the registration clutch 5 is turned on.
【0023】レジストクラッチ5がON状態になると、
転写紙の画像形成ユニットへの搬送が開始され、感光体
のトナー像と転写紙が、転写器位置に同期して到達し、
感光体トナー像が転写紙に転写される。When the registration clutch 5 is turned on,
The transfer of the transfer paper to the image forming unit is started, and the toner image of the photoconductor and the transfer paper arrive in synchronization with the transfer device position,
The photoconductor toner image is transferred to the transfer paper.
【0024】また、比較器16の一致信号が、0R回路
7を介してキャプチャレジスタ13に入力されると、キ
ャプチャレジスタ13によって、タイマカウントレジス
タ8の記録値(この場合は12CFh)が取り込まれ、
新たな基準時間が設定され、比較器16からの一致信号
によって、モード設定器12により「モード1」が設定
される。そして、モート設定器12からの切換信号によ
って、オフセット選択器10により、オフセットレジス
タ9bが選択され、新たな基準時間12CFhに、レジ
ストクラッチOFF時間に対応する値7A12hが加算
され、図4(e)に示すように、加算値8CE1hが一
致レジスタ15に取込まれる。When the coincidence signal of the comparator 16 is input to the capture register 13 via the OR circuit 7, the capture register 13 captures the recorded value of the timer count register 8 (12 CFh in this case).
A new reference time is set, and “mode 1” is set by the mode setting unit 12 according to the coincidence signal from the comparator 16. Then, the offset register 9b is selected by the offset selector 10 according to the switching signal from the mote setting unit 12, and the value 7A12h corresponding to the registration clutch OFF time is added to the new reference time 12CFh, and FIG. The added value 8CE1h is taken into the match register 15 as shown in FIG.
【0025】この状態でレジスト0FF時間に到達する
と、タイマカウントレジスタ8の記録値と一致レジスタ
15の記録値が等しくなるので、比較器16から一致信
号が出力され、出力ラッチ回路17からのクラッチ制御
信号がlowレベルとなり、ドライバ4の駆動が停止さ
れ、レジストクラッチ5が0FF状態となる。In this state, when the time reaches the register 0FF, the recorded value of the timer count register 8 and the recorded value of the coincidence register 15 become equal, so that the comparator 16 outputs a coincidence signal, and the clutch control from the output latch circuit 17 The signal becomes low level, the driving of the driver 4 is stopped, and the registration clutch 5 enters the OFF state.
【0026】また、比較器16からの一致信号によっ
て、モード設定器12は「モード2」を設定し、モード
検出器12によってモード検出ラッチ回路19がモード
終了信号が出力し、制御用マイコン1がレジストクラッ
チの制御の終了を検知し、制御用マイコン1からのモー
ド終了クリア信号によって、モード検出ラッチ回路19
が次の転写紙に備えてクリアされる。The mode setting unit 12 sets "mode 2" according to the coincidence signal from the comparator 16, the mode detection latch circuit 19 outputs a mode end signal by the mode detector 12, and the control microcomputer 1 The end of the control of the registration clutch is detected, and the mode detection latch circuit 19 receives a mode end clear signal from the control microcomputer 1.
Is cleared in preparation for the next transfer sheet.
【0027】このように、本実施の形態によると、事前
に制御用マイコン1によって、オフセットレジスタ9a
に、原稿先端信号の検出からレジストクラッチ5のON
までの時間が、オフセットレジスタ9bに、レジストク
ラッチ5のONからOFFまでの時間が記録され、モー
ド設定器12によって、レジストクラッチ5の制御動作
の開始から出力ラッチ回路17から出力されるクラッチ
制御信号がhighレベルになるまでのモード0、クラ
ッチ制御信号がhighレベルになってから、クラッチ
制御信号がlowレベルになるまでのモード1、クラッ
チ制御信号がlowレベルになりレジストクラッチ5の
制御動作が終了するモード2が設定される。As described above, according to the present embodiment, the offset microcomputer 9a is controlled by the control microcomputer 1 in advance.
Then, from the detection of the document leading edge signal, the registration clutch 5 is turned on
The time from when the resist clutch 5 is turned on to when the resist clutch 5 is turned off is recorded in the offset register 9b. The mode setting unit 12 outputs the clutch control signal output from the output latch circuit 17 from the start of the control operation of the resist clutch 5. Mode 0 until the clutch control signal goes high, mode 1 until the clutch control signal goes low until the clutch control signal goes low, and the control operation of the resist clutch 5 ends when the clutch control signal goes low. Mode 2 is set.
【0028】そして、タイマカウントレジスタ8から取
り込まれる時間の記録値と、モード設定器12で設定さ
れるモードに対応して、オフセット選択器10で選択さ
れるオフセットレジスタ9a、9bの時間の記録値とに
基づいて、出力ラッチ回路17からのクラッチ制御信号
のhighレベル、lowレベルの切り換えが行なわ
れ、レジストクラッチ5のON−OFF制御が行なわ
れ、モード検出ラッチ回路19によって、モードの終了
が制御用マイコン1で検知される。Then, the recorded value of the time taken from the timer count register 8 and the recorded value of the time of the offset registers 9a and 9b selected by the offset selector 10 corresponding to the mode set by the mode setting device 12. , The high level and the low level of the clutch control signal from the output latch circuit 17 are switched, the ON / OFF control of the resist clutch 5 is performed, and the mode detection latch circuit 19 controls the end of the mode. Is detected by the microcomputer 1.
【0029】このために、本実施の形態によると、基準
クロックをカウントするタイマカウントレジスタ8の時
間記録値とオフセットレジスタ9a、9bの時間記録値
に基づき、レジストクラッチ5の0N−0FF制御行
い、制御のモードが制御用マイコン1で的確に検知さ
れ、制御用マイコン1の処理時間の影響を受けずに、レ
ジストクラッチ5のON−OFF制御を高精度に行い、
画像形成装置に画像ずれのない高品質の画像形成を行な
わせることが可能になる。Therefore, according to the present embodiment, 0N-0FF control of the registration clutch 5 is performed based on the time record value of the timer count register 8 for counting the reference clock and the time record value of the offset registers 9a and 9b. The control mode is accurately detected by the control microcomputer 1, and the ON / OFF control of the registration clutch 5 is performed with high accuracy without being affected by the processing time of the control microcomputer 1.
It is possible to cause the image forming apparatus to perform high-quality image formation without image shift.
【0030】[0030]
【発明の効果】請求項1記載の発明によると、予めマイ
コンによって、第1のオフセットレジスタに、遷移検出
器による原稿先端信号の検出から、レジストクラッチを
ONするまでの時間が、第2のオフセットレジスタに、
レジストクラッチをONしてからOFFするまでの時間
が記録され、遷移検出器による原稿読取りユニットから
の原稿先端信号の検出により、キャプチャレジスタに、
基準クロックをカウントするタイマカウントレジスタの
出力値が取り込まれ、モード設定器により、レジストク
ラッチの制御過程のモードが設定され、オフセット選択
器により、モード設定器が設定したモードに基づき、第
1のオフセットレジスタの記録時間と第2のオフセット
レジスタの記録時間との何れかが選択出力され、ラッチ
回路により、キャプチャレジスタの出力値、オフセット
選択器の出力値及びタイマカウントレジスタの出力値に
基づき、レジストクラッチをON−OFFするクラッチ
制御信号が保持出力され、このクラッチ制御信号により
転写紙の画像形成ユニットへの搬送が制御されるので、
レジストクラッチの0N−0FFがマイコンの他の処理
の影響を受けずに高精度で行なうことが可能になる。According to the first aspect of the present invention, the time from the detection of the document leading edge signal by the transition detector to the turning-on of the registration clutch is previously stored in the first offset register by the microcomputer. In the register,
The time from when the registration clutch is turned on to when it is turned off is recorded. When the transition detector detects the leading edge signal of the document from the document reading unit,
The output value of the timer count register for counting the reference clock is fetched, the mode of the control process of the registration clutch is set by the mode setting device, and the first offset is set by the offset selector based on the mode set by the mode setting device. Either the recording time of the register or the recording time of the second offset register is selected and output, and the latch circuit is used by the latch circuit based on the output value of the capture register, the output value of the offset selector, and the output value of the timer count register. A clutch control signal for turning on and off the printer is held and output, and conveyance of the transfer paper to the image forming unit is controlled by the clutch control signal.
0N-0FF of the registration clutch can be performed with high accuracy without being affected by other processing of the microcomputer.
【0031】請求項2記載の発明によると、請求項1記
載の発明で得られる効果に加えて、モード検出ラッチ回
路により、モート設定器が設定するモードが検出される
ので、レジストクラッチの制御過程がマイコンに的確に
通報され、レジストクラッチの制御が高精度に行なわれ
る。According to the second aspect of the present invention, in addition to the effect obtained by the first aspect of the present invention, since the mode set by the mote setting device is detected by the mode detection latch circuit, the control process of the registration clutch is performed. Is accurately notified to the microcomputer, and the control of the registration clutch is performed with high accuracy.
【図1】本発明の一実施の形態の要部の構成を示すブロ
ック図である。FIG. 1 is a block diagram illustrating a configuration of a main part of an embodiment of the present invention.
【図2】図1のレジストクラッチ制御装置の構成を示す
ブロック図である。FIG. 2 is a block diagram illustrating a configuration of a registration clutch control device of FIG. 1;
【図3】同実施の形態の前半動作を示すタイムチャート
である。FIG. 3 is a time chart showing the first half operation of the embodiment.
【図4】同実施の形態の後半動作を示すタイムチャート
である。FIG. 4 is a time chart showing a latter half operation of the embodiment.
1 制御用マイコン 2 原稿読取り装置 3 レジストクラッチ制御装置 4 ドライバ 5 レジストクラッチ 6 遷移検出器 8 タイマカウントレジスタ 9a、9b オフセットレジスタ 10 オフセット選択器 11 初期化信号デコーダ 12 モード設定器 13 キャプチャレジスタ 15 一致レジスタ 16 比較器 17 出力ラッチ回路 18 遷移検出ラッチ回路 19 モード検出ラッチ回路 DESCRIPTION OF SYMBOLS 1 Control microcomputer 2 Document reading device 3 Registration clutch control device 4 Driver 5 Registration clutch 6 Transition detector 8 Timer count register 9a, 9b Offset register 10 Offset selector 11 Initialization signal decoder 12 Mode setting device 13 Capture register 15 Match register Reference Signs List 16 comparator 17 output latch circuit 18 transition detection latch circuit 19 mode detection latch circuit
Claims (2)
ンからの信号に基づいて、クラッチ制御信号を出力し、
レジストクラッチをON−OFFすることにより転写紙
の画像形成ユニットへの搬送を制御するレジストクラッ
チ制御装置であり、 基準クロックをカウントするタイマカウントレジスタ
と、 原稿読取りユニットからの原稿先端信号を検出する遷移
検出器と、 該遷移検出器による前記原稿先端信号の検出から、前記
レジストクラッチをONするまでの時間が記録される第
1のオフセットレジスタと、 前記レジストクラッチをONしてからOFFするまでの
時間が記録される第2のオフセットレジスタと、 前記遷移検出器による前記原稿先端信号の検出に基づい
て、前記タイマカウントレジスタの出力値を取込むキャ
プチャレジスタと、 前記レジストクラッチの制御過程のモードを設定するモ
ード設定器と、 該モード設定器が設定したモードに基づいて、前記第1
のオフセットレジスタの記録時間と前記第2のオフセッ
トレジスタの記録時間との何れかを選択出力するオフセ
ット選択器と前記キャプチャレジスタの出力値、前記オ
フセット選択器の出力値及び前記タイマカウントレジス
タの出力値に基づいて、前記レジストクラッチをON−
OFFする制御信号を保持出力するラッチ回路とを有す
ることを特徴とするレジストクラッチ制御装置。An output unit that outputs a clutch control signal based on a signal from a microcomputer;
A resist clutch control device that controls the transfer of transfer paper to the image forming unit by turning on and off the resist clutch. A timer count register that counts the reference clock, and a transition that detects the leading edge signal from the document reading unit A first offset register in which a time from the detection of the document leading edge signal by the transition detector to the ON of the registration clutch is recorded; and a time from the ON to the OFF of the registration clutch. A second offset register in which the register value is recorded; a capture register that captures the output value of the timer count register based on the detection of the document leading edge signal by the transition detector; and a mode for controlling the registration clutch. Mode setting device to perform, and the mode set by the mode setting device Based on the first
An offset selector for selecting and outputting one of the recording time of the offset register and the recording time of the second offset register, the output value of the capture register, the output value of the offset selector, and the output value of the timer count register. ON, the registration clutch is turned ON-
And a latch circuit for holding and outputting a control signal for turning off.
置に対して、前記モート設定器が設定するモードを検出
するモード検出ラッチ回路が設けられていることを特徴
とするレジストクラッチ制御装置。2. A registration clutch control device according to claim 1, further comprising a mode detection latch circuit for detecting a mode set by said mote setting device.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8269295A JPH1097111A (en) | 1996-09-19 | 1996-09-19 | Registration clutch control device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8269295A JPH1097111A (en) | 1996-09-19 | 1996-09-19 | Registration clutch control device |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH1097111A true JPH1097111A (en) | 1998-04-14 |
Family
ID=17470366
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8269295A Pending JPH1097111A (en) | 1996-09-19 | 1996-09-19 | Registration clutch control device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH1097111A (en) |
-
1996
- 1996-09-19 JP JP8269295A patent/JPH1097111A/en active Pending
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