JPH11145199A - 半導体装置 - Google Patents

半導体装置

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JPH11145199A
JPH11145199A JP9308801A JP30880197A JPH11145199A JP H11145199 A JPH11145199 A JP H11145199A JP 9308801 A JP9308801 A JP 9308801A JP 30880197 A JP30880197 A JP 30880197A JP H11145199 A JPH11145199 A JP H11145199A
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rectangular
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Abstract

(57)【要約】 【課題】本発明は外部接続端子として突起電極(バン
プ)を有した半導体装置に関し、信頼性の高いフリップ
チップ実装を可能とすることを課題とする。 【解決手段】チップ本体32に複数のパッドが形成され
ると共に、このパッド上にバンプを配設した構成の半導
体装置において、バンプの形状を長円形状とすることに
より長円形状バンプ36を形成すると共にパッドの形状
を矩形状とすることにより矩形状パッド38を形成す
る。そして、この長円形状バンプ36の長手方向と矩形
状パッド38の長手方向とが一致するよう、長円形状バ
ンプ36を矩形状パッド38に配設する。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は半導体装置に係り、
特に外部接続端子として突起電極(バンプ)を有した半
導体装置に関する。近年、半導体装置の高密度化及び小
型化が急速な勢いで進んでおり、これに伴い半導体装置
に配設される外部接続端子数は増大し、よって外部接続
端子の端子間ピッチは狭ピッチ化する傾向にある。
【0002】このため、半導体装置の外部接続端子とし
てバンプ(突起電極)を設けると共に、これを実装用基
板にフリップチップ実装する実装構造が提案されまた実
施されている。
【0003】
【従来の技術】図8は、従来の半導体装置8(以下の説
明では、半導体装置として半導体チップを用いた例につ
いて説明する)を実装用基板2にフリップチップ実装し
た状態を示している。実装用基板2は、樹脂或いはセラ
ミック製の基板本体4の上面に配線6が所定のパターン
で形成されている。また、半導体チップ8は、図9に示
すように、チップ本体12(基板)の回路形成面14に
突起電極となる複数のバンプ10(梨地で示す)が配設
されている。
【0004】バンプ10はスタッドバンプであり、ワイ
ヤボンディング技術を利用して形成されている。このバ
ンプ10は、下段部10aと上段部10bとを有した形
状とされており、特に下段部10aは略半球形状とされ
ている。前記のように、バンプ10はチップ本体12の
回路形成面14に配設されるが、チップ本体12のバン
プ形成位置にはパッド16が形成されている。よって、
バンプ10はパッド16に接合されることにより、チッ
プ本体12に接合された構成となる。
【0005】このパッド16の形状は、図9に示される
ように、バンプ10の形状(即ち、下段部10aの略半
球形状)に対応するよう平面視した状態で円形状に形成
されていた。また、上記のようにパッド16はバンプ1
0が接合されるものであるため、位置決め誤差及び取り
付け誤差等を考慮して、パッド16の直径W1はバンプ
10の径寸法R1に対して大きく設定されていた(W1
>R1)。
【0006】上記構成とされた半導体チップ8は、実装
用基板2にフリップチップ実装されるが、この実装状態
においてバンプ10は導電性を有した接着剤26により
配線6に固定される。これにより、半導体チップ8はフ
リップチップ実装用基板2に電気的及び機械的に接続さ
れた構成とされていた。ところで、半導体チップ8の高
密度化が近年程進んでいない従来では、半導体チップ8
のピン数は少なく、よって隣接するパッド16間のピッ
チP1は広く取ることができた。
【0007】よって、各パッド16の面積(直径W1)
を大きくとることができ、これに伴いバンプ10の形状
(径寸法R1)も大きくすることができた。このため、
バンプ10をパッド16に接合した時におけるバンプ1
0とパッド16の接合面積を大きく取ることができ、よ
って接合力の強い信頼性の高い接合を行なうことができ
た。
【0008】
【発明が解決しようとする課題】しかるに、近年の半導
体チップの急激な高密度化及び小型化に伴い、半導体チ
ップに設けられるピン数は増大する傾向にある。図10
は、図9に示した半導体チップ8に対し、多ピン化が図
られた、従来の半導体チップ18を示している。上記の
ように、半導体チップ18が小型化しかつ多ピン化が図
られると、チップ本体12に配設されるパッド22の隣
接ピッチP2は、図9に示した半導体チップ8のパッド
16間のピッチP1に比べて必然的に狭くなる(P2<
P2)。
【0009】また、隣接するパッド22が干渉すること
は許されないため、上記のようにパッド間ピッチP2が
小さくなることにより各パッド22の面積(直径W2)
も小さくなる。また、このように各パッド22の面積
(直径W2)が小さくなることに伴い、バンプ20の形
状(径寸法R2)も小さくせざるおえなくなる。このた
め、図10に示す半導体チップ18では、バンプ20を
パッド22に接合した際、バンプ20とパッド22との
接合面積は小さくなり、バンプ20とパッド22との間
における接合力は低下してしまう。よって、半導体チッ
プ18は実装用基板2から離脱し易くなり、フリップチ
ップ実装の信頼性が低下してしまうという問題点があっ
た。
【0010】本発明は上記の点に鑑みてなされたもので
あり、信頼性の高いフリップチップ実装を可能とした半
導体装置を提供することを目的とする。
【0011】
【課題を解決するための手段】上記課題を解決するため
に本発明では、次の手段を講じたことを特徴とするもの
である。請求項1記載の発明では、複数の突起電極を有
する半導体装置において、前記突起電極の形状を長円形
状とし、この各突起電極の長手方向が互いに平行となる
よう列設した構成としたことを特徴とするものである。
【0012】また、請求項2記載の発明では、複数のパ
ッドを有すると共に、このパッド上に突起電極を配設し
た構成の半導体装置において、前記突起電極の形状を長
円形状とすると共に前記パッドの形状を矩形状とし、か
つ、前記パッドの長手方向と前記突起電極の長手方向と
が一致するよう、前記突起電極を前記パッドに配設した
ことを特徴とするものである。
【0013】上記の各手段は、次のように作用する。請
求項1記載の発明によれば、突起電極の形状を長円形状
とし、この各突起電極の長手方向が互いに平行となるよ
う列設したことにより、隣接する突起電極を近接して配
設することが可能となり、突起電極を高密度に配置する
ことができる。これにより、半導体装置の小型化及び多
ピン化に容易に対応することができる。
【0014】また、請求項2記載の発明によれば、突起
電極の形状を長円形状とすると共にパッドの形状を矩形
状とし、かつパッドの長手方向と突起電極の長手方向と
が一致するよう突起電極をパッドに配設したことによ
り、隣接する突起電極を近接して配設することが可能と
なり、突起電極を高密度に配置することができる。
【0015】また、長手方向に対しては突起電極は長く
形成することが可能であるため、上記のように隣接する
突起電極間の距離を短くしても、突起電極とパッドとの
接合面積は広くすることができ、よって突起電極とパッ
ドとの接合力を大きく維持させることができる。
【0016】
【発明の実施の形態】次に、本発明の実施の形態につい
て図面と共に説明する。図1は、本発明の一実施例であ
る半導体装置(以下の説明では、半導体装置として半導
体チップ30を用いた例について説明する)の部分拡大
図であり、図6は半導体チップ30を実装用基板46に
フリップチップ実装した状態を示している。
【0017】半導体チップ30は、いわゆるベアチップ
であり、例えばシリコン或いはガリウム−砒素よりなる
チップ本体34(基板)の回路形成面34に所定の回路
が形成されると共に、回路形成部分を囲繞するように複
数のパッド38が形成されている。本実施例では、この
パッド38の形状を矩形状(即ち、長方形状)としたこ
とを特徴の一つとしている。尚、以下この矩形状のパッ
ド38を矩形状パッド38と称する。
【0018】このパッド38の大きさは、短辺の長さW
S(短編長)が先に図10を用いて説明した高密度化さ
れた半導体チップ18のパッド径W2と略等しい寸法と
されている(WS≒W2)。これに対し長辺の長さWL
(長辺長)は、半導体チップ18のパッド径W2に比べ
て長い寸法に設定されている(WL>W2)。また、各
パッド38は、図1に示されるように、その長手方向が
互いに平行となるよう配設されている。これを換言すれ
ば、隣接する各パッド38は、その長辺同志が互いに平
行に対向するよう列設されている。
【0019】このように各パッド38を列設させること
により、図中矢印X方向及び図中矢印Y方向にパッド3
8を列設させる際、パッド38を高密度に配設すること
ができる(即ち、単位長さ内に多数のパッド38を配設
することができる)。これにより、半導体チップ30が
高密度化及び多ピン化しても、これに容易に対応するこ
とが可能となる。
【0020】続いて、上記構成とされたパッド38に設
けられるバンプ36(突起電極)について、図1に加え
図2乃至図5を用いて説明する。本実施例ではバンプ3
6としてスタッドバンプを採用しており、その形状を平
面視した状態において略長円形状に形成したことを特徴
とするものである(以下、このバンプ36を長円形状バ
ンプ36という)。即ち、図1乃至図3に示されるよう
に、長円形状バンプ36は長手方向とこれに直交する方
向でその径寸法が異なっており、具体的には長径RLと
短径RSとを有した構成となっている(RL>RS)。
【0021】また、長円形状バンプ36は、下段部36
aと上段部36bとを有した形状とされており、下段部
36aが上記のように略長円形状とされており、その上
部に突設した上段部36bは略円柱形状とされている。
即ち、本実施例に係る長円形状バンプ36は、いわゆる
二段構造のバンプ形状とされている。この長円形状バン
プ36は、チップ本体32の回路形成面34に配設され
るが、回路形成面34の所定バンプ形成位置には、前記
した矩形状を有したした矩形状パッド38が形成されて
いる。よって、図6に示されるように、半導体チップ3
0を実装用基板46にフリップチップ実装した際、長円
形状バンプ36は各矩形状パッド38に接合され、これ
により半導体チップ30と実装用基板46は電気的に接
続された状態となる。
【0022】このフリップチップ実装の際、長円形状バ
ンプ36は導電性を有した接着剤49により配線6に固
定される。上記のように、長円形状バンプ36は下段部
36aと上段部36bとを有した2段形状とされている
ため、接着剤49の乗りがよく確実に半導体チップ30
を実装用基板46に電気的及び機械的に接続することが
できる。また、はんだを用いることなく半導体チップ3
0を実装用基板46に搭載することができるため、鉛規
制に対しても対応することができる。
【0023】ここで、長円形状バンプ36と矩形状パッ
ド38との接合構造に注目し、以下説明する。先ず、長
円形状バンプ36と矩形状パッド38の大きさに注目す
ると、本実施例では、長円形状バンプ36の長径RLは
矩形状パッド38の長辺長WLに対して若干小さく設定
されており(RL<WL)、同様に長円形状バンプ36
の短径RSは矩形状パッド38の短辺長WSに対しても
若干小さく設定されている(RS<WS)。
【0024】この構成とすることにより、半導体チップ
30を実装用基板46にフリップチップ実装する際、位
置決め誤差及び取り付け誤差等が存在したとしても、確
実に半導体チップ30を実装用基板46に実装すること
が可能となる。次に、矩形状パッド38に対する長円形
状バンプ36の接合方向に注目する。前記のように、矩
形状パッド38は矩形状とされており、また長円形状バ
ンプ36は長円形状を有した形状とれさている。この長
円形状バンプ36を矩形状パッド38に接合する際、長
円形状バンプ36の長手方向と矩形状パッド38の長手
方向とが一致するよう接合される。
【0025】このように長円形状バンプ36を矩形状パ
ッド38に接合することにより、隣接する長円形状バン
プ36を近接して配設することが可能となり(即ち、バ
ンプ間ピッチを狭ピッチ化することができ)、よって長
円形状バンプ36を高密度に配置することができる。従
って、半導体チップ30が高密度化及び多ピン化して
も、これに十分に対応することができる。
【0026】また、上記のように半導体チップ30の高
密度化及び多ピン化に対応させるこためには、前記の長
手方向と直交する方向(即ち、図1に矢印X,Yで示す
方向)に長円形状バンプ36及び矩形状パッド38を狭
ピッチで配設することが重要である。これに対し長手方
向に関しては、これが直接に半導体チップ30の高密度
化及び多ピン化に影響を与えないため、この長手方向に
は長円形状バンプ36及び矩形状パッド38を長く形成
することが可能である。即ち、長円形状バンプ36の長
径RL及び矩形状パッド38の長辺長WLを長く形成し
ても、半導体チップ30の高密度化及び多ピン化が妨げ
られるようなことはない。
【0027】このため本実施例では、半導体チップ30
の小型化の妨げとならない範囲において、長円形状バン
プ36の長径RL及び矩形状パッド38の長辺長WLは
可能な限り長く形成した構成としている。この構成とす
るこにとより、半導体チップ30を実装用基板46に実
装した状態において、長円形状バンプ36と矩形状パッ
ド38の接合面積を大きく取ることができる。
【0028】周知のように、バンプとパッドとの接合力
はバンプとパッドとの接合面積が増大する程強くなるた
め、上記した本実施例の構成とすることにより、隣接す
る長円形状バンプ36のピッチP3を小さくしても、長
円形状バンプ36と矩形状パッド38との接合力を大き
く維持させることができ、よってフリップチップ実装の
信頼性を向上させることができる。
【0029】続いて、上記した長円形状バンプ36の形
成方法について、図4及び図5を用いて説明する。前記
したように、本実施例で用いている長円形状バンプ36
は、スタッドバンプである。周知のように、一般的にス
タッドバンプはワイヤボンディング技術を利用して形成
される。本実施例における長円形状バンプ36も、一般
に用いられいるスタッドバンプと同様にワイヤボンディ
ング技術を利用して形成することができる。
【0030】以下、長円形状バンプ36の具体的な形成
方法について説明する。ワイヤボンディング技術を長円
形状バンプ36を形成するには、先ずワイヤボンディン
グ装置に設けられているキャピラリ40を矩形状パッド
38に押し当て、内部に挿通されたワイヤ(金線)42
を矩形状パッド38に超音波溶接する。この際、本実施
例では使用するキャピラリ40に、予め下段用キャビテ
ィ部44a及び上段用キャビティ部44bを形成してお
く。下段用キャビティ部44aは略半楕円球形状を有し
た凹部であり、その長径及び短径は前記した長円形状バ
ンプ36の長径RL及び短径RSに対応するよう設定さ
れている。また、上段用キャビティ部44bは、長円形
状バンプ36の上段部36bの形状に対応した円筒形状
とされている。
【0031】よって、キャピラリ40を矩形状パッド3
8に押し当て金線42を矩形状パッド38に超音波溶接
することにより、自動的に図2及び図3に示された長円
形状バンプ36が形成される。即ち、従来から一般に用
いられているワイヤボンディング装置に配設されている
ワイヤボンディング用のキャピラリを、図4及び図5に
示されるキャピラリ40に取り替えるのみで、本実施例
で用いる長円形状バンプ36を形成することができる。
【0032】これにより、半導体製造設備を大きく変更
することなく、かつ高いスループットで長円形状バンプ
36を形成することができ、よって製造される半導体チ
ップ30のコスト低減を図ることができる。次に、図1
乃至図6を用いて説明した半導体チップ30の変形例に
ついて説明する。
【0033】図7は、先に説明した半導体チップ30の
変形例である半導体チップ50を示している。尚、図7
において、図1乃至図6を用いて説明した半導体チップ
30の構成と同一構成については同一符号を付して、そ
の説明を省略する。本変形例では、チップ本体32に配
設される長円形状パッド52及び矩形状パッド54の夫
々の長手方向が、チップ本体32の中心位置に対して放
射状に向くよう構成したことを特徴とするものである。
この構成とすることにより、半導体チップ50を実装用
基板に実装した際の信頼性を向上させることができる。
以下、この理由について説明する。
【0034】半導体チップ30は、加熱することにより
熱膨張する。この際、チップ本体32は図7に矢印で示
されるように放射状に熱膨張する。よって、半導体チッ
プ30を実装用基板に実装した後に加熱処理が行なわれ
ると、各長円形状パッド52にもチップ本体32の中心
に対し放射方向に応力が印加されることとなる。ここ
で、長円形状パッド52の剥離強さについて考察する
と、長円形状パッド52の長手方向(図7に矢印Aで示
す方向)に対する剥離強さは、長円形状パッド52の長
手方向に直交する方向(図7に矢印Bで示す方向)に対
する剥離強さに対して強くなっている。
【0035】よって本変形例のように、チップ本体32
に配設される長円形状パッド52及び矩形状パッド54
の夫々の長手方向がチップ本体32の中心位置に対して
放射方向に向くよう構成することにより、実装後におい
て半導体チップ30に加熱処理が実施されても、チップ
本体32の熱膨張方向に対し各長円形状パッド52はそ
の剥離強さが大きくなっているため、半導体チップ30
が実装用基板から離脱することを防止することができ
る。よって、本変形例の構成とすることにより、半導体
チップ50を実装用基板に実装した際の信頼性を向上さ
せることが可能となる。
【0036】尚、上記した実施例においては、半導体装
置としてベアチップ状態の半導体チップ30,50を例
に挙げて説明したが、本発明の適用はこれに限定される
ものではなく、例えばBGA(Ball Grid Array) 等のバ
ンプ(突起電極)を有した半導体装置に広く適用できる
ものである。また、上記した実施例では、長円形状バン
プ36,52をスタッドバンプとしワイヤボンディング
技術を用いて形成する方法を例に挙げて説明したが、長
円形状バンプはスタッドバンプに限定されるものではな
く、はんだバンプ等の他の構成のバンプを用いることも
可能である。また、その製造方法も、メッキ法,転写法
等の種々のバンプ形成方法を用いることも可能である。
【0037】
【発明の効果】上述の如く本発明によれば、次に述べる
種々の効果を実現することができる。請求項1記載の発
明によれば、隣接する突起電極を近接して配設すること
が可能となり、突起電極を高密度に配置することができ
るため、半導体装置の小型化及び多ピン化に容易に対応
することができる。
【0038】また、請求項2記載の発明によれば、隣接
する突起電極を近接して配設することが可能となり、突
起電極を高密度に配置することができる。また、長手方
向に対しては突起電極は長く形成することが可能である
ため、隣接する突起電極間の距離を短くしても突起電極
とパッドとの接合面積は広くすることができ、よって突
起電極とパッドとの接合力を大きく維持させることがで
きる。
【図面の簡単な説明】
【図1】本発明の一実施例である半導体チップの底面を
拡大して示す図である。
【図2】本発明の一実施例である半導体チップに設けら
れる長円形状バンプの正面図である。
【図3】本発明の一実施例である半導体チップに設けら
れる長円形状バンプの側面図である。
【図4】本発明の一実施例である半導体チップに設けら
れる長円形状バンプを形成する際に用いられるキャピラ
リの横断面図である。
【図5】本発明の一実施例である半導体チップに設けら
れる長円形状バンプを形成する際に用いられるキャピラ
リの縦断面図である。
【図6】本発明の一実施例である半導体チップが実装用
基板にフリップチップ実装された状態を示す図である。
【図7】本発明の変形例である半導体チップの底面を示
す図である。
【図8】従来の一例である半導体チップが実装用基板に
フリップチップ実装された状態を示す図である。
【図9】従来の一例である半導体チップの底面を拡大し
て示す図である(その1)。
【図10】従来の一例である半導体チップの底面を拡大
して示す図である(その2)。
【符号の説明】
30,50 半導体チップ 32 チップ本体 36,52 長円形状バンプ 38,54 矩形状パッド 40 キャピラリ 42 金線 44 キャビティ部 46 実装用基板 47 基板本体 48 配線

Claims (2)

    【特許請求の範囲】
  1. 【請求項1】 複数の突起電極を有する半導体装置にお
    いて、 前記突起電極の形状を長円形状とし、該各突起電極の長
    手方向が互いに平行となるよう列設した構成としたこと
    を特徴とする半導体装置。
  2. 【請求項2】 複数のパッドを有すると共に、該パッド
    上に突起電極を配設した構成の半導体装置において、 前記突起電極の形状を長円形状とすると共に前記パッド
    の形状を矩形状とし、かつ、前記パッドの長手方向と前
    記突起電極の長手方向とが一致するよう、前記突起電極
    を前記パッドに配設したことを特徴とする半導体装置。
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