JPH11215500A5 - - Google Patents
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- JPH11215500A5 JPH11215500A5 JP1998014444A JP1444498A JPH11215500A5 JP H11215500 A5 JPH11215500 A5 JP H11215500A5 JP 1998014444 A JP1998014444 A JP 1998014444A JP 1444498 A JP1444498 A JP 1444498A JP H11215500 A5 JPH11215500 A5 JP H11215500A5
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このように、上述したブロック歪の除去フィルタでは、除去フィルタを通過させた画像データにブロック歪補正処理を施した後にさらに新たな疑似エッジが生じた場合、再度ブロック歪を補正することが考慮されていない。また、補正後に生ずる新たな疑似エッジを補正前に予測する等の処理もなされてない。
MB0=(MB0+MB1+MB2+MB3+MB4+MB5+MB6+MB7+MB8)/9
すなわち、図4に示したマクロブロックMB0について動きベクトル差分MV及びIDCT係数を算出するときには、周囲に隣接するマクロブロックMB8も考慮して算出される。
すなわち、図4に示したマクロブロックMB0について動きベクトル差分MV及びIDCT係数を算出するときには、周囲に隣接するマクロブロックMB8も考慮して算出される。
垂直相関検出回路5は、ブロック境界に沿った方向のエッジの相関の強さを検出する。具体的には、パラメータKpは、符号化難易度が高いほど大きくなるように、0〜1の範囲内に多段階に設定し、後述するように、ブロック歪判定回路6によりブロック境界におけるエッジ成分を抽出する。垂直相関検出回路5では、このようにして抽出されたエッジ成分のブロック境界における垂直相関の強さを求める。このときの垂直相関の強さを求める方法の一例を図6を用いて説明する。
また、この垂直相関検出回路5は、検出した垂直相関の強さを、ブロック歪判定回路6に出力する場合のみならず、相関検出の強さを符号化するときの難易度として、ブロック歪補正回路7にも出力しても良い。すなわち、垂直相関検出回路5で検出される垂直相関が大きいほど符号化を行う難易度が高いとみなして、垂直相関に応じたパラメータをブロック歪補正回路7に出力して、ブロック歪補正回路7で算出した補正値に当該パラメータを乗算処理する。
ブロック歪判定回路6は、符号化難易度評価回路3からのパラメータKp、パラメータ演算回路4からの各パラメータ、垂直相関検出回路5からの重み係数Kcを用いて、ブロック歪の有無を判定する。また、このブロック歪補正回路7は、ブロック歪補正を行うか否かの閾値det_thを有している。
具体的には、このブロック歪判定回路6は、|tmp0|>|tmp|が満たされているときには、ブロック境界に段差があると判定する。また、このブロック歪判定回路6は、|tmp0|<det_thが満たされているときには、ブロック境界にエッジがないと判断する。|tmp0|≧|diff3|及び|tmp0|≧|diff4|が満たされていると判断したときには、ブロック境界の両側にエッジがないことを判断する。
クロマ信号入力端子11に供給された入力画像データのクロマ(色)成分は、遅延回路14を介してクロマ信号出力端子40より取り出される。遅延回路14は、輝度成分についてのブロック歪低減処理が施されるのに要する時間を遅延させて、出力される輝度成分とクロマ成分とのタイミングを合わせるためのものである。
さらに、ブロック歪判定回路6では、上述の第1及び第2の実施の形態でブロック歪に対する補正の処理を行った結果、新たにエッジが生じないようにするために、図20に示すようなブロック歪の補正を行うとき、(1) |step|<σ0×corr_ratio(2) σ0>|diff3| かつ σ0>|diff4|(3) |tmp0|<corr_thという第1〜第3の判定条件を追加して、ブロック歪を判定する。すなわち、第1の判定条件では補正後の段差|step|が補正量σ0に比べて一定の比(corr_ratio)よりも小さいか否かを判断し、第2の判定条件では補正量σ0がブロック境界の両脇の段差(diff3,diff4)よりも大きいか否かを判断し、第3の判定条件ではブロック境界の段差|step|が補正量決定の為の閾値corr_thよりも小さいか否かを判断する。なお、第3の判定条件において、補正後の段差|step|と補正量との比を0<corr_ratio<1とする。
ステップST115では、ブロック歪補正回路7でステップST112での判定結果を示すフラグが入力されると、|tmp0|>corr_thを満たすか否かを判断し、この条件を満たす場合にはステップST116に進み補正を弱とし、満たさない場合にはステップST117に進み補正を強としてステップST122に進む。
ステップST120及びステップST121では、ブロック歪補正回路7で上述のステップST116、ステップST117と同様に、補正の強弱を決定してステップST122に進む。
次にステップST145では上述のステップST124と同様の処理を行い、ステップST146では上述のステップST125と同様の処理を行うことで処理を終了する。
Priority Applications (1)
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| JP01444498A JP4239231B2 (ja) | 1998-01-27 | 1998-01-27 | ブロック歪低減装置及び方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
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| JP01444498A JP4239231B2 (ja) | 1998-01-27 | 1998-01-27 | ブロック歪低減装置及び方法 |
Publications (3)
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| JPH11215500A JPH11215500A (ja) | 1999-08-06 |
| JPH11215500A5 true JPH11215500A5 (ja) | 2005-08-11 |
| JP4239231B2 JP4239231B2 (ja) | 2009-03-18 |
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ID=11861211
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
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| JP01444498A Expired - Fee Related JP4239231B2 (ja) | 1998-01-27 | 1998-01-27 | ブロック歪低減装置及び方法 |
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| JP (1) | JP4239231B2 (ja) |
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| JP2005020294A (ja) | 2003-06-25 | 2005-01-20 | Sony Corp | ブロック歪低減装置 |
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1998
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