JPH1127251A - フレーム同期制御装置 - Google Patents
フレーム同期制御装置Info
- Publication number
- JPH1127251A JPH1127251A JP9173591A JP17359197A JPH1127251A JP H1127251 A JPH1127251 A JP H1127251A JP 9173591 A JP9173591 A JP 9173591A JP 17359197 A JP17359197 A JP 17359197A JP H1127251 A JPH1127251 A JP H1127251A
- Authority
- JP
- Japan
- Prior art keywords
- synchronization
- electric field
- state
- reception
- aperture gate
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Time-Division Multiplex Systems (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
- Mobile Radio Communication Systems (AREA)
Abstract
(57)【要約】
【課題】 時分割多重無線システムにおいて受信を行う
際に、同期語の検出を許可するアパーチャゲートの制御
を、受信電界強度により制御することにより耐マルチパ
スフェージング性能を向上させるフレーム同期制御装置
を提供することを目的とする。 【解決手段】 電界強度の測定を行う電界強度測定回路
６を設け、同期ワード検出により状態遷移を行って、受
信同期状態でバースト受信を行っている際に、電界強度
が一定値を越えている場合、アパーチャゲートの幅を多
少広げることにより、マルチパスによって同期ワードの
位置が全スロットからずれても、アパーチャゲートの幅
を越えないため、同期ワードを検出可能であり、受信状
態も同期状態を維持できるため、良好なフレーム同期を
得てより品質の高い通話を実現することができる。
際に、同期語の検出を許可するアパーチャゲートの制御
を、受信電界強度により制御することにより耐マルチパ
スフェージング性能を向上させるフレーム同期制御装置
を提供することを目的とする。 【解決手段】 電界強度の測定を行う電界強度測定回路
６を設け、同期ワード検出により状態遷移を行って、受
信同期状態でバースト受信を行っている際に、電界強度
が一定値を越えている場合、アパーチャゲートの幅を多
少広げることにより、マルチパスによって同期ワードの
位置が全スロットからずれても、アパーチャゲートの幅
を越えないため、同期ワードを検出可能であり、受信状
態も同期状態を維持できるため、良好なフレーム同期を
得てより品質の高い通話を実現することができる。
Description
【０００１】
【発明の属する技術分野】本発明は、時分割多重通信方
式のディジタル無線通信方式におけるフレーム同期制御
装置に関するものである。
式のディジタル無線通信方式におけるフレーム同期制御
装置に関するものである。
【０００２】
【従来の技術】従来、移動体通信において、１つの周波
数を時間軸上で複数のフレームに分割し、それぞれを異
なる局に割り当てるＴＤＭＡ（時分割多重通信）方式を
用いた場合、フレーム同期を確立するために同期ワード
が用いられている。受信回路は、この同期ワードの検出
を行うことにより、１バースト中のデータの位置を検出
し、受信データ処理動作が可能となる。
数を時間軸上で複数のフレームに分割し、それぞれを異
なる局に割り当てるＴＤＭＡ（時分割多重通信）方式を
用いた場合、フレーム同期を確立するために同期ワード
が用いられている。受信回路は、この同期ワードの検出
を行うことにより、１バースト中のデータの位置を検出
し、受信データ処理動作が可能となる。
【０００３】以下、図面を参照しながら従来のフレーム
同期制御回路について説明する。図３は、従来のフレー
ム同期制御装置の構成図である。図３において、１は無
線部、２は同期ワード検出器、３は受信状態遷移回路、
４はアパーチャゲート制御回路、５は受信状態遷移回路
３とアパーチャゲート制御回路４からなる受信同期制御
回路である。
同期制御回路について説明する。図３は、従来のフレー
ム同期制御装置の構成図である。図３において、１は無
線部、２は同期ワード検出器、３は受信状態遷移回路、
４はアパーチャゲート制御回路、５は受信状態遷移回路
３とアパーチャゲート制御回路４からなる受信同期制御
回路である。
【０００４】以上のように構成された従来のフレーム同
期制御回路について、以下その動作を説明する。通常の
同期状態においては、無線部１にて復調されたデータは
同期ワード検出器２に入力され、アパーチャゲート制御
回路４からのアパーチャゲート信号が「１」の期間の
み、検出動作が行われる。同期ワードが検出されると同
期ワード検出信号が、受信状態遷移回路３に入力され
る。受信同期制御回路５は内部にタイマーを有し、次の
スロットまで、前記同期ワード検出信号が入力されたタ
イミングを保持し、次の受信スロットでは、前記の同期
ワード検出タイミングに対して狭い範囲で前後一定期間
「１」、その他の期間は「０」となるようアパーチャゲ
ートを制御し、本来同期ワードを検出するはずのない位
置での同期ワード検出の確立を低減させている。
期制御回路について、以下その動作を説明する。通常の
同期状態においては、無線部１にて復調されたデータは
同期ワード検出器２に入力され、アパーチャゲート制御
回路４からのアパーチャゲート信号が「１」の期間の
み、検出動作が行われる。同期ワードが検出されると同
期ワード検出信号が、受信状態遷移回路３に入力され
る。受信同期制御回路５は内部にタイマーを有し、次の
スロットまで、前記同期ワード検出信号が入力されたタ
イミングを保持し、次の受信スロットでは、前記の同期
ワード検出タイミングに対して狭い範囲で前後一定期間
「１」、その他の期間は「０」となるようアパーチャゲ
ートを制御し、本来同期ワードを検出するはずのない位
置での同期ワード検出の確立を低減させている。
【０００５】この様に、同期ワード検出器２は狭くなっ
たアパーチャゲートの範囲内で同期ワードの検出を行
い、同期ワード検出が出来なくなると、前方保護状態を
経由して非同期状態へ移行する。
たアパーチャゲートの範囲内で同期ワードの検出を行
い、同期ワード検出が出来なくなると、前方保護状態を
経由して非同期状態へ移行する。
【０００６】
【発明が解決しようとする課題】しかしながら、前記従
来の方法では受信電界強度が十分ある場合にも関わら
ず、マルチパス等の影響で、同期ワードの位置がアパー
チャ幅を越えて移動した場合、同期ワード不検出とな
り、その後その状態が続くと、非同期状態となり、幅の
広いアパーチャゲートに制御が移るまで、同期ワードが
検出出来ず、フレーム同期は行えないという課題を有し
ていた。
来の方法では受信電界強度が十分ある場合にも関わら
ず、マルチパス等の影響で、同期ワードの位置がアパー
チャ幅を越えて移動した場合、同期ワード不検出とな
り、その後その状態が続くと、非同期状態となり、幅の
広いアパーチャゲートに制御が移るまで、同期ワードが
検出出来ず、フレーム同期は行えないという課題を有し
ていた。
【０００７】そこで本発明は、電波状態の情報を状態遷
移に反映させてアパーチャゲート制御を行うことによ
り、高品質のフレーム同期制御を得ることができるフレ
ーム同期制御装置を提供することを目的とする。
移に反映させてアパーチャゲート制御を行うことによ
り、高品質のフレーム同期制御を得ることができるフレ
ーム同期制御装置を提供することを目的とする。
【０００８】
【課題を解決するための手段】請求項１に記載の発明
は、入力された受信電波を復調しバーストデータを出力
する無線部と、入力したバーストデータに対して同期ワ
ード検出を行い、その検出結果により同期ワード検出信
号を出力する同期ワード検出器と、この同期ワード検出
器からの検出信号に基づいてフレーム同期状態の遷移を
判定し、その判定された状態において状態信号を出力す
る受信状態遷移回路と、前記同期ワード検出器に対して
前記状態信号に対応したアパーチャ制御を行うアパーチ
ャゲート制御回路とを備えた受信同期制御回路から構成
され、同期状態において前記同期ワード検出器に対する
アパーチャゲート幅を可変制御する。
は、入力された受信電波を復調しバーストデータを出力
する無線部と、入力したバーストデータに対して同期ワ
ード検出を行い、その検出結果により同期ワード検出信
号を出力する同期ワード検出器と、この同期ワード検出
器からの検出信号に基づいてフレーム同期状態の遷移を
判定し、その判定された状態において状態信号を出力す
る受信状態遷移回路と、前記同期ワード検出器に対して
前記状態信号に対応したアパーチャ制御を行うアパーチ
ャゲート制御回路とを備えた受信同期制御回路から構成
され、同期状態において前記同期ワード検出器に対する
アパーチャゲート幅を可変制御する。
【０００９】請求項２に記載の発明は、前記無線部に入
力された電波の電界強度を測定する電界強度測定回路を
備え、前記受信状態遷移回路から前記同期ワード検出器
に出力するアパーチャゲートの制御を電界強度の値に基
づいて制御する。
力された電波の電界強度を測定する電界強度測定回路を
備え、前記受信状態遷移回路から前記同期ワード検出器
に出力するアパーチャゲートの制御を電界強度の値に基
づいて制御する。
【００１０】
【発明の実施の形態】請求項１に記載の発明は、入力さ
れた受信電波を復調しバーストデータを出力する無線部
と、入力したバーストデータに対して同期ワード検出を
行い、その検出結果により同期ワード検出信号を出力す
る同期ワード検出器と、この同期ワード検出器からの検
出信号に基づいてフレーム同期状態の遷移を判定し、そ
の判定された状態において状態信号を出力する受信状態
遷移回路と、前記同期ワード検出器に対して前記状態信
号に対応したアパーチャ制御を行うアパーチャゲート制
御回路とを備えた受信同期制御回路から構成され、同期
状態において同期ワード検出器に対するアパーチャゲー
ト幅を可変制御するようにしているので、同期状態に応
じてスロット毎にアパーチャゲートを可変させ、最適な
フレーム同期状態を確立することができる。
れた受信電波を復調しバーストデータを出力する無線部
と、入力したバーストデータに対して同期ワード検出を
行い、その検出結果により同期ワード検出信号を出力す
る同期ワード検出器と、この同期ワード検出器からの検
出信号に基づいてフレーム同期状態の遷移を判定し、そ
の判定された状態において状態信号を出力する受信状態
遷移回路と、前記同期ワード検出器に対して前記状態信
号に対応したアパーチャ制御を行うアパーチャゲート制
御回路とを備えた受信同期制御回路から構成され、同期
状態において同期ワード検出器に対するアパーチャゲー
ト幅を可変制御するようにしているので、同期状態に応
じてスロット毎にアパーチャゲートを可変させ、最適な
フレーム同期状態を確立することができる。
【００１１】請求項２に記載の発明は、請求項１に記載
のフレーム同期制御装置において、無線部に入力された
電波の電界強度を測定する電界強度測定回路を備え、受
信状態遷移回路から同期ワード検出器に出力するアパー
チャゲートの制御を電界強度の値に基づいて制御するよ
うにしているので、電波状態の情報を状態遷移に反映さ
せてフレーム同期を行うことにより、高品質のフレーム
同期制御を得ることができる。
のフレーム同期制御装置において、無線部に入力された
電波の電界強度を測定する電界強度測定回路を備え、受
信状態遷移回路から同期ワード検出器に出力するアパー
チャゲートの制御を電界強度の値に基づいて制御するよ
うにしているので、電波状態の情報を状態遷移に反映さ
せてフレーム同期を行うことにより、高品質のフレーム
同期制御を得ることができる。
【００１２】以下、本発明の実施の形態について、図面
を参照しながら説明する。図１は本発明の実施の形態１
におけるフレーム同期制御装置の構成図、図２は本発明
の実施の形態１における状態遷移図である。図１におい
て、１は無線部、２は同期ワード検出器、３は受信状態
遷移回路、４はアパーチャゲート制御回路、５は受信状
態遷移回路３とアパーチャゲート制御回路４からなる受
信同期制御回路、６は電界強度測定回路である。
を参照しながら説明する。図１は本発明の実施の形態１
におけるフレーム同期制御装置の構成図、図２は本発明
の実施の形態１における状態遷移図である。図１におい
て、１は無線部、２は同期ワード検出器、３は受信状態
遷移回路、４はアパーチャゲート制御回路、５は受信状
態遷移回路３とアパーチャゲート制御回路４からなる受
信同期制御回路、６は電界強度測定回路である。
【００１３】以上の様に構成されたフレーム同期制御装
置について、以下その動作を説明する。無線部１にて復
調されたバーストデータは、同期ワード検出器２に入力
され同期ワードの検出が可能な場合、検出信号を受信状
態遷移回路３に対して出力する。検出信号を受けた受信
状態遷移回路３は、図２に示す状態遷移図に基づき非同
期状態から、連続して同期ワードを検出することにより
後方保護状態を経て同期状態に移行する。同期状態にお
いて受信状態遷移回路３は状態制御信号をアパーチャゲ
ート制御回路４に与えることによりアパーチャゲートの
幅の調整を行う。通常、同期状態ではアパーチャゲート
は狭い範囲で設定されているが、電界強度測定回路６か
らの電界強度データを受信して一定値を越えている場
合、マルチパスフェージング等により前回のバーストと
受信タイミングが異なっても十分復調が可能であると判
定し、アパーチャゲートの幅を広めに制御して、多少の
バーストデータの位置のずれに対してもアパーチャの範
囲を越えることなく受信出来るよう動作する。
置について、以下その動作を説明する。無線部１にて復
調されたバーストデータは、同期ワード検出器２に入力
され同期ワードの検出が可能な場合、検出信号を受信状
態遷移回路３に対して出力する。検出信号を受けた受信
状態遷移回路３は、図２に示す状態遷移図に基づき非同
期状態から、連続して同期ワードを検出することにより
後方保護状態を経て同期状態に移行する。同期状態にお
いて受信状態遷移回路３は状態制御信号をアパーチャゲ
ート制御回路４に与えることによりアパーチャゲートの
幅の調整を行う。通常、同期状態ではアパーチャゲート
は狭い範囲で設定されているが、電界強度測定回路６か
らの電界強度データを受信して一定値を越えている場
合、マルチパスフェージング等により前回のバーストと
受信タイミングが異なっても十分復調が可能であると判
定し、アパーチャゲートの幅を広めに制御して、多少の
バーストデータの位置のずれに対してもアパーチャの範
囲を越えることなく受信出来るよう動作する。
【００１４】
【発明の効果】本発明は、受信電界強度からのデータを
受信状態遷移に加味出来るため、同期状態において電界
強度が十分大きい場合にアパーチャゲートを広げること
により、極端なマルチパスフェージングに対して同期ワ
ードの不検出を防止することが可能となり、良好なフレ
ーム同期を得ることができる。
受信状態遷移に加味出来るため、同期状態において電界
強度が十分大きい場合にアパーチャゲートを広げること
により、極端なマルチパスフェージングに対して同期ワ
ードの不検出を防止することが可能となり、良好なフレ
ーム同期を得ることができる。
【図１】本発明の実施の形態１におけるフレーム同期制
御装置の構成図
御装置の構成図
【図２】本発明の実施の形態１における状態遷移図
【図３】従来のフレーム同期制御装置の構成図
１ 無線部 ２ 同期ワード検出器 ３ 受信状態遷移回路 ４ アパーチャゲート制御回路 ５ 受信同期制御回路 ６ 電界強度測定回路
Claims (2)
- 【請求項１】入力された受信電波を復調しバーストデー
タを出力する無線部と、入力したバーストデータに対し
て同期ワード検出を行い、その検出結果により同期ワー
ド検出信号を出力する同期ワード検出器と、この同期ワ
ード検出器からの検出信号に基づいてフレーム同期状態
の遷移を判定し、その判定された状態において状態信号
を出力する受信状態遷移回路と、前記同期ワード検出器
に対して前記状態信号に対応したアパーチャ制御を行う
アパーチャゲート制御回路とを備えた受信同期制御回路
から構成され、同期状態において前記同期ワード検出器
に対するアパーチャゲート幅を可変制御することを特徴
とするフレーム同期制御装置。 - 【請求項２】前記無線部に入力された電波の電界強度を
測定する電界強度測定回路を備え、前記受信状態遷移回
路から前記同期ワード検出器に出力するアパーチャゲー
トの制御を電界強度の値に基づいて制御することを特徴
とする請求項１に記載のフレーム同期制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9173591A JPH1127251A (ja) | 1997-06-30 | 1997-06-30 | フレーム同期制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9173591A JPH1127251A (ja) | 1997-06-30 | 1997-06-30 | フレーム同期制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH1127251A true JPH1127251A (ja) | 1999-01-29 |
Family
ID=15963439
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9173591A Pending JPH1127251A (ja) | 1997-06-30 | 1997-06-30 | フレーム同期制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH1127251A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6757687B2 (en) | 2001-05-31 | 2004-06-29 | Nokia Corporation | Storage of data entries in digital devices and methods |
-
1997
- 1997-06-30 JP JP9173591A patent/JPH1127251A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6757687B2 (en) | 2001-05-31 | 2004-06-29 | Nokia Corporation | Storage of data entries in digital devices and methods |
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Free format text: JAPANESE INTERMEDIATE CODE: R313531 |
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