JPH11282402A - Plasma display driving method and apparatus - Google Patents
Plasma display driving method and apparatusInfo
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- JPH11282402A JPH11282402A JP10083961A JP8396198A JPH11282402A JP H11282402 A JPH11282402 A JP H11282402A JP 10083961 A JP10083961 A JP 10083961A JP 8396198 A JP8396198 A JP 8396198A JP H11282402 A JPH11282402 A JP H11282402A
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Abstract
(57)【要約】
【課題】 電力を抑制した場合の画質の劣化を防止し、
実際の消費電力が抑制された割合を所望の抑制率と同じ
程度にできるプラズマディスプレイ駆動方法及びその装
置を得る。
【解決手段】 抑制率に対応して、サブフィールド毎の
放電回数からなる1フィールドの複数種類の放電回数パ
ターンを、1フィールド毎に所定の順序で発生するパタ
ーン発生回路24と、パターン発生回路24で発生した
放電回数パターンが示す放電回数で放電パルスをサブフ
ィールド毎に発生する駆動波形発生回路26とを備え
る。
(57) [Summary] [Problem] To prevent deterioration of image quality when power is suppressed,
A plasma display driving method and apparatus capable of reducing the rate at which actual power consumption is suppressed to the same degree as a desired suppression rate are obtained. SOLUTION: A pattern generation circuit 24 for generating a plurality of types of discharge number patterns of one field consisting of the number of discharges for each subfield in a predetermined order for each field in accordance with the suppression rate. And a drive waveform generating circuit 26 for generating a discharge pulse for each subfield with the number of discharges indicated by the pattern of the number of discharges generated in step (1).
Description
【0001】[0001]
【発明の属する技術分野】この発明は、プラズマディス
プレイパネル(以下、PDPと称す)を駆動するための
プラズマディスプレイ駆動方法及びその装置に関する。[0001] 1. Field of the Invention [0002] The present invention relates to a plasma display driving method and apparatus for driving a plasma display panel (hereinafter, referred to as PDP).
【0002】[0002]
【従来の技術】図3は従来のプラズマディスプレイ駆動
装置の構成図である。図3において、1は画像信号を印
加するための画像信号入力端子、3はプラズマディスプ
レイパネル、2は画像信号入力端子1に印加された画像
信号に従ってPDP3を駆動するための駆動回路であ
る。2. Description of the Related Art FIG. 3 is a block diagram of a conventional plasma display driving device. In FIG. 3, reference numeral 1 denotes an image signal input terminal for applying an image signal, 3 denotes a plasma display panel, and 2 denotes a drive circuit for driving the PDP 3 in accordance with an image signal applied to the image signal input terminal 1.
【0003】PDP3は、第1〜第3電極を有する多数
の画素によって構成される。多数の第1電極の集合が電
極群31、第2電極の集合が電極群32、第3電極の集
合が電極群33である。電極群31及び32間には画素
を放電させるための放電パルスが印加される。電極群3
3には、サブフィールド毎に放電パルスに基づく放電を
行うか否かを示す信号(以下、放電許可信号と呼ぶ)が
印加される。PDP3を構成する多数の画素には、放電
パルスが与えられるが、放電を行うことを示す放電許可
信号受けている画素に限り放電する。放電パルス及び放
電許可信号は駆動回路2が生成する。[0005] The PDP 3 is composed of a number of pixels having first to third electrodes. A group of many first electrodes is an electrode group 31, a group of second electrodes is an electrode group 32, and a group of third electrodes is an electrode group 33. A discharge pulse for discharging a pixel is applied between the electrode groups 31 and 32. Electrode group 3
A signal (hereinafter referred to as a discharge permission signal) indicating whether or not to perform a discharge based on a discharge pulse for each subfield is applied to 3. A discharge pulse is given to a number of pixels constituting the PDP 3, but only the pixels receiving the discharge permission signal indicating that the discharge is to be performed are discharged. The driving circuit 2 generates the discharge pulse and the discharge permission signal.
【0004】駆動回路2は、同期信号分離回路21、階
調データ処理回路22、輝度情報検出回路23、タイミ
ング発生回路25、駆動波形発生回路26、放電回数格
納回路27及び乗算器28を含む。The drive circuit 2 includes a synchronization signal separation circuit 21, a gradation data processing circuit 22, a luminance information detection circuit 23, a timing generation circuit 25, a drive waveform generation circuit 26, a discharge count storage circuit 27, and a multiplier 28.
【0005】同期信号分離回路21は画像信号入力端子
1に印加された画像信号を1フィールドを規定する同期
信号と階調度を示す階調データとに分離して出力する。A synchronizing signal separating circuit 21 separates an image signal applied to the image signal input terminal 1 into a synchronizing signal defining one field and gradation data indicating a gradation, and outputs the result.
【0006】輝度情報検出回路23は、同期信号分離回
路21が出力した階調データに基づいてPDP3の駆動
で消費される電力を類推し、この消費電力を抑制する割
合を示す抑制率を出力する。The luminance information detection circuit 23 estimates the power consumed in driving the PDP 3 based on the grayscale data output from the synchronization signal separation circuit 21 and outputs a suppression rate indicating the rate at which the power consumption is suppressed. .
【0007】放電回数格納回路27は、1フィールドを
構成する複数のサブフィールド毎に、それぞれ対応した
複数の固定の放電回数を格納しており、同期信号に同期
して順番に繰り返し放電回数を出力する。The discharge count storage circuit 27 stores a plurality of fixed discharge counts corresponding to each of a plurality of subfields constituting one field, and repeatedly outputs the number of discharges in synchronization with a synchronization signal. I do.
【0008】タイミング発生回路25は同期信号に基づ
いてタイミング信号を生成して出力する。The timing generation circuit 25 generates and outputs a timing signal based on the synchronization signal.
【0009】乗算器28は、放電回数格納回路27が出
力した放電回数に輝度情報検出回路23が出力した抑制
率を乗じて、この演算結果を出力する。The multiplier 28 multiplies the number of discharges output by the number-of-discharges storage circuit 27 by the suppression rate output by the luminance information detection circuit 23, and outputs the result of the calculation.
【0010】駆動波形発生回路26は、タイミング信号
に同期して、乗算器28の演算結果が示す放電回数の放
電パルスを出力する。The drive waveform generating circuit 26 outputs a discharge pulse of the number of discharges indicated by the operation result of the multiplier 28 in synchronization with the timing signal.
【0011】階調データ処理回路22は階調データを、
上述の放電許可信号に変換して、当該放電許可信号をタ
イミング信号に同期して出力する。The gradation data processing circuit 22 converts the gradation data into
The signal is converted into the above-described discharge permission signal, and the discharge permission signal is output in synchronization with the timing signal.
【0012】表1は、サブフィールド毎の放電回数を消
費電力を抑制しない場合(すなわち、抑制率が1の場
合)、および消費電力を抑制した場合について示す。Table 1 shows the number of discharges for each subfield when the power consumption is not suppressed (that is, when the suppression rate is 1) and when the power consumption is suppressed.
【0013】[0013]
【表1】 [Table 1]
【0014】ここでは、消費電力を抑制した場合の抑制
率を例えば16分の13(=0.8125)とし、簡単
のためサブフィールドの数を4とし、放電回数格納回路
27は、サブフィールドSF1〜SF4毎に1、2、
4、8の放電回数を出力する場合を考える。この場合、
消費電力を抑制しない場合の放電回数は、放電回数格納
回路27が出力した放電回数と同じで、1、2、4、8
である。一方、消費電力を抑制した場合の放電回数は、
乗算器28の演算を整数化して得られるため、1、2、
3、7になる。Here, the suppression rate when the power consumption is suppressed is, for example, 13/16 (= 0.8125), the number of subfields is 4 for simplicity, and the number-of-discharges storage circuit 27 stores the subfield SF1 ~ 1,2 for each SF4,
Consider a case where the number of discharges of 4 and 8 is output. in this case,
The number of discharges when the power consumption is not suppressed is the same as the number of discharges output from the discharge number storage circuit 27, and is 1, 2, 4, 8
It is. On the other hand, the number of discharges when power consumption is suppressed is
Since the operation of the multiplier 28 is obtained by converting it into an integer, 1, 2,
3,7.
【0015】表2に、階調データに対する、電力を抑制
した場合の1フィールドの放電回数及び実効抑制率を示
す。なお、実効抑制率は、実際に消費電力が抑制された
割合であって、消費電力を抑制した場合の放電回数を消
費電力を抑制しない場合の放電回数で割ったものと等価
である。ここでは、消費電力を抑制しない場合の放電回
数は階調データと同じである。Table 2 shows the number of discharges per field and the effective suppression rate for the grayscale data when the power is suppressed. The effective suppression rate is a rate at which power consumption is actually suppressed, and is equivalent to a value obtained by dividing the number of discharges when power consumption is suppressed by the number of discharges when power consumption is not suppressed. Here, the number of discharges when the power consumption is not suppressed is the same as the gradation data.
【0016】[0016]
【表2】 [Table 2]
【0017】例えば、階調データが11の場合、電力を
抑制した場合の1フィールドの放電回数は、サブフィー
ルドSF1,SF2,SF4において放電が許可される
ため、それぞれの放電回数を足し合わせた10であり、
実効抑制率は、11分の10(=0.9091)であ
る。For example, when the grayscale data is 11, the number of discharges in one field when the power is suppressed is equal to the sum of the number of discharges in each of the subfields SF1, SF2, and SF4. And
The effective suppression rate is 10/11 (= 0.9091).
【0018】なお、抑制率の意義は、次の通りである。
画面全体が明るいときはPDPで消費される電力が大き
くなるため、画面全体が明るい場合に合わせてPDPに
電源を供給するための電源装置を用意すれば、大型で高
価な電源装置が必要となる。また、画面全体が明るいと
きは、PDPが高温になることが予想される。そこで、
輝度情報検出回路23は、階調データに基づいて画面全
体の明るさを判断し、画面全体が明るいほど、消費電力
が大きく抑制される値を出力することによって、大型で
高価な電源装置を必要としなくて済むようにしたり、P
DPが高温にならないようにしたりすることができる。The significance of the suppression rate is as follows.
When the entire screen is bright, the power consumed by the PDP is large. Therefore, if a power supply for supplying power to the PDP is prepared in accordance with the case where the entire screen is bright, a large and expensive power supply is required. . When the entire screen is bright, it is expected that the PDP will become hot. Therefore,
The luminance information detection circuit 23 determines the brightness of the entire screen based on the grayscale data, and outputs a value that greatly reduces power consumption as the entire screen is bright, thereby requiring a large and expensive power supply device. So that you don't have to
For example, the DP may not be heated to a high temperature.
【0019】[0019]
【発明が解決しようとする課題】従来では以上のような
構成のため、階調データが3及び4あるいは11及び1
2では、電力を抑制した場合、放電回数は同じなので、
画素の輝度は同じになる。このように、電力を抑制した
場合、階調データが変化しても、画素の実際の階調(以
下、実効表示階調と呼ぶ)は変化しない場合があり、画
質が劣化するという問題点がある。Conventionally, because of the above configuration, the gradation data is 3 and 4 or 11 and 1
In case 2, when the power is suppressed, the number of discharges is the same,
The pixels have the same brightness. As described above, when the power is suppressed, the actual gray level of a pixel (hereinafter, referred to as an effective display gray level) may not change even if the gray level data changes, and the image quality deteriorates. is there.
【0020】さらに、上述したように、例えば階調デー
タが11では、電力を抑制した場合の実効抑制率は0.
9091であり、抑制率(=0.8125)と著しく異
なる。このように、実際の消費電力が抑制された割合
が、所望の抑制率と著しく異なるという問題点もある。Further, as described above, for example, when the gradation data is 11, the effective suppression rate when the power is suppressed is 0.1.
9091, which is significantly different from the suppression rate (= 0.8125). As described above, there is also a problem that the rate at which the actual power consumption is suppressed is significantly different from the desired suppression rate.
【0021】本発明は、これらの問題点を解決するため
になされたものであり、電力を抑制した場合の画質の劣
化を防止し、実際の消費電力が抑制された割合を所望の
抑制率と同じ程度にできるプラズマディスプレイ駆動方
法及びその装置を得ることを目的とする。The present invention has been made to solve these problems, and it is possible to prevent the image quality from deteriorating when the power is suppressed, and to set the rate at which the actual power consumption is suppressed to a desired suppression rate. It is an object of the present invention to obtain a plasma display driving method and a plasma display driving device which can be set to the same degree.
【0022】[0022]
【課題を解決するための手段】本発明の請求項1に係る
課題解決手段は、各々放電回数が設定されたサブフィー
ルドの複数からなる1フィールド毎に、プラズマディス
プレイの画素を放電させ、前記サブフィールド毎に前記
画素を放電させるか否かを所定の階調度を示す信号に応
じて決定するプラズマディスプレイの駆動方法であっ
て、(a)前記サブフィールド毎の前記放電回数の複数
からなる1フィールドの放電回数パターンを、1つの所
定の抑制率に対して複数種類準備する行程と、(b)前
記行程(a)で準備された複数種類の放電回数パターン
のうちの一つを所定の順序で選択する行程と、(c)前
記行程(b)で選択された前記放電回数パターンが示す
前記放電回数で前記放電パルスを前記サブフィールド毎
に発生する行程とを備え、前記行程(b)及び(c)が
1フィールド毎に繰り返される。According to a first aspect of the present invention, there is provided a plasma display apparatus comprising the steps of: discharging a pixel of a plasma display for each field including a plurality of subfields each having a set number of discharges; A driving method of a plasma display for determining whether or not to discharge the pixel for each field in accordance with a signal indicating a predetermined gradient, wherein (a) one field including a plurality of the number of discharges for each subfield (B) preparing one of the plurality of types of discharge frequency patterns prepared in the step (a) in a predetermined order. And (c) generating the discharge pulse for each sub-field at the number of discharges indicated by the number-of-discharges pattern selected in the step (b). For example, the stroke (b) and (c) are repeated for each field.
【0023】本発明の請求項2に係る課題解決手段にお
いて、前記所定の順序は、前記複数種類の放電回数パタ
ーンを順に並べた順序である。In the means for solving problems according to claim 2 of the present invention, the predetermined order is an order in which the plurality of types of discharge frequency patterns are arranged in order.
【0024】本発明の請求項3に係る課題解決手段にお
いて、前記所定の順序は、前記複数種類の放電回数パタ
ーンの順列による順序の組み合わせである。[0024] In the means for solving problems according to claim 3 of the present invention, the predetermined order is a combination of an order based on a permutation of the plurality of types of discharge frequency patterns.
【0025】本発明の請求項4に係る課題解決手段にお
いて、前記所定の順序は、乱数に基づく順序である。In the fourth aspect of the present invention, the predetermined order is an order based on random numbers.
【0026】本発明の請求項5に係る課題解決手段は、
サブフィールド毎に、プラズマディスプレイの画素を放
電させるための放電パルスを所定の抑制率に応じた放電
回数で発生させるが、前記画素を放電させるか否かにつ
いては所定の階調度を示す信号に応じて決定するプラズ
マディスプレイの駆動装置であって、前記所定の抑制率
に対応して、前記サブフィールド毎の前記放電回数から
なる1フィールドの放電回数パターンの複数種類を、1
フィールド毎に所定の順序で発生するパターン発生回路
と、前記パターン発生回路で発生した前記放電回数パタ
ーンが示す前記放電回数で前記放電パルスを前記サブフ
ィールド毎に発生する駆動波形発生回路とを備える。According to a fifth aspect of the present invention, there is provided:
For each subfield, a discharge pulse for discharging a pixel of the plasma display is generated at the number of discharges according to a predetermined suppression rate, and whether or not to discharge the pixel is determined according to a signal indicating a predetermined gradient. A plurality of types of one-field discharge number patterns each including the number of discharge times for each of the sub-fields, corresponding to the predetermined suppression rate.
A pattern generating circuit that generates a predetermined order for each field; and a drive waveform generating circuit that generates the discharge pulse for each of the subfields at the number of discharges indicated by the number-of-discharges pattern generated by the pattern generating circuit.
【0027】本発明の請求項6に係る課題解決手段にお
いて、前記パターン発生回路は、前記複数種類の放電回
数パターンが予め格納された記憶部を含む。[0027] In the means for solving problems according to claim 6 of the present invention, the pattern generation circuit includes a storage unit in which the plurality of types of discharge number patterns are stored in advance.
【0028】本発明の請求項7に係る課題解決手段にお
いて、前記記憶部は、前記複数種類の放電回数パターン
のうち下位のサブフィールドの放電回数を格納し、前記
パターン発生回路は、前記複数種類の放電回数パターン
のうち上位のサブフィールドの放電回数を、固定の放電
回数と前記所定の抑制率との乗算によって算出する算出
部をさらに備える。[0028] In the means for solving problems according to claim 7 of the present invention, the storage section stores the number of discharges in a lower subfield of the plurality of types of discharge number patterns, and the pattern generation circuit stores the plurality of types of discharge number patterns. And a calculating unit for calculating the number of discharges of the upper subfield in the number of discharges pattern by multiplying the fixed number of discharges by the predetermined suppression rate.
【0029】本発明の請求項8に係る課題解決手段にお
いて、前記所定の順序は、前記複数種類の放電回数パタ
ーンを順に並べた順序である。In the means for solving problems according to claim 8 of the present invention, the predetermined order is an order in which the plurality of types of discharge frequency patterns are arranged in order.
【0030】本発明の請求項9に係る課題解決手段にお
いて、前記所定の順序は、前記複数種類の放電回数パタ
ーンの順列による順序の組み合わせである。In the ninth aspect of the present invention, the predetermined order is a combination of an order based on a permutation of the plurality of types of discharge frequency patterns.
【0031】本発明の請求項10に係る課題解決手段に
おいて、前記所定の順序は、乱数に基づく順序である。In the means for solving problems according to claim 10 of the present invention, the predetermined order is an order based on random numbers.
【0032】[0032]
【発明の実施の形態】実施の形態1.図1は本発明のプ
ラズマディスプレイ駆動装置を示す構成図である。図1
において、24は抑制率及び同期信号を受け、同期信号
に同期して放電回数を出力するパターン発生回路、24
1はパターン発生回路24に含まれたROM、その他の
符号は図3に対応している。DESCRIPTION OF THE PREFERRED EMBODIMENTS Embodiment 1 FIG. 1 is a configuration diagram showing a plasma display driving device of the present invention. FIG.
In 24, a pattern generation circuit 24 receives a suppression rate and a synchronization signal, and outputs the number of discharges in synchronization with the synchronization signal.
Reference numeral 1 denotes a ROM included in the pattern generation circuit 24, and other reference numerals correspond to FIG.
【0033】駆動回路2の動作は、主として、従来の技
術と同様である。すなわち、サブフィールド毎に、PD
P3の画素を放電させるための放電パルスを所定の抑制
率に応じた放電回数で発生させるが、前記画素を放電さ
せるか否かについては所定の階調度を示す階調データに
応じてサブフィールド毎に決定する。但し、実施の形態
では、従来の放電回数格納回路27及び乗算器28をパ
ターン発生回路24に置き換えているため、次のように
動作が異なる。The operation of the drive circuit 2 is mainly the same as in the prior art. That is, for each subfield, PD
A discharge pulse for discharging the pixel P3 is generated at the number of discharges corresponding to a predetermined suppression rate. Whether or not to discharge the pixel is determined for each subfield according to grayscale data indicating a predetermined grayscale. To decide. However, in the embodiment, since the conventional discharge number storage circuit 27 and multiplier 28 are replaced with the pattern generation circuit 24, the operation is different as follows.
【0034】ROM241には、抑制率に対応した複数
種類の放電回数パターンが予め格納されている。この複
数種類の放電パターンの一例を表3に示す。The ROM 241 stores a plurality of types of discharge frequency patterns corresponding to the suppression rates in advance. Table 3 shows an example of the plurality of types of discharge patterns.
【0035】[0035]
【表3】 [Table 3]
【0036】ここでは、従来の技術の説明に合わせて、
消費電力を抑制した場合の抑制率を16分の13(=
0.8125)、サブフィールドの数が4の場合を用い
て説明する。また、表3では、A〜Dが抑制率が0.8
125の場合に対応した複数種類の放電回数パターンで
ある。Here, along with the description of the conventional technology,
When the power consumption is suppressed, the suppression rate is 13/16 (=
0.8125), and the case where the number of subfields is four will be described. In Table 3, A to D indicate that the suppression rate is 0.8.
It is a plurality of types of discharge frequency patterns corresponding to the case of No. 125.
【0037】放電回数パターンは、サブフィールドSF
1〜SF4それぞれに対応する放電回数からなる。The pattern of the number of discharges is represented by subfield SF
1 to SF4.
【0038】パターン発生回路24は、0.8125の
抑制率を受けると、ROM241から放電回数パターン
A〜Dを読み出す。そして、パターン発生回路24は、
1フィールドの開始を示す同期信号を受けると、放電パ
ターンAを出力し、次の1フィールドの開始を示す同期
信号を受けると、放電パターンBを出力する。このよう
にして、パターン発生回路24は、0.8125の抑制
率を受けている間、放電回数パターンを所定の順に選択
し、同期信号に同期して、放電パターンA,B,C,
D,A,B,C,D,A,……という様に出力し続け
る。When the pattern generation circuit 24 receives the suppression rate of 0.8125, it reads the number-of-discharges patterns A to D from the ROM 241. Then, the pattern generation circuit 24
Upon receiving a synchronization signal indicating the start of one field, the circuit outputs a discharge pattern A, and receiving a synchronization signal indicating the start of the next field, outputs a discharge pattern B. In this way, while receiving the suppression rate of 0.8125, the pattern generation circuit 24 selects the number-of-discharge patterns in a predetermined order, and synchronizes with the synchronization signal to generate the discharge patterns A, B, C,
D, A, B, C, D, A,... Continue to be output.
【0039】駆動波形発生回路26は、放電回数及びタ
イミング発生回路25が出力するタイミング信号を受け
る。タイミング信号は、サブフィールドSF1〜SF4
それぞれの開始のタイミングを示す。駆動波形発生回路
26は、放電回数パターンAを受け、サブフィールドS
F1の開始のタイミングを示すタイミング信号を受ける
と、表3のSF1とAとの欄に示す数の放電パルスを出
力し、次のサブフィールドSF2の開始のタイミングを
示すタイミング信号を受けると、表3のSF2とAとの
欄に示す数の放電パルスを出力する。このようにして、
駆動波形発生回路26は、放電回数パターンAを受ける
と、サブフィールドSF1〜SF4それぞれにおいて、
1つの放電パルス、1つの放電パルス、4つの放電パル
ス、6つの放電パルスを出力する。なお、駆動波形発生
回路26は、放電回数パターンB,C,Dを受けた場合
の動作は、放電回数パターンAを受けた場合に準ずる。The drive waveform generation circuit 26 receives the number of discharges and the timing signal output from the timing generation circuit 25. The timing signal is transmitted from subfields SF1 to SF4.
The timing of each start is shown. The drive waveform generation circuit 26 receives the discharge number pattern A,
When a timing signal indicating the start timing of F1 is received, the number of discharge pulses shown in the columns of SF1 and A in Table 3 is output, and when a timing signal indicating the start timing of the next subfield SF2 is received, a table is displayed. The discharge pulses of the number shown in the column of SF2 and A of 3 are output. In this way,
When receiving the discharge number pattern A, the drive waveform generation circuit 26 sets the subfields SF1 to SF4 in each of the subfields SF1 to SF4.
One discharge pulse, one discharge pulse, four discharge pulses, and six discharge pulses are output. The operation of the drive waveform generation circuit 26 when receiving the discharge number patterns B, C, and D is the same as the operation when receiving the discharge number pattern A.
【0040】表4に、階調データに対する、電力を抑制
した場合の4フィールドの放電回数(放電許可信号に基
づいて実際に放電されたもの)、実効表示階調及び実効
抑制率を示す。なお、実効表示階調は、いわゆる人間の
視覚特性から認識される階調であり、4フィールドの放
電回数の合計を4で割ることによって計算される。ま
た、実効抑制率は、従来の技術で説明した通りである
が、消費電力を抑制した場合の4フィールドの放電回数
の合計を消費電力を抑制しない場合の4フィールドの放
電回数の合計で割ったものと等価である。Table 4 shows the number of discharges in four fields (actually discharged based on the discharge permission signal), the effective display gradation, and the effective suppression rate when the power is suppressed with respect to the gradation data. Note that the effective display gradation is a gradation recognized from so-called human visual characteristics, and is calculated by dividing the total number of discharges in four fields by four. The effective suppression rate is as described in the related art, but the total number of discharges in four fields when power consumption is suppressed is divided by the total number of discharges in four fields when power consumption is not suppressed. Is equivalent to
【0041】[0041]
【表4】 [Table 4]
【0042】例えば、階調データが11の場合、電力を
抑制した場合の放電パターンAに対応する1フィールド
の放電回数は、サブフィールドSF1,SF2,SF4
において放電が許可されるため、それぞれの放電回数を
足し合わせた8である。同様に、階調データが11の場
合、電力を抑制した場合の放電パターンB,C,Dに対
応する1フィールドの放電回数はそれぞれ9,9,9で
ある。したがって、階調データが11の場合の4フィー
ルドの放電回数の合計は35である。実効表示階調は4
分の35(=8.75)、実効抑制率は44分の35
(=0.7955)である。For example, when the gradation data is 11, the number of discharges in one field corresponding to the discharge pattern A when the power is suppressed is the subfield SF1, SF2, SF4.
Since the discharge is permitted at the time of, the number of times of each discharge is added up to 8. Similarly, when the gradation data is 11, the number of discharges in one field corresponding to the discharge patterns B, C, and D when the power is suppressed is 9, 9, and 9, respectively. Therefore, when the gradation data is 11, the total number of discharges in four fields is 35. Effective display gradation is 4
35 / (= 8.75), effective suppression rate is 35/44
(= 0.7955).
【0043】表2と表4を対比すると、表4に示す実効
抑制率は、表2に示す実効抑制率と比較して、所望の抑
制率(=0.8125)と同じ程度である。また、従来
の技術で説明したように、表2に示す実効表示階調(電
力を抑制した場合の放電回数と同じ)は、階調データが
変化すれば、表4に示す実効表示階調は必ず変化する。Comparing Tables 2 and 4, the effective suppression rate shown in Table 4 is about the same as the desired suppression rate (= 0.8125) as compared to the effective suppression rate shown in Table 2. Further, as described in the background art, the effective display gradation shown in Table 2 (same as the number of discharges when power is suppressed) is changed as shown in Table 4 if the gradation data changes. It always changes.
【0044】以上のように、ROM241は抑制率に対
応して、放電回数パターンA〜Dを準備し、パターン発
生回路24は放電パターンA〜Dのうちの一つを所定の
順序で選択して出力し、駆動波形発生回路26はパター
ン発生回路の出力が示す放電回数で放電パルスをサブフ
ィールド毎に発生し、階調データ処理回路22は放電パ
ルスによる放電の可否をサブフィールド毎に決定する。As described above, the ROM 241 prepares the discharge number patterns A to D corresponding to the suppression rate, and the pattern generation circuit 24 selects one of the discharge patterns A to D in a predetermined order. The drive waveform generation circuit 26 generates a discharge pulse for each subfield with the number of discharges indicated by the output of the pattern generation circuit, and the gradation data processing circuit 22 determines whether or not discharge by the discharge pulse is possible for each subfield.
【0045】なお、ROM241には、放電回数パター
ンA〜Dのように、抑制率が16分の1、16分の2、
……、16分の16のそれぞれに対応する放電回数パタ
ーンが格納されている。パターン発生回路24は、1つ
の抑制率に対して複数種類の放電回数パターンをROM
241から読み出す。It should be noted that the ROM 241 has a suppression rate of 1/16, 2/16, as in the discharge number patterns A to D.
.., And the number of discharge patterns corresponding to 16/16 are stored. The pattern generation circuit 24 stores a plurality of types of discharge frequency patterns for one suppression rate in a ROM.
241.
【0046】また、抑制率が16分の16の場合、すな
わち、電力を抑制しない場合は、放電パターンの種類は
表4に示すZのみである。複数種類の放電回数パターン
には、例外として、電力を抑制しない場合の1種類の放
電回数パターンも含める。When the suppression rate is 16/16, that is, when the power is not suppressed, the type of the discharge pattern is only Z shown in Table 4. The plurality of types of discharge frequency patterns include, as an exception, one type of discharge frequency pattern in the case where power is not suppressed.
【0047】実施の形態1によれば、複数種類の放電回
数パターンが繰り返されることによって、実効表示階調
を連続的に変化させることができ、画質の劣化を防止で
きる。また、従来と比較して、実際の消費電力が抑制さ
れた割合が所望の抑制率と同じ程度である。According to the first embodiment, the effective display gradation can be continuously changed by repeating a plurality of types of discharge frequency patterns, and the deterioration of image quality can be prevented. In addition, the rate at which the actual power consumption is suppressed is about the same as the desired suppression rate as compared with the related art.
【0048】なお、以上の説明では、サブフィールドの
数が4つの場合を用いて説明したが、4つ以外の場合で
もよい。In the above description, the case where the number of subfields is four has been described, but a case other than four may be used.
【0049】実施の形態2.サブフィールドの数が多く
なると、放電回数パターンは指数的に増加し、データ数
が膨大になる。そこで、実施の形態2では、パターン発
生回路24が乗算器(算出部)242をさらに含み、R
OM241は複数種類の放電回数パターンのうち下位の
サブフィールドの放電回数を格納し、乗算器242は複
数種類の放電パターンのうち上位のサブフィールドの放
電回数を算出する。Embodiment 2 As the number of subfields increases, the number of discharge patterns increases exponentially, and the number of data becomes enormous. Therefore, in the second embodiment, the pattern generation circuit 24 further includes a multiplier (calculation unit) 242, and R
The OM 241 stores the number of discharges of the lower subfield of the plurality of types of discharge patterns, and the multiplier 242 calculates the number of discharges of the upper subfield of the plurality of types of discharge patterns.
【0050】なお下位のサブフィールドとは、複数のサ
ブフィールドのうち、発光維持期間が短い方を指し、下
位のサブフィールド以外が上位のサブフィールドであ
る。例えば、サブフィールドが、発光維持期間が短い側
から順にSF1〜SF4である場合、下位のサブフィー
ルドをSF1及びSF2とすると、上位のサブフィール
ドはSF3及びSF4であり、下位のサブフィールドを
SF1とすると、上位のサブフィールドはSF2〜SF
4である。The lower sub-field refers to a sub-field having a shorter light emission sustaining period among a plurality of sub-fields, and a sub-field other than the lower sub-field is an upper sub-field. For example, when the subfields are SF1 to SF4 in order from the side with the shortest light emission sustain period, if the lower subfields are SF1 and SF2, the upper subfields are SF3 and SF4, and the lower subfields are SF1 and SF4. Then, the upper subfields are SF2 to SF
4.
【0051】実施の形態2における複数種類の放電パタ
ーンの一例を表5に示す。Table 5 shows an example of a plurality of types of discharge patterns according to the second embodiment.
【0052】[0052]
【表5】 [Table 5]
【0053】ここでは、消費電力を抑制した場合の抑制
率を32分の27(=0.8438)、サブフィールド
の数が5の場合を用いて説明する。また、実施の形態2
では、A〜Dが当該抑制率に対応した複数種類の放電回
数パターンである。Here, the case where the suppression rate when the power consumption is suppressed is 27/32 (= 0.8438) and the number of subfields is 5 will be described. Embodiment 2
Here, A to D are a plurality of types of discharge frequency patterns corresponding to the suppression rate.
【0054】表5に示すように、放電回数パターンA〜
Dは、サブフィールドSF1〜SF4については当該放
電回数パターンA〜D毎に放電回数のデータが設定さ
れ、これらの放電回数はROM241に予め格納されて
いる。サブフィールドSF5については乗算器242が
算出する。As shown in Table 5, the discharge frequency patterns A to
In D, the data of the number of discharges is set for each of the number-of-discharges patterns A to D for the subfields SF1 to SF4, and the number of discharges is stored in the ROM 241 in advance. The multiplier 242 calculates the subfield SF5.
【0055】乗算器242は、固定の放電回数を有し、
この固定の放電回数と抑制率とを乗算し、この乗算結果
を上位のサブフィールドの放電回数とする。表5に示す
上位のサブフィールドSF5の放電回数(14)は、固
定の放電回数(16)と抑制率(0.8438)とを乗
算結果は、当該乗算器242の演算によって整数化され
たものである。The multiplier 242 has a fixed number of discharges,
The fixed number of times of discharge is multiplied by the suppression rate, and the result of the multiplication is used as the number of times of discharge in the upper subfield. The number of discharges (14) of the upper subfield SF5 shown in Table 5 is obtained by multiplying the fixed number of discharges (16) by the suppression rate (0.8438) and converted to an integer by the operation of the multiplier 242. It is.
【0056】また、放電回数パターンA〜Dのサブフィ
ールドSF1〜SF4の放電回数については、サブフィ
ールドSF5が14であることが予め決定されているた
め、階調データが変化すれば必ず変化するように放電回
数パターンを設定することができ、かつ、実際の消費電
力が抑制された割合が所望の32分の27になるように
決めることが可能である。このように決められた放電回
数をROM241に書き込む。Since the number of discharges in subfields SF1 to SF4 of discharge number patterns A to D is previously determined to be 14 in subfield SF5, the number of discharges always changes when gradation data changes. It is possible to set a pattern in which the actual power consumption is suppressed to a desired 27/32. The determined number of discharges is written to the ROM 241.
【0057】表6に、階調データに対する、電力を抑制
した場合の4フィールドの放電回数、実効表示階調及び
実効抑制率の例を示す。Table 6 shows an example of the number of discharges, the effective display gradation, and the effective suppression rate of the four fields when the power is suppressed with respect to the gradation data.
【0058】[0058]
【表6】 [Table 6]
【0059】表6に示すように、SF5に対応する放電
回数を同じにしても、実効表示階調は階調データに応じ
て変化させることができ、かつ、実効抑制率を所望の抑
制率(=0.8438)と同じ程度にできる。As shown in Table 6, even if the number of discharges corresponding to SF5 is the same, the effective display gradation can be changed in accordance with the gradation data, and the effective suppression ratio is set to the desired suppression ratio ( = 0.8438).
【0060】実施の形態2によれば、上位のサブフィー
ルドの放電回数については乗算器242によって算出す
ることによって、ROM241の容量を増加させること
なく、複数種類の放電回数パターンを発生することがで
きる。According to the second embodiment, by calculating the number of discharges of the upper subfield by multiplier 242, it is possible to generate a plurality of types of discharge number patterns without increasing the capacity of ROM 241. .
【0061】また、以上の説明では、サブフィールドS
F5の放電回数を算出する場合を説明したが、サブフィ
ールドSF5及びSF4、あるいはサブフィールドSF
5〜SF3、あるいはサブフィールドSF5〜SF2の
ように、発光維持期間が長いものから順にいくつかのサ
ブフィールドの放電回数を算出し、残りの下位のサブフ
ィールドの放電回数をROM241に予め書き込んでも
よい。但し、少なくとも最も下位のサブフィールドの放
電回数については、ROM241に書き込まなければな
らない。なぜなら、全てのサブフィールドの放電回数を
算出するようにすれば、ある抑制率についての放電回数
パターンは唯一に決定され、従来と同じだからであり、
少なくとも最も下位のサブフィールドの放電回数につい
てはROM241で複数種類設定することによって、従
来と比較して、画素の階調及び消費電力の精度を改善で
きるからである。In the above description, the subfield S
Although the case of calculating the number of discharges of F5 has been described, the subfields SF5 and SF4 or the subfield SF
For example, the number of discharges of some subfields may be calculated in ascending order of the light emission sustain period, such as 5 to SF3 or subfields SF5 to SF2, and the number of discharges of the remaining lower subfields may be written in the ROM 241 in advance. . However, at least the number of discharges of the lowest subfield must be written in the ROM 241. This is because if the number of discharges of all subfields is calculated, the number of discharges pattern for a certain suppression rate is uniquely determined and is the same as the conventional one.
This is because, by setting a plurality of types of discharge at least in the lowest subfield in the ROM 241, the accuracy of pixel gradation and power consumption can be improved as compared with the related art.
【0062】また、乗算器242は、固定の放電回数を
有し、この固定の放電回数と抑制率とを乗算し、さらに
この乗算結果に最も近い整数(例えば、乗算結果の10
分の1の位を例えば四捨五入したもの)を採用するのが
望ましい。これによって、上位のサブフィールドの放電
回数の平均的な値が算出されるため、ROM241には
画素の階調及び消費電力の精度をさらに改善できる放電
回数を設定できる。The multiplier 242 has a fixed number of discharges, multiplies the fixed number of discharges by the suppression rate, and further obtains an integer closest to the multiplication result (for example, 10 times the multiplication result).
It is desirable to adopt a value in which the ones place is rounded off, for example. As a result, the average value of the number of discharges of the upper subfield is calculated, and therefore, the number of discharges that can further improve the accuracy of the gradation and power consumption of the pixel can be set in the ROM 241.
【0063】実施の形態3.実施の形態3では、実施の
形態1又は2の複数種類の放電回数パターンを繰り返す
順序について説明する。Embodiment 3 In the third embodiment, a description will be given of an order in which a plurality of types of discharge number patterns of the first or second embodiment are repeated.
【0064】放電回数パターンA〜Dを繰り返す順序に
は、 (1) 実施の形態1で触れたように、放電回数パター
ンA,B,C,D,A,B,C,D,A,……のよう
に、放電回数パターンA〜Dを順に並べた順序で繰り返
す場合 (2) 表7に示すように、放電回数パターンA〜Dを
順列による順序で繰り返す場合The order of repeating the number-of-discharge patterns A to D is as follows: (1) As mentioned in the first embodiment, the number-of-discharge patterns A, B, C, D, A, B, C, D, A,. (2) When the discharge number patterns A to D are repeated in the permutation order as shown in Table 7
【0065】[0065]
【表7】 [Table 7]
【0066】(3) 乱数に基づいて繰り返す場合 等が考えられる。(3) The case of repeating based on a random number may be considered.
【0067】(1)の場合はパターン発生回路24の構
成が簡単になる。In the case of (1), the configuration of the pattern generation circuit 24 is simplified.
【0068】(2)の場合について、例えば、放電回数
パターンA及びBは放電回数パターンC及びDと比較し
て放電回数が多い(すなわち、明るい)場合を考える。
放電回数パターンをA,B,C,Dの順に並べた順序で
繰り返す場合の(1)では、明るい画面,明るい画面,
暗い画面,暗い画面という繰り返しのみが含まれる。一
方、(2)の場合では、4つのパターンの順列の組み合
わせをいろいろ採用することにより、例えば、A,B,
C,D,A,C,B,D……のように同じ繰り返しを含
まないようにすることができ、明るい画面と暗い画面と
の切り替わりを認識することが困難になる。したがっ
て、(2)の場合はフリッカが低減できる。In the case of (2), for example, consider a case where the number of discharge patterns A and B are larger (ie, brighter) than the number of discharge patterns C and D.
In the case (1) where the pattern of the number of discharges is repeated in the order of A, B, C and D, a bright screen, a bright screen,
Only repetition of dark screen, dark screen is included. On the other hand, in the case of (2), by adopting various combinations of the permutations of the four patterns, for example, A, B,
.. Can not be included as in C, D, A, C, B, D,..., And it is difficult to recognize the switching between a bright screen and a dark screen. Therefore, in the case of (2), flicker can be reduced.
【0069】(3)の場合も(2)と同様に、明るい画
面と暗い画面との切り替わりが頻繁になるためフリッカ
が低減でき、特に静止画や動きの遅い動画のときは有効
である。また、放電回数パターンA〜Dの出現率が等し
くなる周期が小さければ、実効抑制率と所望の抑制率と
が著しく異なることもない。In the case of (3), similarly to the case of (2), the switching between the bright screen and the dark screen becomes frequent, so that flicker can be reduced. This is particularly effective for a still image or a moving image having a slow motion. In addition, if the cycle in which the appearance rates of the discharge number patterns A to D are equal is small, the effective suppression rate does not significantly differ from the desired suppression rate.
【0070】なお、(3)の場合は、例えば、次のよう
に構成すればよい。駆動回路2は乱数を出力するための
乱数発生回路(例えばCPU等)を設け、乱数と複数種
類の放電回数パターンとを予め対応させておく。パター
ン発生回路24は乱数発生回路が出力する乱数に対応す
る放電回数パターンを出力する。In the case of (3), for example, the following configuration may be adopted. The drive circuit 2 is provided with a random number generation circuit (for example, CPU or the like) for outputting a random number, and associates the random number with a plurality of types of discharge number patterns in advance. The pattern generation circuit 24 outputs a number-of-discharges pattern corresponding to the random number output by the random number generation circuit.
【0071】変形例.パターン発生回路24は、ROM
241に代えて、例えば、RAM等のメモリに放電回数
パターンを格納してもよいし、組み合わせ回路によって
放電回数パターンを生成してもよい。Modified example. The pattern generation circuit 24 has a ROM
Instead of 241, for example, the number-of-discharges pattern may be stored in a memory such as a RAM, or the number-of-discharges pattern may be generated by a combinational circuit.
【0072】また、算出部は、乗算器242に代えて、
CPU等でもよい。Further, the calculating section replaces multiplier 242 with
It may be a CPU or the like.
【0073】さらに、1つの抑制率に対する複数種類の
放電回数パターンは、4つ以外でもよい。Further, a plurality of types of discharge frequency patterns for one suppression rate may be other than four.
【0074】[0074]
【発明の効果】本発明請求項1によると、放電パルスに
ついて、行程(b)及び(c)が繰り返されることによ
って、行程(a)で準備された複数種類の放電回数パタ
ーンが繰り返される。画素の階調及び消費電力は、複数
のフィールドの平均になるため、精度が向上する。例え
ば、画質劣化を防ぎつつ、消費電力を抑制率と同じ程度
にすることが可能である。According to the first aspect of the present invention, by repeating steps (b) and (c) for the discharge pulse, a plurality of types of discharge frequency patterns prepared in step (a) are repeated. Since the gradation and power consumption of the pixel are averaged over a plurality of fields, the accuracy is improved. For example, it is possible to reduce power consumption to the same degree as the suppression rate while preventing image quality deterioration.
【0075】本発明請求項2によると、所定の順序が複
数種類の放電回数パターンを順に並べた順序であること
によって、構成が簡単になる。According to the second aspect of the present invention, since the predetermined order is an order in which a plurality of types of discharge frequency patterns are arranged in order, the configuration is simplified.
【0076】本発明請求項3によると、所定の順序が複
数種類の放電回数パターンの順列による順序の組み合わ
せであることによって、フリッカが低減できる。According to the third aspect of the present invention, flicker can be reduced because the predetermined order is a combination of the order based on the permutation of a plurality of types of discharge number patterns.
【0077】本発明請求項4によると、所定の順序が乱
数に基づく順序であることによって、フリッカが低減で
きる。According to the fourth aspect of the present invention, since the predetermined order is an order based on random numbers, flicker can be reduced.
【0078】本発明請求項5によると、駆動波形発生回
路が発生する放電パルスについて、パターン発生回路の
動作に基づき、複数種類の放電回数パターンが繰り返さ
れる。画素の階調及び消費電力は、複数のフィールドの
平均になるため、精度が向上する。例えば、画質劣化を
防ぎつつ、消費電力を抑制率と同じ程度にすることが可
能である。According to the fifth aspect of the present invention, a plurality of types of discharge frequency patterns are repeated for the discharge pulse generated by the drive waveform generation circuit based on the operation of the pattern generation circuit. Since the gradation and power consumption of the pixel are averaged over a plurality of fields, the accuracy is improved. For example, it is possible to reduce power consumption to the same degree as the suppression rate while preventing image quality deterioration.
【0079】本発明請求項6によると、例えば複数種類
の放電回数パターンを記憶部に書き込むことによって、
複数種類の放電回数パターンが記憶部から得ることがで
き、構成を簡単にできる。According to the sixth aspect of the present invention, for example, by writing a plurality of types of discharge frequency patterns in the storage unit,
A plurality of types of discharge frequency patterns can be obtained from the storage unit, and the configuration can be simplified.
【0080】本発明請求項7によると、上位のサブフィ
ールドの放電回数については算出部によって算出するこ
とによって、記憶部の容量を増加させることなく、複数
種類の放電回数パターンを発生することができる。According to the seventh aspect of the present invention, by calculating the number of discharges of the upper subfield by the calculation unit, a plurality of types of discharge number patterns can be generated without increasing the capacity of the storage unit. .
【0081】本発明請求項8によると、所定の順序が複
数種類の放電回数パターンを順に並べた順序であること
によって、パターン発生回路の構成が簡単になる。According to the eighth aspect of the present invention, since the predetermined order is an order in which a plurality of types of discharge frequency patterns are arranged in order, the configuration of the pattern generating circuit is simplified.
【0082】本発明請求項9によると、所定の順序が複
数種類の放電回数パターンの順列による順序の組み合わ
せであることによって、フリッカが低減できる。According to the ninth aspect of the present invention, flicker can be reduced because the predetermined order is a combination of an order based on a permutation of a plurality of types of discharge frequency patterns.
【0083】本発明請求項10によると、所定の順序が
乱数に基づく順序であることによって、フリッカが低減
できる。According to the tenth aspect of the present invention, since the predetermined order is an order based on random numbers, flicker can be reduced.
【図面の簡単な説明】[Brief description of the drawings]
【図1】 本発明の実施の形態1におけるプラズマディ
スプレイ駆動装置を示すブロック図である。FIG. 1 is a block diagram illustrating a plasma display driving device according to a first embodiment of the present invention.
【図2】 本発明の実施の形態2におけるプラズマディ
スプレイ駆動装置を示すブロック図である。FIG. 2 is a block diagram showing a plasma display driving device according to a second embodiment of the present invention.
【図3】 従来のプラズマディスプレイ駆動装置を示す
ブロック図である。FIG. 3 is a block diagram showing a conventional plasma display driving device.
24 パターン発生回路、25 駆動波形発生回路、3
1〜33 電極群、241 ROM、242 乗算器。24 pattern generation circuit, 25 drive waveform generation circuit, 3
1-33 electrode group, 241 ROM, 242 multiplier.
Claims (10)
ドの複数からなる1フィールド毎に、プラズマディスプ
レイの画素を放電させ、前記サブフィールド毎に前記画
素を放電させるか否かを所定の階調度を示す信号に応じ
て決定するプラズマディスプレイの駆動方法であって、 (a)前記サブフィールド毎の前記放電回数の複数から
なる1フィールドの放電回数パターンを、1つの所定の
抑制率に対して複数種類準備する行程と、 (b)前記行程(a)で準備された複数種類の放電回数
パターンのうちの一つを所定の順序で選択する行程と、 (c)前記行程(b)で選択された前記放電回数パター
ンが示す前記放電回数で前記放電パルスを前記サブフィ
ールド毎に発生する行程と、を備え、 前記行程(b)及び(c)が1フィールド毎に繰り返さ
れる、プラズマディスプレイ駆動方法。1. A method for discharging a pixel of a plasma display for each one field including a plurality of subfields each of which the number of discharges is set, and determining whether or not to discharge the pixel for each of the subfields, by a predetermined gradient. A driving method for a plasma display, which is determined according to a signal indicated by the signal, wherein: (a) a plurality of types of discharge frequency patterns of one field including a plurality of the number of discharge times for each subfield with respect to one predetermined suppression rate; A preparing step; (b) a step of selecting one of a plurality of types of discharge frequency patterns prepared in the step (a) in a predetermined order; and (c) a step of selecting in the step (b). Generating the discharge pulse at each of the subfields at the number of discharges indicated by the discharge number pattern, wherein the steps (b) and (c) are performed every one field. Ri returned, the plasma display driving method.
回数パターンを順に並べた順序である請求項1記載のプ
ラズマディスプレイ駆動方法。2. The method according to claim 1, wherein the predetermined order is an order in which the plurality of types of discharge number patterns are arranged in order.
回数パターンの順列による順序の組み合わせである請求
項1記載のプラズマディスプレイ駆動方法。3. The plasma display driving method according to claim 1, wherein the predetermined order is a combination of an order based on a permutation of the plurality of types of discharge frequency patterns.
ある請求項1記載のプラズマディスプレイ駆動方法。4. The method according to claim 1, wherein the predetermined order is an order based on a random number.
レイの画素を放電させるための放電パルスを所定の抑制
率に応じた放電回数で発生させるが、前記画素を放電さ
せるか否かについては所定の階調度を示す信号に応じて
決定するプラズマディスプレイの駆動装置であって、 前記所定の抑制率に対応して、前記サブフィールド毎の
前記放電回数からなる1フィールドの放電回数パターン
の複数種類を、1フィールド毎に所定の順序で発生する
パターン発生回路と、 前記パターン発生回路で発生した前記放電回数パターン
が示す前記放電回数で前記放電パルスを前記サブフィー
ルド毎に発生する駆動波形発生回路と、を備えたプラズ
マディスプレイ駆動装置。5. A discharge pulse for discharging a pixel of a plasma display is generated for each sub-field at a number of discharges corresponding to a predetermined suppression rate, and it is determined whether or not to discharge the pixel by a predetermined gradation. A drive device for a plasma display, which is determined in accordance with a signal indicating one of a plurality of types of one-field discharge frequency patterns including the number of discharge times for each of the sub-fields, corresponding to the predetermined suppression rate. A pattern generation circuit that generates a discharge pulse for each of the sub-fields at the number of discharges indicated by the number-of-discharges pattern generated by the pattern generation circuit. Plasma display driving device.
部を含む請求項5記載のプラズマディスプレイ駆動装
置。6. The plasma display driving device according to claim 5, wherein the pattern generation circuit includes a storage unit in which the plurality of types of discharge frequency patterns are stored in advance.
ールドの放電回数を格納し、 前記パターン発生回路は、 前記複数種類の放電回数パターンのうち上位のサブフィ
ールドの放電回数を、固定の放電回数と前記所定の抑制
率との乗算によって算出する算出部をさらに備えた請求
項6記載のプラズマディスプレイ駆動装置。7. The storage unit stores the number of discharges in a lower sub-field of the plurality of types of discharge frequency patterns, and the pattern generation circuit stores an upper sub-field of the plurality of types of discharge frequency patterns. 7. The plasma display driving device according to claim 6, further comprising a calculating unit for calculating the number of discharges by multiplying the fixed number of discharges by the predetermined suppression rate.
回数パターンを順に並べた順序である請求項5記載のプ
ラズマディスプレイ駆動装置。8. The plasma display driving device according to claim 5, wherein the predetermined order is an order in which the plurality of types of discharge frequency patterns are arranged in order.
回数パターンの順列による順序の組み合わせである請求
項5記載のプラズマディスプレイ駆動装置。9. The plasma display driving device according to claim 5, wherein the predetermined order is a combination of an order based on a permutation of the plurality of types of discharge frequency patterns.
である請求項5記載のプラズマディスプレイ駆動装置。10. The plasma display driving device according to claim 5, wherein the predetermined order is an order based on a random number.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10083961A JPH11282402A (en) | 1998-03-30 | 1998-03-30 | Plasma display driving method and apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10083961A JPH11282402A (en) | 1998-03-30 | 1998-03-30 | Plasma display driving method and apparatus |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH11282402A true JPH11282402A (en) | 1999-10-15 |
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|---|---|
| JP (1) | JPH11282402A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2010067601A1 (en) * | 2008-12-11 | 2010-06-17 | パナソニック株式会社 | Plasma display device drive method |
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1998
- 1998-03-30 JP JP10083961A patent/JPH11282402A/en active Pending
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