JPH11317460A5 - - Google Patents

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【特許請求の範囲】
【請求項１】第１のデバイス（１０）の第１の端子（１２）から、該第１のデバイスの基板（１３）に流れる電流の量を制御するシステムであって、該第１のデバイスのチャネルは、ｐ形であり、該第１のデバイスの第２の端子（１１）は電源に接続されており、
前記第１のデバイスの基板に接続される第１の端子（１３）および前記第１のデバイスの第２の端子に接続される第２の端子（１７）を有するメカニズム（１５）を備え、
前記電源がオフのとき、前記第１のデバイスの第１の端子および該第１のデバイスの基板はｐｎダイオードを形成し、前記メカニズムの第１の端子および該メカニズムの基板は、該ダイオードに直列に接続される少なくとも１つのダイオード要素を構成し、前記直列接続の閾値電圧は、前記電流に関連付けられた電圧を上回って、該電流が流れるのを防ぐ、
システム。
【請求項２】前記電源がオンのとき、前記メカニズムは、該電源を前記第１のデバイスの基板に接続して、前記電流が流れることを可能にする、
請求項１に記載のシステム。
【請求項３】第１のデバイス（２０）のチャネルを介して、該第１のデバイスの第１の端子（２２）から第２の端子（２１）に流れる電流の量を制御するシステムであって、該第１のデバイスのチャネルは、ｐ形であり、該第１のデバイスの第２の端子は、電源に接続されており、
前記第１のデバイスおよび第２のデバイスに共通の接地レベルに接続される第１の端子と、前記第１のデバイスの制御ゲートに接続される第２の端子（２４）と、前記電源に接続される制御ゲートと、を有する該第２のデバイス（２７）と、
前記第１のデバイスの第１の端子に接続される第１の端子と、前記第２のデバイスの第２の端子に接続される第２の端子と、前記電源に接続される制御ゲートと、を有する第３のデバイス（２６）と、を備え、
前記電源がオンのとき、前記第３のデバイスの制御ゲートは、該第３のデバイスをオフにし、前記第２のデバイスの制御ゲートは、該第２のデバイスをオンにすることで、前記第１のデバイスの制御ゲートを接地すると共に、該第１のデバイスをオンにして、前記電流が流れることを可能にし、
前記電源がオフのとき、前記第２のデバイスの制御ゲートは、該第２のデバイスをオフにし、前記第３のデバイスの制御ゲートは、該第３のデバイスをオンにすることで、前記第１のデバイスの制御ゲートを、前記電流に関連付けられた電圧にすると共に、前記第１のデバイスをオフにして、前記電流が流れるのを防ぐ、
システム。
【請求項４】前記第３のデバイスの制御ゲートは、該第３のデバイスのチャネルをピンチオフすることにより、該第３のデバイスをオフにし、
前記第２のデバイスの制御ゲートは、該第２のデバイスのチャネルをピンチオフすることにより、該第２のデバイスをオフにし、
前記第１のデバイスの制御ゲートは、該第１のデバイスのチャネルをピンチオフすることにより、該第１のデバイスをオフにし、
前記第３のデバイスの制御ゲートは、該第３のデバイスのチャネルを開くことにより、該第３のデバイスをオンにし、
前記第２のデバイスの制御ゲートは、該第２のデバイスのチャネルを開くことにより、該第２のデバイスをオンにし、
前記第１のデバイスの制御ゲートは、該第１のデバイスのチャネルを開くことにより、該第１のデバイスをオンにする、
請求項３に記載のシステム。
【請求項５】第１のデバイスの第１の端子（３２）から流れる電流の量を制御するシステムであって、該デバイスは、制御ゲート（３３）、基板、ｐ形チャネル、および電源に接続される第２の端子（３１）を有しており、
前記第１のデバイスの基板に接続される第１の端子（３５）と、該第１のデバイスの制御ゲートに接続される制御ゲートと、該第１のデバイスの第２の端子に接続される第２の端子と、を有するメカニズム（１５）と、
前記第１および第２のデバイスに共通の接地レベルに接続される第１の端子と、該第１のデバイスの制御ゲートに接続される第２の端子と、前記電源に接続される制御ゲートと、を有する第２のデバイス（２７）と、
前記第１のデバイスの第１の端子に接続される第１の端子と、前記第２のデバイスの第２の端子に接続される第２の端子と、前記電源に接続される制御ゲートと、を有する第３のデバイス（２６）と、を備え、
前記電源がオフのとき、前記第２のデバイスの制御ゲートは、該第２のデバイスをオフにし、前記第３のデバイスの制御ゲートは、該第３のデバイスをオンにすることで、前記第１のデバイスの制御ゲートを、前記電流に関連付けられた電圧にすると共に、該第１のデバイスをオフにして、該第１のデバイスの第１の端子から該第１のデバイスの第２の端子に、該第１のデバイスのチャネルを介して前記電流が流れるのを防ぎ、
前記電源がオフのとき、前記第２のデバイスの制御ゲートは、該第２のデバイスをオフにし、前記第３のデバイスの制御ゲートは、該第３のデバイスをオンにすることで、前記メカニズムの制御ゲートを、前記電流に関連付けられた電圧にすると共に、該メカニズムをオフにし、前記第１のデバイスの第１の端子および該第１のデバイスの基板は、ｐｎダイオードを形成し、前記メカニズムの第１の端子および該メカニズムの基板は、該ダイオードに直列接続される少なくとも１つのダイオード要素を構成し、前記直列接続の閾値電圧が、前記電流に関連付けられた電圧を超え、該第１のデバイスの第１の端子から該第１のデバイスの基板に前記電流が流れるのを防ぎ、
前記電源がオンのとき、前記第３のデバイスの制御ゲートは、該第３のデバイスをオフにし、前記第２のデバイスの制御ゲートは、該第２のデバイスをオンにすることで、前記第１のデバイスの制御ゲートを接地すると共に、該第１のデバイスをオンにして、該第１のデバイスの第１の端子から該第１のデバイスの第２の端子に、該第１のデバイスのチャネルを介して前記電流が流れることを可能にし、
前記電源がオンのとき、前記第３のデバイスの制御ゲートは、該第３のデバイスをオフにし、前記第２のデバイスの制御ゲートは、該第２のデバイスをオンにすることで、前記メカニズムの制御ゲートを接地すると共に、該メカニズムをオンにし、これにより、前記第１のデバイスの基板が前記電源に接続されて、該第１のデバイスの第１の端子から該第１のデバイスの第２の端子に、前記第１のデバイスのチャネルを介して前記電流が流れることを可能にする、
システム。
【請求項６】前記電流は、前記第１のデバイスを含む第２のチップに対して離れている第１のチップから発する、
請求項１、請求項３および請求項５のいずれかに記載のシステム。
【請求項７】接地される第１の端子と、前記第１のデバイスの第１の端子に接続される第２の端子と、を有する他のデバイス（３８）を備えており、
前記電源がオフのとき、該他のデバイスが、前記電流を終端させる、
請求項６に記載のシステム。
【請求項８】前記電源がオンのとき、前記他のデバイスは、前記第１のデバイスのインピーダンスに近似的に整合するインピーダンスを有する、
請求項７に記載のシステム。
【請求項９】前記メカニズムは、直列回路に配置された複数のデバイスを有しており、
該直列回路の最初のデバイス（３５）は、前記メカニズムの第１の端子を有しており、該直列回路の残りのデバイスは、前に隣接したデバイスの基板に接続される端子をそれぞれ有しており、
該直列回路における最後のデバイス（３６）は、前記メカニズムの基板を有しており、該直列回路の残りのデバイスは、後ろに隣接したデバイスの端子に接続される基板をそれぞれ有している、
請求項１または５に記載のシステム。