JPS58120343A - デ−タ伝送システム - Google Patents

デ−タ伝送システム

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JPS58120343A
JPS58120343A JP57003949A JP394982A JPS58120343A JP S58120343 A JPS58120343 A JP S58120343A JP 57003949 A JP57003949 A JP 57003949A JP 394982 A JP394982 A JP 394982A JP S58120343 A JPS58120343 A JP S58120343A
Authority
JP
Japan
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data
terminal
center
transmission
response
Prior art date
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Pending
Application number
JP57003949A
Other languages
English (en)
Inventor
Toshio Azuma
東 敏雄
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Omron Corp
Original Assignee
Tateisi Electronics Co
Omron Tateisi Electronics Co
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Filing date
Publication date
Application filed by Tateisi Electronics Co, Omron Tateisi Electronics Co filed Critical Tateisi Electronics Co
Priority to JP57003949A priority Critical patent/JPS58120343A/ja
Publication of JPS58120343A publication Critical patent/JPS58120343A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L12/00Data switching networks

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Computer And Data Communications (AREA)
  • Small-Scale Networks (AREA)
  • Communication Control (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 この発明は、データ伝送システムに関し、特にたとえば
半2臆伝送のデータ伝送システムであって、かつモデム
を使用しないデータ伝送シテムの改良に関する。
第1図(a )ないしくC)は従来のデータ伝送システ
ムのセンタと端末機−のデータの送受信状態を示す図で
あり、第1図(a )は正常にデータが伝送された場合
を示し、第1図(b)はデータの伝送に異常があった場
合を示し、第1図(C)は従来のデータ伝送システムの
同■となる場合を示す図である。なお、この第1図に示
すデータ伝送システムでは、半2臆のデータ伝送システ
ムを示している。この半2膳のデータ伝送システムとは
、たとえば通信端AおよびBがあるとき、Aから8と、
BからAに交互に通信は可能であるが、両方向同時に通
信をしないデータ伝送方式を言うまず、第1図(’a 
)を参照して正常なデータの送受信状態を説明する。最
初に、センタから端末機に対してポーリング(poll
lng )がかけられる。
このポーリングによって指定された端末機はセンタに対
してポーリングデータCあるいはテキスト)を伝送する
。このポーリングデータはその最初にデータの始めを表
わすコードS T X (5tart  oftext
)を含む。また、ポーリングデータはその最後にデータ
の最終を示すコードETX(endor  text)
を含む。さらに、ポーリングデータには、上述のコード
ETXの直後に、たとえば水平パリティで構成されるデ
ータブロックチェックのためのキャラクタB CC(b
lock  check  charaoter )が
付加される。
センタは上述のETXおよびBCGを正常に受信し、か
つBCGに誤りがな番ノれば、ポーリングをかけた端末
機に対し、承認応答として、シードA CK (ack
nowledue )を伝送する。このACKを受けた
端末機は1つ以上のデータの伝送終了を表わすコードE
 OT (cvd  of  transmissio
n)をセンタに伝送する。これに応答して、センタは上
述のEOTを2回端末機に伝送する。これで、少なくと
も1つのポーリングデータの伝送が終了する。
次に、第1図(b)を参照して、データの伝送に異常が
生じた場合の動作を説明する。センタから端末機に対し
てポーリングがかけられ、そのポーリングがかけられた
端末機からセンタに対してポーリングデータが伝送され
るまでは第1図(a)の場合と同様である。ここで、端
末−からセンタに伝送されるETXあるいはBccがセ
ンタに正常に受信されなかった場合、あるいはBccが
ポーリングデータの誤りを示している場合は、センタか
ら端末機に対しデータの再送を要求するコードNAK 
(negatlve  acknowledge )が
伝送される。端末機はこのNAKに応答して、再び同じ
ポーリングデータなセンタに伝送する。この再送された
ポーリングデータがセンタに正常に受信され、かつBC
Ck、Ilりがなかりた場合は、第1図(a)の場合と
同様に、センタから端末機に対しACKが伝送され、端
末機からセンタに対しEOTが伝送される。さらに、セ
ンタから端末機に対しEOTが2@連続して伝送される
次に、第1図(C)を参照して、従来のデータ伝送シス
テムにおける問題点について説明する。
この第1図(C)では、端末機からセンタにポーリング
データが伝送される際、ノイズなどの何らかの原因でポ
ーリングデータの一部がETXあるいはBCCと同じピ
ット構成に変形されてしまった場合を示している。この
ようにして、変形された擬似的なETXあるいはBCC
に応答して、センタはNAKを端末機に伝送する。しか
し、端末機はポーリングデータの伝送を終了していない
前述のように、半211のデータ伝送システムでは、同
時に両方向からのデータの伝送が不可能であるため、こ
のNAKは端末機に受信されない。そのため、端末機は
同じデータをセンタに再送することができない。なお、
このような場合従来のデータ伝送システムでは、NAK
を伝送してから時間TOの間に再送データを受信しなけ
れば、無条件にEOTを2回連続して端末機に伝送し、
そのデータブロックの伝送を終了する。
上述のように、従来のデータ伝送システムでは、何らか
の原因でポーリングデータの一部がETXあるいはBC
Gに擬似的に冑化した場合、正常なデータの伝送が全く
できなくなる。
それゆえに、この発明の主たる目的は、上述のような欠
点を解消し得るデ−タ伝送システムを提供することであ
る。
この発明は、要約すれば、いわゆる半2臘のデータ伝送
システムであって、かついわゆるモデムを使用せずセン
タと端末機とが直結されたようなデータ伝送システムに
おいて、端末機からセンタへデータを伝送している状態
の継続していることをセンタにおいて判断させ、その伝
送状態の継続の判断に応答して応答信号の伝送を遷らせ
るようにしたものである。
以下、図面に示す実施例とともにこの発明をより具体的
に説明する。
第2図はこの発明の一実施例のブロック図である。図に
おいて、センタ1は伝送ライン41ないし4nを介して
各端末一群21ないし2nと直結されている。また、伝
送ウィン51ないし5nを介して各端末機群31ないし
3nと直結されている。センタ1はこのセンタ1全体の
動作を11.1JI11するCPLJ2と、このCPU
2の動作プログラムや処理されるデータが格納されるメ
モリ3とを含む。
また、このCPU2およびメモリ3に関連して■104
が設けられる。このiノ′04は、たとえばフロッピデ
ィスクやプリンタやディスプレイなどの外部入出力WA
Wを含む。
さらに、センタ1は上述の各端末機群との通信の制御を
行なうための通信制御装置5を含む。この通信制−装置
5は、その動作を制御するためのCPLJ6と、このC
PtJ6の動作プログラムや処理データを記憶するメモ
リ7とを含む。これらCPU6およびメモリ7はインタ
フェイス8を介して上述のCPU2に接続される。なお
、メモリ7は、この実施例に興味ある記憶領域として、
センタ1が端末機へのデータの伝送を特機していること
を記憶するlll域(以下送信時らフラグと称す)71
と、センタ1が送信可能モードになったことを記憶する
領域(以下送信モードフラグと称す)72と、後述する
タイマカウンタ75の計数値が1以上であることを記憶
する領域(以下動作中フラグと称す)73とを含む。さ
らに、メモリ7は端末機から伝送されたデータを一時記
憶する領域(以下受信バッファと称す)74を含む、さ
らに、メモリ7は端末機からデータの最小単位(たとえ
ば1バイト)を受信するごとに2が設定され、端末機か
らのデータが受信されないときは後述するクロック発生
回路9のクロック周期ごとに−1される領域(以下タイ
マカウンタと称す)75を含む。前述のように、このタ
イマカウンタ75の計数値が1以上のときは動作中フラ
グ73がセットされている。そして、この動作中7ラグ
73がセットされている閣は、センタ1から端末機への
データの伝送が禁止される。
通信制御装置5には、上述のCPu6に関連してクロッ
ク発生回路9が設けられる。このクロック発生回路9か
ら出力されるクロックパルスは割込み指令とてCPU6
に与えられる。すなわち、CPu6はクロック発生回路
9からりOツクパルスが与えられるごとにたとえば第3
図に示すような割込み動作を行なう。ここで、膳要なこ
とはクロック発生回路9のクロックパルスの周期と、端
末機から伝送されてくるデータの1バイト期閣との関係
である。すなわち、センタ1が端末機から1バイトのデ
ータを受信する期間に1個以上2個以下のクロックパル
スがCPU6に与えられるようにクロックパルスの周期
が運ばれる。そして、好ましくはクロックパルスの1w
4期は端末機から伝送されてくるデータの1バイト期間
の約0.8倍に選ばれる。このようにクロックパルスの
周期を選ぶことによって、端末機から1バイトのデータ
を受信するごとに必ずタイマカウンタ75には2が設定
される。なお、端末機から1バイトのデータを受信する
期間に2個のクロックパルスがCPU6に与えられたと
しても、タイマカウンタ75は−1されるだけであるた
め、端末機から連続してデータが伝送されているときは
タイマカウンタ75の計数値がOとならない。
ざらに、迩儂制W装置5には、CPU6に関連して、伝
送制御用LSIl0および11が設けられる。この伝送
制御用LSI(たとえばHD48850:日立親作所製
)10および11は、並列データを直列データに変換し
たり、直列データを並列データに変換したりするための
ものである。
伝送−iml装置10には、ドライバレシーバ121な
いし12nが接続される。これらドライバレシーバ12
1ないし12nは、それぞれ、前述の伝送ライン41な
いし4nに接続される。また、伝送−需用LS111は
ドライバレシーバ131ないし13nに接続される。こ
れらドライバレシーバ131ないし13nは、それぞれ
、前述の伝送ライン51ないし5nに接続される。
第3図は第2図に示すCPU6の動作を説明するための
フローチャートである。第4allはセンタ1が端末機
から正規のETXおよびBCCを受信したときの動作を
説明するためのタイムチャートである。第5図はポーリ
ングデータの一部が擬似的にETXあるいはBCCに変
形された場合におけるこの実施例データの送受信状態を
示す図である。以下、第2図ないし第5allを参照し
て、この実施例の動作について説明する。
まず、第1図(a )あるいは(b)で示したように、
端末機からセンタ1に伝送されるデータがETXヤBC
Cに変形されていない場合の動作について説明する。こ
の場合、センタ1がポーリングデータな1バイト受偏す
れば、第3図のステップ(図示ではSと略す)1におい
てそのことが判断される。そして、ステップ2において
タイマカウンタ75に2が設定される。続いて、ステッ
プ3において動作中フラグ73がセットされ、ステップ
4において端末機からの受信データが受信バッファ74
に転送される。次に、ステップ5において受信データが
EOTでないことが判断され、ステップ6において受信
データがBCCr″ないことが判断される。なお、クロ
ック発生回路9から出力されるクロックパルスの111
1期は端末機から伝送されてくるデータの1バイト期間
のたとえば0.8倍に選ばれているため、センタ1が1
バイトのデータを受信する閣に2−のクロックパルスが
CPu6に与えられる場合が生じる。このような場合、
1−目のクロックパルスでは上述のステップ1ないし6
の動作が行なわれる。そして、2個目のクロックパルス
では、ステップ1およびステップ7の動作の慢、ステッ
プ8において動作中フラグ73のセットが判断される。
そのため、ステップ9においてタイマカウンタ75が−
1される。しかし、このときタイマカウンタ75には2
が設定されているため、その計数値はOとならない。そ
のことがステップ10で判断され、センタ1から端末機
へはデータの伝送が行なわれない。
上述のステップ1ないし10の動作が繰り返して行なわ
れ、センタ1はBCCを受信する。このBCCは通常1
バイトで構成されており、このBCCの受信は第4図に
示すクロックパルスC1に基づく割込み動作で判断され
る。すなわち、クロックパルスC1がCPU6に与えら
れると、CPU6は第3図に示すステップ1ないし6お
よびステップ11の動作を行なう。したがって、このと
きタイマカウンタ75には2が設定され、送信モードフ
ラグ72がセントされる。なお、CPLJ6は13図の
動作の模、端末機へのデータ(A C,KあるいはNA
K)の伝送準備を行なう。
次に、第4図に示ずクロックパルスC2がCPU6に与
えられるど、CPLI6は13図のステップ7において
1バイトの伝送準備の完了を判断する。そして、ステッ
プ12において送信モードフラグ72のLノドが判断さ
れ、ステップ13において動作中フラグのセットが判断
される。さらに、ステップ14において送信持ちフラグ
71がセットされる。続いて、ステップ8において動作
中7ラグ73のセットが判断され、ステップ9において
タイマカウンタ75が−1される。このステップ9の動
作によ)てタイマカウンタ75の計数値は1となる。そ
のため、ステップ10においてタイマカウンタの計数値
が0でないことが判断される。
次に、第4図に示すクロックパルスC3がCPLJ61
C与lられる。!:、CPU6はlll3allのステ
ップ1および7の動作の一ステップ8において動作中7
ラグ73のセットを判断する。そして、ステップ9にお
いてタイマカウンタ75を−1する。
これによって、タイマカウンタ75の計数値は0となる
。そのため、ステップ10においてタイマカウンの計数
値が0であることが判断され、ステップ15において動
作中7ラグ73がリセットされる。このとき、送信持ち
フラグ71は前述のステップ14においてセットされて
いるため、そのことがステップ16において判断され、
ステップ17において送信持ちフラグ71がリセットさ
れる。さらに、ステップ18において端末機に伝送すべ
きデータが伝送制御用18110あるいは11の送信デ
ータレジスタ(図示せず)に転送される。応じて、伝送
制御用LS I 10あるいは11から所定のドライバ
レシーバを介して端末機にデータが伝送される。なお、
この実施例では、端末機に伝送するACKあるいはNA
Kはそのデータ量が1バイトであるため、ステップ19
において直ちに全データの伝送終了が判断され、ステッ
プ20において送信モードフラグ72がリセットされる
。しかし、端末機に伝送するACKあるいはNAKのデ
ータ量が1バイトを越える場合は、ステップ19におい
て全データの伝送が終了していないことが判断され、再
びステップ1,7.12.13.18および19の動作
が繰り返される。
その慢、ステップ19において全データの伝送終了が判
断されるとステップ20の動作が行なわれる。
次に、この実施例で特に興味ある場合、すなわち第6図
に示すようにポーリングデータの一部が擬似的にETX
あるいはBCCに変形された場合の動作について説明す
る。端末機からセンタ1にポーリングデータが伝送され
ている間は、CPU6はクロック発生回路9からクロッ
クパルスが与えられるごとに、第3図のステンブコない
し6の動作あるいはステップ1および7ないし10のい
ずれかの動作を行なう。
次に、第6WAに示すように、ポーリングデータの一部
がETXあるいは8σCに擬似的に変形され、このET
XあるいはBCCがセンタ1に受信されると、前述のス
テップ6において受信データがBCGであると判断され
、ステップ11において送信モードフラグ72がセット
される。そして、センタ1は擬似的に変形されたBCG
に応答してNAKの伝送準備を行なう、この伝送準備の
完了はステップ7において判断され、ステップ12にお
いて送信モードフラグ72のセットが判断される。さら
に、ステップ10において動作中7ラグ73のセットが
判断され、ステップ14において送信持ちフラグ71が
セットされる。つづいて、ステップ8において動作中7
ラグ73のセットが判l!iされ、ステップ9において
タイマカウンタ75が−1される。しかし、タイマカウ
ンタ75は前述のステップ2において2が設定されてい
るため、その計数値は1となる。したがって、ステップ
10ではタイマカウンタ75の計数値が0でないことが
判断される。ここで、端末機からセンタ1へのポーリン
グデータの伝送は続行されている。
そのため、CPU6はステップ1ないし6の動作を繰り
返して行なう。したがって、タイマカウンタ75の計数
値は0どならず、応じて動作中フラグ73もリセットさ
れない。したがって、たとえセンタ1の伝送準備が完了
していても端末機へのデータの伝送は行なわれない。こ
のように、端末機からのデータの伝送が続いている場合
は、センタ1から端末機へのデータの伝送が禁止される
上述のような動作の後、センタ1はポーリングデータの
正規のBCCを受信するが、そのときの動作は第4図に
示した動作とほぼ同様であるため、その説明を省略する
以上のごとく、上述の実施例では、端末機からセンタ1
に何らかのデータが伝送され゛【いるときは、タイマカ
ウンタ75の計数値が1以上に保たれており、センタ1
から端末機へのデータの伝送が禁止される。したがって
、たとえポーリングデータの一部が擬似的にErXある
いはBCCに変形されたとし−〔も、必ず正常なデータ
が端末機からセンタ1へ再送される。
以上のように、この発明によれば、端末機からセンタへ
のデータの伝送の継続していることを判断し、その判断
によって端末機への応答信号の伝送を遡らせるようにし
たので、センタは端末機からのデータの伝送が終了して
から端末機へ応答信号を送ることができ、端末−はその
応答信号を正常に受信することができる。したがって、
端末−からセンタへのデータの一部から何らかの原因に
よって変形されても、端末機はセンタから送られる応答
信号に応答して正常なデータを再送することができる。
【図面の簡単な説明】
第1図は従来のデータ伝送システムのデータの送受信状
態を示す図である。第2図はこの発明の一実施例を示す
ブロック図である。第3図は第2図に示すCPU6の動
作を説明するためのフローチャートである。第4図は第
2図に示すセンタ1が正規の8CCを受信した場合の動
作を説明するためのタイムチャートである。第5all
はこの実施例のデータの送受信状態を示す図である。 図において、1はセンタ、5は通信制御l@置、9はク
ロック発生回路、21ないし2nおよび31ないし3n
は端末機群、73は動作中フラグ、75はタイマカウン
タを示す。 裏3凹 塾41tU

Claims (2)

    【特許請求の範囲】
  1. (1) センタと、前記センタに直結される端末−とを
    含み、 前記端末−から前記センタへ伝送されるデータはその最
    後にデータの終了を表わすコードと伝送エラーの有無を
    表わすコードとを含み、前記センタは、前記データの終
    了を表わすコードおよび前記伝送エラーに有無を表わす
    コードに応答して、前記端末−からのデータの承認ある
    いは鼻承認を表わす応答信号を前記端末機に伝送し、前
    記センタは、 前記端末機から前記センタへデータを伝送している状態
    の継続していることを判断する手段、および 前記判断手段が伝送状態の継続を判断していることに応
    答して前記応答信号の伝送を遷らせる伝送遷延手段を備
    える、データ伝送システム。
  2. (2) 前記判断手段は、 前記端末機からデータの最小単位を受信するごとに所定
    値が設定され、前記端末機からのデータが受信されない
    所定時間ごとに減算する計数手段と、 前記計数手段の計数値が一定値以下にな)ことを検出す
    る検出手段とを含み、 前記伝送遅延手段は前記検出手段出力に応答して前記応
    答信号の伝送を遡らせる、特許請求の範囲第111記載
    のデータ伝送システム。 〈3) 前記計数手段は、 カウンタと、 前記端末機からデータの最小単位を受信したことを検出
    する受信状態検出手段と、 前記受信状態検出手段出力に応答して前記カウンタに前
    記所定値を設定させるプリセット手段と、 前記受信状態検出手段出力がないことに応答して前記所
    定時間ごとに前記カウンタの計数値を減算させる手段と
    を含む、特許請求の範囲第2項記載のデータ伝送システ
    ム。
JP57003949A 1982-01-12 1982-01-12 デ−タ伝送システム Pending JPS58120343A (ja)

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