JPS5830652B2 - Multi truck digital digital camera - Google Patents
Multi truck digital digital cameraInfo
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- JPS5830652B2 JPS5830652B2 JP12039574A JP12039574A JPS5830652B2 JP S5830652 B2 JPS5830652 B2 JP S5830652B2 JP 12039574 A JP12039574 A JP 12039574A JP 12039574 A JP12039574 A JP 12039574A JP S5830652 B2 JPS5830652 B2 JP S5830652B2
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- Signal Processing For Digital Recording And Reproducing (AREA)
Description
【発明の詳細な説明】
本発明はオーディオ信号やビデオ信号をアナログ・ディ
ジタル変換器によって、一旦符号化したディジタル信号
をマルチトラックを有する磁気記録係に記録する際、各
符号化ビットの各トラックへの磁気記録方式に関するも
のである。DETAILED DESCRIPTION OF THE INVENTION The present invention provides a method for converting each coded bit into each track when recording an encoded digital signal using an analog-to-digital converter into a magnetic recording section having multi-tracks. This relates to magnetic recording methods.
従来、例えばオーディオ信号をアナログ・ディジタル変
換器(以下A−D変換器と略す。Conventionally, for example, an audio signal is converted to an analog-to-digital converter (hereinafter abbreviated as an A-D converter).
)によって12ビツトの符号化パルス列に変換し、MS
B(Most 51gn1ficant Bit)から
LS B (LeastSignificant Bi
t)まで、第1トラツクから第12トラツクまで対応さ
せて記録することが提案されている。) into a 12-bit encoded pulse train, and MS
B (Most 51gn1ficant Bit) to LS B (Least Significant Bit)
t), it has been proposed to record tracks correspondingly from the first track to the twelfth track.
なお、各トラックではテープ変調ノイズ、ヘッドアンプ
ノイズに起因する信号誤りやテープ・ヘッド系のドロッ
プアウトに起因する信号誤りが生じる。In each track, signal errors occur due to tape modulation noise, head amplifier noise, and dropouts in the tape head system.
この信号誤りを検出するために、通常、第1図に示すご
とく、第13トラツクと第14トラツクにそれぞれMS
Bすなわち第1ビツトから第3ビツトのパリティビット
C1、第4ビツトから第6ビツトのパリティビットC2
をそれぞれ記録している。In order to detect this signal error, normally, as shown in FIG.
B, that is, the parity bit C1 from the 1st bit to the 3rd bit, and the parity bit C2 from the 4th bit to the 6th bit.
are recorded respectively.
なお、第7ビツト以下LSBすなわち第12ビツトまで
の信号誤りは聴覚的に無視できるとして、信号誤り検出
を行なっていないのが通例である。Note that signal errors from the 7th bit onwards to the LSB, that is, up to the 12th bit, are considered to be audibly negligible, so signal error detection is generally not performed.
ところで、上記したように信号誤りの原因はテープ変調
ノイズやアンプノイズによるものと、テープのキズやヘ
ッドに耐着したゴミによって生じるいわゆるドロップア
ウトの2種に分けられ、前者は1〜2ビット程度にある
のに対して、後者は高密度記録になると数十ビットから
数百ビットに達する。By the way, as mentioned above, the causes of signal errors are divided into two types: those caused by tape modulation noise and amplifier noise, and so-called dropouts caused by scratches on the tape or dust stuck to the head. On the other hand, the latter reaches from tens of bits to hundreds of bits when it comes to high-density recording.
例えば第1トラツクにドロップアウトが生じると第1図
の縦の1列はオーディオ信号の1サンプルに対応するの
で、ドロップアウトによって数十サンプルから数百サン
プルにわたって信号誤りが起ることになる。For example, if a dropout occurs in the first track, one vertical column in FIG. 1 corresponds to one sample of the audio signal, so the dropout will cause signal errors over tens to hundreds of samples.
信号誤りが起ると、前値保持をせるような信号誤り補償
を行なうとすれば、当然数十サンプルから数百サンプル
前値が保持されてしまい、再生音質の劣化は著しい。When a signal error occurs, if signal error compensation is performed to retain the previous value, the previous value of several tens to hundreds of samples will naturally be retained, resulting in a significant deterioration of the reproduced sound quality.
したがって、本発明の目的はかかるドロップアウトが起
った場合にも、再生音質の劣化を伴なわないビットの各
トラックへの磁気記録方式を提供することである。Therefore, an object of the present invention is to provide a method for magnetically recording bits on each track without deteriorating the reproduced sound quality even when such dropout occurs.
上記目的を遠戚するために、本発明ではパリティビット
と、そのパリティビットに属する符号化ビット群に対応
するトラックが、少なくとも1サンプルごとに重り合わ
ないように分配する。In order to achieve the above object, the present invention distributes a parity bit and tracks corresponding to a group of coded bits belonging to the parity bit so that they do not overlap each other for at least one sample.
こうすることによって、あるトラックでドロップアウト
が起っても、ある符号化ビットが連続的に誤ることを防
ぐことができる。By doing this, even if a dropout occurs in a certain track, it is possible to prevent a certain encoded bit from being continuously erroneous.
以下、本発明を実施例によって詳細に説明する3第2図
が本発明による第1ビツトから第12ビツトと、2つの
チェックビットの各トラックの分配を示した図で、テー
プ上の記録パターンである3図かられかるように、第1
ビツトから第3ビツトがパリティビットC3に属する群
で、第4ビツトから第6ビツトがパリティビットC2に
属する群である。Hereinafter, the present invention will be explained in detail with reference to examples. 3 Figure 2 is a diagram showing the distribution of the 1st to 12th bits and two check bits in each track according to the present invention, and shows the recording pattern on the tape. As can be seen from three figures, the first
The third to third bits are a group belonging to parity bit C3, and the fourth to sixth bits are a group belonging to parity bit C2.
これらの群は1サンプルごとに各トラック群を変換して
いる。These groups convert each track group on a sample-by-sample basis.
同様にパリティビットC1およびC2も第13トラツク
および第14トラツクを交互に変換する。Similarly, parity bits C1 and C2 alternately convert between the 13th track and the 14th track.
なお、第7ビツトから第12ビツトは信号誤りが起って
も、聴覚的に無視できるとして、記録すべきトラックを
;回定のままにしておく。Note that even if a signal error occurs in the 7th to 12th bits, it is assumed that it can be ignored audibly, and the track to be recorded is left as is.
このような分配にしておけば、第1トラツクから第6ト
ラツクおよび第13トラツク第14トラツクのいずれか
にドロップアウトが起って、数十サンプル信号誤りが連
続したとしても、あるビットがつねに信号誤りを起すと
いうことがない。With this kind of distribution, even if a dropout occurs in any of the 1st to 6th tracks, the 13th track, and the 14th track, and several tens of sample signal errors occur in succession, a certain bit will always remain in the signal. There is no chance of making a mistake.
また、パリティビットを記録している1つのトラックに
ドロップアウトが起っても、あるパリティビットに属す
るビット群がつねに信号誤りを起しているという判定を
与えない。Furthermore, even if a dropout occurs in one track recording parity bits, it is not determined that a group of bits belonging to a certain parity bit always causes a signal error.
第2図に示すような各ビットの分配は第3図に示すよう
に、ゲート回路の組み合せで実現できる。The distribution of each bit as shown in FIG. 2 can be realized by a combination of gate circuits as shown in FIG.
端子11から端子16が第1ビツトから第6ビツトの入
力端子、端子17.18かパリティビットC1,C2の
入力端子、端子19が分配のタイミングクロック入力端
子、素子31から素子46はゲート素子(アンドゲート
)、素子47は反転素子、端子21から端子26は第1
トラツクから第6トラツクに接続する出力端子、端子2
7.28は第13トラツク、第14トラツクに接続する
出力端子である。Terminals 11 to 16 are input terminals for the first to sixth bits, terminals 17 and 18 are input terminals for parity bits C1 and C2, terminal 19 is a timing clock input terminal for distribution, and elements 31 to 46 are gate elements ( and gate), element 47 is an inverting element, and terminals 21 to 26 are the first
Output terminal connecting track to 6th track, terminal 2
7.28 is an output terminal connected to the 13th track and the 14th track.
端子19にはサンプルごとに反転するタイミングクロッ
クが入力され、素子31,33゜35.37,39,4
1.43,45のゲート信号となる。A timing clock that is inverted for each sample is input to the terminal 19, and the elements 31, 33, 35, 37, 39, 4
The gate signals are 1.43 and 45.
いっぽう、反転素子47で反転させられたタイミングク
ロックは素子32,34,36゜38.40,42,4
4,46にそれぞれ加えられゲート信号となる。On the other hand, the timing clock inverted by the inverting element 47 is transmitted to the elements 32, 34, 36°38.40, 42,4.
4 and 46, respectively, and become gate signals.
たとえば、第1ビツトは端子11を介して、素子31.
32にそれぞれ入力される。For example, the first bit is transmitted via terminal 11 to element 31 .
32 respectively.
タイミングクロックとその反転タイミングクロックでゲ
ートされ、端子21、および端子24に1サンプルごと
交互に分配される。It is gated using a timing clock and its inverted timing clock, and is alternately distributed to terminals 21 and 24 on a sample-by-sample basis.
以下同様に各ビットは1サンプルごとに交互に所定トラ
ックに分配される。Similarly, each bit is alternately distributed to predetermined tracks for each sample.
以上、説明したように、第3図のような分配回路によっ
て、第2図のように各ビットを分配することができる。As explained above, each bit can be distributed as shown in FIG. 2 by the distribution circuit shown in FIG. 3.
上述したようにこのような分配では、あるトラックにド
ロップアウトが生じても、聴覚的に問題となるビットが
連続的に信号誤りを起すことがなくなる。As mentioned above, with such a distribution, even if a dropout occurs in a certain track, the audibly problematic bits will not continue to cause signal errors.
そして、ドロップアウトが起っている期間においても1
サンプルおきに、上記の例では上位3ビツトは必ず正し
く再生されることになる。And even during the period when dropout occurs, 1
For every sample, in the example above, the top three bits will always be reproduced correctly.
したがって、信号誤りの補償法として、信号誤りの前後
値の平均値を採用すれば、上記の理由により信号誤りの
起っている前後値は少なくとも上位3ビツトが正しく再
生されているので、その平均で信号誤りの補償を行なう
と再生音質の劣化が少ない。Therefore, if the average value of the values before and after the signal error is adopted as a compensation method for signal errors, the average value of the values before and after the signal error will be reproduced correctly because at least the upper 3 bits are correctly reproduced. If signal errors are compensated for, there will be little deterioration in reproduced sound quality.
もちろん、前値保持の補償も多少再生音質の劣化を伴な
うが、回路構成が簡単なため実用上はかなり有効である
。Of course, the compensation for holding the previous value also involves some deterioration in the reproduced sound quality, but it is quite effective in practice because the circuit configuration is simple.
以上、説明したように本発明によれば、任意のトラック
にドロップアウトが数十ビットにわたって起っても、少
なくとも上位3ビツトは1サンプルおきに正しく再生さ
れることになり、極めて再生音質の劣化が少ないPCM
録音機が実現できる。As explained above, according to the present invention, even if dropout occurs over several tens of bits in any track, at least the upper three bits will be correctly reproduced every other sample, resulting in a significant deterioration in the playback sound quality. PCM with less
A recorder can be realized.
なお、上記の例は2個のチェックビットを用いた場合を
示したが、1個のチェックビットの場合でも、また、任
意のN個の場合でも同様に実現できることは容易に類推
できる。Note that although the above example shows the case where two check bits are used, it can be easily inferred that the same implementation can be achieved with one check bit or any N check bits.
第1図は従来のビット分配による磁気テープ上の記録パ
ターン、第2図は本発明によるビット分配の磁気テープ
上の記録パターン、第3図は本発明の実施例における分
配に必要な分配回路。
11〜16・・・・・第1ビツト乃至第6ビツト入力端
子、17〜18・・・・・・パリティビットC1,C2
入力端子、19・・・・・・タイミングクロック入力端
子、31〜46・・・−・・アンドゲート、47・・・
・・・反転素子、21〜26・・・・・・第1トラツク
乃至第6トラツクに接続する信号出力端子、27〜28
・・・−・・第13トラツク及び第14トラツクに接続
する信号出力端子。FIG. 1 shows a recording pattern on a magnetic tape using conventional bit distribution, FIG. 2 shows a recording pattern on a magnetic tape using bit distribution according to the present invention, and FIG. 3 shows a distribution circuit necessary for distribution in an embodiment of the present invention. 11-16... 1st bit to 6th bit input terminal, 17-18... Parity bit C1, C2
Input terminal, 19...Timing clock input terminal, 31-46...--And gate, 47...
... Inverting element, 21-26 ... Signal output terminal connected to the first track to the sixth track, 27-28
. . . Signal output terminal connected to the 13th track and the 14th track.
Claims (1)
号をサンプリングして並列のnビットのデジタル信号に
符号化し、該各デジタル信号を記録媒体の各トラックに
分配する方式において、同一サンプリング時刻における
前記レジタル信号の分配先を各サンプリング時刻毎に変
更し、少くともパリティビットとパリティビットに属す
る符号化ビットが、隣接するサンプリング時刻の分配先
で重なり合わないように分配することを特徴とするマル
チトラックのデジタル磁気記録方式っ1 In a method in which an analog signal such as an audio signal or a video signal is sampled and encoded into parallel n-bit digital signals, and each digital signal is distributed to each track of a recording medium, the distribution of the digital signal at the same sampling time. A multi-track digital magnetic recording characterized in that a parity bit and encoded bits belonging to the parity bit are distributed such that at least parity bits and coded bits belonging to the parity bit do not overlap at distribution destinations of adjacent sampling times. Method
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12039574A JPS5830652B2 (en) | 1974-10-21 | 1974-10-21 | Multi truck digital digital camera |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12039574A JPS5830652B2 (en) | 1974-10-21 | 1974-10-21 | Multi truck digital digital camera |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5147408A JPS5147408A (en) | 1976-04-23 |
| JPS5830652B2 true JPS5830652B2 (en) | 1983-06-30 |
Family
ID=14785135
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12039574A Expired JPS5830652B2 (en) | 1974-10-21 | 1974-10-21 | Multi truck digital digital camera |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5830652B2 (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6231670A (en) * | 1985-08-05 | 1987-02-10 | Teijin Ltd | Twining yarn detector |
-
1974
- 1974-10-21 JP JP12039574A patent/JPS5830652B2/en not_active Expired
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6231670A (en) * | 1985-08-05 | 1987-02-10 | Teijin Ltd | Twining yarn detector |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5147408A (en) | 1976-04-23 |
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