JPS5840819A - 半導体装置とその製法 - Google Patents

半導体装置とその製法

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Publication number
JPS5840819A
JPS5840819A JP56138913A JP13891381A JPS5840819A JP S5840819 A JPS5840819 A JP S5840819A JP 56138913 A JP56138913 A JP 56138913A JP 13891381 A JP13891381 A JP 13891381A JP S5840819 A JPS5840819 A JP S5840819A
Authority
JP
Japan
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single crystal
recessed section
film
substrate
semiconductor
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Pending
Application number
JP56138913A
Other languages
English (en)
Inventor
Seiichi Iwamatsu
誠一 岩松
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Seiko Epson Corp
Suwa Seikosha KK
Original Assignee
Seiko Epson Corp
Suwa Seikosha KK
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Publication date
Application filed by Seiko Epson Corp, Suwa Seikosha KK filed Critical Seiko Epson Corp
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Publication of JPS5840819A publication Critical patent/JPS5840819A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10PGENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P14/00Formation of materials, e.g. in the shape of layers or pillars
    • H10P14/20Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials
    • H10P14/29Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials characterised by the substrates
    • H10P14/2924Structures
    • H10P14/2925Surface structures

Landscapes

  • Bipolar Transistors (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は半導体装置構造とその製造方法に関する。
従来単結晶半導体膜を単結晶半導体基板上に形成した半
導体装14′としては、一般に平板な単結晶半導体基板
表面にエビタキシャ/に法により単結晶半導体膜を形成
した構造が用いられている。
しかし、上記従来構造および方法では、半導体装置の一
層の微小化、高速化、大電力化に不向きであるという欠
点を有する。
本発明はかかる欠点をなくし、微小で高速且つ大電力化
が可能な半導体装置構造とその製造方法を提供すること
を目的とし、この目的を達成するための本発明の基本構
成は、単結晶半導体基板にはエツチングより四部が形成
され、該凹部には少なくとも単結晶半導体膜が形成され
て成ることを特徴とする。
以下、実施例に従って本発明を具体的に説明する。
第1図は本発明の一実施例を示すダイオード構造の断面
図であり、N型半導体単結晶基板1にP型半導体単結晶
2がエピタキシャル法により形成されたものを模式的に
示したものである。
第2図は本発明の他の実施例を示すダイオード構造の断
面図であり、N型半導体単結晶基板11にP型半導体結
晶12がエピタキシャル法により形成され、更に多結晶
シリコン電極BがOVD法により形成されたものを模式
的に示したものである。
この様に半導体単結晶基板に半導体単結晶Jl、Jを埋
め込んで形成することにより、素子の微小化。
高速化が計れると共に、大面積でのPN接合が可能とな
り大電力化も計ることができる。
本発明はダイオードのみならずトランジスタの形成にも
用いることができ、単結晶牛導体膜には更に拡散層を形
成したり、多層単結晶半導体膜を四部に形成することも
できる。
更に、形成した単結晶膜は四部の一部表面あるいは側面
にその一部が連らなったり、表面Si、0゜膜上にも形
成されるシリコン膜とつらなって形成されても良い。
半導体単結晶基板凹部には予かじめ拡散層がフヒ成され
、その後エピタキシャル膜が埋め込まれて形成されても
良い。
【図面の簡単な説明】
第1図、第2図は本発明の実施例を示すダイオード構造
の断面図である。 1.11・・・・・・半導体単結晶基板2.12・・・
・・・埋込み半導体単結晶膜3・・・・・・・・・・・
・・・・電 極以  上 出願人 株式会社諏訪精工舎 代理人 弁理士 最上  務

Claims (1)

    【特許請求の範囲】
  1. 単結晶半導体基板にはエツチングによる四部が形成され
    、該凹部には少なくとも単結晶半導体膜が形成されて成
    ることを特徴とする半導体装92とその製造方法。
JP56138913A 1981-09-03 1981-09-03 半導体装置とその製法 Pending JPS5840819A (ja)

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS4915663A (ja) * 1972-06-03 1974-02-12

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS4915663A (ja) * 1972-06-03 1974-02-12

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