JPS5850000A - 音声合成器 - Google Patents
音声合成器Info
- Publication number
- JPS5850000A JPS5850000A JP14910081A JP14910081A JPS5850000A JP S5850000 A JPS5850000 A JP S5850000A JP 14910081 A JP14910081 A JP 14910081A JP 14910081 A JP14910081 A JP 14910081A JP S5850000 A JPS5850000 A JP S5850000A
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- JP
- Japan
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- mode
- counter
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は音声合成器、特に七の発生音声の選択構造に関
するものである。
するものである。
現在、音声合成器としての合成用ＬＳＩは種々発表、実
用化されているが、その多くはマイコン制御により発生
すべき音声の選択９発生音声のシーケンス等を実行して
いる。本発明による合成用ＬＳＩは、基本的にマイコン
なしで音声発生を実行することを目的とし、音声の選択
９発生音声のシーケンス等、すべて１チツプ上で実行で
きることを基本とし、もちろん、マイコン制御でも動作
すべく設計されている。本発明はこのような音声合成器
において、発声コメントの選択構造を改良し、例えば、
２系統の発声コメントの選択機能を設け、更に多くの仕
様に合致し得るようにしたものである。
用化されているが、その多くはマイコン制御により発生
すべき音声の選択９発生音声のシーケンス等を実行して
いる。本発明による合成用ＬＳＩは、基本的にマイコン
なしで音声発生を実行することを目的とし、音声の選択
９発生音声のシーケンス等、すべて１チツプ上で実行で
きることを基本とし、もちろん、マイコン制御でも動作
すべく設計されている。本発明はこのような音声合成器
において、発声コメントの選択構造を改良し、例えば、
２系統の発声コメントの選択機能を設け、更に多くの仕
様に合致し得るようにしたものである。
以下図面に従って本発明の一実施例を説明する。
第１図は一実施例の音声合成器を構成する音声合成用Ｌ
ＳＩの回路例を示すブロック図である。
ＳＩの回路例を示すブロック図である。
ここでは図の１点鎖線より左方の回路部が音声合成用Ｌ
ＳＩに含まれる。
ＳＩに含まれる。
１及び６は４ビツトのポリノミナルカウンターで、出力
９４ビツトコードは発生すべき音声にそれぞれ対応して
いる。このカウンターは、発゛生すべき音声選択用ろイ
ッチＳ１及びＳ２によシ適宜カウントアツプすることが
可能である。４及び９は各カウンター毎に設けられたカ
ウンターのスタートアドレス設定のためのＰＬＡ （プ
ログラマブルロジックアレイ）で、この値によって各カ
ウンターのスタート位置が設定できる。また２及び７は
各カウンターのストップアドレス設定のためのＰＬＡで
おる。３及び７はカウンターの内容とストップアドレス
との一致を検出する回路で、一致信号が発生すると、再
度ＰＬＡ４及び９のスタートアドレスをカウンター（て
Ｉプリセットする。
９４ビツトコードは発生すべき音声にそれぞれ対応して
いる。このカウンターは、発゛生すべき音声選択用ろイ
ッチＳ１及びＳ２によシ適宜カウントアツプすることが
可能である。４及び９は各カウンター毎に設けられたカ
ウンターのスタートアドレス設定のためのＰＬＡ （プ
ログラマブルロジックアレイ）で、この値によって各カ
ウンターのスタート位置が設定できる。また２及び７は
各カウンターのストップアドレス設定のためのＰＬＡで
おる。３及び７はカウンターの内容とストップアドレス
との一致を検出する回路で、一致信号が発生すると、再
度ＰＬＡ４及び９のスタートアドレスをカウンター（て
Ｉプリセットする。
第２図は、後述する各シリアルモード、）（ラレルモー
ド、スイッチモードにおける、音声合成用ＬＳＩへの入
力と発生すべき音声の４ビツトコードとの対応を示すも
のである。上述したポリノミナルカウンター１及び６の
内容で発生すべき音声を選択するモードを１シリアルモ
ードと称している。第２図のシリアルモードは、カウン
ターカく左欄コードのように順次カウントアツプされ得
るものとして、スタートアドレス設定用ＰＬＡ４及び９
にφ及びＣ１またストップアドレス設定用ＰＬＡ２及び
７に９及び１のコードをそれぞれ設定した場合を示して
いる。すなわち、ポリノミナルカランｆｉ−１及び６は
、図示の一印の範囲内で、スイッチＳ１及びＳ２を押す
毎にカウントアツフ゛され、そのポリノミナルコードに
従って設定された音声を発生し、ストップコードと一致
するとスタートコードに帰る動作を繰返す。
ド、スイッチモードにおける、音声合成用ＬＳＩへの入
力と発生すべき音声の４ビツトコードとの対応を示すも
のである。上述したポリノミナルカウンター１及び６の
内容で発生すべき音声を選択するモードを１シリアルモ
ードと称している。第２図のシリアルモードは、カウン
ターカく左欄コードのように順次カウントアツプされ得
るものとして、スタートアドレス設定用ＰＬＡ４及び９
にφ及びＣ１またストップアドレス設定用ＰＬＡ２及び
７に９及び１のコードをそれぞれ設定した場合を示して
いる。すなわち、ポリノミナルカランｆｉ−１及び６は
、図示の一印の範囲内で、スイッチＳ１及びＳ２を押す
毎にカウントアツフ゛され、そのポリノミナルコードに
従って設定された音声を発生し、ストップコードと一致
するとスタートコードに帰る動作を繰返す。
１１は、上記の如く設定された発生すべき音声の発声ト
リガー条件で、ＴＲＧ２とＴＲＧ３の２ビツトコード、
若しくはいずれか一方の信号が入力された時、その信号
形態より１″！！たはｊを発生するＰ Ｌ Ａである。
リガー条件で、ＴＲＧ２とＴＲＧ３の２ビツトコード、
若しくはいずれか一方の信号が入力された時、その信号
形態より１″！！たはｊを発生するＰ Ｌ Ａである。
５及び１０はカウンターの入力制御回路で、スイッチＳ
１及びＳ２の他、発声トリガー信号の入力に応じても各
カウンターをインクリメントし得るようにしている。イ
ンクリメントの様子はスイッチＳ１及びＳ２による場合
と同様である。
１及びＳ２の他、発声トリガー信号の入力に応じても各
カウンターをインクリメントし得るようにしている。イ
ンクリメントの様子はスイッチＳ１及びＳ２による場合
と同様である。
１３はモード別データ選択用ＭＰＸ（マルチプレクサ）
で、Ｓ／Ｐ、ＳＴの各モード設定用入力によりシリアル
モード、パラレルモード、スイノチードで、ポリノミナ
ルカウンター１又は６０４ビツトコード出力が採られる
。Ｓ／Ｐ＝φ、ＳＴ＝φの時パラレルモードで、Ｐφ〜
Ｐ３の４ビツトパラレル入力が各音声に対応する４ビツ
トコ一ド信号として採られる。Ｓ／Ｐ＝φ、５Ｔ＝１の
時スイッチモードで、Ｐφ〜Ｐ３、Ｓｌ、Ｓ２の各６人
力をスイッチ（又はキー）信号として採るもので、４ビ
ツトコードにはＭＰＸＩ ３内部のエンコーダ等により
適宜変換される。
で、Ｓ／Ｐ、ＳＴの各モード設定用入力によりシリアル
モード、パラレルモード、スイノチードで、ポリノミナ
ルカウンター１又は６０４ビツトコード出力が採られる
。Ｓ／Ｐ＝φ、ＳＴ＝φの時パラレルモードで、Ｐφ〜
Ｐ３の４ビツトパラレル入力が各音声に対応する４ビツ
トコ一ド信号として採られる。Ｓ／Ｐ＝φ、５Ｔ＝１の
時スイッチモードで、Ｐφ〜Ｐ３、Ｓｌ、Ｓ２の各６人
力をスイッチ（又はキー）信号として採るもので、４ビ
ツトコードにはＭＰＸＩ ３内部のエンコーダ等により
適宜変換される。
パラレルモードは音声合成用ＬＳＩにマイコンを接続し
て構成するシステムに有用で、Ｐφ〜Ｐ３としてマイコ
ンの４ビツトパラレル出力を入力することができる。ｆ
ｒｃ、スイッチモードは、６個のスイッチ（又はキー）
に対応した音声をスイッチ（又はキー）をオンすると同
時に発生させる７ステムとして構成することができる。
て構成するシステムに有用で、Ｐφ〜Ｐ３としてマイコ
ンの４ビツトパラレル出力を入力することができる。ｆ
ｒｃ、スイッチモードは、６個のスイッチ（又はキー）
に対応した音声をスイッチ（又はキー）をオンすると同
時に発生させる７ステムとして構成することができる。
ノ（ラレルモード、スイッチモードにおける４ビツトコ
ードとの対応例は、例えば第２図に示されるとおりであ
る。シリアルモードについては後に更に詳しく説明する
。
ードとの対応例は、例えば第２図に示されるとおりであ
る。シリアルモードについては後に更に詳しく説明する
。
アドレス設定用ＰＬＡ１４はモード別データ選択用ＭＰ
Ｘ１３の出力に基づいて、第２図に示す如きコード位置
に対応した音声のトップアドレスＡｉを音声用データＲ
ＯＭ１５に入力する。データＲＯＭ１５からの音声デー
タは合成コントロールｇｌＫ１６に入力され、更にＤ／
Ａ コンバータ１７を介し、アンプ１８を通しスピーカ
ー１９よや放音される。
Ｘ１３の出力に基づいて、第２図に示す如きコード位置
に対応した音声のトップアドレスＡｉを音声用データＲ
ＯＭ１５に入力する。データＲＯＭ１５からの音声デー
タは合成コントロールｇｌＫ１６に入力され、更にＤ／
Ａ コンバータ１７を介し、アンプ１８を通しスピーカ
ー１９よや放音される。
１２は音声発生トリガーコントロール回路で、各モード
により定義されたトリガー条件になった時トリガー信号
Ｔｇを発生し、合成コントロール部１６に入力し合成を
スタートする。
により定義されたトリガー条件になった時トリガー信号
Ｔｇを発生し、合成コントロール部１６に入力し合成を
スタートする。
シリアルモードではＳ／Ｐ＝１であり、入力制御回路５
及び１０に加えられたＳ／Ｐ入力により、このシリアル
モードにおいてのみカウンターを動作可能としている。
及び１０に加えられたＳ／Ｐ入力により、このシリアル
モードにおいてのみカウンターを動作可能としている。
スイッチＳ１及びスイッチＳ２によるカウントアツプ動
作時は、モード別データ選択用ＭＰＸ１３に制御信号と
して入力される同８１．８２人力によシポリノミナルカ
ウンター１又は６かが選択され、対応するカウンターか
ら４ビツトコードを採り音声出力される。
作時は、モード別データ選択用ＭＰＸ１３に制御信号と
して入力される同８１．８２人力によシポリノミナルカ
ウンター１又は６かが選択され、対応するカウンターか
ら４ビツトコードを採り音声出力される。
一方、このシリアルモードにおいて、発生トリガー信号
ＴＲＧ２．ＴＲＧ３の入力に応じても、ポリノミナルカ
ウンター１又は６に設定された４ビツトコードに対応し
て音声出力することが可能であり、また選択された側の
カウンターを自動的に＋１インクリメントすることがで
きる。例えば、シリアルモードは、第４図のように音声
合成用ＬＳＩ２０に時計用ＬＳＩ等のコントローラ２１
を接続し、トリガーの発声毎に順次具なった音声を発生
するシステム構成に好都合°である。
ＴＲＧ２．ＴＲＧ３の入力に応じても、ポリノミナルカ
ウンター１又は６に設定された４ビツトコードに対応し
て音声出力することが可能であり、また選択された側の
カウンターを自動的に＋１インクリメントすることがで
きる。例えば、シリアルモードは、第４図のように音声
合成用ＬＳＩ２０に時計用ＬＳＩ等のコントローラ２１
を接続し、トリガーの発声毎に順次具なった音声を発生
するシステム構成に好都合°である。
特にこのように２系統を有している場合、トリガーコー
ドによって全く異質の発声内容をも選択し得、非常に有
用である。
ドによって全く異質の発声内容をも選択し得、非常に有
用である。
第１図において、ＰＬＡＩＩのｉ＋ｊはモード別データ
選択用ＭＰＸ１３にも入力されており、ＰＬＡＩＩで例
えばＡ＝φ、Ｂ＝１の時ｉを、Ａ＝１．Ｂ＝φの時ｊを
発生するようプログラムされていれば、前者ではポリノ
ミナルカウンター１゜後者ではポリノミナルカウンター
２０４ビツトコード出力が採られ音声出力される。この
とき、トリガー信号Ｔｇが発生し、合成コントロール部
１６が動作し所定のプログラムに従って実行しマイクオ
ーダ■信号を発生する。この■信号は音声出力に先立っ
て出力される。
選択用ＭＰＸ１３にも入力されており、ＰＬＡＩＩで例
えばＡ＝φ、Ｂ＝１の時ｉを、Ａ＝１．Ｂ＝φの時ｊを
発生するようプログラムされていれば、前者ではポリノ
ミナルカウンター１゜後者ではポリノミナルカウンター
２０４ビツトコード出力が採られ音声出力される。この
とき、トリガー信号Ｔｇが発生し、合成コントロール部
１６が動作し所定のプログラムに従って実行しマイクオ
ーダ■信号を発生する。この■信号は音声出力に先立っ
て出力される。
入力制御回路５及び１０では、ｉ＝１．■＝１の条件時
ポリノミナルカウンター１をインクリメントし、ｊ＝１
．■＝１の条件時はポリノミナルカウンター６をインク
リメントする。トリガー信号の発生に応じてなさ八る音
声の内容は、このようにしてインクリメントされたカウ
ンターの４ビツトコード出力に対応する。５Ｃ１１及′
びＳＣＩ２はトリガー信号発生時に各カウンターをイン
クリメントするか否かの制御用入力で、例えば１でイン
クリメント可能としている。例えば一方を０とすれば、
該当のカウンターはトリガー信号によってはインクリメ
ントすることができず、スイッチＳ１又はＳ２により設
定したもののみをそのトリガー信号毎に発声させること
もできる。
ポリノミナルカウンター１をインクリメントし、ｊ＝１
．■＝１の条件時はポリノミナルカウンター６をインク
リメントする。トリガー信号の発生に応じてなさ八る音
声の内容は、このようにしてインクリメントされたカウ
ンターの４ビツトコード出力に対応する。５Ｃ１１及′
びＳＣＩ２はトリガー信号発生時に各カウンターをイン
クリメントするか否かの制御用入力で、例えば１でイン
クリメント可能としている。例えば一方を０とすれば、
該当のカウンターはトリガー信号によってはインクリメ
ントすることができず、スイッチＳ１又はＳ２により設
定したもののみをそのトリガー信号毎に発声させること
もできる。
なお、実施例では２予統の発声コメントの選択機能を有
するものについて述べたが、３系統、４系統等それ以上
の系統を有するものでも同様に実施することができる。
するものについて述べたが、３系統、４系統等それ以上
の系統を有するものでも同様に実施することができる。
また使用において、独立して一つの系統のみ、あるいは
場合によっては複数系統を適当に組合せて使用し得るこ
とは、上述の説明より容易に理解できる。
場合によっては複数系統を適当に組合せて使用し得るこ
とは、上述の説明より容易に理解できる。
以上のように本発明によれば、マイコンなしでも音声発
生を実行できるものであり、複数系統の発声コメント機
能を有し、しかも独立に発声コメントの設定が可能なた
め、異質の音声発生の必要がある場合において容易に使
用できる特徴をもち、より汎用性に富んだ有用な音声合
成器が提供できる０
生を実行できるものであり、複数系統の発声コメント機
能を有し、しかも独立に発声コメントの設定が可能なた
め、異質の音声発生の必要がある場合において容易に使
用できる特徴をもち、より汎用性に富んだ有用な音声合
成器が提供できる０
第１図は本発明の一実施例を示すブロック図、第２図は
各モードにおける発声すべき音声の４ビツトコードとの
対応を説明する図、第３図は各モードとモード設定用入
力との対応を説明する図、第４図はシステム構成の一例
を説明するプロ、ツク図である。 １・６・・・ポリノミナルカウンター、２拳７・・・ス
トップアドレス設定用ＰＬＡ、３・８・・一致検出５・
１０・・入力制御回路、１１・・・ｉ −ｊ発生ＰＬＡ
、１３・・モード別データ選択用ＭＰＸ。 １４・・・トップアドレス設宥用ＰＬＡ、１５・・・音
声用データＲＯＭ、２０・・・音声合成用ＬＳＩ、２１
・、・コントローラ、Ｓｌ・Ｓ２・・音声選択スイッチ
、ＴＲＧ２・ＴＲＧ３・・・トリガー信号、Ｓ／Ｐ・Ｓ
Ｔ ・・モード設定用入力。 代理人 弁理士 福 士 愛 彦
各モードにおける発声すべき音声の４ビツトコードとの
対応を説明する図、第３図は各モードとモード設定用入
力との対応を説明する図、第４図はシステム構成の一例
を説明するプロ、ツク図である。 １・６・・・ポリノミナルカウンター、２拳７・・・ス
トップアドレス設定用ＰＬＡ、３・８・・一致検出５・
１０・・入力制御回路、１１・・・ｉ −ｊ発生ＰＬＡ
、１３・・モード別データ選択用ＭＰＸ。 １４・・・トップアドレス設宥用ＰＬＡ、１５・・・音
声用データＲＯＭ、２０・・・音声合成用ＬＳＩ、２１
・、・コントローラ、Ｓｌ・Ｓ２・・音声選択スイッチ
、ＴＲＧ２・ＴＲＧ３・・・トリガー信号、Ｓ／Ｐ・Ｓ
Ｔ ・・モード設定用入力。 代理人 弁理士 福 士 愛 彦
Claims (1)
- １、外部よりスイッチ入力又はトリガー人力により順次
発声コメントを選択し得るようにしたものにおいて、複
数系統の発声コメントの選択機能を有し、該選択機能は
各系統で内蔵する音声発生データ領域をそれぞれ独立し
て指定する手°段を備えてなることを特徴とする音声合
成器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14910081A JPS5850000A (ja) | 1981-09-18 | 1981-09-18 | 音声合成器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14910081A JPS5850000A (ja) | 1981-09-18 | 1981-09-18 | 音声合成器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5850000A true JPS5850000A (ja) | 1983-03-24 |
Family
ID=15467692
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14910081A Pending JPS5850000A (ja) | 1981-09-18 | 1981-09-18 | 音声合成器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5850000A (ja) |
-
1981
- 1981-09-18 JP JP14910081A patent/JPS5850000A/ja active Pending
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