JPS5852732A - 表示方式 - Google Patents
表示方式Info
- Publication number
- JPS5852732A JPS5852732A JP15070681A JP15070681A JPS5852732A JP S5852732 A JPS5852732 A JP S5852732A JP 15070681 A JP15070681 A JP 15070681A JP 15070681 A JP15070681 A JP 15070681A JP S5852732 A JPS5852732 A JP S5852732A
- Authority
- JP
- Japan
- Prior art keywords
- error
- display
- turn
- light emitting
- turned
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Digital Computer Display Output (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は表示方式に関するものでらシ、特に特定の状態
を表示するために適する表示方式に関す石ものである。
を表示するために適する表示方式に関す石ものである。
従来、電子計算機、中でも小型の電子卓上計算＊（以下
電車という）におけるエラー表示は、単にエラーである
ことのみｔ−表示するｒＥＪやｒｌＲＯＲＪマークを表
示させるか又はエラーコードで表示している。更に他の
表示としては、エラ一時特有の表示、例えば全表示素子
を点滅させる等の表示方式を採用している。しかしなが
ら、斯る表示方式では、如何なる原因でエラーを発生し
たのが使用者が推測しなければならず、また工２−コー
ドでエラー表示を行う場合は、別に設けたエラーコード
表示から該尚するエラーコードｔ＊ぺる不利益がある。
電車という）におけるエラー表示は、単にエラーである
ことのみｔ−表示するｒＥＪやｒｌＲＯＲＪマークを表
示させるか又はエラーコードで表示している。更に他の
表示としては、エラ一時特有の表示、例えば全表示素子
を点滅させる等の表示方式を採用している。しかしなが
ら、斯る表示方式では、如何なる原因でエラーを発生し
たのが使用者が推測しなければならず、また工２−コー
ドでエラー表示を行う場合は、別に設けたエラーコード
表示から該尚するエラーコードｔ＊ぺる不利益がある。
本発明は従来の真水方式が上述したような不利益を有す
ることに鑑み提案されるものであシ、その目的とする所
は、特定の状態を連想させる通知要素を結合表示すると
とＫよシ、エラー原因を表示させ、表示内容からエラー
原因の把掘が谷易な表示方式を提案することにある。
ることに鑑み提案されるものであシ、その目的とする所
は、特定の状態を連想させる通知要素を結合表示すると
とＫよシ、エラー原因を表示させ、表示内容からエラー
原因の把掘が谷易な表示方式を提案することにある。
また１本発明の他の目的は、表示要素の共用が可能な表
示方式を提案する所にある。
示方式を提案する所にある。
以下ニ「オーバーフローエラーＪ、ｒ７ンダーフロー表
示」、「０で割つ九ことによるエラー」「関数等の定義
域に関するエラー」、「キーラーー′ングログツムや定
数メモリーを使用中にＲＡＭ領域がいっばいになったこ
とＫよる表示」という５つのエラーｔ−表示させ電卓の
エラー表示に本発明を適用した一実施例に基づいて詳細
に説明する。
示」、「０で割つ九ことによるエラー」「関数等の定義
域に関するエラー」、「キーラーー′ングログツムや定
数メモリーを使用中にＲＡＭ領域がいっばいになったこ
とＫよる表示」という５つのエラーｔ−表示させ電卓の
エラー表示に本発明を適用した一実施例に基づいて詳細
に説明する。
第１図は本発明の一実施例を示す電卓の工２−表示のブ
ロック回路図である。第１の示すブロックは、ＩＮは数
値キー、ファンクションキー等からなる入力装置であシ
、その入力信号により動作する中央処理装置ＣＰＵ、キ
ーラーングログ２ムの記憶や、定数メモリーとして使わ
れる読み書き両用記憶装置ＲＡＭ％ＣＰＵから上記５つ
のエラー信号・１〜・５によりｐｔ〜ｐ６の６つの工２
−セグメントパターン（これは発光ダイオードＬＥＤ等
で構成される）をＯＮ、ＯＦＦ’する信号を発生させる
パターン発生装置ｆＰＧと、数値やエラーセグメントを
表示させる表示器ＤＩＳとからなる。
ロック回路図である。第１の示すブロックは、ＩＮは数
値キー、ファンクションキー等からなる入力装置であシ
、その入力信号により動作する中央処理装置ＣＰＵ、キ
ーラーングログ２ムの記憶や、定数メモリーとして使わ
れる読み書き両用記憶装置ＲＡＭ％ＣＰＵから上記５つ
のエラー信号・１〜・５によりｐｔ〜ｐ６の６つの工２
−セグメントパターン（これは発光ダイオードＬＥＤ等
で構成される）をＯＮ、ＯＦＦ’する信号を発生させる
パターン発生装置ｆＰＧと、数値やエラーセグメントを
表示させる表示器ＤＩＳとからなる。
第１図に示す実施例では１発生する工２−原因を６１〜
・５の合計５個として、その内容を第４図にまとめて示
しである。
・５の合計５個として、その内容を第４図にまとめて示
しである。
即ち、ｅｌは関数等の定義域に関する工２−で。
例えば対数の真数が負になったとか、Ｓ Ｉ Ｎ””ｘ
のＸがｌよシ大きな値になったときのエラーであり、ｅ
ｚｕアンダー７０−エラー、・３はオーバーフローエラ
ー、・４は零で割ったことに関するエラー、ｅ５はＲＡ
ＭＩの空領域が無く表った場合のエフ−である。
のＸがｌよシ大きな値になったときのエラーであり、ｅ
ｚｕアンダー７０−エラー、・３はオーバーフローエラ
ー、・４は零で割ったことに関するエラー、ｅ５はＲＡ
ＭＩの空領域が無く表った場合のエフ−である。
次に、ｍ１図のようなブロック図においていかにエラー
表示させるのかｔ−第２図、第３図、第４図を参照して
説明する。
表示させるのかｔ−第２図、第３図、第４図を参照して
説明する。
第２図は、０１〜・５のエラーが発生してからパターン
発生装ｆｌｔｉ’Ｇによシェラ−表示セグメント・量タ
ーンｐ１〜ｐ６を点滅させる回路例を示したものである
。ｅ−１〜・５はＣＰＵ３からの入力信号で前述した５
つのエラーに対応するものである。Ｄｌ〜Ｄ１５はダイ
オード、ｐ１〜Ｐ６Ｆｉ工２−に関するセグメントパタ
ーン化された発光〆イオーＶ（ＬＥＤ）である、液晶等
の表示素子を使用しても容易に構成可能である。今ＣＰ
ＵＩ／ｉでエラーが発生しｅｌがＯＮ（例えば＋５Ｖ）
、ｅ２〜の５がＯＦＦ （例えばｏＶ）となったとする
。
発生装ｆｌｔｉ’Ｇによシェラ−表示セグメント・量タ
ーンｐ１〜ｐ６を点滅させる回路例を示したものである
。ｅ−１〜・５はＣＰＵ３からの入力信号で前述した５
つのエラーに対応するものである。Ｄｌ〜Ｄ１５はダイ
オード、ｐ１〜Ｐ６Ｆｉ工２−に関するセグメントパタ
ーン化された発光〆イオーＶ（ＬＥＤ）である、液晶等
の表示素子を使用しても容易に構成可能である。今ＣＰ
ＵＩ／ｉでエラーが発生しｅｌがＯＮ（例えば＋５Ｖ）
、ｅ２〜の５がＯＦＦ （例えばｏＶ）となったとする
。
このと＊ｅｌに流れる電流は・ダイオードＤＩ、Ｄ２゜
Ｄ３を通過しセグメントパターンｐ１．ｐ２，１）３を
点灯させグランドに達するが、ダイオードの接続されな
いｐ４ 、ｐ５ 、ｐ６の発光ダイオードは点灯しない
、同様にしてｅ２がＯＮすると、ｐ２゜ｐ３．Ｐ５が、
ｅ３がＯＮするとｐ２ 、ｐ３ 、ｐ５゜ｐ６が点灯す
る。尚、Ｒ１−Ｒ６は発光ダイ交−）ＰＰＩ〜ｐ６に流
れる電流を制限するための抵抗である。また、ＣＰＵは
処理中の最初に発生したエラー（これは０１〜・５のう
ちのいずれが１つである）で以後の処理を中止して対応
するエン−信号を出力するので、６１〜ｅ５の２つ以上
が同時にＯＮすることはない。
Ｄ３を通過しセグメントパターンｐ１．ｐ２，１）３を
点灯させグランドに達するが、ダイオードの接続されな
いｐ４ 、ｐ５ 、ｐ６の発光ダイオードは点灯しない
、同様にしてｅ２がＯＮすると、ｐ２゜ｐ３．Ｐ５が、
ｅ３がＯＮするとｐ２ 、ｐ３ 、ｐ５゜ｐ６が点灯す
る。尚、Ｒ１−Ｒ６は発光ダイ交−）ＰＰＩ〜ｐ６に流
れる電流を制限するための抵抗である。また、ＣＰＵは
処理中の最初に発生したエラー（これは０１〜・５のう
ちのいずれが１つである）で以後の処理を中止して対応
するエン−信号を出力するので、６１〜ｅ５の２つ以上
が同時にＯＮすることはない。
以上の説明を実際の・量ターン例にもとづいて更に具体
的に説明する。第３図は、エラー表示セグメント・臂タ
ーンｐ１〜ｐ６の一実施例である。第４図はこの実施例
をもとに、エラー信号６１〜・５からｐ１〜ｐ６の６つ
のセグメントノ譬ターンを組み合わせて５禎類のエラー
表示をさせたエフ−コードと表示の対応を示す図である
。第２図の説明で明らかなように０１がＯＮするとｐｌ
−ｐ ６のセグメントは順に”１１１００（Ｍｌｌｏ
ｏ（”１’。
的に説明する。第３図は、エラー表示セグメント・臂タ
ーンｐ１〜ｐ６の一実施例である。第４図はこの実施例
をもとに、エラー信号６１〜・５からｐ１〜ｐ６の６つ
のセグメントノ譬ターンを組み合わせて５禎類のエラー
表示をさせたエフ−コードと表示の対応を示す図である
。第２図の説明で明らかなように０１がＯＮするとｐｌ
−ｐ ６のセグメントは順に”１１１００（Ｍｌｌｏ
ｏ（”１’。
０ＦＦｔ−０”とする）となり、これに対応して第３図
ｐＨｐ２１ｐ３が点灯し「−）ｃ −Ｊというエラー表
示・ヤターンが表示され関数部の定義域に関するエラー
を示す、以下同様に０２がＯＮのときはｒｘ→（Ｊ、Ｊ
（アンダー７０−）、ｅ３がＯＮのときは「Ｘ→■」（
オーバーフロー）、・４がＯＮのときはｒｘ／○」（０
割シ）、ｅ５がＯＮのときはｒ−−Ｊ（ＲＡＭ領域がい
っばいになった）のエラー表示をする。
ｐＨｐ２１ｐ３が点灯し「−）ｃ −Ｊというエラー表
示・ヤターンが表示され関数部の定義域に関するエラー
を示す、以下同様に０２がＯＮのときはｒｘ→（Ｊ、Ｊ
（アンダー７０−）、ｅ３がＯＮのときは「Ｘ→■」（
オーバーフロー）、・４がＯＮのときはｒｘ／○」（０
割シ）、ｅ５がＯＮのときはｒ−−Ｊ（ＲＡＭ領域がい
っばいになった）のエラー表示をする。
前述した実施例ではエラー表示を行なう表示方式に関し
て説明したが、本発明の適用範囲はこの種の分野の表示
方式に限定されるものではなく、例えばステータス表示
や、操負指示表示等にも適用できることは当業者は勿論
のことである。
て説明したが、本発明の適用範囲はこの種の分野の表示
方式に限定されるものではなく、例えばステータス表示
や、操負指示表示等にも適用できることは当業者は勿論
のことである。
以上説明したように本発明は構成されかつ動作するため
、次のような優れた効果を提供するものである。
、次のような優れた効果を提供するものである。
まず第１に、本発明によれば通知要素は該通知要素が表
示しようとする目的と図式上において関連をもたせであ
るので１表示内容から表示の目的を容易に理解すること
ができる。
示しようとする目的と図式上において関連をもたせであ
るので１表示内容から表示の目的を容易に理解すること
ができる。
また更に、セグメントとパターンを組み合せて表示する
ため、表示素子の節約ができ、表示゛のための領域も少
なくて済む効果を提供する。
ため、表示素子の節約ができ、表示゛のための領域も少
なくて済む効果を提供する。
１１ｇ１図は木兄１ｊｌｌを電卓に適用したときのエラ
ー表示のブロック図、 第２図はセグメン）パターンを点滅させる回軸を示す回
路図、 第３図はセグメントノ譬ターンの例を示す図。 第４図はエラーコードと表示の態様を示す図である。 ここで、・ｌ〜・５・・・エラー信号、ＰＧ・・・／母
ターン発生装置、ｐ１〜ｐ６・・・発光ダイオードであ
る。 特許出願人 キャノン株式会社
ー表示のブロック図、 第２図はセグメン）パターンを点滅させる回軸を示す回
路図、 第３図はセグメントノ譬ターンの例を示す図。 第４図はエラーコードと表示の態様を示す図である。 ここで、・ｌ〜・５・・・エラー信号、ＰＧ・・・／母
ターン発生装置、ｐ１〜ｐ６・・・発光ダイオードであ
る。 特許出願人 キャノン株式会社
Claims (1)
- 複数の特定の目的を表示させる表示方式において、該特
定の目的を連想させる通知Ｊｊ！索であって他の状態１
に表示する通知要素と一部重複して使用する通知ｇ！素
を準備し、該通知要素を抽出しかつ組合せることによシ
前記特定の状態を連想させる表示ｔ−得ることを特徴と
する嵌木方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15070681A JPS5852732A (ja) | 1981-09-25 | 1981-09-25 | 表示方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15070681A JPS5852732A (ja) | 1981-09-25 | 1981-09-25 | 表示方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5852732A true JPS5852732A (ja) | 1983-03-29 |
Family
ID=15502627
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15070681A Pending JPS5852732A (ja) | 1981-09-25 | 1981-09-25 | 表示方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5852732A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01305420A (ja) * | 1988-06-02 | 1989-12-08 | Nec Corp | キャラクタディスプレイ装置 |
-
1981
- 1981-09-25 JP JP15070681A patent/JPS5852732A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01305420A (ja) * | 1988-06-02 | 1989-12-08 | Nec Corp | キャラクタディスプレイ装置 |
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