JPS5853837B2 - 電信交換用切替接続マトリックス回路 - Google Patents
電信交換用切替接続マトリックス回路Info
- Publication number
- JPS5853837B2 JPS5853837B2 JP52025721A JP2572177A JPS5853837B2 JP S5853837 B2 JPS5853837 B2 JP S5853837B2 JP 52025721 A JP52025721 A JP 52025721A JP 2572177 A JP2572177 A JP 2572177A JP S5853837 B2 JPS5853837 B2 JP S5853837B2
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- mo8ic
- matrix circuit
- output
- switch
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 239000011159 matrix material Substances 0.000 title claims description 16
- 230000004048 modification Effects 0.000 claims 1
- 238000012986 modification Methods 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 4
- 238000006243 chemical reaction Methods 0.000 description 2
- 230000002457 bidirectional effect Effects 0.000 description 1
- 230000005540 biological transmission Effects 0.000 description 1
- 230000000295 complement effect Effects 0.000 description 1
- 238000004806 packaging method and process Methods 0.000 description 1
- 238000007493 shaping process Methods 0.000 description 1
- 230000005236 sound signal Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04Q—SELECTING
- H04Q3/00—Selecting arrangements
- H04Q3/42—Circuit arrangements for indirect selecting controlled by common circuits, e.g. register controller, marker
- H04Q3/52—Circuit arrangements for indirect selecting controlled by common circuits, e.g. register controller, marker using static devices in switching stages, e.g. electronic switching arrangements
- H04Q3/521—Circuit arrangements for indirect selecting controlled by common circuits, e.g. register controller, marker using static devices in switching stages, e.g. electronic switching arrangements using semiconductors in the switching stages
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Data Exchanges In Wide-Area Networks (AREA)
- Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)
Description
【発明の詳細な説明】
本発明はC−MO8ICアナログマルチプレクサ/ディ
マルチプレクサを用いた切替接続マトリックス回路に関
するものである。
マルチプレクサを用いた切替接続マトリックス回路に関
するものである。
従来、交換機等に用いられる空間分割形切替接続マトリ
ックス回路の構成素子としては、主に機械接点式の電磁
リレーが使われてきたが、電磁リレーの数は多数必要で
あり、小形で経済的な特別設計のリレーを使用しなけれ
ばならない。
ックス回路の構成素子としては、主に機械接点式の電磁
リレーが使われてきたが、電磁リレーの数は多数必要で
あり、小形で経済的な特別設計のリレーを使用しなけれ
ばならない。
又、開閉比は大きくとれるが動作時間、動作電力が犬で
ある等、装置設計上程々の制約があった。
ある等、装置設計上程々の制約があった。
また、C−MO8ICによるアナログスイッチを用いて
上記リレーを用いたときに生ずる欠点を除去することも
できるか、例えば電信信号はそのレベルが電流、電圧と
もに高いため、そのままでは上記アナログスイッチを動
作させ得ない。
上記リレーを用いたときに生ずる欠点を除去することも
できるか、例えば電信信号はそのレベルが電流、電圧と
もに高いため、そのままでは上記アナログスイッチを動
作させ得ない。
本発明の目的は、切替接続スイッチに汎用のC−MO8
ICアナログマルチプレクサ/ディマルチプレクサを適
用し、安価にして低消費電力、雑音に強く高密度実装可
能な切替接続マトリックス回路、特に電信交撹用の切替
接続マトリックス回路を提供することにある。
ICアナログマルチプレクサ/ディマルチプレクサを適
用し、安価にして低消費電力、雑音に強く高密度実装可
能な切替接続マトリックス回路、特に電信交撹用の切替
接続マトリックス回路を提供することにある。
本発明はこの問題を解決するにあたり、スイッチの出力
段をC−MO8ICアナログゲ′−トにより終端し、ス
イッチOFF時のクロストーク低減を画ったこと、又電
話用切替接続マl−IJラック回路に関してはスイッチ
の入出力端にOP −A m pをそれぞれ配置するこ
とによりインピーダンス整合、並びに利得損失補償機能
を付は加えたことによりマトリックス回路を形成したこ
とlこ特徴がある。
段をC−MO8ICアナログゲ′−トにより終端し、ス
イッチOFF時のクロストーク低減を画ったこと、又電
話用切替接続マl−IJラック回路に関してはスイッチ
の入出力端にOP −A m pをそれぞれ配置するこ
とによりインピーダンス整合、並びに利得損失補償機能
を付は加えたことによりマトリックス回路を形成したこ
とlこ特徴がある。
以下、図面等により回路の各部を説明する。
第1図および第2図は本発明を電話交換用並びをこ電信
交換用切替接続マトリックス回路にそれぞれ適用した構
成図である。
交換用切替接続マトリックス回路にそれぞれ適用した構
成図である。
第1図において、1,7は600Q入出力インピ一ダン
ス整合用のトランス、2,6はOP−Amp(演算増幅
器)を用いた伝送損失補償用回路で、一般tcC−MO
SゲートのON抵抗は100〜300gであり、音声信
号を通した場合抵抗弁による利得損失が無視できない。
ス整合用のトランス、2,6はOP−Amp(演算増幅
器)を用いた伝送損失補償用回路で、一般tcC−MO
SゲートのON抵抗は100〜300gであり、音声信
号を通した場合抵抗弁による利得損失が無視できない。
本回路においてはスイッチの入出力端のトランス1,7
前後に、汎用OP −Amp 2.6を配置し、入力イ
ンピーダンスの整合および利得補償(C−MOSゲート
における利得損失分の相殺)を行なう。
前後に、汎用OP −Amp 2.6を配置し、入力イ
ンピーダンスの整合および利得補償(C−MOSゲート
における利得損失分の相殺)を行なう。
因みに入力抵抗8を10に8以上にすることにより、O
N抵抗の存在は実際上無視できる。
N抵抗の存在は実際上無視できる。
また、3,4はC−MOSを用いたマトリックス回路、
5は、スイッチOFFの時のライン・クロストークを低
減する為に設けられた終端用スイッチであり、このスイ
ッチ5に連らなるスイッチが0FF(ON)時、相補的
に0N(OFF)となる様に動作する。
5は、スイッチOFFの時のライン・クロストークを低
減する為に設けられた終端用スイッチであり、このスイ
ッチ5に連らなるスイッチが0FF(ON)時、相補的
に0N(OFF)となる様に動作する。
これによりスイッチOFF時のラインインピーダンスが
低下し、OP−Amp6は誘導雑音を受けにくくなる。
低下し、OP−Amp6は誘導雑音を受けにくくなる。
この工夫により、ライン間のクロストークは、スイッチ
の開閉時にかかわらず一80dB以下に抑えることが出
来る。
の開閉時にかかわらず一80dB以下に抑えることが出
来る。
また、本発明の第二の実施例の第2図において10は電
流/電圧変換用フォトカプラである。
流/電圧変換用フォトカプラである。
電信における入力信号レベルは±20mA(±60V)
の電流ループであり、これを直接C−MO8ICアナロ
グスイッチに印加することは出来ないので、このフォト
カプラ1による変換が必要となる。
の電流ループであり、これを直接C−MO8ICアナロ
グスイッチに印加することは出来ないので、このフォト
カプラ1による変換が必要となる。
12は波形整形用のC−MO8ICドライバ、11はマ
トリックスの入力段で電流/電圧変換された信号を出力
段で逆変換する為に設けられたリレー回路であり、13
はそのドライバ回路である。
トリックスの入力段で電流/電圧変換された信号を出力
段で逆変換する為に設けられたリレー回路であり、13
はそのドライバ回路である。
これにより、マトリックスを通過した信号は再び±20
mAの電流ループ信号に変換され出力される。
mAの電流ループ信号に変換され出力される。
第3図はC−MO8ICによる8チヤンネル双方向マル
チプレクサ/デイマルチプレクサの多段接続により構成
されるマトリックス回路の実施例である。
チプレクサ/デイマルチプレクサの多段接続により構成
されるマトリックス回路の実施例である。
このようなC−MO8ICとしては米国モトローラ社よ
り販売されているMC14051Bが適当である。
り販売されているMC14051Bが適当である。
このような接続の回路は、入力端(出力端)21〜2N
と出力端31〜38とをIC1〜ICNにより図のよう
に接続し、ICの制御端子に制御電圧を加えることによ
り切替制御が可能となる。
と出力端31〜38とをIC1〜ICNにより図のよう
に接続し、ICの制御端子に制御電圧を加えることによ
り切替制御が可能となる。
以上、説明した様に、C−MO8ICの入出力端に適切
なトランスおよびOP−Ampなどの附属回路を付ける
ことにより電話電信用交換機における空間分割形切替接
続マトリックス回路をC−MO8ICアナログマルチプ
レクサ/ディマルチプレクサの多段接続により構成する
ことができる。
なトランスおよびOP−Ampなどの附属回路を付ける
ことにより電話電信用交換機における空間分割形切替接
続マトリックス回路をC−MO8ICアナログマルチプ
レクサ/ディマルチプレクサの多段接続により構成する
ことができる。
本発明による回路構成上の利点は下記の通りである。
(1)使用素子が汎用ICに限られており部品入手が容
易である。
易である。
(2)C−MOS ICの採用により低消費電力化、
耐雑音性の向上が実現できる。
耐雑音性の向上が実現できる。
(3)スイッチ回路をIC化することによりスイッチの
動作時間が短縮され、且つ実装密度を高めることができ
る。
動作時間が短縮され、且つ実装密度を高めることができ
る。
第1図は本発明の実施例の回路構成図、第2図は本発明
の第2の実施例の回路構成図、第3図は第1図、第2図
に用いられるマ) IJラックス路の実施例の構成図で
ある。 図において、1,7・・・・・・トランス、2,6・・
・・・・OP −Amp、 3 、4・・・・・・マト
リックス回路、5・・・・・・終端用スイッチ、10・
・・・・・フォトカプラ、11・・・・・・リレー、1
2,13・・・・・・ドライバ回路、21〜2N・・・
・・・入力端、31〜38・・・・・・出力端である。
の第2の実施例の回路構成図、第3図は第1図、第2図
に用いられるマ) IJラックス路の実施例の構成図で
ある。 図において、1,7・・・・・・トランス、2,6・・
・・・・OP −Amp、 3 、4・・・・・・マト
リックス回路、5・・・・・・終端用スイッチ、10・
・・・・・フォトカプラ、11・・・・・・リレー、1
2,13・・・・・・ドライバ回路、21〜2N・・・
・・・入力端、31〜38・・・・・・出力端である。
Claims (1)
- IC−MO8ICアナログマルチプレクサ/ディマルチ
プレクサの人出端を網目状に接続したマトリックス回路
と、このマトリックス回路の入力端に接続された波形変
形用の第1のC−MO8ICドライバと、電信信号電流
の所定の電圧に変換して前記第1のC−MO8ICドラ
イバに出力するフォトカプラと、前記マトリックス回路
の出力端に第2のC−MO8ICドライバを介して接続
され、前記マl−IJラック回路の出力端に出力が生じ
たときと出力がないときで極性の異なるパルス出力を生
ずるように電源が接続されたリレー回路とを備えて成る
ことを特徴とする電信交換用切替接続ヤトリックス回路
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP52025721A JPS5853837B2 (ja) | 1977-03-08 | 1977-03-08 | 電信交換用切替接続マトリックス回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP52025721A JPS5853837B2 (ja) | 1977-03-08 | 1977-03-08 | 電信交換用切替接続マトリックス回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS53110310A JPS53110310A (en) | 1978-09-27 |
| JPS5853837B2 true JPS5853837B2 (ja) | 1983-12-01 |
Family
ID=12173653
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP52025721A Expired JPS5853837B2 (ja) | 1977-03-08 | 1977-03-08 | 電信交換用切替接続マトリックス回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5853837B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60139065U (ja) * | 1984-02-24 | 1985-09-13 | 本田技研工業株式会社 | 気化器のフロ−ト弁装置 |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS55117394A (en) * | 1979-03-02 | 1980-09-09 | Nec Corp | Semiconductor channel switch |
| JPS57176895A (en) * | 1981-04-24 | 1982-10-30 | Fujitsu Ltd | Loss compensating circuit |
| JPS6017077U (ja) * | 1984-06-07 | 1985-02-05 | 富士通株式会社 | 電子スイツチ網 |
-
1977
- 1977-03-08 JP JP52025721A patent/JPS5853837B2/ja not_active Expired
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60139065U (ja) * | 1984-02-24 | 1985-09-13 | 本田技研工業株式会社 | 気化器のフロ−ト弁装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS53110310A (en) | 1978-09-27 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| US5471517A (en) | Subscriber system testing method | |
| CA2019176A1 (en) | Subscriber line interface circuit in a switching system | |
| IL107575A0 (en) | Communications channel testing arrangement | |
| MY113346A (en) | Remotely actuated switch and protection circuit. | |
| JPS5853837B2 (ja) | 電信交換用切替接続マトリックス回路 | |
| JPS59501811A (ja) | 電話回線用インタ−フェイス | |
| GB1572595A (en) | Two-wire to four-wire converters | |
| FR2718909B1 (fr) | Matrice de connexion configurable électriquement entre lignes d'au moins un port d'entrée-sortie de signaux électriques. | |
| JPH06205131A (ja) | モデムを有する電話装置 | |
| US4188509A (en) | Tone signalling arrangement for a telecommunications exchange | |
| JPS628997B2 (ja) | ||
| JPH01152894A (ja) | 時分割スイッチ接続方式 | |
| JPS5624896A (en) | Multipartite telephone set calling system | |
| JPS57104354A (en) | Button telephone set | |
| CN106888306B (zh) | 一种用于测试的模拟话音手柄 | |
| JPS628983B2 (ja) | ||
| JPH067698B2 (ja) | ベル信号断続雑音防止回路 | |
| JPS5852766Y2 (ja) | 電話交換装置のスイツチフレ−ム | |
| JPH0327656A (ja) | ハイブリッド回路 | |
| JPH036959A (ja) | 電話装置 | |
| JPH0121660B2 (ja) | ||
| JPH01209892A (ja) | トランク | |
| JPS6084051A (ja) | 折り返し回路 | |
| JPS63111798A (ja) | 局線インタフエイス回路 | |
| JPH0256880B2 (ja) |