JPS5856574A - 信号２値化回路 - Google Patents
信号２値化回路Info
- Publication number
- JPS5856574A JPS5856574A JP56155034A JP15503481A JPS5856574A JP S5856574 A JPS5856574 A JP S5856574A JP 56155034 A JP56155034 A JP 56155034A JP 15503481 A JP15503481 A JP 15503481A JP S5856574 A JPS5856574 A JP S5856574A
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- JP
- Japan
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- signal
- circuit
- effective
- binarization
- integrating
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
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- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
- H04N1/40—Picture signal circuits
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- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Image Input (AREA)
- Facsimile Image Signal Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はアナログ信号を２値信号に変換する２値化回路
に係り、特に２値化されるアナログ信号の有効弁別なも
行なう信号２値化回路に関する。
に係り、特に２値化されるアナログ信号の有効弁別なも
行なう信号２値化回路に関する。
従来、信号２値化方式として入力信号を２値化する為の
ＩＩ（ｉｉを変化させる浮動スライスレベル方式がある
。しかしながら前記方式は入力信号に含まれる浮動信号
が不必要な信号であってもそれに追従してしまう欠点を
有している。
ＩＩ（ｉｉを変化させる浮動スライスレベル方式がある
。しかしながら前記方式は入力信号に含まれる浮動信号
が不必要な信号であってもそれに追従してしまう欠点を
有している。
この問題を解決する方法として、人力信号の有効無効を
判別し、有効領域のみ２値化する方式がある。有効領域
を判別する方式は、不必要な浮動信号に対して改善され
るが、有効領域を無効領域として判断してｔＪ’）場合
があった。
判別し、有効領域のみ２値化する方式がある。有効領域
を判別する方式は、不必要な浮動信号に対して改善され
るが、有効領域を無効領域として判断してｔＪ’）場合
があった。
第１図は有効領域と判別して２値化する従来の回路構成
を示す。入力端子ｌは有効領斌弁別回路２０人力３と２
値化回路４の入力５に接続されている。有効領域弁別回
路２の出力６は２値化回路４の有効人カフに接続されて
いる。又、２値化囲路４では入力端子５は上側包絡線弁
別回路８の入力９、下側包絡線弁別回路１０の人力１１
．コンパレータ１２の第１の入力１３に接続されている
。
を示す。入力端子ｌは有効領斌弁別回路２０人力３と２
値化回路４の入力５に接続されている。有効領域弁別回
路２の出力６は２値化回路４の有効人カフに接続されて
いる。又、２値化囲路４では入力端子５は上側包絡線弁
別回路８の入力９、下側包絡線弁別回路１０の人力１１
．コンパレータ１２の第１の入力１３に接続されている
。
上側包路線弁別回路８の出力８′、下側包路線弁別回路
１０の出力１０’ｆ’！、それぞれ加算回路１４の第１
、第２の人力１５．１６に入り、前記加算回路１４の出
力１７は、コンパレータ１２の第２の人力１８に入る。
１０の出力１０’ｆ’！、それぞれ加算回路１４の第１
、第２の人力１５．１６に入り、前記加算回路１４の出
力１７は、コンパレータ１２の第２の人力１８に入る。
コンパレータ１２の出力１９は出力端子２０に接続され
る。入力端子ｌより入った入力信号は、上側包絡線弁別
回路８によって上側包絡線信号（変換される。同様に、
下側包結線弁別回路１０によって下情包絡線信号に変換
される。
る。入力端子ｌより入った入力信号は、上側包絡線弁別
回路８によって上側包絡線信号（変換される。同様に、
下側包結線弁別回路１０によって下情包絡線信号に変換
される。
前記２つの信号は加算回路１４に入り、加算されさらに
２分のＩＫされる。加算回路１４の出力は、浮動スライ
スレベルとなる。コン・Ｉレータ］２は、前記加算回路
１４の出力すなわち浮動ヌライスレベル信号と人力信号
とを比較し出力する。
２分のＩＫされる。加算回路１４の出力は、浮動スライ
スレベルとなる。コン・Ｉレータ］２は、前記加算回路
１４の出力すなわち浮動ヌライスレベル信号と人力信号
とを比較し出力する。
一方、有効領域弁別回路２では人力信号の有効弁別を行
ない、上側包絡線弁別回路８、下側包結線弁別回路１０
に包結線弁別を行なうが否かを出力する。
ない、上側包絡線弁別回路８、下側包結線弁別回路１０
に包結線弁別を行なうが否かを出力する。
第２図は、第１図に示１〜だ上側包絡線弁別回路８、下
側包絡線弁別回路１０、加算回路１４をさらに詳細に示
す。入力端子２１は、ダイオードＤ８のアノード２２と
ダイオードＤ、のカソード２３に接続される。
側包絡線弁別回路１０、加算回路１４をさらに詳細に示
す。入力端子２１は、ダイオードＤ８のアノード２２と
ダイオードＤ、のカソード２３に接続される。
ダイオードＤ、のカソード２４は抵抗Ｒ７、Ｒ８、コン
デンサＣＩのそれぞれの一方の端子と、スイッチ５Ｆ、
の一方の端子にそれぞれ接続される。
デンサＣＩのそれぞれの一方の端子と、スイッチ５Ｆ、
の一方の端子にそれぞれ接続される。
又、ダイオードＤ、のアノード２５は、抵抗Ｒ３、Ｒ４
、コンデンサＣ３のそれぞれの一方の端子とスイッチＳ
Ｗ、 の一方の端子にそれぞれ接続される。抵抗Ｒ，
，Ｒ，の他の端子と抵抗Ｒ３の一端は、演算増幅器ｏｐ
の負入力２６に接続される。
、コンデンサＣ３のそれぞれの一方の端子とスイッチＳ
Ｗ、 の一方の端子にそれぞれ接続される。抵抗Ｒ，
，Ｒ，の他の端子と抵抗Ｒ３の一端は、演算増幅器ｏｐ
の負入力２６に接続される。
演算増幅器ＯＰの正人力２７は、抵抗Ｒ６を介して接地
されている。Ｒ３の他端子は演算増幅器ＯＰの出力２８
に接続されている。演算増幅器Ｏ？の出力２８は、この
ままでは極性が反対なため、極性反転回路を経て閾値出
力として出力２９に出力される。又、抵抗Ｒ１、Ｃ１の
他の端子には、ＦＣＣ例えば、−１２Ｖが印加されてい
る。又、スイッチＳＦＩの他の端子には抵抗Ｒ６を介し
てｙｃｃが印加されている。
されている。Ｒ３の他端子は演算増幅器ＯＰの出力２８
に接続されている。演算増幅器Ｏ？の出力２８は、この
ままでは極性が反対なため、極性反転回路を経て閾値出
力として出力２９に出力される。又、抵抗Ｒ１、Ｃ１の
他の端子には、ＦＣＣ例えば、−１２Ｖが印加されてい
る。又、スイッチＳＦＩの他の端子には抵抗Ｒ６を介し
てｙｃｃが印加されている。
同様に、抵抗Ｒ＊、Ｃ１の他端子には、＋ｒｃｃ例えば
、１２Ｖが印加され、スイッチＳＩＦ、 の匍の端子
には、抵抗Ｒ７を介して前記子ＶＣＣが印加されている
。有効信号入力端子３０は、スイッチｓｒ１、ｓｔｙ、
の制御端子３１．３２に接続されている。スイッチｓｒ
、 、 ｓｒ、は前記制御端子３１、−３２に有効を表
わす信号が印加された時、接点を開放とする。ダイオー
ドＤ１、抵抗Ｒ１１コンデンサＣ３は上側包絡線を検出
する素子であり、メイオードＤ、 、ｉ抗Ｒｔ ％コン
デンサＣ室は下側包絡線を検出する素子であり、それぞ
れ積分回路を構成している。抵抗Ｒｍ、Ｒ４は、演算増
幅器ＯＰの人力抵抗であり、各々の入力の利得は抵抗Ｒ
１、Ｒ４と帰償抵抗Ｒ１の比によって決まる。
、１２Ｖが印加され、スイッチＳＩＦ、 の匍の端子
には、抵抗Ｒ７を介して前記子ＶＣＣが印加されている
。有効信号入力端子３０は、スイッチｓｒ１、ｓｔｙ、
の制御端子３１．３２に接続されている。スイッチｓｒ
、 、 ｓｒ、は前記制御端子３１、−３２に有効を表
わす信号が印加された時、接点を開放とする。ダイオー
ドＤ１、抵抗Ｒ１１コンデンサＣ３は上側包絡線を検出
する素子であり、メイオードＤ、 、ｉ抗Ｒｔ ％コン
デンサＣ室は下側包絡線を検出する素子であり、それぞ
れ積分回路を構成している。抵抗Ｒｍ、Ｒ４は、演算増
幅器ＯＰの人力抵抗であり、各々の入力の利得は抵抗Ｒ
１、Ｒ４と帰償抵抗Ｒ１の比によって決まる。
第３図は、有効領域弁別回路を示す。コン／ｆｌ／−タ
３３の入力３４は入力端子３５に、他の人力３６には可
変抵抗Ｖｒ の一つの端子３７が接続される。可変抵抗
Ｖｒの他の端には、＋Ｖｃ、と−ＦＣＣが印加される。
３３の入力３４は入力端子３５に、他の人力３６には可
変抵抗Ｖｒ の一つの端子３７が接続される。可変抵抗
Ｖｒの他の端には、＋Ｖｃ、と−ＦＣＣが印加される。
コン・ンレータ３３の出力３９は有効、無効の信号とし
て出力４０に出力される。
て出力４０に出力される。
第４図は、前述の回路の動作を示す。人力信号は、第５
図に示す半導体チップ５０のパッド５１、プロダクトプ
ロービング痕（以下、ＰＰ痕と呼ぶ）５２を視野５３内
で走査５４した時の撮像信号５５である。撮像信号５５
に対し、上側包絡線５６、下側包絡線５７を検出し、そ
の平均信号即ち、・母ツドマークスライス信号５８を検
出する。
図に示す半導体チップ５０のパッド５１、プロダクトプ
ロービング痕（以下、ＰＰ痕と呼ぶ）５２を視野５３内
で走査５４した時の撮像信号５５である。撮像信号５５
に対し、上側包絡線５６、下側包絡線５７を検出し、そ
の平均信号即ち、・母ツドマークスライス信号５８を検
出する。
前記有効領域弁別回路２の出力即ち廟効信号５９には、
撮像信号５５のｐｐ痕に対するくぼみ■を検出している
為に、きれつ■′が生じている。これは、くぼみ■がス
ライスレベルＳＬ以下にあるからである。その為に上側
及び下側包絡線はその間撮像信号と同じになってしまい
、パッド会マーク信＠ＰＳとして検出しなければならな
い領域にカケ６０が生じてしまいこれを検出してない。
撮像信号５５のｐｐ痕に対するくぼみ■を検出している
為に、きれつ■′が生じている。これは、くぼみ■がス
ライスレベルＳＬ以下にあるからである。その為に上側
及び下側包絡線はその間撮像信号と同じになってしまい
、パッド会マーク信＠ＰＳとして検出しなければならな
い領域にカケ６０が生じてしまいこれを検出してない。
以上述べた様に、浮動スライスレベル方式と有効領域弁
別を同時に用いた２値化回路は、急激に太き（変化する
信号を有効と判断せず、２値化出力信号に検出されない
カケ６０が生じるという問題点を有していた。
別を同時に用いた２値化回路は、急激に太き（変化する
信号を有効と判断せず、２値化出力信号に検出されない
カケ６０が生じるという問題点を有していた。
本発明は前記問題点を解決するものであり、その目的は
振幅が急激に大きく変化する場合においても誤りなく入
力信号を２値化する信号２値化回路を提供することにあ
る。
振幅が急激に大きく変化する場合においても誤りなく入
力信号を２値化する信号２値化回路を提供することにあ
る。
本発明の信号２値化回路の特徴とするところは外部情報
を電気信号に変換するセンサと前記センサからの電気信
号を２億信号に変換する２値化回路と前記電気信号のう
ち有効部分を弁別し有効の間２値化回路と動作させる有
効領域弁別回路を備え、前記電気信号を２値化信号に賛
換する場合において、前記電気信号を積分回路に人力し
て積分し、前記積分回路出力を有効領域弁別回路に人力
することである。
を電気信号に変換するセンサと前記センサからの電気信
号を２億信号に変換する２値化回路と前記電気信号のう
ち有効部分を弁別し有効の間２値化回路と動作させる有
効領域弁別回路を備え、前記電気信号を２値化信号に賛
換する場合において、前記電気信号を積分回路に人力し
て積分し、前記積分回路出力を有効領域弁別回路に人力
することである。
以下、図面を参照して本発明の詳細な説明する。
第６図は本発明の１実施例を示すもので、第１図に示し
た従来例と異与る点は入力端子１と有効領域弁別回路２
間に積分回路６３が挿入されている点である。すなわち
、積分回路６３の入力６１には入力端子１が接続され、
その出力６２は有効領域弁別回路２の人力３に接続され
る。
た従来例と異与る点は入力端子１と有効領域弁別回路２
間に積分回路６３が挿入されている点である。すなわち
、積分回路６３の入力６１には入力端子１が接続され、
その出力６２は有効領域弁別回路２の人力３に接続され
る。
第７図は積分回路６０と有効領域弁別回路２を詳細に示
す。第３図に示した有効領域弁別回路２０人力に抵抗Ｒ
８、コンデンサＣ５を付加した構成となっている。すな
わち、入力端子１は抵抗Ｒ８を介してコンパレータ３３
の一方の入力３４に接続される。また、コンパレータ３
３の前記人力３４はコンデンサＣ３を介して接地されて
いる。
す。第３図に示した有効領域弁別回路２０人力に抵抗Ｒ
８、コンデンサＣ５を付加した構成となっている。すな
わち、入力端子１は抵抗Ｒ８を介してコンパレータ３３
の一方の入力３４に接続される。また、コンパレータ３
３の前記人力３４はコンデンサＣ３を介して接地されて
いる。
第８図は第６図に示した本発明の実施例の動作を示す。
撮像信号５５は積分回路６３によって積分され積分信号
Ｓ２を得る。積分信号は有効領域弁別回路２によってス
ライスＳＬでスライスされ有効信号５９′ に変換さ
れる。
Ｓ２を得る。積分信号は有効領域弁別回路２によってス
ライスＳＬでスライスされ有効信号５９′ に変換さ
れる。
本発明を用いた場合には前述の有効；言号５９と比較し
て明らかな様にＰＰ痕によって生じる有効信号のくぼみ
が無くなっている。すなわち、下側包絡＠５６’、下側
包結線５７′は撮像信号５５のＰＰ痕によって生じたく
ぼみ■に対しても正しく包絡線を検出している。その結
果、・ｇットマークスライス信号５８′は撮像信号５５
の正しいスライスレベルとなり、パットマークスライス
信号５８′によって撮像信号５５をスライスし、２値化
した信号すなわち）！ットマーク信号ＰＳ′ は求める
べきノぞットマーク信号となっている。
て明らかな様にＰＰ痕によって生じる有効信号のくぼみ
が無くなっている。すなわち、下側包絡＠５６’、下側
包結線５７′は撮像信号５５のＰＰ痕によって生じたく
ぼみ■に対しても正しく包絡線を検出している。その結
果、・ｇットマークスライス信号５８′は撮像信号５５
の正しいスライスレベルとなり、パットマークスライス
信号５８′によって撮像信号５５をスライスし、２値化
した信号すなわち）！ットマーク信号ＰＳ′ は求める
べきノぞットマーク信号となっている。
上述の説明から明らかな様に本発明を用いることにより
従来第４図に示したパットマーク信号のｉ−住６０がな
く正しく撮ｇＩ信号を２値化している。
従来第４図に示したパットマーク信号のｉ−住６０がな
く正しく撮ｇＩ信号を２値化している。
本発明によれば誤りのない、浮動スライスレベル方式の
２値化回路が可能となる。
２値化回路が可能となる。
尚、第４図、第８図において、上側包絡＠５６．５６′
、下側包絡Ｍ５７．５７′、・にットマークスライス！
−１’＋５８．５８′は図面を見やすくする為、撮像信
号より少しずらして表わしである。
、下側包絡Ｍ５７．５７′、・にットマークスライス！
−１’＋５８．５８′は図面を見やすくする為、撮像信
号より少しずらして表わしである。
第１図は従来の２値化回路の構成図、第２図は従来の２
値化回路の絆細な回路図、第３図は有効弁別回路の詳細
回路図、第４図は従来の２値化回路の信号を示す図、第
５図はＩＣチップの／４’ターン図、第６図は本発明の
２値化回路の回路構成、第７図は本発明の回路図の積分
回路、有効領域弁別回路を詳細に示す回路図、第８図は
本発明の２値化回路の信号を示す図である。 ２・・・有効領域弁別回路 ８・・・上側包絡線弁別回路 １０・・・下側包絡線弁別回路 １２・・・コンパレータ １４・・・加算回路 ６３・・・積分回路
値化回路の絆細な回路図、第３図は有効弁別回路の詳細
回路図、第４図は従来の２値化回路の信号を示す図、第
５図はＩＣチップの／４’ターン図、第６図は本発明の
２値化回路の回路構成、第７図は本発明の回路図の積分
回路、有効領域弁別回路を詳細に示す回路図、第８図は
本発明の２値化回路の信号を示す図である。 ２・・・有効領域弁別回路 ８・・・上側包絡線弁別回路 １０・・・下側包絡線弁別回路 １２・・・コンパレータ １４・・・加算回路 ６３・・・積分回路
Claims (1)
- 【特許請求の範囲】 ｌ）外部情報を電気信号に変換するセンサと前記センサ
からの電気信号を２値化信号に変換する２値化回路と、
前記電気信号のうち有効部分を弁別し有効の関２値化回
路を動作させる有効領域弁別回路を備え、前記電気信号
を２値化信号に変換する場合において、前記電気信号を
積分回路に入力して積分し、前記積分回路出力を有効領
域弁別回路に入力することを特徴とする信号２値化回路
。 幻 前記センナは光電変換を行う撮儂系より成ることを
特徴とする特許請求の範囲第１項記載の信号２値化回路
。 ３）前記２値化回路は、前記電気信号に於ける高レベル
側の包結線信号及び低レベル側の包路線信号を作成する
積分回路と前記２つの積分回路の出力を加算し分圧する
加算器と前記積分回路中のコンアンサに並列に抵抗を介
して設けられ有効領域の時に開放となるスイッチを有す
る閾値形成回路を有することを特徴とする特許請求の範
囲第１項記載の信号２値化回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56155034A JPS5856574A (ja) | 1981-09-30 | 1981-09-30 | 信号２値化回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56155034A JPS5856574A (ja) | 1981-09-30 | 1981-09-30 | 信号２値化回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5856574A true JPS5856574A (ja) | 1983-04-04 |
| JPS6159032B2 JPS6159032B2 (ja) | 1986-12-15 |
Family
ID=15597221
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56155034A Granted JPS5856574A (ja) | 1981-09-30 | 1981-09-30 | 信号２値化回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5856574A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6134040A (ja) * | 1984-07-26 | 1986-02-18 | Toyota Motor Corp | ポリプロピレン樹脂組成物の製造方法 |
| JPS62151071A (ja) * | 1985-12-25 | 1987-07-06 | Nec Corp | ビデイオ信号処理装置 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS52151513A (en) * | 1976-06-11 | 1977-12-16 | Hitachi Ltd | Binary signal generation device |
-
1981
- 1981-09-30 JP JP56155034A patent/JPS5856574A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS52151513A (en) * | 1976-06-11 | 1977-12-16 | Hitachi Ltd | Binary signal generation device |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6134040A (ja) * | 1984-07-26 | 1986-02-18 | Toyota Motor Corp | ポリプロピレン樹脂組成物の製造方法 |
| JPS62151071A (ja) * | 1985-12-25 | 1987-07-06 | Nec Corp | ビデイオ信号処理装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6159032B2 (ja) | 1986-12-15 |
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