JPS5865700U - リフレツシユ回路 - Google Patents

リフレツシユ回路

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JPS5865700U
JPS5865700U JP16006681U JP16006681U JPS5865700U JP S5865700 U JPS5865700 U JP S5865700U JP 16006681 U JP16006681 U JP 16006681U JP 16006681 U JP16006681 U JP 16006681U JP S5865700 U JPS5865700 U JP S5865700U
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JP
Japan
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shift register
refresh
memory device
refresh circuit
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JP16006681U
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抜山　知二
恵治 松本
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NEC Corp
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案の一実施例を示すブロック図、第２図は
シフトレジスタ部を構成した具体例を示す回路図でＰ基
盤ＮチャネルＭＯ３集積回路正論理で記述されている。 第３図は第２図の入力信号を示すタイムチャートである
。 １・・・・・・ダイナミックＲＡＭ、２・・・・・・シ
フトレジスタ、３・・・・・・リフレッシュ信号検出回
路、４・・・・・・アドレス発生部、１１・・・・・・
ＲＡＭのワード線に対応したシフトカウンタの出力、１
２・・・・・・ＲＡＭのアドレス、１３・・・・・・Ｒ
ＡＭの入力データ、１４・・・・・・リフレッシュ要求
信号、１５・・・・・・制御信号。

Claims (1)

    【実用新案登録請求の範囲】
  1. メモリ装置のワード線に対応したシフトレジスタと該シ
    フトレジスタの状態をリフレッシュ要求信号によって修
    飾する手段と前記シフトレジスタによって規定される該
    メモリ装置のワード線をリフレッシュ時に選択する機構
    を有しワード線のアクセスによって該メモリ装置のリフ
    レッシュを行うことを特徴としたリフレッシュ回路。
JP16006681U 1981-10-27 1981-10-27 リフレツシユ回路 Granted JPS5865700U (ja)

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JP16006681U JPS5865700U (ja) 1981-10-27 1981-10-27 リフレツシユ回路

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Publication Number Publication Date
JPS5865700U true JPS5865700U (ja) 1983-05-04
JPS6128320Y2 JPS6128320Y2 (ja) 1986-08-22

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ID=29952496

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JPS6128320Y2 (ja) 1986-08-22

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