JPS5896397A - 表示出力回路 - Google Patents

表示出力回路

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Publication number
JPS5896397A
JPS5896397A JP19616981A JP19616981A JPS5896397A JP S5896397 A JPS5896397 A JP S5896397A JP 19616981 A JP19616981 A JP 19616981A JP 19616981 A JP19616981 A JP 19616981A JP S5896397 A JPS5896397 A JP S5896397A
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JP
Japan
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display
output
circuit
signal
gate
Prior art date
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Pending
Application number
JP19616981A
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English (en)
Inventor
岡野 勝
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP19616981A priority Critical patent/JPS5896397A/ja
Publication of JPS5896397A publication Critical patent/JPS5896397A/ja
Pending legal-status Critical Current

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  • Audible And Visible Signals (AREA)
  • Alarm Systems (AREA)
  • Selective Calling Equipment (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 この発明は、遠方監視制御装置などに適用される表示゛
出力回路に関するものである。
第1図に従来の表示出力回路を示す。図において1およ
び2は入力信号端子、11および12は表示メモリ、2
1.22は表示状態変化検出回路、31.32はフリッ
カメモリ、3はフリッカメモリ31.32のリセット信
号入力端子、4はフリッカ信号入力端子、41.42は
フリッカ信号のためのANDゲート、51.52は表示
メモリ11.12の出力信号のためのANDゲート、6
1゜62はORゲート、10.20は表示出力端子。
w、Rは表示灯をそれぞれ示す。
第2図は第1図の回路の動作タイムチャートを示す〇 第1図の回路の動作はつぎのとおりである。入力信号端
子1.2に入力された表示情報は、それぞれ表示メモI
J 11 、12に記憶される。状態変化検出回路21
.22は、表示メモリ11.12の出力状態、すなわち
出力が1”であるか@θ″であるかを監視し、状態変化
が検出されればフリッカメモリ31.32に信号を供給
してこれをセットする。通常、フリッカメモリ31.3
2がセットされていないとき、表示メモリ11.12の
出力はANDゲート51.52およびORゲート61.
62を通過し、表示灯W、Rを連続点灯または連続消灯
させる。
一方、表示入力信号に変化があり、状態変化検出回路2
1.22の出力によりフリッカメモリ31.32がセッ
トされると、表示メモリ11.12の出力はANDゲー
)51.52でロックされ、フリッカ信号入力端子4よ
り入力された7リツ力信号がANDゲー)41.42お
よびORゲート61.62を通過して表示灯W、RK供
給されてこれを点滅させる。このときベル、ブザー等の
警報を出力させることもあるが、図では省略している。
運転員はこの表示灯W、Rの点滅により変化項目を確認
し、その後にフリッカ停止動作を行う。
すなわち入力端子3よりリセット信号を入力させ、状態
変化検出回路31.32をリセットする。これKより表
示灯W、Rは再び表示メモ!J 11.12の内容に応
じて連続点灯または連続消灯し、変化後の状態を表示す
る。
第2図のタイムチャートにおいて、1,2,3.4,1
0.20はそれぞれ第1図における同一符号の出入力端
子での信号波形を示している。入力信号端子1または2
における状態が変化する時点t1.t7またはt3tt
5より表示出力端子10または20における信号が7リ
ツカを開始し、リセット操作される時点t2*”8また
はt4゜t6でフリッカが停止し、連続点灯または連続
消灯となる。
第1図では、機器の運転状態を表わす白色表示灯Wと1
機器の故障状態を表わす赤色表示灯Rからなる2回路の
表示出力回路を示したが、近年、監視制御システムの規
模が太き(なるにつれて、親局監視盤に機器の動作状態
を表わすシンボルと故障状態を表わすシンボルとを個々
に設けていたのでは、監視盤が複雑になり、小形化の面
からも有利とはいえない。このため機器のシンボルを1
つにし、運転状態では白色ランプが点灯し、故障状態で
は赤色ランプを点灯させる表示方式が採用されてきてい
る。しかし第1図に示した従来回路で上記のような表示
方式を採用する際、機器によっては運転中に故障が発生
しても運転を停止しないものもあるので、運転を表わす
白色ランプと故障を表わす赤色ランプとが同時に点灯し
、機器シンボルの色による判別が不明確となる欠点があ
ったO この発明は上記のような従来の欠点をなくすためになさ
れたもので、動作中または故障中の表示を明確に行うこ
とができるようにした表示出力回路を提供することを目
的としている。
以下、この発明の一実施例を図について説明する。第3
図において、1,2は入力信号端子、11.12は表示
メモリ、21.22は表示状態変化検出回路、31.3
2はフリッカメモリ、3はリセット信号入力端子、4は
フリッカ信号入力端子。
41.42,51.52はANDゲート、61!62は
ORゲート、10.20は表示出力端子、W、Rは表示
灯をそれぞれ示す。これらの要素を丁第1図に示したも
のと同等であるので、対応する部分は同一の符号で示し
、その説明を省略する。
さらに符号81.82は表示出力中を示す信号の出力端
子、91.92は他の回路の表示出力中信号の入力端子
、71.72は他の回路が出力表示中であるときに表示
出力をロックするANDゲートである。
第3図において、入力端子1に連なる回路は機器の運転
状態を、また入力端子2に連なる回路は機器の故障状態
を表わすものとする。そして故障状態表示灯Rが消灯し
ているときは、表示メモリ12およびフリッカメモリ3
2はともにクリアされており、表示出力中信号の出力端
子82には信号は出力されない。したがって入力端子1
に連なる機器の運転状態表示出力回路におけるANDゲ
ート71は、入力端子91からの故障状態表示出力中の
信号がないため、ORゲート61の出力を通過させる。
このときの動作は第1図の場合と全(同一である。
一方、故障状態表示灯Rが点灯または点滅しているとき
は、故障状態表水中信号の出力端子82には故障状態表
示灯Rを点灯または点滅させる信号が現われ、この信号
は、出力端子82および入力端子91を経てANDゲー
ト71の県止入力に加えられる。したがってORゲート
61から何らかの出力信号が出力されている状態でも、
ANDゲートγ1で阻止されるため、この間、運転状態
表示灯Wは消灯する。
第4図に第3図の回路の動作タイムチャートを示す。こ
こに示した各部の動作順序は第2図の場合と同じである
。第1図の従来回路では、第2図における時点t3から
t6まで、出力端子10゜20に出力信号が現われ、白
色表示灯Wおよび赤色表示灯Rが同時に点灯していた。
しかし第3図に示したこの発明の回路では、第4図から
明らかなように、時点t3からt6までの間、ORゲー
ト61の出力信号はANDゲート71で阻止されるため
に、出力端子10に出力信号が現われることはなく、白
色表示灯Wは消灯状態に保たれる。
なお上記の実施例では、故障状態表示灯Rの点灯時に運
転状態表示灯Wを消灯させるように出力端子82を入力
端子91に接続した場合を示したが、これとは逆の動作
を得ようとする場合には、出力端子81を入力端子92
に接続すればよい。
また運転状態表示灯Wと故障状態表示灯Rとを別々のシ
ンボルとして用いる場合には、出力端子81.82およ
び出力端子91.92をすべて開放状態とすればよく、
従来回路と同じ動作が得られる。
以上のようにこの発明によれば、表示出力回路の最終段
にゲート回路を挿入し、このゲート回路によって、他回
路の表示出力中には自回路の表示出力を禁止するように
構成したので、表示が常に明確に行われるという効果が
得られる。
【図面の簡単な説明】
第1図は従来の表示出力回路のブロック図、第2図は第
1図の回路の動作タイムチャート、第3図はこの発明の
一実施例による表示出力回路のブロック図、第4図は第
3図の回路の動作タイミングチャートである。 1.2・・・入力信号端子、11.12・φ・表示メモ
リ、21.22・・・表示状態変化検出回路、31.3
2・・・フリッカメモリ、3・・・リセット信号入力端
子、4・・・7リツ力信号入力端子、41 .42,5
1 .52・・・ANDゲート、61゜62・・−OR
ゲート、71.72・・・ANDゲート、81.82・
・・出力端子、91.92・・・入力端子、10.20
・・・表示出力端子、W 、 R−・表示灯。 なお、図中同一符号は同−又は相当部分を示す〇代理人
 葛野信−(はが1名)

Claims (1)

    【特許請求の範囲】
  1. 入力された表示情報を記憶する表示メモリと、この表示
    メモリの出力状態の変化が検出されたときにセットされ
    る7リツカメモリと、この7リツカメモリがセットされ
    ていないときには上記表示メモリの出力信号を通過させ
    、セットされているときKは7リツ力信号を通過させる
    第1のゲート回路と、他回路の表示出力がないときには
    上記第1のゲート回路の出力信号を表示器に供給し、他
    回路の表示出力中には上記第1のゲート回路の出力信号
    を禁止する第2のゲート回路とを備えた表示出力回路。
JP19616981A 1981-12-02 1981-12-02 表示出力回路 Pending JPS5896397A (ja)

Priority Applications (1)

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JP19616981A JPS5896397A (ja) 1981-12-02 1981-12-02 表示出力回路

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JPS5896397A true JPS5896397A (ja) 1983-06-08

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ID=16353349

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JP19616981A Pending JPS5896397A (ja) 1981-12-02 1981-12-02 表示出力回路

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