JPS5910947Y2 - 電源装置 - Google Patents
電源装置Info
- Publication number
- JPS5910947Y2 JPS5910947Y2 JP16298382U JP16298382U JPS5910947Y2 JP S5910947 Y2 JPS5910947 Y2 JP S5910947Y2 JP 16298382 U JP16298382 U JP 16298382U JP 16298382 U JP16298382 U JP 16298382U JP S5910947 Y2 JPS5910947 Y2 JP S5910947Y2
- Authority
- JP
- Japan
- Prior art keywords
- main switch
- transformer
- switch element
- power supply
- current
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Dc-Dc Converters (AREA)
Description
【考案の詳細な説明】
考案の技術分野
本考案は、人出力が直流的に絶縁された小形，軽量で経
済的なＤＣ−ＤＣコンバータより或る電源装置に関する
ものである。
済的なＤＣ−ＤＣコンバータより或る電源装置に関する
ものである。
従来技術と問題点
従来の入出力絶縁形のＤＣ−ＤＣコンバータの１例を第
１図に示す。
１図に示す。
同図において、電源１の直流電圧ＶＩＮをスイッチング
トランジスタより或る主スイッチ（Ｓ．）３で矩形波交
流に変換し、トランス２の１次側巻線Ｎ０に加え、２次
側巻線Ｎ２から整流用ダイオード７，還流用ダイオード
８と、直列インダクタンス９と並列キャパシタンス１０
より戊る低域通過フィルタを通して所定の直流出力電圧
■。
トランジスタより或る主スイッチ（Ｓ．）３で矩形波交
流に変換し、トランス２の１次側巻線Ｎ０に加え、２次
側巻線Ｎ２から整流用ダイオード７，還流用ダイオード
８と、直列インダクタンス９と並列キャパシタンス１０
より戊る低域通過フィルタを通して所定の直流出力電圧
■。
が取出される。
更にこの出力電圧Ｖ。を検出増幅回路１１により検出増
幅した後、ホトカプラ又はパルストランス等より或る絶
縁結合部１２を介して制御回路４に入力し、発振回路６
からの駆動信号を制御して主スイッチ（Ｓ．）３の断続
比を可変にして出力電圧Ｖ。
幅した後、ホトカプラ又はパルストランス等より或る絶
縁結合部１２を介して制御回路４に入力し、発振回路６
からの駆動信号を制御して主スイッチ（Ｓ．）３の断続
比を可変にして出力電圧Ｖ。
の安定制御を行なう帰還回路が設けられる。
又主スイッチ（Ｓ．）３を流れる電流を電流トランス５
で検出し、電流がある値以上になると制御回路４を制御
し主スイッチ（Ｓ．）３を強制的に遮断する信号を出す
過電流保護回路が設けられる。
で検出し、電流がある値以上になると制御回路４を制御
し主スイッチ（Ｓ．）３を強制的に遮断する信号を出す
過電流保護回路が設けられる。
第２図ａ−ｃはこの過電流保護回路の動作波形図を示す
。
。
同図ａの過電流検出信号が同図ｂの主スイッチ（Ｓ．）
３の駆動信号に対応して検出された時、主スイッチ電流
は同図Ｃに示すように、主スイツ（Ｓ．）３固有の蓄積
時間ｔ５のために主スイッチ電流は流れ続け、トランス
２が飽和に近づいて主スイッチ（Ｓ．）３には同図に示
す過電流検出時の電流■１よりも大きな電流Ｉ２が流れ
てしまう。
３の駆動信号に対応して検出された時、主スイッチ電流
は同図Ｃに示すように、主スイツ（Ｓ．）３固有の蓄積
時間ｔ５のために主スイッチ電流は流れ続け、トランス
２が飽和に近づいて主スイッチ（Ｓ．）３には同図に示
す過電流検出時の電流■１よりも大きな電流Ｉ２が流れ
てしまう。
過電流に対する保護を確実に行なうためには、蓄積時間
ｔ５を見込んで過電流検出点を設定する必要が生じるが
、蓄積時間ｔ５はスイッチ素子によりばらつきが大きく
、初期にその値を見込むと主スイッチ（Ｓ．）３の最大
許容電流に対して余裕をとった小さな値にしなければな
らず無駄が大きい。
ｔ５を見込んで過電流検出点を設定する必要が生じるが
、蓄積時間ｔ５はスイッチ素子によりばらつきが大きく
、初期にその値を見込むと主スイッチ（Ｓ．）３の最大
許容電流に対して余裕をとった小さな値にしなければな
らず無駄が大きい。
又トランスも蓄積時間ｔ５による主スイッチ導通時間の
増加に対して飽和しないような大きな容量を必要とする
ため大形化し価格的にも不経済である。
増加に対して飽和しないような大きな容量を必要とする
ため大形化し価格的にも不経済である。
考案の目的
本考案の目的は、入出力が直流的に絶縁された小形，軽
量で経済的なＤＣ−ＤＣコンバータより或る電源装置を
提供することである。
量で経済的なＤＣ−ＤＣコンバータより或る電源装置を
提供することである。
以下本考案を実施例につき詳述する。
考案の実施例
第３図は本考案の実施例の構威を示す説明図であり、第
４図ａ−ｅはその動作波形図を示す。
４図ａ−ｅはその動作波形図を示す。
第３図において、電源１の直流電圧ＶＩＮを第１の主ス
イッチ（Ｓ．）３を介しトランス２の１次側巻線Ｎ１に
加え、主スイッチ（Ｓ１）３が発振回路６からの一定周
期駆動信号により断続動作を行なう。
イッチ（Ｓ．）３を介しトランス２の１次側巻線Ｎ１に
加え、主スイッチ（Ｓ１）３が発振回路６からの一定周
期駆動信号により断続動作を行なう。
トランス２の２次側巻線Ｎ２からの矩形波交流を直列の
スイッチングトランジスタより戒る第２の主スイッチ（
Ｓ２）２１を通して整流した後、直列インダクタンス９
と並列キャパシタンク１０より或る低域通過を通して所
定の直流出力電圧■。
スイッチングトランジスタより戒る第２の主スイッチ（
Ｓ２）２１を通して整流した後、直列インダクタンス９
と並列キャパシタンク１０より或る低域通過を通して所
定の直流出力電圧■。
が取出される。
なお、ダイオード８は直列インダクタンス９の電流を連
続して流すための還流用ダイオードである。
続して流すための還流用ダイオードである。
更にこの出力電圧■。を検出増幅回路１１により検出増
幅し、制御回路２２により主スイッチ（ Ｓ ２） ２
１の断続比を可変として出力電圧■。
幅し、制御回路２２により主スイッチ（ Ｓ ２） ２
１の断続比を可変として出力電圧■。
の安定制御を行なう。
前述のように、主スイッチ（Ｓ２）２１は整流用ダイオ
ードの役目を兼用しており 主スイッチ（Ｓ２）２１は
制御回路２２から制御され、制御回路２２は、検出増幅
回路１１，同期検出回路２３，電流トランス２４からの
信号に応じて、主スイッチ（Ｓ２）２１の駆動信号を出
力するものである。
ードの役目を兼用しており 主スイッチ（Ｓ２）２１は
制御回路２２から制御され、制御回路２２は、検出増幅
回路１１，同期検出回路２３，電流トランス２４からの
信号に応じて、主スイッチ（Ｓ２）２１の駆動信号を出
力するものである。
この場合、第１の主スイッチ（Ｓｌ）３と第２の主スイ
ッチ（Ｓ２）２１との同期がとられ、かつ主スイッチ（
Ｓ２）２１の最大導通時間が主スイッチ（Ｓｔ）３の最
大導通時間より小さくなるように制御回路２２が構戊さ
れているものである。
ッチ（Ｓ２）２１との同期がとられ、かつ主スイッチ（
Ｓ２）２１の最大導通時間が主スイッチ（Ｓｔ）３の最
大導通時間より小さくなるように制御回路２２が構戊さ
れているものである。
又主スイッチ（Ｓ２）２１を流れる電流が過電流となっ
た場合には電流トランス（ＣＴ）２４で検出し、制御回
路２２により主スイッチ（Ｓ２）２１を強制的に遮断す
る。
た場合には電流トランス（ＣＴ）２４で検出し、制御回
路２２により主スイッチ（Ｓ２）２１を強制的に遮断す
る。
第４図ａ−ｅは第３図の実施例における要部の波形図を
示す。
示す。
同図ａの発振回路６の出力信号に対応して同図ｂに示す
駆動信号により１次側の主スイッチ（Ｓ．）３が駆動時
間ｔ１で断続され、又同図ｄに示す２次側の主スイッチ
（Ｓ２）２１が駆動時間ｔ２で断続されるものであり、
これは、補助巻線Ｎ３を介して同期検出回路２３が主ス
イッチ（Ｓ．）３の電流の立上りを検出し、その検出信
号により制御回路２２は同図ｄに示す主スイッチ（Ｓ２
）２１の駆動信号を出力する。
駆動信号により１次側の主スイッチ（Ｓ．）３が駆動時
間ｔ１で断続され、又同図ｄに示す２次側の主スイッチ
（Ｓ２）２１が駆動時間ｔ２で断続されるものであり、
これは、補助巻線Ｎ３を介して同期検出回路２３が主ス
イッチ（Ｓ．）３の電流の立上りを検出し、その検出信
号により制御回路２２は同図ｄに示す主スイッチ（Ｓ２
）２１の駆動信号を出力する。
又制御回路２２はｔ１〉ｔ２となるように駆動信号を出
力するものである。
力するものである。
従って第１と第２の主スイッチ駆動信号の立上りは同期
化され、第２の主スイッチ駆動信号の立下り後に第１の
主スイッチ駆動信号が立下る。
化され、第２の主スイッチ駆動信号の立下り後に第１の
主スイッチ駆動信号が立下る。
主スイッチ（Ｓ２）２１により主スイッチＳ２電流は固
有の蓄積時間ｔ′８だけｔ２時間の主スイッチ駆動信号
より遅れて立下り、同図Ｃの主スイッチＳ１電流も同じ
立下りを示した後、ｔ１時間の終りまで無負荷電流ｉｏ
が流れる。
有の蓄積時間ｔ′８だけｔ２時間の主スイッチ駆動信号
より遅れて立下り、同図Ｃの主スイッチＳ１電流も同じ
立下りを示した後、ｔ１時間の終りまで無負荷電流ｉｏ
が流れる。
このようにすれば、主スイッチ（Ｓ２）２１が必ず主ス
イッチ（Ｓ．）３より先に遮断し、ここで電流トランス
（ＣＴ）２４に過電流が検出されても時間ｔ′８が時間
ｔ１−ｔ２を超すことはないから主スイッチ（Ｓ．）３
の電流が過電流となることはなくなる。
イッチ（Ｓ．）３より先に遮断し、ここで電流トランス
（ＣＴ）２４に過電流が検出されても時間ｔ′８が時間
ｔ１−ｔ２を超すことはないから主スイッチ（Ｓ．）３
の電流が過電流となることはなくなる。
考案の効果 ・
以上説明したように、本考案によれば、トランス２の１
次側に一定の矩形波交流で断続する第１のスイッチ素子
即ち主スイッチ（Ｓ．）３を設け、２次側に整流用の断
続制御可能な第２のスイッチ素子即ち、主スイッチ（Ｓ
２）２１を設け、第１と第２のスイッチ素子の導通開始
を同期化させて直流出力電圧の安定制御を行なうもので
、トランス２に補助巻線Ｎ３を設けても、そのトランス
２が特に大形化することはなく、又第１のスイッチ素子
の最大導通時間より第２のスイッチ素子の最大導通時間
を短く設定したことにより、スイッチング損失を少くし
、１次側の第１のスイッチング素子を流れる過電流を有
効に制限することができるものであるから、トランス２
等の小形化を図ることができる利点がある。
次側に一定の矩形波交流で断続する第１のスイッチ素子
即ち主スイッチ（Ｓ．）３を設け、２次側に整流用の断
続制御可能な第２のスイッチ素子即ち、主スイッチ（Ｓ
２）２１を設け、第１と第２のスイッチ素子の導通開始
を同期化させて直流出力電圧の安定制御を行なうもので
、トランス２に補助巻線Ｎ３を設けても、そのトランス
２が特に大形化することはなく、又第１のスイッチ素子
の最大導通時間より第２のスイッチ素子の最大導通時間
を短く設定したことにより、スイッチング損失を少くし
、１次側の第１のスイッチング素子を流れる過電流を有
効に制限することができるものであるから、トランス２
等の小形化を図ることができる利点がある。
第１図は従来例の構威を示す説明図、第２図は第１図の
要部の動作波形図、第３図は本考案の構或を示す説明図
、第４図は第３図の要部の動作説明図であり、図中、１
は直流電源、２はトランス、Ｎ１は１次側巻線、Ｎ２は
２次側巻線、Ｎ３は補助巻線、３は主スイッチＳ１、６
は発振回路、８は整流用ダイオード、９はインダクタン
ス、１０はキャパシタンス、１１は検出増幅回路、２１
は主スイッチＳ２、２２は制御回路、２３は同期検出回
路、２４は電流トランスを示す。
要部の動作波形図、第３図は本考案の構或を示す説明図
、第４図は第３図の要部の動作説明図であり、図中、１
は直流電源、２はトランス、Ｎ１は１次側巻線、Ｎ２は
２次側巻線、Ｎ３は補助巻線、３は主スイッチＳ１、６
は発振回路、８は整流用ダイオード、９はインダクタン
ス、１０はキャパシタンス、１１は検出増幅回路、２１
は主スイッチＳ２、２２は制御回路、２３は同期検出回
路、２４は電流トランスを示す。
Claims (1)
- 直流電圧を第１のスイッチ素子により断継してトランス
の１次側巻線に印加し、該トランスの２次側巻線に誘起
する電圧を整流して直流出力電圧とするＤＣ−ＤＣコン
バータより戊る電源装置において、前記トランスの２次
側巻線に整流用の断続制御可能な第２のスイッチ素子を
接続し、前記トランスに補助巻線を設け、該補助巻線に
接続され前記第１のスイッチ素子に流れる電流の立上り
を検出する同期検出回路と、該同期検出回路の検出信号
により、前記第１のスイッチ素子の導通開始に同期し、
且つ該第１のスイッチ素子の最大導通時間より前記第２
のスイッチ素子の最大導通時間が短くなるように該第２
のスイッチ素子の断続動作を制御する制御回路とを設け
たことを特徴とする電源装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16298382U JPS5910947Y2 (ja) | 1982-10-27 | 1982-10-27 | 電源装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16298382U JPS5910947Y2 (ja) | 1982-10-27 | 1982-10-27 | 電源装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58108781U JPS58108781U (ja) | 1983-07-25 |
| JPS5910947Y2 true JPS5910947Y2 (ja) | 1984-04-04 |
Family
ID=30102009
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16298382U Expired JPS5910947Y2 (ja) | 1982-10-27 | 1982-10-27 | 電源装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5910947Y2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP4803822B2 (ja) * | 2007-03-23 | 2011-10-26 | Ｔｄｋラムダ株式会社 | 多出力電源装置 |
-
1982
- 1982-10-27 JP JP16298382U patent/JPS5910947Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS58108781U (ja) | 1983-07-25 |
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