JPS59111435A - フエ−ジングシミユレ−タ - Google Patents
フエ−ジングシミユレ−タInfo
- Publication number
- JPS59111435A JPS59111435A JP57220142A JP22014282A JPS59111435A JP S59111435 A JPS59111435 A JP S59111435A JP 57220142 A JP57220142 A JP 57220142A JP 22014282 A JP22014282 A JP 22014282A JP S59111435 A JPS59111435 A JP S59111435A
- Authority
- JP
- Japan
- Prior art keywords
- wave
- phase
- phase shifter
- delay time
- controlled
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B17/00—Monitoring; Testing
- H04B17/30—Monitoring; Testing of propagation channels
- H04B17/391—Modelling the propagation channel
- H04B17/3912—Simulation models, e.g. distribution of spectral power density or received signal strength indicator [RSSI] for a given geographic region
Landscapes
- Physics & Mathematics (AREA)
- Spectroscopy & Molecular Physics (AREA)
- Electromagnetism (AREA)
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Radio Transmission System (AREA)
- Monitoring And Testing Of Transmission In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、主波と干渉波の位相、振幅及び遅延を容易に
制御することができ、主波・干渉波間の遅延時間差を変
動させることな（位相差の調整が可能な７エージングシ
ミユレータに関するものである。
制御することができ、主波・干渉波間の遅延時間差を変
動させることな（位相差の調整が可能な７エージングシ
ミユレータに関するものである。
７エージングシミーレータは無線伝送路に発生スルマル
チパスフェージングにより生ずる伝送路の振幅および遅
延の周波数喘性を擬似的に発生させる装置であり、無線
送受信装置の耐フエージング特性を測定するためのもの
である。マルチパスフェージングの周波数特性は一無線
チャネル程度の周波数帯域では２波干渉による周波数特
性で近似できることが伝搬実験から明らかにされており
、主波干渉波間の振幅比をρ、遅延時間差をτとすると
、伝搬特性Ｔ（ω）は次式で表わされる。
チパスフェージングにより生ずる伝送路の振幅および遅
延の周波数喘性を擬似的に発生させる装置であり、無線
送受信装置の耐フエージング特性を測定するためのもの
である。マルチパスフェージングの周波数特性は一無線
チャネル程度の周波数帯域では２波干渉による周波数特
性で近似できることが伝搬実験から明らかにされており
、主波干渉波間の振幅比をρ、遅延時間差をτとすると
、伝搬特性Ｔ（ω）は次式で表わされる。
Ｔ（ωｌ＝１＋ρｅ−ｊ（ωｔ−θ）
フェージングシミュレータの動作は、送信出力信号を分
岐しく主波と干渉波に相当する）分岐信号の振幅１位相
、遅延時間を調整した後合成することによって行なわれ
る。従来、フェージングシミュレータは第１図に示す回
路を用いて実現されていた。１は信号入力端子、２は信
号出力端子、３は分岐回路、４は合成回路である。分岐
回路３の分岐出力信号の一方は遅延線５を通過し合成回
路の入力端子の一方ａに人力される。また、分岐出力信
号の他方はラインストレッチャ６および可変減衰器７に
より振幅１位相を調整され、合成回路の入力端子すに入
力される。合成回路４の入力信号ａは受信波の主波に相
当し、他方の入力信号すは受信波の干渉波に相当する。
岐しく主波と干渉波に相当する）分岐信号の振幅１位相
、遅延時間を調整した後合成することによって行なわれ
る。従来、フェージングシミュレータは第１図に示す回
路を用いて実現されていた。１は信号入力端子、２は信
号出力端子、３は分岐回路、４は合成回路である。分岐
回路３の分岐出力信号の一方は遅延線５を通過し合成回
路の入力端子の一方ａに人力される。また、分岐出力信
号の他方はラインストレッチャ６および可変減衰器７に
より振幅１位相を調整され、合成回路の入力端子すに入
力される。合成回路４の入力信号ａは受信波の主波に相
当し、他方の入力信号すは受信波の干渉波に相当する。
マルチパスフェージングの主波に対する干渉波の遅延時
間差τ１位相差θ、振幅比ρは遅延線５．ラインストレ
ッチャ６および可変減衰器７により調整される。ところ
がラインストレッチャによる位相調整は遅延時間の変化
を利用しているため、従来の装置はフェージングのτお
よびθの調整を個別に行うことはできなかった。また、
ラインストレッチャの代りに遅延時間が変化する移相器
等を使用しても同様な欠点があった。
間差τ１位相差θ、振幅比ρは遅延線５．ラインストレ
ッチャ６および可変減衰器７により調整される。ところ
がラインストレッチャによる位相調整は遅延時間の変化
を利用しているため、従来の装置はフェージングのτお
よびθの調整を個別に行うことはできなかった。また、
ラインストレッチャの代りに遅延時間が変化する移相器
等を使用しても同様な欠点があった。
本発明は、これらの欠点を解決するため、干渉波の位相
制御を無限移相器を使用して行うように構成したフェー
ジングシミュレータを提供スるものである。
制御を無限移相器を使用して行うように構成したフェー
ジングシミュレータを提供スるものである。
以下図面により本発明の詳細な説明する。
第２図は本発明の実施例であって、１は信号入力端子、
２は信号出力端子、３は分岐回路、４は合成回路、５は
遅延線、７は可変減衰器、８は無限移相器、９は遅延線
である。これを動作させるには、送信信号を分岐回路３
に入力させ、分岐回路３の出力の一方は遅延線５を通過
し、合成回路４０入力端子ａに入力される。また、分岐
回路３の出力の他方は無限移相器８により位相調整され
、遅延線９を通過し可変減衰器７により振幅調整を行い
、合成回路４の入力端子すに入力される。このとき合成
回路４の出力には主波ａと干渉波すの合成信号が得られ
る。主波側に挿入された遅延線５は、干渉波側に挿入さ
れる無限移相器８および可変減衰器７の持つ遅延時間差
を補償するものであり、予め干渉波側の遅延線９の遅延
時間をＯとしたときに、主波ａと干渉波すの遅延時間が
等しくなるように調整しておく。無限移相器８は、遅延
時間を変動させることなく出力信号の位相を０゜〜３６
０ｏ連続に制御することができるという特徴があり、第
２図の構成では干渉波の振幅をｏＴ変減衰器７で、主波
−干渉波間の位相差を無限移相器８で、また遅延時間差
を遅延線９で制御することができる。
２は信号出力端子、３は分岐回路、４は合成回路、５は
遅延線、７は可変減衰器、８は無限移相器、９は遅延線
である。これを動作させるには、送信信号を分岐回路３
に入力させ、分岐回路３の出力の一方は遅延線５を通過
し、合成回路４０入力端子ａに入力される。また、分岐
回路３の出力の他方は無限移相器８により位相調整され
、遅延線９を通過し可変減衰器７により振幅調整を行い
、合成回路４の入力端子すに入力される。このとき合成
回路４の出力には主波ａと干渉波すの合成信号が得られ
る。主波側に挿入された遅延線５は、干渉波側に挿入さ
れる無限移相器８および可変減衰器７の持つ遅延時間差
を補償するものであり、予め干渉波側の遅延線９の遅延
時間をＯとしたときに、主波ａと干渉波すの遅延時間が
等しくなるように調整しておく。無限移相器８は、遅延
時間を変動させることなく出力信号の位相を０゜〜３６
０ｏ連続に制御することができるという特徴があり、第
２図の構成では干渉波の振幅をｏＴ変減衰器７で、主波
−干渉波間の位相差を無限移相器８で、また遅延時間差
を遅延線９で制御することができる。
このような構造になっているので、その効−果としては
フェージングの主波−干渉波間の遅延時間差と位相を別
個に制御することができ、７エージングの主波−干渉波
間の遅延時間差１２位相差θおよび振幅比ρを直読する
ことが可能となる。また、振幅制御を電圧制御形可変利
得増幅器で行い、無限移相器として電圧制御形無限移相
器を使用することにより、フェージングのρおよびθを
電圧制御することが可能となる。
フェージングの主波−干渉波間の遅延時間差と位相を別
個に制御することができ、７エージングの主波−干渉波
間の遅延時間差１２位相差θおよび振幅比ρを直読する
ことが可能となる。また、振幅制御を電圧制御形可変利
得増幅器で行い、無限移相器として電圧制御形無限移相
器を使用することにより、フェージングのρおよびθを
電圧制御することが可能となる。
第３図は本発明の実施例として無限移相器に電圧制御形
無限移相器を用い、振幅制御に電圧制御形可変利得増幅
器を使用したもので、マイクロプロセッサ１１とＤ／Ａ
変換器１２によりフェージングのρおよびθを電圧制御
することができる。ｎ波干渉モデルのフェージングシミ
ュレータも２波干渉の場合と同様な構成となる。
無限移相器を用い、振幅制御に電圧制御形可変利得増幅
器を使用したもので、マイクロプロセッサ１１とＤ／Ａ
変換器１２によりフェージングのρおよびθを電圧制御
することができる。ｎ波干渉モデルのフェージングシミ
ュレータも２波干渉の場合と同様な構成となる。
第４図は本発明の実施例によるｎ波干渉モデルフェージ
ングシミュレータの構成図を示す。
ングシミュレータの構成図を示す。
以上説明したように、本発明は７エージングの主波・干
渉波遅延時間差１１位相差θ、および振幅比ρを別個に
制御できるので、フェージング特性のρ、τ、θを容易
に制御でき、精度良（調整することができるという利点
がある。
渉波遅延時間差１１位相差θ、および振幅比ρを別個に
制御できるので、フェージング特性のρ、τ、θを容易
に制御でき、精度良（調整することができるという利点
がある。
第１図は従来の）エージングシミュレータの構成図、第
２図は本発明の１実施例の構成を示すブロック図、第３
図は本発明の別の実施例を示すブロック図、第４図は本
発明の実施例によるｎ波干渉モデルフェージングシミュ
レータの構成図である。 １・・・信号入力端子、２・・・信号出力端子、３・・
・分岐回路、４・・・合成回路、５・・・遅延線、６・
・・ラインストレッチャ、７・・・可変減衰器、８・・
・無限移相器、９・・・遅延線、 １ｏ・・・電圧制御
形可変利得増幅器、 １１・・・マイクロプロセッサ、
１２・・・Ｄ／Ａ変換器。 特許出願人 日本電信電話公社 代理人 白水常雄 外１名
２図は本発明の１実施例の構成を示すブロック図、第３
図は本発明の別の実施例を示すブロック図、第４図は本
発明の実施例によるｎ波干渉モデルフェージングシミュ
レータの構成図である。 １・・・信号入力端子、２・・・信号出力端子、３・・
・分岐回路、４・・・合成回路、５・・・遅延線、６・
・・ラインストレッチャ、７・・・可変減衰器、８・・
・無限移相器、９・・・遅延線、 １ｏ・・・電圧制御
形可変利得増幅器、 １１・・・マイクロプロセッサ、
１２・・・Ｄ／Ａ変換器。 特許出願人 日本電信電話公社 代理人 白水常雄 外１名
Claims (1)
- 入力信号を分岐する手段と、少（とも分岐出力に接続さ
れた無限移相器、遅延線および利得を変化する手段と、
分岐信号を合成する合成回路を有することを特徴とする
フェージングシミュレータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57220142A JPS59111435A (ja) | 1982-12-17 | 1982-12-17 | フエ−ジングシミユレ−タ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57220142A JPS59111435A (ja) | 1982-12-17 | 1982-12-17 | フエ−ジングシミユレ−タ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59111435A true JPS59111435A (ja) | 1984-06-27 |
Family
ID=16746550
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57220142A Pending JPS59111435A (ja) | 1982-12-17 | 1982-12-17 | フエ−ジングシミユレ−タ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59111435A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5355519A (en) * | 1993-03-04 | 1994-10-11 | Fujitsu Limited | Fading simulation method and fading simulator |
| CN112866158A (zh) * | 2021-01-25 | 2021-05-28 | 凯迈（洛阳）测控有限公司 | 一种双通道无线电引信模拟器 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5714228A (en) * | 1980-06-30 | 1982-01-25 | Fujitsu Ltd | Simulator for phasing state |
-
1982
- 1982-12-17 JP JP57220142A patent/JPS59111435A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5714228A (en) * | 1980-06-30 | 1982-01-25 | Fujitsu Ltd | Simulator for phasing state |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5355519A (en) * | 1993-03-04 | 1994-10-11 | Fujitsu Limited | Fading simulation method and fading simulator |
| CN112866158A (zh) * | 2021-01-25 | 2021-05-28 | 凯迈（洛阳）测控有限公司 | 一种双通道无线电引信模拟器 |
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