JPS5911532U - 周波数変換回路 - Google Patents

周波数変換回路

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JPS5911532U
JPS5911532U JP10784582U JP10784582U JPS5911532U JP S5911532 U JPS5911532 U JP S5911532U JP 10784582 U JP10784582 U JP 10784582U JP 10784582 U JP10784582 U JP 10784582U JP S5911532 U JPS5911532 U JP S5911532U
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JP
Japan
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predetermined level
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pulse signal
conversion circuit
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JP10784582U
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俊博 小林
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Shimadzu Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
・　　第１図はこの考案の一実施例を示す周波数変換回
路の接続図、第２図は第１図に示す実施例回路の動作を
説明すやための信号波形図である。 １・２：入力端子、３：増幅器（積分用）、４・５：比
較器、６：ワンショットマルチ回路、７：スイッチング
トランジスタ、８：増幅器（コントロール用）、ＶＳ：
設定電源、９・１０：出力端子。

Claims (1)

  1. 【実用新案登録請求の範囲】 入力電圧を受けて積分する積分回路と、この積分回路の
    正極性出力電圧が第１の所定レベルに達したことを検出
    する第１検出回路と、前記積分回路の負極性出力電圧が
    第２の所定レベルに達したことを検出する第２検出回路
    と、これら検出回路による第１所定レベルの検出もしく
    は第２の所定レベル検出でオンするスイッチング手段′
    と、この　。 スイッチング手段がオンすると前記積分回路の出力電圧
    を前記第１所定レベルと第２所定レベル間に存する第３
    の所定レベルにコントロールする手段と、前記第１所定
    レベルもしくは第２の所定レベルの検出に同期してパル
    ス信号を発生する手段とを備え、前記積分回路が前記ス
    イッチング手段のオフ・オフの繰り返しで前記第３所定
    レベルから第１所定レベルまでの、または前記第３所定
    レベルから第２所定レベルまでの積分動作を繰り返すこ
    とにより、前記パルス信号発生手段は入力電圧に応じた
    周波数のパルス信号を出力することを特徴とする周波数
    変換回路。
JP10784582U 1982-07-15 1982-07-15 周波数変換回路 Granted JPS5911532U (ja)

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JPS5911532U true JPS5911532U (ja) 1984-01-24
JPH0218601Y2 JPH0218601Y2 (ja) 1990-05-24

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