JPS59116996A - サンプル・ホ−ルド回路 - Google Patents
サンプル・ホ−ルド回路Info
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- JPS59116996A JPS59116996A JP57230382A JP23038282A JPS59116996A JP S59116996 A JPS59116996 A JP S59116996A JP 57230382 A JP57230382 A JP 57230382A JP 23038282 A JP23038282 A JP 23038282A JP S59116996 A JPS59116996 A JP S59116996A
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- Japan
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- operational amplifier
- amplifier
- input terminal
- switch
- terminal
- Prior art date
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- G—PHYSICS
- G11—INFORMATION STORAGE
- G11C—STATIC STORES
- G11C27/00—Electric analogue stores, e.g. for storing instantaneous values
- G11C27/02—Sample-and-hold arrangements
Landscapes
- Amplifiers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
、本発明はＡ／Ｄ変換器の入力部分などで多く用いられ
る、入力信号をサンプリングして保持するサンプル・ホ
ールド回路の改良に関するものである。
る、入力信号をサンプリングして保持するサンプル・ホ
ールド回路の改良に関するものである。
第１図は従来のサンプル・ホールド回路の例を示した電
気回路図である。サンプル時即ち、スイッチＳ１が閉じ
た状態で入力信号Ｖｉｎが入力端子１に加えられると、
増幅器Ａ１によりキャノ２シタＣ１に充電が行われる。
気回路図である。サンプル時即ち、スイッチＳ１が閉じ
た状態で入力信号Ｖｉｎが入力端子１に加えられると、
増幅器Ａ１によりキャノ２シタＣ１に充電が行われる。
ホールド時にはスイッチＳ１がオフとなりサンプル時に
充電したキャノくシタＣ１の両端の電圧がバッファ増幅
器鯰を介して出力Ｖｏｕｔとして出力される。（前記の
スイッチＳ１は端子からのＳ／Ｈ（サンプル・ホールド
）コマンド信号によって制御されている。）とのような
構成のサンプル・ホールド回路では、増幅器Ａ１の入力
オフセット電圧をｖＯ８１とすると出力ＶｏｕｔはＶｏ
ｕｔ ＝ Ｖｉｎ −Ｖｏｓｌ となり、入力オフセット電圧の分だけ誤差を生じる。こ
のため充分な精度のサンプル・ホ−ルド回路を得るため
には入力オフセット電圧およびその温度係数の小さな高
価な増幅器が必要とされた。
充電したキャノくシタＣ１の両端の電圧がバッファ増幅
器鯰を介して出力Ｖｏｕｔとして出力される。（前記の
スイッチＳ１は端子からのＳ／Ｈ（サンプル・ホールド
）コマンド信号によって制御されている。）とのような
構成のサンプル・ホールド回路では、増幅器Ａ１の入力
オフセット電圧をｖＯ８１とすると出力ＶｏｕｔはＶｏ
ｕｔ ＝ Ｖｉｎ −Ｖｏｓｌ となり、入力オフセット電圧の分だけ誤差を生じる。こ
のため充分な精度のサンプル・ホ−ルド回路を得るため
には入力オフセット電圧およびその温度係数の小さな高
価な増幅器が必要とされた。
またこのような高性能の増幅器とスイッチ回路を一体と
して集積化することは難かしいため、ＩＣとして実現さ
れているよいサンプル・ホールド回路はこれまでになか
った。
して集積化することは難かしいため、ＩＣとして実現さ
れているよいサンプル・ホールド回路はこれまでになか
った。
本発明は上記の問題を解消するためになされたもので、
増幅器の入力オフセット電圧が出力に誤差となって現わ
れないサンプル・ホールド回路を実現することを目的と
する。
増幅器の入力オフセット電圧が出力に誤差となって現わ
れないサンプル・ホールド回路を実現することを目的と
する。
前記の目的を達成するために本発明の第１の要旨とする
ところは、入力信号が加えられる入力端子と、この入力
端子にその一方の端子が接続する第１のスイッチと、こ
の第１のスイッチの他方の端子がその非反転入力端子に
加えられる第１の演算増幅器と、一端がこの第１の演算
増幅器の反転入力端子に接続し他端がコモンに接続する
キャパシタと、このキャパシタの前記一端と前記第１の
演算増幅器の出力端子との間に接続する第２のスイッチ
と、一端が前記第１の演算増幅器の前記出力端子に接続
する第１の抵抗と、この第１の抵抗の他端がその反転入
力端子に接続する第２の演算増幅器と、この第２の演算
増幅器の前記反転入力端子と出力端子とを接続する第２
の抵抗と、前記第２の演算増幅器の前記出力端子と前記
第１の演算増幅器の前記非反転入力とを接続する第５の
スイッチとを備えたサンプル・ホールド回路に存する。
ところは、入力信号が加えられる入力端子と、この入力
端子にその一方の端子が接続する第１のスイッチと、こ
の第１のスイッチの他方の端子がその非反転入力端子に
加えられる第１の演算増幅器と、一端がこの第１の演算
増幅器の反転入力端子に接続し他端がコモンに接続する
キャパシタと、このキャパシタの前記一端と前記第１の
演算増幅器の出力端子との間に接続する第２のスイッチ
と、一端が前記第１の演算増幅器の前記出力端子に接続
する第１の抵抗と、この第１の抵抗の他端がその反転入
力端子に接続する第２の演算増幅器と、この第２の演算
増幅器の前記反転入力端子と出力端子とを接続する第２
の抵抗と、前記第２の演算増幅器の前記出力端子と前記
第１の演算増幅器の前記非反転入力とを接続する第５の
スイッチとを備えたサンプル・ホールド回路に存する。
本発明の第２の要旨とするところは、入力信号が加えら
れる入力端子と、この入力端子にその一方の端子が接続
する第１のスイッチと、この第１のスイッチの他方の端
子がその非反転入力端子に加えられる第１の演算増幅器
と、一端がこの第１の演算増幅器の反転入力端子に接続
し他端がコモンに接続するキャパシタと、このキャパシ
タの前記一端と前記第１の演算増幅器の出力端子との間
に接続する第２のスイッチと、一端が前記第１の演算増
幅器の前記出力端子に接続する第１の抵抗と、この第１
の抵抗の他端がその反転入力端子に接続する第２の演算
増幅器と、この第２の演算増幅器の前記反転入力端子と
出力端子とを接続する第２の抵抗と前記第２の演算増幅
器の出力端子に接続する第１のサンプル・ホールド回路
と、この第１のサンプル・ホールド回路の出力端子と前
記第１の演算増幅器の非反転入力端子とに接続する第３
のスイッチとを備えたサンプル・ホールド回路に存する
。
れる入力端子と、この入力端子にその一方の端子が接続
する第１のスイッチと、この第１のスイッチの他方の端
子がその非反転入力端子に加えられる第１の演算増幅器
と、一端がこの第１の演算増幅器の反転入力端子に接続
し他端がコモンに接続するキャパシタと、このキャパシ
タの前記一端と前記第１の演算増幅器の出力端子との間
に接続する第２のスイッチと、一端が前記第１の演算増
幅器の前記出力端子に接続する第１の抵抗と、この第１
の抵抗の他端がその反転入力端子に接続する第２の演算
増幅器と、この第２の演算増幅器の前記反転入力端子と
出力端子とを接続する第２の抵抗と前記第２の演算増幅
器の出力端子に接続する第１のサンプル・ホールド回路
と、この第１のサンプル・ホールド回路の出力端子と前
記第１の演算増幅器の非反転入力端子とに接続する第３
のスイッチとを備えたサンプル・ホールド回路に存する
。
本発明の第３の要旨とするところは、入力信号が加えら
れる入力端子と、この入力端子にその一方の端子が接続
する第１のスイッチと、この第１のスイッチの他方の端
子がその非反転入力端子に加えられる第１の演算増幅器
と、一端がこの第１の演算増幅器の反転入力端子に接続
し他端がコモンに接続する第１のキャパシタと、この第
１のキャパシタの前記一端と前記第１の演算増幅器の出
力端子との間に接続する第２のスイッチと、一端が前記
第１の演算増幅器の前記出力端子に接続する第１の抵抗
と、この第１の抵抗の他端がその一端に接続する第４の
スイッチと、この第４のスイッチの他端がその反転入力
端子に接続するＭ２の演算増幅器と、この第２の演算増
幅器の出力端子と前記第１の抵抗の前記他端とに接続す
る第２の抵抗と、前記第２の演算増幅器の前記反転入力
端子と前記出力禮子とを接続する第２のキャパシタと、
前記第２の演算増幅器の前記出力端子と前記第１の演算
増幅器の前記非反転入力端子とを接続する第３のスイッ
チとを備えたサンプル・ホールド回路に存する。
れる入力端子と、この入力端子にその一方の端子が接続
する第１のスイッチと、この第１のスイッチの他方の端
子がその非反転入力端子に加えられる第１の演算増幅器
と、一端がこの第１の演算増幅器の反転入力端子に接続
し他端がコモンに接続する第１のキャパシタと、この第
１のキャパシタの前記一端と前記第１の演算増幅器の出
力端子との間に接続する第２のスイッチと、一端が前記
第１の演算増幅器の前記出力端子に接続する第１の抵抗
と、この第１の抵抗の他端がその一端に接続する第４の
スイッチと、この第４のスイッチの他端がその反転入力
端子に接続するＭ２の演算増幅器と、この第２の演算増
幅器の出力端子と前記第１の抵抗の前記他端とに接続す
る第２の抵抗と、前記第２の演算増幅器の前記反転入力
端子と前記出力禮子とを接続する第２のキャパシタと、
前記第２の演算増幅器の前記出力端子と前記第１の演算
増幅器の前記非反転入力端子とを接続する第３のスイッ
チとを備えたサンプル・ホールド回路に存する。
以下図面にもとづき本発明を説明する。
第２図は本発明の一実施例を示す電気回路図である。１
１は入力信号Ｖｉｎが加えられる入力端子、Ｓ１１はこ
の入力端子１１に一端が接続する第１のスイッチ、Ａｌ
ｌはこの第１のスイーッチＳ１１の他端にその非反転入
力端子が接続する第１の演算増幅器、Ｃ１ｌはその一端
がこの第１の演算増幅器の反転入力端子に接続し他端が
コモンに接続する（充電用）キャパシタ、Ｓ１２はこの
キャパシタＣ１１の前記一端と前記第１の演算増幅器Ａ
ｌｌの出力端子との間に接続する第２のスイッチ、Ｒ１
は一端が前記第１の演算増幅器Ａｌｌに接続する第１の
抵抗、Ａ１２はこの第１の抵抗Ｒ１の他端がその反転入
力端子に接菌２の抵抗、Ｓ１３は前記第２の演算増幅器
Ａ１２の前記出力端子と前記第１の演算増幅器Ａｌｌの
前記非反転入力端子とを接続する第３のスイッチである
。１２は前記スイッチ８１１．８１２． Ｓ１３を制御
するＳ／Ｈ（サンプル・ホールド）コマンド信号が加え
らね−るＳ／Ｈコマンド入力端子である。
１は入力信号Ｖｉｎが加えられる入力端子、Ｓ１１はこ
の入力端子１１に一端が接続する第１のスイッチ、Ａｌ
ｌはこの第１のスイーッチＳ１１の他端にその非反転入
力端子が接続する第１の演算増幅器、Ｃ１ｌはその一端
がこの第１の演算増幅器の反転入力端子に接続し他端が
コモンに接続する（充電用）キャパシタ、Ｓ１２はこの
キャパシタＣ１１の前記一端と前記第１の演算増幅器Ａ
ｌｌの出力端子との間に接続する第２のスイッチ、Ｒ１
は一端が前記第１の演算増幅器Ａｌｌに接続する第１の
抵抗、Ａ１２はこの第１の抵抗Ｒ１の他端がその反転入
力端子に接菌２の抵抗、Ｓ１３は前記第２の演算増幅器
Ａ１２の前記出力端子と前記第１の演算増幅器Ａｌｌの
前記非反転入力端子とを接続する第３のスイッチである
。１２は前記スイッチ８１１．８１２． Ｓ１３を制御
するＳ／Ｈ（サンプル・ホールド）コマンド信号が加え
らね−るＳ／Ｈコマンド入力端子である。
サンプル時には、ｓ／）■コマンド信号によりスイッチ
Ｓ１１および８１２が閉じられ、スイッチＳ１３が開と
なる。このとき増幅器Ａｌｌは反転入力端子と端子とは
抵抗Ｒ１を介して接続されるので抵抗Ｒ１の両端が同電
位となり、その結果抵抗Ｒ１には電流が流れずオーブン
と等価な状態となる。、しだがって増幅器Ａ１２は帰還
抵抗Ｒ２を有するゲイン１の非反転増幅器を構成する。
Ｓ１１および８１２が閉じられ、スイッチＳ１３が開と
なる。このとき増幅器Ａｌｌは反転入力端子と端子とは
抵抗Ｒ１を介して接続されるので抵抗Ｒ１の両端が同電
位となり、その結果抵抗Ｒ１には電流が流れずオーブン
と等価な状態となる。、しだがって増幅器Ａ１２は帰還
抵抗Ｒ２を有するゲイン１の非反転増幅器を構成する。
入力電圧Ｖｉｎが入力端子１１に加えられるとキャパシ
タｃ１１は増幅器Ａｌｌにょって入力電圧に従って充電
される。充電が完了した時点でのキャパシタＣ１１の充
電電圧Ｖｃは増幅器Ａｌｌの入力オフセット電圧をＶｏ
Ｓｌｌとすると、Ｖｃ ＝ Ｖｉｎ −Ｖｏｓｌｌ（１
）となる。
タｃ１１は増幅器Ａｌｌにょって入力電圧に従って充電
される。充電が完了した時点でのキャパシタＣ１１の充
電電圧Ｖｃは増幅器Ａｌｌの入力オフセット電圧をＶｏ
Ｓｌｌとすると、Ｖｃ ＝ Ｖｉｎ −Ｖｏｓｌｌ（１
）となる。
ホールド時には、Ｓ／Ｈコマンド信号によりスイッチ８
１１およびＳ１２が開き、スイッチＳ１３が閉じられる
。このとき増幅器Ａ１２は抵抗Ｒ１およびＲ２と共にゲ
イン−１（Ｒ１＝Ｒ２の場合）の反転増幅器を構成する
。増幅器ＡｌｌとＡ１２を含む全ループではゲイン１の
非反転増幅器（これをＡと呼ぶ）を構成［７、増幅器Ａ
ｌｌの非反転入力端子は（増幅器Ａ１２で反転されてい
るから）前記非反転増幅器Ａの反転入力端子となり、増
幅器Ａ１１の反転入力端子は（前記と同様の理由で）非
反転増幅器人の非反転入力端子となる。すなわち、キャ
パシタＣ１ｌの充電電圧Ｖｃは増幅器ＡｌｌとＡ１２で
構成される非反転増幅器Ａの非反転入力端子に加わり、
非反転増幅器＼Ａの反転入力端子に帰還される出力電圧
Ｖｏｕｔと入力オフセット電圧を介してバランスする。
１１およびＳ１２が開き、スイッチＳ１３が閉じられる
。このとき増幅器Ａ１２は抵抗Ｒ１およびＲ２と共にゲ
イン−１（Ｒ１＝Ｒ２の場合）の反転増幅器を構成する
。増幅器ＡｌｌとＡ１２を含む全ループではゲイン１の
非反転増幅器（これをＡと呼ぶ）を構成［７、増幅器Ａ
ｌｌの非反転入力端子は（増幅器Ａ１２で反転されてい
るから）前記非反転増幅器Ａの反転入力端子となり、増
幅器Ａ１１の反転入力端子は（前記と同様の理由で）非
反転増幅器人の非反転入力端子となる。すなわち、キャ
パシタＣ１ｌの充電電圧Ｖｃは増幅器ＡｌｌとＡ１２で
構成される非反転増幅器Ａの非反転入力端子に加わり、
非反転増幅器＼Ａの反転入力端子に帰還される出力電圧
Ｖｏｕｔと入力オフセット電圧を介してバランスする。
すなわち、
Ｖｏｕｔ ＝ Ｖｃ ＋ Ｖｏｓｌｌ（２）となる。こ
こで（１）式ｔ （２）式に代入するとＶｏｕｔ ＝Ｖ
ｉｎ−Ｖｏｓ１１＋Ｖｏｓ１１＝Ｖｉｎとなる。すなわ
ち増幅器の入カオフセッ）ｔｉｌｔ圧Ｖｏ８１１がキャ
ンセルされ、入力電圧Ｖｉｎに正確に対応した出力電圧
Ｖｏｕｔを得ることができる。
こで（１）式ｔ （２）式に代入するとＶｏｕｔ ＝Ｖ
ｉｎ−Ｖｏｓ１１＋Ｖｏｓ１１＝Ｖｉｎとなる。すなわ
ち増幅器の入カオフセッ）ｔｉｌｔ圧Ｖｏ８１１がキャ
ンセルされ、入力電圧Ｖｉｎに正確に対応した出力電圧
Ｖｏｕｔを得ることができる。
第５図（１）〜（５）は上記のような構成のサンプル・
ホールド回路の各部のタイム・チャートを示したもので
入力電圧ＶｉｎがＶｉｎ （１）か′らＶｉｎ （２）
へ変化する場合について示している。Ｖｏｓｌ。は
増幅器Ａ１２の入力オフセット電圧である。第３図（５
）が示すようにサンプル時には増幅器の入力オフセット
電圧が出力電圧Ｖｏｕｔに現われるが、ホールド時には
キャンセルされて現われない１．サンプル区間中のオフ
セットはどちらか一方の増幅器のオフセット電圧を調整
することによりなくすことができる。
ホールド回路の各部のタイム・チャートを示したもので
入力電圧ＶｉｎがＶｉｎ （１）か′らＶｉｎ （２）
へ変化する場合について示している。Ｖｏｓｌ。は
増幅器Ａ１２の入力オフセット電圧である。第３図（５
）が示すようにサンプル時には増幅器の入力オフセット
電圧が出力電圧Ｖｏｕｔに現われるが、ホールド時には
キャンセルされて現われない１．サンプル区間中のオフ
セットはどちらか一方の増幅器のオフセット電圧を調整
することによりなくすことができる。
入力を０としたときこのオフセットは矩形波として観測
できるので調整は容易である。
できるので調整は容易である。
このような構成のサンプル・ホールド回路にょれば、ホ
ールド区間中には増幅器の入力オフセット電圧の影響が
出力に現われないので、オフセット特性のよくない安価
な増幅器を利用できるという利点がある。
ールド区間中には増幅器の入力オフセット電圧の影響が
出力に現われないので、オフセット特性のよくない安価
な増幅器を利用できるという利点がある。
まだホールド用キャパシタＣ１１が増幅器Ａｌｌのルー
プ内に入っているので充電時間が短かくなる。
プ内に入っているので充電時間が短かくなる。
更に増幅器Ａｌｌ、 Ａ１２としてはオフセット特性の
良くない高速アンプが使えることからサンプル・ホール
ド回路全体としての高速動作が容易に実現できる。
良くない高速アンプが使えることからサンプル・ホール
ド回路全体としての高速動作が容易に実現できる。
まだ増幅器Ａ１２はループ内にあるので、ゲイン誤差は
あまり問題とならず、したがって大きなオープン・ルー
プ・ゲインは要求されない。
あまり問題とならず、したがって大きなオープン・ルー
プ・ゲインは要求されない。
また増幅器Ａｌｌ、 Ａ１２ （の性能）に対する要求
がゆるやかなので、例えばＣＭＯ８演算増幅器などの構
成をとることにより容易にＩＣ化できるという利点もあ
る。
がゆるやかなので、例えばＣＭＯ８演算増幅器などの構
成をとることにより容易にＩＣ化できるという利点もあ
る。
１だサンプル・ホールド回路の入出力がバッファされて
いるので他回路との接続が容易である。
いるので他回路との接続が容易である。
第４図は、本発明の第２の実施例を示す電気回路図であ
る。第１の実施例（第２図）と同一の部分は同一符号を
付して説明を省略する。この実施例は第１の実施例にお
いて生じるサンプル時のオフセットを防ぐために、出力
側にサンプル・ホール）” 回路ＳＨＩを付加したもの
である。サンプル・ホールド回路５ｉｌｌにおいてＳ２
１は一端が増幅器Ａ１２の出力端子に接続するスイッチ
、Ｃ２２はその一端がスイッチＳ２１の他端に接続し他
端がコモンに接続する（充電用）キャパシタ、Ａ２３は
前記キャパシタＣ２２の前記一端にその入力端子が接続
するゲイン１程度の非反転のバッファで、ソースフ、オ
ロワなどの簡単なものでよい。バッファＡ２３の出力が
前記スイッチＳ１３を介して帰還されている。
る。第１の実施例（第２図）と同一の部分は同一符号を
付して説明を省略する。この実施例は第１の実施例にお
いて生じるサンプル時のオフセットを防ぐために、出力
側にサンプル・ホール）” 回路ＳＨＩを付加したもの
である。サンプル・ホールド回路５ｉｌｌにおいてＳ２
１は一端が増幅器Ａ１２の出力端子に接続するスイッチ
、Ｃ２２はその一端がスイッチＳ２１の他端に接続し他
端がコモンに接続する（充電用）キャパシタ、Ａ２３は
前記キャパシタＣ２２の前記一端にその入力端子が接続
するゲイン１程度の非反転のバッファで、ソースフ、オ
ロワなどの簡単なものでよい。バッファＡ２３の出力が
前記スイッチＳ１３を介して帰還されている。
スイッチＳ２１はサンプル・ホールド回路全体の（Ｓ／
ＩＩコマンド信号の）ホールド区間で閉じ、キャパシタ
Ｃ２２は増幅器Ａ１２から出力されるオフセットの影響
のない出力電圧により充電される。サンプル区間ではス
イッチＳ２１は開き、前記ホールド区間で充電されたキ
ャパシタＣ２２の充電電圧にもとすいた出力がバッファ
Ａ２３から出力される。
ＩＩコマンド信号の）ホールド区間で閉じ、キャパシタ
Ｃ２２は増幅器Ａ１２から出力されるオフセットの影響
のない出力電圧により充電される。サンプル区間ではス
イッチＳ２１は開き、前記ホールド区間で充電されたキ
ャパシタＣ２２の充電電圧にもとすいた出力がバッファ
Ａ２３から出力される。
この結果、第３図（６）のタイム・チャートに示すよう
に、サンプル・ホールド回路の出力Ｖｏｕｔはサンプル
区間とホールド区間で共にオフセットによる影響のない
、同一の電圧出力となる。
に、サンプル・ホールド回路の出力Ｖｏｕｔはサンプル
区間とホールド区間で共にオフセットによる影響のない
、同一の電圧出力となる。
このように構成されたサンプル・ホールド回路には、第
１の実施例における前記の各利点に加えてオフセットの
調整が不要になるという利点がある。
１の実施例における前記の各利点に加えてオフセットの
調整が不要になるという利点がある。
第４図の実施例においてＶｉｎとＶｏｕｔの間でゲイ／
を得たい場合には、第５図に示すような抵抗回路を出力
側に挿入すれば、 で表わされる出力を得ることができる（ Ｖｉｎ （ｔ
−１）は前回サンプルの意味）。
を得たい場合には、第５図に示すような抵抗回路を出力
側に挿入すれば、 で表わされる出力を得ることができる（ Ｖｉｎ （ｔ
−１）は前回サンプルの意味）。
第６図は本発明の第３の実施例を示す電気回路図で第１
の実施例における増幅器Ａ１２を含む反転増幅器に出力
ホールド機能を持たせたものである１゜第４図と同様第
２図の実施例と同一の部分には同一符号を付して説明を
省略する６、“図において３３１け抵抗Ｒ１と増幅器Ａ
１２の反転入力端子との間に挿入されたスイッチ、Ｃ３
２は前記増幅器Ａ１２の出力端子と前記反転入力端子と
を接続する（充電用）代ヤパシタである。
の実施例における増幅器Ａ１２を含む反転増幅器に出力
ホールド機能を持たせたものである１゜第４図と同様第
２図の実施例と同一の部分には同一符号を付して説明を
省略する６、“図において３３１け抵抗Ｒ１と増幅器Ａ
１２の反転入力端子との間に挿入されたスイッチ、Ｃ３
２は前記増幅器Ａ１２の出力端子と前記反転入力端子と
を接続する（充電用）代ヤパシタである。
スイッチＳ３１は８／Ｈコマンド信号のホールド区間で
閉じ、キャパシタＣ３２は増幅器Ａ１２の、オフセット
の影響のない出力電圧に対応して充電される。サンプル
区間ではスイッチＳ３１は開き、前記ホールド区間で充
電されたキャパシタＣ３２の充電電圧にもとづいた出力
が増幅器Ａ１２から出力される。このような構成のサン
プル・ホールド回路によれば、第２の実施例（第４図）
の場合と同様、第３図（６）で示すタイム・チャートの
ように、サンプル区間およびホールド区間の両方にわた
ってオフセットの影響のない出力を得ることができる。
閉じ、キャパシタＣ３２は増幅器Ａ１２の、オフセット
の影響のない出力電圧に対応して充電される。サンプル
区間ではスイッチＳ３１は開き、前記ホールド区間で充
電されたキャパシタＣ３２の充電電圧にもとづいた出力
が増幅器Ａ１２から出力される。このような構成のサン
プル・ホールド回路によれば、第２の実施例（第４図）
の場合と同様、第３図（６）で示すタイム・チャートの
ように、サンプル区間およびホールド区間の両方にわた
ってオフセットの影響のない出力を得ることができる。
本実施例の利点も第１の実施例の場合と同様であるが、
この場合には増幅器Ａ１２の非反転入力端子がコモンに
接続するので、入力電圧によっては増幅器Ａｌｌの出力
レベルが大きく変化することに、なり多少動作速度に制
限を受けることもある。１なお第５図に示すような抵抗
回路を前述第４図の場合と同様に第２図、第６図の場合
にも適用（抵抗ＲＡの一端を演算増幅器Ａ１２に接続）
することによすＶｉｎとＶｏｕｔの間でゲインを得るこ
とができる。
この場合には増幅器Ａ１２の非反転入力端子がコモンに
接続するので、入力電圧によっては増幅器Ａｌｌの出力
レベルが大きく変化することに、なり多少動作速度に制
限を受けることもある。１なお第５図に示すような抵抗
回路を前述第４図の場合と同様に第２図、第６図の場合
にも適用（抵抗ＲＡの一端を演算増幅器Ａ１２に接続）
することによすＶｉｎとＶｏｕｔの間でゲインを得るこ
とができる。
以上述べたように本発明によれば、増幅器の入力オフセ
ット電圧が出力に誤差となって現われないサンプル・ホ
ールド回路をｆｉｌ ｊｍな構成で実現できる。オた安
価な増幅器を使用でき高速動作が可能、集積回路化が容
易などの優れた利点も備えている。
ット電圧が出力に誤差となって現われないサンプル・ホ
ールド回路をｆｉｌ ｊｍな構成で実現できる。オた安
価な増幅器を使用でき高速動作が可能、集積回路化が容
易などの優れた利点も備えている。
第１図は従来のサンプル・ホールド回路の一例を示す電
気回路図、第２図は本発明の第１の実施例を示す電気回
路図、第３図は第２図、第４図および第６図の実施例の
動作を説明するためのタイム・チャート、第４図は本発
明の第２の実施例を示す電気回路図、第５図は第４図の
実施例の変形を示すための電気回路図、第６図は本発明
の第３の実施例を示す電気回路図である。 １．１１・・・入力端子、Ｖｉｎ・・・入力信号、ｓｌ
、 ８１１゜８１２、 Ｓ１３． Ｓ２１．８３１、−
・スイッチ、ＡＩ、 Ａ２． Ａｌｌ、 Ａ１２．、。 演算増幅器、Ｃ１ｌ、 Ｃ２２，Ｃ３２−キー？ ハ’
／ Ｉ 、Ｒ１，Ｒ２・・・抵抗、ＳＨＩ・・・第１の
サンプル・ボールド回路。 爪３図 蔦５図 第６図
気回路図、第２図は本発明の第１の実施例を示す電気回
路図、第３図は第２図、第４図および第６図の実施例の
動作を説明するためのタイム・チャート、第４図は本発
明の第２の実施例を示す電気回路図、第５図は第４図の
実施例の変形を示すための電気回路図、第６図は本発明
の第３の実施例を示す電気回路図である。 １．１１・・・入力端子、Ｖｉｎ・・・入力信号、ｓｌ
、 ８１１゜８１２、 Ｓ１３． Ｓ２１．８３１、−
・スイッチ、ＡＩ、 Ａ２． Ａｌｌ、 Ａ１２．、。 演算増幅器、Ｃ１ｌ、 Ｃ２２，Ｃ３２−キー？ ハ’
／ Ｉ 、Ｒ１，Ｒ２・・・抵抗、ＳＨＩ・・・第１の
サンプル・ボールド回路。 爪３図 蔦５図 第６図
Claims (3)
- （１） 入力信号が加えられる入力端子と、この入力
端子にその一方の端子が接続する第１のスイッチと、こ
の第１のスイッチの他方の端子がその非反転入力端子に
加えられる第１の演算増幅器と、一端がこの第１の演算
増幅器の反転入力端子に接続し他端がコモンに接続する
キャパシタと、このキャパシタの前記一端と前記第１の
演演増幅器の出力端子とに接続する第２のスイッチと、
一端が前記第１の演算増幅器の前記出力端子に接続する
第１の抵抗と、との廁１の抵抗の他端がその反転入力端
子に接続する第２の演算増幅器と、この第２の演算増幅
器の前記反転入力端子と出力端子とを接続する第２の抵
抗と、前記第２の演算増幅器の前記出力端子と前記第１
の演算増幅器の前記非反転入力端子とを接続する第３の
スイッチとを備えたサンプル・ホールド回路。 - （２） 入力信号が加えられる入力端子と、この入力
端子にその一方の端子が接続する第１のスイッチと、こ
の第１のスイッチの他方の端子がその非反転入力端子に
加えられる第１の演算増幅器と、一端がこの第１の演算
増幅器の反転入力端子に接続し他端がコモンに接続する
キャパシタと、このキャパγりの前記一端と前記第１の
演算増幅器の出力端子との間に接続する第２のスイッチ
と、一端が前記第１の演算増幅器の前記出力端子に接続
する第１の抵抗と、この第１の抵抗の他端がその反転入
力端子に接続する第２の演算増幅器と、この第２の演算
増幅器の前記反転入力端子と出力端子とを接続する第２
の抵抗と、前記第２の演算増幅器の出力端子に接続する
第１のサンプル・ホールド回路と、この第１のサンプル
・ホールド回路の出力端子と前記第１の演算増幅器の非
反転入力端子とに接続する第３のスイッチとを備えたサ
ンプル・ホールド回路。 - （３） 入力信号が加えられる入力端子と、この入力
端子にその一方の端子が接続する第１のスイッチと、こ
の第１のスイッチの他方の端子がその非反転入力端子に
加えられる第１の演算増幅器と、一端がこの第１の演算
増幅器の反転入力端子に接続し他端がコモンに接続する
第１のキャパシタと、この第１のキャパシタの前記一端
と前記第１の演算増幅器の出力端子との間に接続する第
２のスイッチと、一端が前記第１の演算増幅器の前記出
力端子に接続する第１の抵抗と、この第１の抵抗の他端
がその一端に接続する第４のスイッチと、との第４のス
イッチの他端がその反転入力端子に接続する第２の演算
増幅器と、この第２の演算増幅器の出力端子と前記第１
の抵抗の前記他端とに接続する第２の抵抗と、前記第２
の演算増幅器の前記反転入力端子と前記出力端子とを接
続する第２のキャパシタと、前記第２の演算増幅器の前
記出力端子と前記第１の演算増幅器の前記非反転入力端
子とを接続する第３のスイッチとを備えたサンプル・ホ
ールド回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57230382A JPS59116996A (ja) | 1982-12-23 | 1982-12-23 | サンプル・ホ−ルド回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57230382A JPS59116996A (ja) | 1982-12-23 | 1982-12-23 | サンプル・ホ−ルド回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59116996A true JPS59116996A (ja) | 1984-07-06 |
| JPS6233678B2 JPS6233678B2 (ja) | 1987-07-22 |
Family
ID=16906986
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57230382A Granted JPS59116996A (ja) | 1982-12-23 | 1982-12-23 | サンプル・ホ−ルド回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59116996A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01144299A (ja) * | 1987-11-30 | 1989-06-06 | Toshiba Corp | サンプル・ホールド回路 |
-
1982
- 1982-12-23 JP JP57230382A patent/JPS59116996A/ja active Granted
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01144299A (ja) * | 1987-11-30 | 1989-06-06 | Toshiba Corp | サンプル・ホールド回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6233678B2 (ja) | 1987-07-22 |
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