JPS59137650U - 発振回路の歩度調整装置 - Google Patents

発振回路の歩度調整装置

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JPS59137650U
JPS59137650U JP3115783U JP3115783U JPS59137650U JP S59137650 U JPS59137650 U JP S59137650U JP 3115783 U JP3115783 U JP 3115783U JP 3115783 U JP3115783 U JP 3115783U JP S59137650 U JPS59137650 U JP S59137650U
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stage
frequency divider
frequency
circuit
rectangular wave
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JP3115783U
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Inventor
望月　勇郎
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ジエコ−株式会社
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Publication date
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  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
  • Electric Clocks (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来の歩度調整装置の一例のブロック系統図、
第２図、第３図は本考案装置の各実施例のブロック系統
図である。 ５・・・・・・発振器、１０〜１３．　１６．　１９・
・・・・・′１／２分周器、１７・・・・・・ｎ進カウ
ンタ、２０・・・・・・出力端子、２１・・・・・・半
導体集積回路、２３ａ〜２３ｊ・・・・・・コンパレー
タ、２４．２７・・・・・・端子、２６・・・・・・オ
ア回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 発振器が発生した一定周波数の信号を縦続接続された複
    数段の分周器にて分周し所望の繰り返し周波数の信号を
    出力する発振回路に設けられ、第ｍ（ｍはｍ＞１の整数
    ）段の分周器の出力する矩形波と第：（１は０≦ｉ＜ｍ
    の整数）段の分周器の出力する矩形波との論理積をとる
    第１の論理回路と、該第１の論理回路の出力パルスを計
    数し計数値に対応した複数の計数信号を出力するカウン
    タと、該複数の計数信号のうち−を選択して取り出す選
    ′　　折回路と、該選択回路よりの計数信号と該第１段
    の分周器よりの矩形波との論理積をとって得られるリセ
    ットパルスで第け１段より第ｍ段までの分周器及び該カ
    ウンタをリセットせしめると共に該リセットパルスを第
    ｍ＋１段の分周器に供給する第２の論理回路とよりなり
    、該第ｍ段の分周器の出、力する矩形波周期を該第１段
    の分周器の出力する矩形波周期の該選択された計数値倍
    だけ増加させて歩度調整を行なうよう構成してなる発振
    回路の歩度調整装置。
JP1983031157U 1983-03-04 1983-03-04 発振回路の歩度調整装置 Expired - Lifetime JPH0633717Y2 (ja)

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JPH0633717Y2 JPH0633717Y2 (ja) 1994-08-31

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS55164588U (ja) * 1980-05-08 1980-11-26

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS55164588U (ja) * 1980-05-08 1980-11-26

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JPH0633717Y2 (ja) 1994-08-31

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