JPS59140757A - オ−トダイヤル装置の制御方式 - Google Patents
オ−トダイヤル装置の制御方式Info
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- JPS59140757A JPS59140757A JP58014320A JP1432083A JPS59140757A JP S59140757 A JPS59140757 A JP S59140757A JP 58014320 A JP58014320 A JP 58014320A JP 1432083 A JP1432083 A JP 1432083A JP S59140757 A JPS59140757 A JP S59140757A
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- 238000000034 method Methods 0.000 claims description 3
- 239000004065 semiconductor Substances 0.000 abstract description 5
- 230000005540 biological transmission Effects 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 4
- 239000013256 coordination polymer Substances 0.000 description 2
- 238000004804 winding Methods 0.000 description 2
- 238000012544 monitoring process Methods 0.000 description 1
- 238000011084 recovery Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04M—TELEPHONIC COMMUNICATION
- H04M1/00—Substation equipment, e.g. for use by subscribers
- H04M1/26—Devices for calling a subscriber
- H04M1/27—Devices whereby a plurality of signals may be stored simultaneously
- H04M1/274—Devices whereby a plurality of signals may be stored simultaneously with provision for storing more than one subscriber number at a time, e.g. using toothed disc
- H04M1/2745—Devices whereby a plurality of signals may be stored simultaneously with provision for storing more than one subscriber number at a time, e.g. using toothed disc using static electronic memories, e.g. chips
- H04M1/27495—Devices whereby a plurality of signals may be stored simultaneously with provision for storing more than one subscriber number at a time, e.g. using toothed disc using static electronic memories, e.g. chips implemented by means of discrete electronic components, i.e. neither programmable nor microprocessor-controlled
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は構成が単純で低電力消費のオートダイヤル装置
の制御方式に関するものである。
の制御方式に関するものである。
第１図は従来のオートダイヤル装置の回路構成図で、Ｄ
Ｋは切分器、８Ａ、ＳＢ、ＳＣ，８Ｄは切分器ＤＫのス
イッチ、ＲＡ、ＲＢ、ＲＣはリレー、ｒａはリレーＲＡ
の接点、ｒｂはリレーＲＢの接点、ｒＣ１〜ｒＣ３はリ
レーＲＣの接点でである。
Ｋは切分器、８Ａ、ＳＢ、ＳＣ，８Ｄは切分器ＤＫのス
イッチ、ＲＡ、ＲＢ、ＲＣはリレー、ｒａはリレーＲＡ
の接点、ｒｂはリレーＲＢの接点、ｒＣ１〜ｒＣ３はリ
レーＲＣの接点でである。
スイッチＳＡ、ＳＢ、ＳＣ，ＳＤがそれぞれ１〜２側に
ある場合は電話機置は局線Ｌ１゜Ｌ２と接続され発着信
が可能な状態にある。
ある場合は電話機置は局線Ｌ１゜Ｌ２と接続され発着信
が可能な状態にある。
一方スイッチｓＡ、ｓＢ、Ｓｃ、ＳＤがそれぞれ１〜３
側にある場合は電話機置は Ｌｌ−＋ Ｓ Ａ Ｉ−３−＋ ｒｂ １−２−＋ ｒ
Ｃ２＋ −２４ｒＣｌｌ−２→Ｓｆ３１−ａ −＊ 置
−＋ＳＣＩ−３−＋ ｒＣ３］ −ｚ −＋ ５ＤＩ−
３→Ｌ２ の経路で局線に接続され発着信可能となっている。この
状態ではオートダイヤル装置からの発信は次のような過
程で行なわれる。
側にある場合は電話機置は Ｌｌ−＋ Ｓ Ａ Ｉ−３−＋ ｒｂ １−２−＋ ｒ
Ｃ２＋ −２４ｒＣｌｌ−２→Ｓｆ３１−ａ −＊ 置
−＋ＳＣＩ−３−＋ ｒＣ３］ −ｚ −＋ ５ＤＩ−
３→Ｌ２ の経路で局線に接続され発着信可能となっている。この
状態ではオートダイヤル装置からの発信は次のような過
程で行なわれる。
キーボードスイッチＫＺを押しマイクロプロセッサＣＰ
Ｕのｋｚ端、子に信号入力すれば、マイクロプロセッサ
ＣＰＵからリレーＲ，Ａ；ＲＢ。
Ｕのｋｚ端、子に信号入力すれば、マイクロプロセッサ
ＣＰＵからリレーＲ，Ａ；ＲＢ。
ＲＣの動作信号が出力され各リレーは動作し次の経路で
局線を通しての直流ループが閉成される。
局線を通しての直流ループが閉成される。
Ｌ １−＋ＳＡ １−３ →ｒａ −＋ ｒｂｔ −ａ
−＋ ５ＤＩ−３−＋２ 接点ｒ３ はインパルススイッチであって、この接点ｒ
ａを断続してダイヤルパルスを局線に送出する。また接
点ｒｂｘ−３はシャントスイッチであって音声ピックア
ップ用、インダクタンスＬを短絡してモニター人力を遮
断する。
−＋ ５ＤＩ−３−＋２ 接点ｒ３ はインパルススイッチであって、この接点ｒ
ａを断続してダイヤルパルスを局線に送出する。また接
点ｒｂｘ−３はシャントスイッチであって音声ピックア
ップ用、インダクタンスＬを短絡してモニター人力を遮
断する。
一方この間電話装置の送受器を上げてオフフック状態に
しであると、マイクロプロセッサＣＰＵのｈｏ端子に下
記の経路で地気が入力するのでマイクロプロセッサＣＰ
Ｕはオフフックと判定する。
しであると、マイクロプロセッサＣＰＵのｈｏ端子に下
記の経路で地気が入力するのでマイクロプロセッサＣＰ
Ｕはオフフックと判定する。
地気→ｒｃｊｌ−３→Ｓ、Ｂ１−５→フックスイッチＨ
８−＋ ５Ｃ１−３＋ ｒＣ３１Ｊ−３→ｈ。
８−＋ ５Ｃ１−３＋ ｒＣ３１Ｊ−３→ｈ。
マイクロプ−ロセッサＣＰＵはオフフックの判定をする
とダイヤル完了後は自動的にリレーＲＡ 、 Ｒ，Ｂ
、 ＲＣを復旧させて電話機置側に局線が復帰し通話可
能となる。
とダイヤル完了後は自動的にリレーＲＡ 、 Ｒ，Ｂ
、 ＲＣを復旧させて電話機置側に局線が復帰し通話可
能となる。
また送受器を下げたオンフッタ状態ではフックスイッチ
Ｈ８が開いているので端子ｈＯの地気がないためマイク
ロプロセッサＣ’ＰＵはオンフックと判定する。マイク
ロプロセッサＣＰＵはオンフックの判定をすると、ダイ
ヤル完了後はリレーＲＡおよびＲＢを復旧させリレーＲ
Ｃは動作を継続する。これによって Ｌ １ →Ｓ Ａｌ−３→ｒｂ Ｉ−２−＋ ｒｃｚ
１−３−） Ｌ−＊５Ｄｌ−３→Ｌ２ の経路で局線が音声ピックアップ用コイルＬに接続され
同時に接点ｒｂ＋−ａ が開くので、リングバンク音
、相手応答音等局線の音声信号が増幅器ＡＭＰで増幅さ
れスピーカＳｐから放声されてモニターすることができ
る。
Ｈ８が開いているので端子ｈＯの地気がないためマイク
ロプロセッサＣ’ＰＵはオンフックと判定する。マイク
ロプロセッサＣＰＵはオンフックの判定をすると、ダイ
ヤル完了後はリレーＲＡおよびＲＢを復旧させリレーＲ
Ｃは動作を継続する。これによって Ｌ １ →Ｓ Ａｌ−３→ｒｂ Ｉ−２−＋ ｒｃｚ
１−３−） Ｌ−＊５Ｄｌ−３→Ｌ２ の経路で局線が音声ピックアップ用コイルＬに接続され
同時に接点ｒｂ＋−ａ が開くので、リングバンク音
、相手応答音等局線の音声信号が増幅器ＡＭＰで増幅さ
れスピーカＳｐから放声されてモニターすることができ
る。
適当時期に発信者が送受器を上げるとフックスイッチＨ
８が閉じるので端子ｈｏが地気され、このためマイク、
ロプロセッサＣＰＵがリレーＲＣのリセット信号を出し
て復旧させ、接点ｒｃ１〜ｒ、ｃ３ が１−２側に切
替わり電話機置が局線に接続され″る。リレーＲＢ及び
Ｒ，Ｃは切替わりの際に局線の直流ループを断としない
ようコンテニアス接点が使われている。ＰＯは電源であ
る。
８が閉じるので端子ｈｏが地気され、このためマイク、
ロプロセッサＣＰＵがリレーＲＣのリセット信号を出し
て復旧させ、接点ｒｃ１〜ｒ、ｃ３ が１−２側に切
替わり電話機置が局線に接続され″る。リレーＲＢ及び
Ｒ，Ｃは切替わりの際に局線の直流ループを断としない
ようコンテニアス接点が使われている。ＰＯは電源であ
る。
以上のように従来は数個のリレーの論理動作によりダイ
ヤルパルスを送出したり電話機側とオートダイヤル装置
側との切替えのための制御をしたりしていたので消費電
力が大きく、電池駆動をすると長時間使用でき、なくな
り、商用電源を用いざるを得なかった。このため電源回
路等のコストアップを招きさらに小形化に適さなかった
。
ヤルパルスを送出したり電話機側とオートダイヤル装置
側との切替えのための制御をしたりしていたので消費電
力が大きく、電池駆動をすると長時間使用でき、なくな
り、商用電源を用いざるを得なかった。このため電源回
路等のコストアップを招きさらに小形化に適さなかった
。
本発明はこれらの欠点を除去するため、オートダイヤル
装置の制御用リレーを自己保持形リレー１ヶとし、また
インパルススイッチ及びシャントスイッチに半、導体ス
イッチを用いて、消費電力の小さいオートダイヤル装置
の制御回路を提供しようとするものである。
装置の制御用リレーを自己保持形リレー１ヶとし、また
インパルススイッチ及びシャントスイッチに半、導体ス
イッチを用いて、消費電力の小さいオートダイヤル装置
の制御回路を提供しようとするものである。
以下本発明を図面について詳細に説明する。
第２図は本発明の実施例を示す回路図である。
ＤＶは切分器、８１．８２．８３．８４は切分器ＤＶの
スイッチ、Ｒは自己保持形のリレー、ｒｌ、ｒ２．ｒ３
はリレーＲの接点、■は半導体のインパルススイッチ、
Ｓは半導体のシャントスイッチ、Ｈ８はフックスイッチ
、ＬＡは音声ピックアップ用インダクタンス、ＣＰＵは
マイクロッ西セッサ、ＤＢはダイオードブリッジである
。゛スイッチ８１〜Ｓ４ がそれぞれ１〜２側に投入さ
れている場合は電話機置は局線Ｌｌ。
スイッチ、Ｒは自己保持形のリレー、ｒｌ、ｒ２．ｒ３
はリレーＲの接点、■は半導体のインパルススイッチ、
Ｓは半導体のシャントスイッチ、Ｈ８はフックスイッチ
、ＬＡは音声ピックアップ用インダクタンス、ＣＰＵは
マイクロッ西セッサ、ＤＢはダイオードブリッジである
。゛スイッチ８１〜Ｓ４ がそれぞれ１〜２側に投入さ
れている場合は電話機置は局線Ｌｌ。
Ｌ２に接続されて発着信が可能である。一方スイッチ８
１〜Ｓ４ がそれぞれ１−３側に投入されている場合は
電話機置は次の経路 Ｌ １−＋Ｓｉ Ｉ ３−＋ ｒｌｌ−２−＊ ８３］
３ →置−＋ ８４１−３ ＋ ｒ２１−２−＋ ８
２１３４ Ｌ ２で局線に接続され発着信可能となって
いる。
１〜Ｓ４ がそれぞれ１−３側に投入されている場合は
電話機置は次の経路 Ｌ １−＋Ｓｉ Ｉ ３−＋ ｒｌｌ−２−＊ ８３］
３ →置−＋ ８４１−３ ＋ ｒ２１−２−＋ ８
２１３４ Ｌ ２で局線に接続され発着信可能となって
いる。
オートダイヤル装置からの発信は次のような過程により
行なわれる。
行なわれる。
すなわちキーボードスイッチＫを押しマイク 、ロプ
ロセッサＣＰＵの端子ｋに信号を入力すれば、マイクロ
プロセッサＣＰＵの端子Ｒｏｐ からリレーＲの動作側
巻線Ａに駆動パルスが出力されるのでリレーＲは動作し
て自己保持し、接点ｒ１．ｒ２．ｒ３はすべて１−６が
閉じＬ １−＋ ８１ｔ−３４ｒ １１−３−＋ Ｄ
Ｂ−＋ Ｉ −＋ ＬＡ７＋ＤＢ−＋８２１−３→Ｌ２ の経路にて局線を通じての直流ループが閉成される。次
の段階でマイクロプロセッサＣ’ＰＵは端子ｊよりの出
力によりインパルススイッチ■゛を制御して局線にダイ
ヤル、ＮＯルスを送出する。
ロセッサＣＰＵの端子ｋに信号を入力すれば、マイクロ
プロセッサＣＰＵの端子Ｒｏｐ からリレーＲの動作側
巻線Ａに駆動パルスが出力されるのでリレーＲは動作し
て自己保持し、接点ｒ１．ｒ２．ｒ３はすべて１−６が
閉じＬ １−＋ ８１ｔ−３４ｒ １１−３−＋ Ｄ
Ｂ−＋ Ｉ −＋ ＬＡ７＋ＤＢ−＋８２１−３→Ｌ２ の経路にて局線を通じての直流ループが閉成される。次
の段階でマイクロプロセッサＣ’ＰＵは端子ｊよりの出
力によりインパルススイッチ■゛を制御して局線にダイ
ヤル、ＮＯルスを送出する。
ダイヤルパルス送出中はマイクロプロセッサＣＰＵは端
子Ｓの出力によりシャントスイッチＳを閉じて音声ピッ
クアップ用インダクタンスＬＡへの入力を遮断する。
子Ｓの出力によりシャントスイッチＳを閉じて音声ピッ
クアップ用インダクタンスＬＡへの入力を遮断する。
一方この間送受器を上げてオフフックするとマイクロプ
ロセッサＣＰＵの端子りは ｈ −＋ ｒ３１−３−＞ ８３ ｓ −’ａ −＋
Ｈ８−＋ Ｓ ４ｔ−３−＋ ｒ２１−３→地気 の経路で地気されるのでマイクロプロセッサＣＰＵはオ
フフック状態と判定する。オフフックと判定するとマイ
クロプロセッサＣＰＵはダイヤル完了後はシャントスイ
ッチＳを引続き閉じるとともに端子Ｒγｅ１からリレー
Ｒの復旧側巻線Ｂに駆動パルスを出させ、リレーＲは自
己保持を解いて復旧し、接点ｒ１．ｒ２．ｒ３がそれぞ
れ１−２側に戻って通話可能となる。このとき局線の断
がないよう接点ｒ１とｒ２はコンテニュアス接点が使わ
れている。
ロセッサＣＰＵの端子りは ｈ −＋ ｒ３１−３−＞ ８３ ｓ −’ａ −＋
Ｈ８−＋ Ｓ ４ｔ−３−＋ ｒ２１−３→地気 の経路で地気されるのでマイクロプロセッサＣＰＵはオ
フフック状態と判定する。オフフックと判定するとマイ
クロプロセッサＣＰＵはダイヤル完了後はシャントスイ
ッチＳを引続き閉じるとともに端子Ｒγｅ１からリレー
Ｒの復旧側巻線Ｂに駆動パルスを出させ、リレーＲは自
己保持を解いて復旧し、接点ｒ１．ｒ２．ｒ３がそれぞ
れ１−２側に戻って通話可能となる。このとき局線の断
がないよう接点ｒ１とｒ２はコンテニュアス接点が使わ
れている。
また送受器を下したオン・フック状態ではフックスイッ
チＨ８力ｆ開いて端子りは地気されないためマイクロプ
ロセッサＣＰＵはオンフックと判定し端子Ｒゴｅｌから
駆動パルスは送出されずリレーＲ１は動作を継続し、ダ
イヤルパルス送出後にシャントスイッチＳを開き、音声
ピックアップ用インダクタンスＬＡよりリングバック音
、相手応答音等を受は増幅器ＡＭＰで増巾しスピーカＳ
ｐから放声してモニターすることができる。適当な時期
に発信者が送受器を上げるとフックスイッチＨ８が閉じ
るので端子りは地気され、この地気により前述のように
マイクロプロセッサＣＰＵはオフフックを判定しリレー
Ｒを復旧させ接点ｒ１．ｒ２．ｒ３は１−２側に戻り電
話装置により通話可能となる。
チＨ８力ｆ開いて端子りは地気されないためマイクロプ
ロセッサＣＰＵはオンフックと判定し端子Ｒゴｅｌから
駆動パルスは送出されずリレーＲ１は動作を継続し、ダ
イヤルパルス送出後にシャントスイッチＳを開き、音声
ピックアップ用インダクタンスＬＡよりリングバック音
、相手応答音等を受は増幅器ＡＭＰで増巾しスピーカＳ
ｐから放声してモニターすることができる。適当な時期
に発信者が送受器を上げるとフックスイッチＨ８が閉じ
るので端子りは地気され、この地気により前述のように
マイクロプロセッサＣＰＵはオフフックを判定しリレー
Ｒを復旧させ接点ｒ１．ｒ２．ｒ３は１−２側に戻り電
話装置により通話可能となる。
以上説明したように本発明によれば制御用のリレーＲは
１個で且つ自己保持形のｆめ駆動パルスｌこより動作し
、動作中電流を消費しない。
１個で且つ自己保持形のｆめ駆動パルスｌこより動作し
、動作中電流を消費しない。
またインパルススイッチエおよびシャントスイッチＳは
半導体スイッチで駆動電力が少ない。
半導体スイッチで駆動電力が少ない。
従って電源の電力容量が小さくて済み電池駆動も可能と
なり、電源回路の小、形化やコストダウンにも有利であ
る。
なり、電源回路の小、形化やコストダウンにも有利であ
る。
第１図は従来のオートダイヤル装−〇回路構成図、第２
図は本発明の実施例を示す回路構成図である。 ＤＫ 、ＤＶ−一切分器、５Ａ−８Ｄ、Ｓ１〜Ｓ４−ス
イッチ、Ｒ，Ａ 、 Ｒ’Ｂ 、 ＲＣ、Ｒ，−リレー
、ｒａ−一−リレー Ｒ，Ａの接点、ｒｂ−リレーＲＢ
の接点、ｒｃｌ 〜ｒｃ３− リレーＲＣの接点、ｒ１
〜ｒ３− リレーＲの接点、Ｌ、ＬＡ−音声ピックア
ップ用インダクタンス、ＣＰＵ−マイクロプロセッサ、
Ｋ、ＫＺ−キーボードスイッチ、■−インパルススイッ
チ、Ｓ−シャントスイッチ、ＡＭＰ−増巾器、ＰＯ，Ｐ
Ｌ−電源。 特許出願人 株式会社 大興電機製作所 取締役社長 肥 後 大 介
図は本発明の実施例を示す回路構成図である。 ＤＫ 、ＤＶ−一切分器、５Ａ−８Ｄ、Ｓ１〜Ｓ４−ス
イッチ、Ｒ，Ａ 、 Ｒ’Ｂ 、 ＲＣ、Ｒ，−リレー
、ｒａ−一−リレー Ｒ，Ａの接点、ｒｂ−リレーＲＢ
の接点、ｒｃｌ 〜ｒｃ３− リレーＲＣの接点、ｒ１
〜ｒ３− リレーＲの接点、Ｌ、ＬＡ−音声ピックア
ップ用インダクタンス、ＣＰＵ−マイクロプロセッサ、
Ｋ、ＫＺ−キーボードスイッチ、■−インパルススイッ
チ、Ｓ−シャントスイッチ、ＡＭＰ−増巾器、ＰＯ，Ｐ
Ｌ−電源。 特許出願人 株式会社 大興電機製作所 取締役社長 肥 後 大 介
Claims (1)
- １、 複数回線の電話番号を記憶しておき、１ボタンな
いし少数ボタンの操作で記憶した電話番号に対応するダ
イヤル信号を送出する機能がマイクロプロセッサにて制
御されるオートダイヤル装置において、オンフック・オ
フフックの判定用切替回路として１ケの自己保持形リレ
ーの接点を介して、オンフック・オフフック条件を前記
マイクロプロセッサに入力するとともにマイクロプロセ
ッサの制御により上記自己保持形リレーを制御するよう
にしたことを特徴とするオートダイヤル装置の制御方式
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58014320A JPS59140757A (ja) | 1983-01-31 | 1983-01-31 | オ−トダイヤル装置の制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58014320A JPS59140757A (ja) | 1983-01-31 | 1983-01-31 | オ−トダイヤル装置の制御方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59140757A true JPS59140757A (ja) | 1984-08-13 |
| JPH039669B2 JPH039669B2 (ja) | 1991-02-08 |
Family
ID=11857789
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58014320A Granted JPS59140757A (ja) | 1983-01-31 | 1983-01-31 | オ−トダイヤル装置の制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59140757A (ja) |
-
1983
- 1983-01-31 JP JP58014320A patent/JPS59140757A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPH039669B2 (ja) | 1991-02-08 |
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