JPS5915434B2 - 垂直同期信号の遅延回路 - Google Patents

垂直同期信号の遅延回路

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JPS5915434B2
JPS5915434B2 JP50047115A JP4711575A JPS5915434B2 JP S5915434 B2 JPS5915434 B2 JP S5915434B2 JP 50047115 A JP50047115 A JP 50047115A JP 4711575 A JP4711575 A JP 4711575A JP S5915434 B2 JPS5915434 B2 JP S5915434B2
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JP
Japan
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signal
synchronization signal
horizontal
circuit
vertical synchronization
Prior art date
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Expired
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JP50047115A
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English (en)
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JPS51122316A (en
Inventor
和雄 小泉
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Sony Corp
Original Assignee
Sony Corp
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Expired legal-status Critical Current

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  • Synchronizing For Television (AREA)
  • Television Signal Processing For Recording (AREA)
  • Testing, Inspecting, Measuring Of Stereoscopic Televisions And Televisions (AREA)

Description

【発明の詳細な説明】 本発明は例えばビデオテープレコーダのトラック切換え
の状態の測定や、カラーテレビジョンカメラからの映像
信号の3色の色の重ね合せの状態の測定等を行う為のモ
ニタ用のテレビジョン受像機に使用して好適な垂直同期
信号の遅延回路に関する。
上述の様な測定を行う場合には、テレビジョン信号中の
垂直ブランキング期間に於ける信号を監視する必要があ
る。
その為にはモニタ用のテレビジョン受像機に於いて垂直
ブランキング期間を画面の中央に映出して監視する。こ
の監視を行う方法として従来より棟々の方法が提案され
ている。この方法としてまず映像信号を遅延回路を用い
て遅延させる方法がある。ところがこの方法を用いた場
合、遅延回路に於いて映像信号のS/Nが非常に劣化す
る。これに対し垂直同期信号を遅延させることにより、
垂直の偏向の時点を変えて垂直のブランキン5 グ期間
を画面上に映出する方法がある。
そしてこの垂直同期信号を遅延させる方法としては、垂
直同期信号の後の水平同期信号を計数し、その所定計数
値を検出して、その検出時点より遅延垂直同期信号を形
成する様にしている。10ところがテレビジョン信号に
於いては、インターレースを行う為に垂直同期信号を基
準として考えた場合、奇数フィールドと偶数フィールド
との画面の水平同期信号の位置はn水平周期ずれている
即ち奇数フィールドの水平同期信号が垂直同15期信号
の位置から各m水平周期(mは整数)後の位置にあるの
に対して、偶数フィールドでは各(m+青)水平周期後
の位置にある。しかしながら、上述の様に水平同期信号
を計数して遅延垂直同期信号を形成した場合には、この
20遅延垂直同期信号の位置は水平同期信号に同期した
位置になり、従つて水平同期信号の位置は常に垂直同期
信号の位置から各m水平周期後の位置になり、J水平周
期のずれが無くなつてしまう。
従つてこの様な垂直同期信号を用いて垂直の偏25向を
行つた場合には、水平の走査線の位置は、奇数画面、偶
数画面に於いて同一となり、インターレースを行うこと
ができなくなつてしまう。
また、垂直同期信号で起動される単安定マルチバイブレ
ータを用いて、遅延垂直同期信号を形成30する方法も
あるが、この場合は、例えば垂直同期信号を工フィード
遅延させる場合、約8msの比較的長いパルス幅を必要
とし、これに対して、必要な立ち下りの精度は渣水平周
期約30μs以下となり、非常に高い精度の単安定マル
チバイブレ35−夕を用いなければならない。
本発明は斯る点に鑑み、上述の従来の欠点を除去し、垂
直同期信号に対する奇数フィールド、偶数フイールド間
の水平同期信号の一水平周期のずれを保存した遅延垂直
同期信号を得ることができる様にしたものである。
即ち本発明は、水平同期信号に同期し、且つ水平周波数
の2倍の周波数のパルス信号を形成するパルス信号形成
回路と、垂直同期信号に同期して上記パルス信号を計数
するカウンタと、該カウンタの計数値が所定値になつた
ことを検出する検出回路と、該検出回路の出力にて所定
巾のパルスを形成するマルチバイブレータ回路とを設け
たものである。
以下図面を参照しながら、本発明の一実施例について説
明するに、第1図はその系統図である。
第1図中1はテレビジヨン信号が供給される入力端子で
あつて、この入力端子1からのテレビジヨン信号を同期
分離回路2に供給する。この同期分離回路2からの水平
同期信号を水平同期信号に同期し且つ水平周波数の2倍
の周波数のパルス信号を形成するパルス信号形成回路3
に供給する。このパルス信号形成回路3からのパルス信
号をカウンタ4のクロツク端子に供給する。また同期分
離回路2からの垂直同期信号を波形成形回路5を通じて
カウンタ4のりセツト端子に供給する。このカウンタ4
の出力信号をデコーダ6に供給し、カウンタ4の計数値
が所定値になつたときこのデコーダ6より出力信号を得
る。このデコーダ6よりの出力信号を3水平周期のパル
ス幅を有する単安定マルチバイブレータ(以下モノマル
チと略称する)7に供給する。このモノマルチ7にて遅
延垂直同期信号形成回路を構成する。このモノマルチ7
からの遅延垂直同期信号を、出力端子8を通じて後段の
垂直偏向回路やブランキング回路(共に図示せず)に供
給する。斯る第1図の回路に於いて、出力端子8に得ら
れる遅延垂直同期信号の遅延量は、カウンタ4で計数さ
れる水平同期信号に同期し且つ2倍の水平周波数のパル
ス信号の数で決定される。
即ち遅延垂直同期信号の位置は一水平周期のパルス信号
に同期した位置になる。この場合、上述した様に奇数フ
イールドに於ける水平同期信号の位置は垂直同期信号の
位置から各m水平周期後の位置にあり、偶数フイールド
では各(m+n)水平周期後の位置にある。
このため垂直同期信号の位置から一水平周期単位で所定
量遅延して形成される遅延垂直同期信号の位置は、奇数
フイールドに於いては水平同期信号に同期した位置にな
り、偶数フイールドでは各水平同期信号の中間に形成し
たパルス信号に同期した位置になる。
従つて斯る遅延垂直同期信号を基準にした映隊信号に於
いて、奇数フイールドの水平同期信号の位置は遅延垂直
同期信号の位置から各m水平周期後の位置になり、偶数
フイールドは各(m+百)水平周期後の位置になる。
即ち、奇数フイールド、偶数フイールド間の水平同期信
号の一水平周期分のずれが保存される。またデコーダ6
に於いて検出するカウンタ4の計数値を任意に変えるこ
とにより、百水平周期のずれを保存したままで、垂直同
期信号の位置を任意に変更することができる。
以上述べた如く、本発明によれば、奇数フイ一ルド、偶
数フイールド間の水平同期信号の百水平周期分のずれを
保存した、任意の遅延量の遅延垂直同期信号を得ること
ができ、斯る垂直同期信号を用いて垂直の偏向を行うこ
とにより、画面上に於いて奇数画面、偶数画面間のイン
ターレースを正確に行なつたままで、映像信号中の任意
の部分、例えば垂直のブランキング期間を画面の中央に
映出することができる。
なお、上述の実施例で、パルス信号形成回路3からのパ
ルス信号は水平周波数の2倍の周波数のパルス信号であ
るに限らず、2n倍(nは整数)であつても良い。
更に第2図は上述のパルス信号形成回路3の一例を示す
もので、図中31は同期分離回路2に接続される入力端
子である。
この入力端子31を負の微分パルスを取り出す微分回路
32を通じて、パルス幅が一水平周期のモノマルチ33
に接続する。このモノマルチ33の出力端子と、入力端
子31とをそれぞれ負の微分パルスを取り出す微分回路
34及び35を通じて、パルス幅が5msのモノマルチ
36に接続する。このモノマルチ36よりカウンタ4に
接続するための出力端子37を導出する。斯る第2図の
回路に於いて、第3図Aに示す如き水平同期信号が入力
端子31に供給された場合、この水平同期信号の立ち下
がりによつてモノマルチ33が起動され、モノマルチ3
3の出力端子に第3図Bに示す如きパルス信号が得られ
る。
更にこのパルス信号と水平同期信号の立ち下がりによつ
てモノマルチ36が起動され、モノマルチ36の出力端
子に第3図Cに示す如き、水平同期信号に同期し、且つ
水平周波数の2倍の周波数のパルス信号が得られる。な
お、この回路でモノマルチ33のパルス幅を決定する抵
抗器38を可変抵抗器とし、モノマルチ33のパルスの
立ち下がりの時点を可変できる様にすることにより画面
上のインターレースの微調整を行うことができる。
【図面の簡単な説明】
第1図は本発明による垂直同期信号の遅延回路の一実施
例の系統図、第2図は本発明に用いるパルス信号形成回
路の一例の接続図、第3図はその説明に供する波形図で
ある。 1は入力端子、2は同期分離回路、3はパルス信号形成
回路、4はカウンタ、5は波形整形回路、6はデコーダ
、7は遅延垂直同期信号形成回路としての単安定マルチ
バイブレータ、8は出力端子である。

Claims (1)

    【特許請求の範囲】
  1. 1 水平同期信号に同期し且つ水平周波数の2n倍(n
    は整数)の周波数のパルス信号を形成するパルス信号形
    成回路と、垂直同期信号に同期して上記パルス信号を計
    数するカウンタと、該カウンタの計数値が所定値になつ
    たことを検出する検出回路と、該検出回路の出力にて所
    定巾のパルスを形成するマルチバイブレータ回路とより
    成る垂直同期信号の遅延回路。
JP50047115A 1975-04-18 1975-04-18 垂直同期信号の遅延回路 Expired JPS5915434B2 (ja)

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JP50047115A JPS5915434B2 (ja) 1975-04-18 1975-04-18 垂直同期信号の遅延回路

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JP50047115A JPS5915434B2 (ja) 1975-04-18 1975-04-18 垂直同期信号の遅延回路

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Publication Number Publication Date
JPS51122316A JPS51122316A (en) 1976-10-26
JPS5915434B2 true JPS5915434B2 (ja) 1984-04-09

Family

ID=12766163

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JP50047115A Expired JPS5915434B2 (ja) 1975-04-18 1975-04-18 垂直同期信号の遅延回路

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JPS545414U (ja) * 1977-06-14 1979-01-13

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JPS51122316A (en) 1976-10-26

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