JPS59169226A - 周波数逓倍器 - Google Patents
周波数逓倍器Info
- Publication number
- JPS59169226A JPS59169226A JP4499683A JP4499683A JPS59169226A JP S59169226 A JPS59169226 A JP S59169226A JP 4499683 A JP4499683 A JP 4499683A JP 4499683 A JP4499683 A JP 4499683A JP S59169226 A JPS59169226 A JP S59169226A
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- JP
- Japan
- Prior art keywords
- circuit
- input
- matching circuit
- frequency
- waveguide
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 230000005669 field effect Effects 0.000 claims description 5
- 230000000903 blocking effect Effects 0.000 claims description 2
- 238000006243 chemical reaction Methods 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 238000000034 method Methods 0.000 description 2
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K19/00—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits
- H03K19/02—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components
- H03K19/14—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components using opto-electronic devices, i.e. light-emitting and photoelectric devices electrically- or optically-coupled
Landscapes
- Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Computing Systems (AREA)
- General Engineering & Computer Science (AREA)
- Mathematical Physics (AREA)
- Microwave Amplifiers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本１発明は、王にマイクロ波周波数帯で使用される周波
数逓倍器に関する。
数逓倍器に関する。
マイクロ波周波数帯信号を得る方法としては）基本波の
高調波を用いるいわゆる周波数逓倍器が良く用いられる
。この周波数逓倍器は、従来１バラクタダイオードを使
って逓倍器を構成する方法が効率の点で優れておシ、良
く用いられていた。
高調波を用いるいわゆる周波数逓倍器が良く用いられる
。この周波数逓倍器は、従来１バラクタダイオードを使
って逓倍器を構成する方法が効率の点で優れておシ、良
く用いられていた。
しかしながら、バラクタダイオードは基本的には受動的
素子であるために、変換損失があり、さらには非線形素
子特有の回路構成の困難性など特性上及び生産上の問題
があった。
素子であるために、変換損失があり、さらには非線形素
子特有の回路構成の困難性など特性上及び生産上の問題
があった。
この問題解決の方法として、素子をトランジスタにかえ
、トランジスタの高調波を使うことで変換損失の問題を
解決することが考えられる。
、トランジスタの高調波を使うことで変換損失の問題を
解決することが考えられる。
本発鳴は上記事情に着目してなされたものであり、従っ
て本発明の目的は、トランジスタとして電界効果型トラ
ンジスタを用いることによって生産性良く構成できる新
規な周波数逓倍器な提供することにある。
て本発明の目的は、トランジスタとして電界効果型トラ
ンジスタを用いることによって生産性良く構成できる新
規な周波数逓倍器な提供することにある。
上記目的を達成する為に、本発明に係る周波数逓倍器は
、電界効果型トランジスタと、入出力整合回路と、入力
周波数で阻止特性を持つカットオフ導波管とを含み、前
記カットオフ導波管を前記出力整合回路の次に接続して
、入力信号分を阻止するように構成される。
、電界効果型トランジスタと、入出力整合回路と、入力
周波数で阻止特性を持つカットオフ導波管とを含み、前
記カットオフ導波管を前記出力整合回路の次に接続して
、入力信号分を阻止するように構成される。
本発明は電界効果型トランジスタ（以下ＦＥＴと略記す
る）が基本的に２次歪のみを生じせしめる素子であるこ
とを考え、この２次特性を利用して高調波（２逓倍波）
を生じせしめ、出力波に含まれるこの高調波を、基本波
を阻止するいわゆるカットオフ導波管で取り出すことを
特徴としている。
る）が基本的に２次歪のみを生じせしめる素子であるこ
とを考え、この２次特性を利用して高調波（２逓倍波）
を生じせしめ、出力波に含まれるこの高調波を、基本波
を阻止するいわゆるカットオフ導波管で取り出すことを
特徴としている。
次に本発明をその好ましい一実施例について図面を参照
しながら具体的に説明する。
しながら具体的に説明する。
第１図は本発明の一実施例を示すブロック構成図である
。図において、参照番号１はＦＥＴ、 ２は入力整合回
路、３は出力整合回路、４はカントオフ導波管をそれぞ
れ示す。
。図において、参照番号１はＦＥＴ、 ２は入力整合回
路、３は出力整合回路、４はカントオフ導波管をそれぞ
れ示す。
ＦＥＴＩの入力整合回路２は、基本波周波数ｆｏで整合
されており、入力信号がＦＥＴＩに効果的に導入される
よう動作する。ＦＥＴ ｌの出力側には出力整合回路３
によシ高調波周波数で整合化されるよう構成され、次の
基本波阻止（カットオフ）導波管４で構成される高域通
過濾波回路を通して高調波成分が出力される構成で′あ
る。出力整合回路３内にはカットオフ導波管４との整合
をとる為の適宜のインターフェイスを含んでいてもよい
。
されており、入力信号がＦＥＴＩに効果的に導入される
よう動作する。ＦＥＴ ｌの出力側には出力整合回路３
によシ高調波周波数で整合化されるよう構成され、次の
基本波阻止（カットオフ）導波管４で構成される高域通
過濾波回路を通して高調波成分が出力される構成で′あ
る。出力整合回路３内にはカットオフ導波管４との整合
をとる為の適宜のインターフェイスを含んでいてもよい
。
本発明はこの様な構成であるから、入力回路は基本波の
整合回路として構成すれば良く、また出力回路は高調波
周波数でのＦＩＴの出力整合回路として構成するのみで
、基本波成分はカットオフ導波管４で十分阻止される。
整合回路として構成すれば良く、また出力回路は高調波
周波数でのＦＩＴの出力整合回路として構成するのみで
、基本波成分はカットオフ導波管４で十分阻止される。
従って、従来のバラクタダイオードを用いて構成してい
た周波数逓倍路のように特にアイドラ回路は必要としな
いために生産性の良い逓倍回路が構成出来る。
た周波数逓倍路のように特にアイドラ回路は必要としな
いために生産性の良い逓倍回路が構成出来る。
特に、入出力回路を、例えば、マイクロ波ストリップ線
路を使った内部整合回路で構成したいわゆるハイブリッ
ド集積回路で構成した場合でも、カットオフ導波管と９
接続を高調波周波数帯でのトランスジューサとして構成
するのみで、効果的な周波数逓倍回路を簡単に構成する
ことが出来る。
路を使った内部整合回路で構成したいわゆるハイブリッ
ド集積回路で構成した場合でも、カットオフ導波管と９
接続を高調波周波数帯でのトランスジューサとして構成
するのみで、効果的な周波数逓倍回路を簡単に構成する
ことが出来る。
第１図は本発明の一実施例を示すブロック構成図である
。 １・―ｅ電界効果型トラ″ンジスタ（ＦＥＴ）、２・・
・入力整合回路、３・會Φ出力整合回路、４・・・カッ
トオフ導波管 特許出願人 日本電気株式会社 代 理 人 弁理士 熊谷雄太部
。 １・―ｅ電界効果型トラ″ンジスタ（ＦＥＴ）、２・・
・入力整合回路、３・會Φ出力整合回路、４・・・カッ
トオフ導波管 特許出願人 日本電気株式会社 代 理 人 弁理士 熊谷雄太部
Claims (1)
- 電界効果型トランジスタと、入出力整合回路と、入力周
波数で阻止特性を持つカットオフ導波管とを含み、前記
カットオフ導波管を前記出力整合回路の次に接続して、
入力信号分を阻止するように構成されたことを特徴とす
る周波数逓倍器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4499683A JPS59169226A (ja) | 1983-03-16 | 1983-03-16 | 周波数逓倍器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4499683A JPS59169226A (ja) | 1983-03-16 | 1983-03-16 | 周波数逓倍器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59169226A true JPS59169226A (ja) | 1984-09-25 |
Family
ID=12707035
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4499683A Pending JPS59169226A (ja) | 1983-03-16 | 1983-03-16 | 周波数逓倍器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59169226A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63217803A (ja) * | 1987-03-06 | 1988-09-09 | Matsushita Electric Ind Co Ltd | 発振逓倍器 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4928249A (ja) * | 1972-07-10 | 1974-03-13 | ||
| JPS5075350A (ja) * | 1973-11-05 | 1975-06-20 |
-
1983
- 1983-03-16 JP JP4499683A patent/JPS59169226A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4928249A (ja) * | 1972-07-10 | 1974-03-13 | ||
| JPS5075350A (ja) * | 1973-11-05 | 1975-06-20 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63217803A (ja) * | 1987-03-06 | 1988-09-09 | Matsushita Electric Ind Co Ltd | 発振逓倍器 |
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