JPS59189633A - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法

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JPS59189633A
JPS59189633A JP58064719A JP6471983A JPS59189633A JP S59189633 A JPS59189633 A JP S59189633A JP 58064719 A JP58064719 A JP 58064719A JP 6471983 A JP6471983 A JP 6471983A JP S59189633 A JPS59189633 A JP S59189633A
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JP
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film
aluminium
gas
ion etching
resist
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JP58064719A
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English (en)
Inventor
Chuichi Takada
高田 忠一
Katsunori Shimizu
清水 活憲
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Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Publication date
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    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10PGENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P70/00Cleaning of wafers, substrates or parts of devices
    • H10P70/20Cleaning during device manufacture
    • H10P70/27Cleaning during device manufacture during, before or after processing of conductive materials, e.g. polysilicon or amorphous silicon layers
    • H10P70/273Cleaning during device manufacture during, before or after processing of conductive materials, e.g. polysilicon or amorphous silicon layers the processing being a delineation of conductive layers, e.g. by RIE
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10PGENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P50/00Etching of wafers, substrates or parts of devices

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  • Drying Of Semiconductors (AREA)
  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (a)  発明の技術分野 本発明は半導体装置の製造方法に於けるアルば方法に関
する。
(b)  従来技術と問題点 LSI等の半導体装置に於いてはアルミニウム(At)
若しくはAt合金からなる膜配線(以後AA膜配線呼ぶ
)が一般的に用いられる。
該At配線は従来から一般的に、蒸着若しくはスパッタ
リング法により絶縁膜上に形成したAt薄膜(At合金
を含む)を、レジスト膜をマスクにして公知の塩素系ガ
スを用いるリアクティブ−イオンエツチング技術により
パターンニングすることによって形成されていた。
しかしながら該従来方法に於ては、エツチング処理中A
t薄膜の側面(エツチング面)に吸着される活性塩素(
Ct−)によってサイド・エツチング(アンダ拳カット
)を生じたり、又エツチング処理を終ってレジスト・マ
スク膜を除去する迄の間に、主としてレジスト膜に吸着
されている活性塩素(CL−)と水分との反応によって
生じた塩酸(HCl)によってAll膜が溶解され、形
成されたAt配線に虫食い状の欠陥を生ずるという問題
がある。
又At薄膜がシリコン(St)等を含むAt合金からな
る場合は、S量が上記塩素系のガスではAtに比較して
エツチングされにくいために、パターンニングが完成し
た時点で配線パターン間の絶縁膜上に81を上部に有す
るAtの残層が形成され1配線パターン間の電気的な絶
縁分離が不兄全になるという問題もあった。
(c)  発明の目的 不発明は上記問題点の発生を防止するA7膜(At合金
を含む)のパターンニング方法f:提供するものであり
、その目的とするところは特にLSI等高密度化された
半導体装置の歩留まり及び信頼性全向上せしめるにある
(dン 発明の(I11成 即ち本発明は半導体装置の製造方法に於て、アルミニウ
ム、若しくはアルミニウム合金からなる薄膜を、塩素系
のガスによるリアクティブ・イオンエツチングにより選
択的に除去する工程の途中でふつ化炭素系のガスによる
プラズマ処理を行うことを特徴とする。
<8)  発明の実施例 以下本発明全実施例について、図を用いて詳細に説明す
る。
第1図(イ)乃至(へ)は不発明の方法に於ける一実施
例の工程断面図で、第2図は同実施例に用いたリアクテ
ィブ・イオンエツチング装置の模式断面図である。
例えばバイボーンICの製造工程に於いて、本発明の方
法を用いて該ICの配線を形成するに際しては、通常の
製造方法に従って例えば第1図(イ)に示すような機能
素子の形成全完了し、表面の絶縁膜に電極コンタクト・
ホールの形成を終った半導体被処理基板を形成する。な
お第1図(イ)に於て1はシリコン基板、2は分離領域
、3は埋込み拡散層、4はコレクタ領域、5はベース領
域、6はエミッタ領域、7はコレクタ・コンタクト領揄
、8は二酸化シリコン(Stへ)絶縁膜、9a y 9
b #98は電極コンタクト・ホールを示す。
次いで第1図←)に示すように、該被処理基板上に通常
通り蒸着成るいはスパッタリング等の方法を用いて厚さ
1〔μm〕程度のアルミニウム(At)膜10を形成し
、次いで通常のフォト・プロセスにより該At膜10上
に配線パターンニング用のレジスト・マスク膜11を形
成する。なお該レジスト・マスク膜11はネガ型、ポジ
型いずれでも良い。
次いで該被処理基板を第3図に示すような通常のりアク
ティブ晦イオンエツチング装置内に挿入する。なお同図
において、21はエツチング室、22はガス導入管、2
3は真空排気管、24はシールド板、25は陽極、26
は陰極、27はサセプタ、28は絶縁体、29は被処理
基板、3,0はプラズマ、RFは高周波発振器(13,
56い/IHz ])、Gは接地、Wは水冷機構を示し
ている。
そして例えば先ず該エツチング装置のエツチング室21
内へ所定の流量で通常用いられる所定混合比の4塩化炭
素(CC4)と3塩化硼素(BCl、)との混合ガスを
流入し、所?の排気を行って該エツチング室21内の混
合ガスの圧力を通常用いられる圧力例えばO−1(To
 r r 〕程度とし、陽極25とfat $X 26
間に13.56 (MHz 〕400 [W)8度の高
周波パワーを印加し、第1図(ハ)に示すように、レジ
スト・マスク膜11から成田しているAt膜10を例え
ばその厚さの1/2の0.5〜0.6〔μm〕程度リア
すティブΦイオンエツチングする。なおこの際At膜l
Oのエツチング面及びレジス)−マスクg11の表面に
活性塩素(C1−)が吸着される。
ング処理と呼ぶ。
次いで該エツチング室21内のガスを0.3〔Torr
3程度のガス圧を有する例えば4ふつ化炭素(CF4)
と酸素(0,)の混合ガス(0□混合比10〜x2(%
E程度)と置換し、300(W)程度の高周波パワーを
印加し、被処理基板の表面即ちレジスト面及びAt膜の
エツチング面金例えば120(see) 程度プラズマ
処理する。このプラズマ処理により前記レジスト面及び
At膜のエツチング面に吸着されているCt・は叩き出
され、その代りに第1囚に)に示すようにレジスト11
面及びAt膜10のエツチング面には活性化されたふっ
素(F−)が注入される。
次いで再びエツチング室21内のガスを前述した0、1
(Torr3程度の圧力のCCt+とBClsの混合ガ
スに切換え、前記第1回目のりアクティブ・イオンエツ
チングと同一条件で第2回目のリアクテイブ・イオンエ
ツチング処理を施し、第1図(ホ)に示−1ようにレジ
スト・マスク膜11から表出しているAt膜10を底部
(S i O!絶縁膜8面)までエツチングし、該At
膜1oのパターンニングを完了する。
なお該第2回目のリアクティブ゛・イオンエツチング処
理に於て、前記プラズマ処理によって第1回目のりアク
ティブ・イオンエツチング処理で形成されたAt膜10
の四部側面に注入されている活性ふっ素(F−)が、該
側面への活性塩素(Ctりの吸着を阻止する之め、該側
面のエツチングが防止されてアンダカットは減少する。
又前記7ラズマ処理によってレジスト・マスク膜11面
に注入されている活性ふっ素(F’−)は、該レジスト
・マスク膜11への活性塩素<Ct−)の吸着を阻止し
、その吸着量を大幅に減少させる。
次いで上記At膜のパターンニングを終った被処理基板
を例えば通常用いられている円筒型プラズマ装置内へ移
し、通常の酸素(o2)プラズマ処理を施してレジスト
・マスク膜11を灰化除去し、第1図(へ)に示すよう
にS i O2膜8上に電極コンタクト−ホール9a、
9b、9cに於てベース領域5、エミッタ領域6.コレ
クタ・コンタクト領域7にそれぞれ接触するAt膜配線
パターン12a。
12b、12cを形成する。
なお前記CF4+O□によるプラズマ処理によってレジ
スト・マスク膜面注入された活性ふっ素(Fつによって
前述したように第2のりアクティブΦイオンエツチング
処理に於けるレジスト・マスク膜への活性塩素の吸着量
は大幅に減しているので、該レジスト・マスク膜が水分
に接した場合に生成するHClの量は大幅に減少する。
従って第2のりアクティブ・イオンエツチングを終って
から上記レジスト・マスク膜の除去を完了するまでの間
に起るAt膜の腐蝕は従来に比べ大幅に減少し、A/=
膜配線バター/ 12 a s 12 b e 12 
cに虫食い状の欠陥が形成されることが防止される。
以後図示しないが、表面保護絶縁膜の形成等がなされて
、バイポーラICが完成する。
上記実施例に於ては、レジスト・マスク膜の表面及びA
t膜の表出面にふっ素(F−)を吸着せしめるためのC
F、+鳴ガスによるプラズマ処理を、゛リアクティブ・
イオンエツチングの途中に1回だけ行ったがS本発明の
方法に於て該プラズマ処理は1回に限定されるものでは
なく、リアクティブ・イオンエツチングの途中に複数回
に分けて挿入しても良い0又該プラズマ処理をリアクテ
ィブ・イオンエツチングの前後にも付加すれば更に有効
である。
そして該プラズマ処理による効果は、CF4+不活性ガ
スp GHFs * C2F6 、e C5Fa等上記
実施例以外のふつ化炭素系のガスを用いても達成するこ
とができる。
なお又本発明の方法は、多層配線構造に於ける上層At
配線のパターンニングに際しても勿論適用することがで
きる。
又不発明の方法はAt−8i、At−Cu等At合金層
からなる配線パターンを形成する−にも勿論有効でオフ
、更に又At−8t合金配線を形成する際には、上記リ
アクティブ・イオンエツチング処理によってエツチング
されずに析出して米たStがぶつ化炭素系のガスによる
プラズマ処理によりエツチング除去されるので、従来起
っていた上記析出SIMの下部にAt層が残留し配線間
の絶縁分離を不完全にする現象がなくなり、配線間の絶
縁耐圧が向上する。
(f)  発明の詳細 な説明したように本発明によれば、アルミニウム合金を
含むアルミニウム膜配線の形成に際して、サイド−エツ
チングによる配線幅の減少、腐食による虫し食い状膜欠
陥の発生、アルミニウム残層1による配線耐圧の低下等
が防止できる。
従って本発明は、LSI等高密度化された半導体装置の
歩留まり及び信頼性の向上に極めて有効である。
【図面の簡単な説明】
第1図(イ)乃至(へ)は本発明の方法に於ける一実施
例の工程断面図で、第2図は同実施例に用いたりアクテ
ィブ・イオンエツチング装置の模式断面図である。 図に於て、5はベース領域、6はエミッタ領域、7はコ
レクタ・コンタクト領域、8は二酸化シリコン絶縁膜、
9a、9b+9cは電極コンタクト・ホール、10は7
ルミニウム膜、11はレジストeマスク層、12a+1
2b、12cはアルミニウム膜配線パターン、F−は活
性ふつ素、Ct−は活性塩素を示す。 峯 I 閉 136一 番I 詔 拳2阻 RF’=G

Claims (1)

    【特許請求の範囲】
  1. アルミニウム若しくはアルミニウム合金からなる薄膜を
    、塩素系のガスによるリアクティブ・イオンエツチング
    により選択的に除去する工程の途中で、ぶつ化炭素系の
    ガスによるプラズマ処理を行なうことを特徴とする半導
    体装置の製造方法。
JP58064719A 1983-04-13 1983-04-13 半導体装置の製造方法 Pending JPS59189633A (ja)

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EP84302493A EP0122776B1 (en) 1983-04-13 1984-04-12 Dry etching aluminum or aluminum alloy layer
DE8484302493T DE3483847D1 (de) 1983-04-13 1984-04-12 Trockenaetzen von schichten aus aluminium oder aus einer aluminiumlegierung.

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Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62202521A (ja) * 1986-02-28 1987-09-07 Tokyo Denshi Kagaku Kk 有機膜の除去方法及び装置
JPH01215986A (ja) * 1988-02-24 1989-08-29 Hitachi Ltd ドライエッチング方法
JPH047829A (ja) * 1990-04-26 1992-01-13 Sony Corp 多層レジスト層のエッチング方法
US6225602B1 (en) * 1997-05-02 2001-05-01 Advanced Semiconductor Materials International N.V. Vertical furnace for the treatment of semiconductor substrates

Families Citing this family (28)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4592800A (en) * 1984-11-02 1986-06-03 Oerlikon-Buhrle U.S.A. Inc. Method of inhibiting corrosion after aluminum etching
US4668335A (en) * 1985-08-30 1987-05-26 Advanced Micro Devices, Inc. Anti-corrosion treatment for patterning of metallic layers
JPS63268258A (ja) * 1987-04-24 1988-11-04 Nec Corp 半導体装置
US4786359A (en) * 1987-06-24 1988-11-22 Tegal Corporation Xenon enhanced plasma etch
US5290733A (en) * 1988-06-23 1994-03-01 Kabushiki Kaisha Toshiba Method of manufacturing semiconductor devices including depositing aluminum on aluminum leads
US4985113A (en) * 1989-03-10 1991-01-15 Hitachi, Ltd. Sample treating method and apparatus
JP3092185B2 (ja) * 1990-07-30 2000-09-25 セイコーエプソン株式会社 半導体装置の製造方法
JPH04221825A (ja) * 1990-12-24 1992-08-12 Nec Corp 選択ドライエッチング方法
US5217570A (en) * 1991-01-31 1993-06-08 Sony Corporation Dry etching method
DE4107006A1 (de) * 1991-03-05 1992-09-10 Siemens Ag Verfahren zum anisotropen trockenaetzen von aluminium bzw. aluminiumlegierungen enthaltenden leiterbahnebenen in integrierten halbleiterschaltungen
JP3185150B2 (ja) * 1991-03-15 2001-07-09 日本テキサス・インスツルメンツ株式会社 半導体装置の製造方法
US5221424A (en) * 1991-11-21 1993-06-22 Applied Materials, Inc. Method for removal of photoresist over metal which also removes or inactivates corosion-forming materials remaining from previous metal etch
US5533635A (en) * 1994-10-11 1996-07-09 Chartered Semiconductor Manufacturing Pte. Ltd. Method of wafer cleaning after metal etch
JP2953974B2 (ja) * 1995-02-03 1999-09-27 松下電子工業株式会社 半導体装置の製造方法
US5627193A (en) * 1995-02-09 1997-05-06 Mitsui Toatsu Chemicals, Inc. Quinoline-4-carbonylguanidine derivatives, process for producing the same and pharmaceutical preparations containing the compounds
JP2996159B2 (ja) * 1995-10-26 1999-12-27 ヤマハ株式会社 ドライエッチング方法
US5843289A (en) 1996-01-22 1998-12-01 Etex Corporation Surface modification of medical implants
US6033582A (en) * 1996-01-22 2000-03-07 Etex Corporation Surface modification of medical implants
US5780363A (en) * 1997-04-04 1998-07-14 International Business Machines Coporation Etching composition and use thereof
US5965465A (en) * 1997-09-18 1999-10-12 International Business Machines Corporation Etching of silicon nitride
US6150282A (en) * 1997-11-13 2000-11-21 International Business Machines Corporation Selective removal of etching residues
US6033996A (en) * 1997-11-13 2000-03-07 International Business Machines Corporation Process for removing etching residues, etching mask and silicon nitride and/or silicon dioxide
US6200891B1 (en) 1998-08-13 2001-03-13 International Business Machines Corporation Removal of dielectric oxides
US6117796A (en) * 1998-08-13 2000-09-12 International Business Machines Corporation Removal of silicon oxide
CN104810279B (zh) * 2014-01-23 2018-07-10 北大方正集团有限公司 一种铝刻蚀方法及装置
JP7342702B2 (ja) * 2017-06-30 2023-09-12 凸版印刷株式会社 フィルムの処理方法及びフィルムの製造方法
US11062921B1 (en) * 2020-09-11 2021-07-13 Applied Materials, Inc. Systems and methods for aluminum-containing film removal
CN118610075B (zh) * 2024-08-08 2024-10-15 上海陛通半导体能源科技股份有限公司 一种半导体晶圆剥铝返工方法

Family Cites Families (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS54158343A (en) * 1978-06-05 1979-12-14 Hitachi Ltd Dry etching method for al and al alloy
JPS55158275A (en) * 1979-05-28 1980-12-09 Hitachi Ltd Corrosion preventing method for al and al alloy
EP0023429B1 (en) * 1979-07-31 1985-12-18 Fujitsu Limited Dry etching of metal film
US4325984B2 (en) * 1980-07-28 1998-03-03 Fairchild Camera & Inst Plasma passivation technique for the prevention of post-etch corrosion of plasma-etched aluminum films
US4380488A (en) * 1980-10-14 1983-04-19 Branson International Plasma Corporation Process and gas mixture for etching aluminum
US4412885A (en) * 1982-11-03 1983-11-01 Applied Materials, Inc. Materials and methods for plasma etching of aluminum and aluminum alloys

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62202521A (ja) * 1986-02-28 1987-09-07 Tokyo Denshi Kagaku Kk 有機膜の除去方法及び装置
JPH01215986A (ja) * 1988-02-24 1989-08-29 Hitachi Ltd ドライエッチング方法
JPH047829A (ja) * 1990-04-26 1992-01-13 Sony Corp 多層レジスト層のエッチング方法
US6225602B1 (en) * 1997-05-02 2001-05-01 Advanced Semiconductor Materials International N.V. Vertical furnace for the treatment of semiconductor substrates

Also Published As

Publication number Publication date
EP0122776A3 (en) 1987-09-23
EP0122776A2 (en) 1984-10-24
US4547260A (en) 1985-10-15
DE3483847D1 (de) 1991-02-07
EP0122776B1 (en) 1990-12-27

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