JPS59225657A - デ−タ転送方式 - Google Patents

デ−タ転送方式

Info

Publication number
JPS59225657A
JPS59225657A JP10109583A JP10109583A JPS59225657A JP S59225657 A JPS59225657 A JP S59225657A JP 10109583 A JP10109583 A JP 10109583A JP 10109583 A JP10109583 A JP 10109583A JP S59225657 A JPS59225657 A JP S59225657A
Authority
JP
Japan
Prior art keywords
data
random access
access memory
read
rom
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP10109583A
Other languages
English (en)
Inventor
Tamahiko Ishiguro
石黒 玲彦
Hisao Kono
河野 久雄
Shuichi Ashihara
芦原 秀一
Naoki Aihara
直樹 相原
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
Priority to JP10109583A priority Critical patent/JPS59225657A/ja
Publication of JPS59225657A publication Critical patent/JPS59225657A/ja
Pending legal-status Critical Current

Links

Classifications

    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04Q—SELECTING
    • H04Q11/00—Selecting arrangements for multiplex systems
    • H04Q11/04—Selecting arrangements for multiplex systems for time-division multiplexing
    • H04Q11/0407—Selecting arrangements for multiplex systems for time-division multiplexing using a stored program control

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Monitoring And Testing Of Exchanges (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (a)8発明の技術分野 本発明はデータ転送方式に係り、特にディジタル形時分
割電子交換機網の保守用ディジタル・リンク・インタフ
ェイス装置の読み出し専用メモリROMからの立ち上げ
データを読み出し専用メモIJ ROMを交換すること
なく変更するデータ転送方式に関するものである。
(b)、従来技術と問題点 ディジタル形時分割電子交換機網の保守センターには従
来ディジタル・リンク・インクフェイス装置DLIを設
置している。
此のディジタル・リンク・インタフェイス装置DLlは
保守センター内の複数個のマスター監視試験用コンソー
ルMSTCNSと接続され、又監視ずべき多数のディジ
タル形時分割電子交換機と回線を介して接続されている
。
此の様にして、各マスター監視試験用コンソールMST
CNSは自分の管轄するディジクル形時分割電子交換機
を監視、保守している。
又どのマスター監視試験用コンソールM S T CN
Sがどのディジクル形時分割電子交換機を管轄するか等
の組合せはディジタル・リンク・インタフェイス装置D
LIに内蔵されているROMに収容されている。
従ってディジタル・リンク・インタフェイス装置DLI
の電源投入時に、初期立ち上げデータをROMからロー
ドする場合特別に若干此の内容を変更しようとしても変
更は出来ない。是非とも変更したい時はROMを交換す
るしかない。
又Iマ○Mを使用せず外部力ごらのデータで立ち上げよ
うとすると、システムに障害の起きた場合に立ち上げ不
可能となる。此の様にディジタル・リンク・インタフェ
イス装置DLIの電源投入時に初期立ぢ上げデータを一
時若干変更しようと・しても簡単には出来ないと云う欠
点がある。
(C)9発明の目的 本発明の目的は従来技術の有する上記の欠点を除去し、
初期立ち上げデータの変更をROMを交換することなく
容易に行うデータ転送方式を提供することである。
(d)8発明の構成 上記の目的は本発明によれば、ディジクル形時分割電子
交換機網の保□守用ディジクル・リンク・インクフェイ
ス装置Gヒ於いて、読み出し専用メモリに記憶されてい
る初期立ち上げデータを一旦ランダム・アクセス・メモ
リに書込み、外部のセントラル・コントローラにより前
記ランダム・アクセス・メモリ上で前記初期立ち上げデ
ータの変更を行った後前肥立ち上げを行うことを特徴と
するデータ転送方式を提供することにより達成される。
(e)8発明の実施例 図は本発明の一実施例を示すブロック図である。
図中、DLIはディジタル・リンク・インクフェ゛ イ
ス装置でマイクロ・プロセッサMPU1、読み出し専用
メモリROM、及びランダム・アクセス・メモリRAM
Iを具備しており、D 、T’はディジタル・トランク
、MSTCNSはマスター監視試験用コンソール、5S
CNSはシステム監視コンソールでマイクロ・プロセッ
サMPU2とランダム・アクセス・メモリRAM2を具
備しており、CCはセントラル・コントローラ、MTは
磁気テープである。
以下図に従って本発明の詳細な説明ず°る。
ディジタル・リンク・インクフェイス装N D 1.1
の電源を投入する時、読み出し専用メモリROMからの
初期立ち上げデータを一旦ランダム・アクセス・メモリ
RAMIヘロードし、此のランダム・アクセス・メモリ
RAMl0上でセントラル・コントローラccがらの変
更データを折り込んでから立ち上げる。
即ち、セントラル・コントローラccは読み出し専用メ
モリROMからの初期立ち上げデータの変更個所のみの
データを磁気テープMTから読み取り、マスター監視試
験用コンソールS S CN5(7)ランダム・アクセ
ス・メモリRAM2へ転送する。
此のデータをディジタル・リンク・インクフェイス装置
DLIのランダム・アクセス・メモリRAM1へ転送し
、読み出し専用メモリROMからの初期立ち上げデータ
をランダム・アクセス・メモリRAMIの上で修正し、
其の上でディジタル・リンク・インタフェイス装置DL
Iの立ぢ上げを実施する。
(f)8発明の効果 以上詳細に説明した様に本発明によれば、初期立ち上げ
データの変更をROMを交換することなく容易に行うこ
とが出来ると云う大きい効果がある。
【図面の簡単な説明】
図は本発明の一実施例を示すブロック図である。 図中、DLIはディジタル・リンク・インクフェイス装
置でマイクロ・プロセッサMpu1、読y出し専用メモ
リROM、及びランダム・アクセス・メモリRAMIを
具備しており、DTはディジタル・トランク、MSTC
NSはマスター監視試験用コンソール、5SCNSはシ
ステム監視コンソールでマイクロ・プロセッサMPU2
とランダム・アクセス・メモリRAM2を具備しており
、CCはセントラル・コントローラ、MTは磁気テ−プ
である。

Claims (1)

    【特許請求の範囲】
  1. ディジタル形時分割電子交換機網の保守用ディジタル・
    リンク・インクフェイス装置に於いて、読み出し専用メ
    モリに記憶されている初期立ち上げデータを一旦ランダ
    ム・アクセス・メモリに書込み、外部のセントラル・コ
    ントローラにより前記ランダム・アクセス・メモリ上で
    前記初期立ち上げデータあ変更を行った後、前記立ち上
    げを行うことを特徴とするデータ転送方式。
JP10109583A 1983-06-07 1983-06-07 デ−タ転送方式 Pending JPS59225657A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP10109583A JPS59225657A (ja) 1983-06-07 1983-06-07 デ−タ転送方式

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP10109583A JPS59225657A (ja) 1983-06-07 1983-06-07 デ−タ転送方式

Publications (1)

Publication Number Publication Date
JPS59225657A true JPS59225657A (ja) 1984-12-18

Family

ID=14291528

Family Applications (1)

Application Number Title Priority Date Filing Date
JP10109583A Pending JPS59225657A (ja) 1983-06-07 1983-06-07 デ−タ転送方式

Country Status (1)

Country Link
JP (1) JPS59225657A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH07177541A (ja) * 1993-12-16 1995-07-14 Nec Corp 構内交換機

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH07177541A (ja) * 1993-12-16 1995-07-14 Nec Corp 構内交換機

Similar Documents

Publication Publication Date Title
EP0231928A3 (en) Program control circuit
IE820793L (en) Distributed control time division exchange
HK7286A (en) Circuit for transferring signals
CA2166766A1 (en) Page-makeup system
EP0307945A3 (en) Memory control apparatus for use in a data processing system
JPS53134304A (en) Automatic telephone exchange system
CA2051817A1 (en) An arrangement and method of downloading data to a plurality of destinations in a digital telephone system
GB1451881A (en) Digital machine of the optimizer type
US5042030A (en) Apparatus for rearranging signal channels of a multi-loop time-division multiplexed transmission system
CA2055784A1 (en) Hierarchical memory controller
JPS5642868A (en) Access method for common memory in multiprocessor system
CA2001528A1 (en) Circuit arrangement for centrally controlled telecommunication exchanges
JPS6335155B2 (ja)
EP0404132A3 (en) Cpu core suitable for a single-chip microcomputer
JPS54157447A (en) Automatic control unit
GR3019640T3 (en) Circuit arrangement for a central controlled telecommunication exchange, especially a PCM telephone exchange, with a central coordination processor and decentralized terminal groups with group processors
JPS63262994A (ja) 発信規制方式
EP0141984A3 (en) Multiprocessor central control unit for a telephone switching system
JP2754885B2 (ja) Cpu出力データ制御回路
JPS6046919B2 (ja) 分配器
JPS5439529A (en) Transfer control system for magnetic bubble element and the like
JPS5593358A (en) Memory unit operation system for telephone exchange network
JPS6484994A (en) Signal processor
JPS6435568A (en) Multicolor printer
JPS56114185A (en) Memory access control system