JPS5936647U - ステレオ・モノラル切換回路 - Google Patents

ステレオ・モノラル切換回路

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Publication number
JPS5936647U
JPS5936647U JP13216382U JP13216382U JPS5936647U JP S5936647 U JPS5936647 U JP S5936647U JP 13216382 U JP13216382 U JP 13216382U JP 13216382 U JP13216382 U JP 13216382U JP S5936647 U JPS5936647 U JP S5936647U
Authority
JP
Japan
Prior art keywords
stereo
circuit
transistors
multiplier
bases
Prior art date
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Pending
Application number
JP13216382U
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English (en)
Inventor
鈴木　康三
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Toko Inc
Original Assignee
Toko Inc
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Filing date
Publication date
Application filed by Toko Inc filed Critical Toko Inc
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案のステレオ・モノラル切換回路を具えた
ステレオ復調回路の一実施例である。 １ニーフロントエンド、２：中間周波増幅段、３：リミ
ッタ回路、４：ＦＭ検波回路、５：掛算器、６：チョッ
パ回路、７：ステレオ復調回路、８　：３８ＫＨｚスイ
ッチンク信号発生回路、９：Ｌ／ベルシフト回路、１０
：１９ＫＨｚパイロット信号の有無を検出する回路、１
１：制御回路、１２．　１３：負荷回路、１４．１５：
出力端子、１６：電流源回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 掛算器が第１と第２のトランジスタのベース間と第３と
    第４のＮＰＮ　トランジスタのベース間に夫々抵抗が接
    続され、該第１乃至第４のトランジスタのエミッタに抵
    抗が接続され該抵抗の夫々の他端が共通接続された差動
    対からなり、ステレオ複合信号が供給される該掛算器の
    入力端間に第１と第２のＰＮＰトランジスタからなるチ
    ョッパ回路を具えてステレオ復調回路を形成し、ステレ
    オ受信時は該第１と第２のＰＮＰ　トランジスタのベー
    スにステレオ復調信号がレベルシフト回路を介し入力さ
    れ、該レベルシフト回路によって電流源回路に互いのエ
    ミッタを共通接続した第３と第４のＰＮＰ　）ランジス
    タのベースにステレオ復調信号が供給されてレベルシフ
    トされたステレオ復調信号が該チョッパ回路に供給され
    該掛算器に入力されたステレオ複合信号の左信号と右信
    号が分離されるようになされ、且つモノラル受信時は該
    レベルシフト回路の該電流源回路を遮断してステレオ復
    調信号のチョッパ回路への供給を断つと共に、該掛算器
    をなす２つのトランジスタ対の一つを遮断することを特
    徴とするステレオ・モノラル切換回路。
JP13216382U 1982-08-31 1982-08-31 ステレオ・モノラル切換回路 Pending JPS5936647U (ja)

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JPS5936647U true JPS5936647U (ja) 1984-03-07

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