JPS5960991A - 照明パタ−ン制御装置 - Google Patents
照明パタ−ン制御装置Info
- Publication number
- JPS5960991A JPS5960991A JP57172249A JP17224982A JPS5960991A JP S5960991 A JPS5960991 A JP S5960991A JP 57172249 A JP57172249 A JP 57172249A JP 17224982 A JP17224982 A JP 17224982A JP S5960991 A JPS5960991 A JP S5960991A
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- JP
- Japan
- Prior art keywords
- lighting
- illumination
- pattern
- patterns
- control device
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
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- Circuit Arrangement For Electric Light Sources In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、例えば体育節および競技場のアリーナ照明等
に用いられる照明パターン制阻方法に関する。
に用いられる照明パターン制阻方法に関する。
一般に、体育館、競技場等は多１」的に使用されること
か多く、その使用のずル様は多様である。例えば体育館
においてバスケア１’、バレー、テニス等の公式戦を１
−」なう場合は中火のコートを用いることか多く、士た
、練習の際はバスケットコートの半面を１利いたり、体
育館の′−Ｉ／、而または１／４面等１部に設けられた
コート、卓球台等を用いることか多い。このように種々
の態（７１ｔで使用される館内をγ：３時全ａ目的Ｖこ
照明することは省電力の見地から好ましくない。そこで
使用の状況に１底、じて必要な箇所を必要な照度で照明
する照明パターン制御が行なわれる。
か多く、その使用のずル様は多様である。例えば体育館
においてバスケア１’、バレー、テニス等の公式戦を１
−」なう場合は中火のコートを用いることか多く、士た
、練習の際はバスケットコートの半面を１利いたり、体
育館の′−Ｉ／、而または１／４面等１部に設けられた
コート、卓球台等を用いることか多い。このように種々
の態（７１ｔで使用される館内をγ：３時全ａ目的Ｖこ
照明することは省電力の見地から好ましくない。そこで
使用の状況に１底、じて必要な箇所を必要な照度で照明
する照明パターン制御が行なわれる。
従来の照明パターン制御装置として第１崗の構成のもの
が知られている。同図において、１は主操作盤、２（２
，、・、２ｎ）は端末装置、３は１云送線、４は照明装
置、５は電力線である。
が知られている。同図において、１は主操作盤、２（２
，、・、２ｎ）は端末装置、３は１云送線、４は照明装
置、５は電力線である。
主操作盤１は、この主操作な１に１全体の動作を制御す
るマイクロプロセッサ等の中央処理装置（ＣＰＵ）１１
と、各種の照明パターンがプログラマブルに記憶される
メモリ１２と、メモリ１２に記憶された照明パターンと
１対１に対応する照明パターン選択スイッチ１３とを具
備し、スイッチ１３により選択された照明パターンに従
って各端末装置２１゜、２１１に１１′Ｊ１分割ナイク
リノクに制御指令を送出する。
るマイクロプロセッサ等の中央処理装置（ＣＰＵ）１１
と、各種の照明パターンがプログラマブルに記憶される
メモリ１２と、メモリ１２に記憶された照明パターンと
１対１に対応する照明パターン選択スイッチ１３とを具
備し、スイッチ１３により選択された照明パターンに従
って各端末装置２１゜、２１１に１１′Ｊ１分割ナイク
リノクに制御指令を送出する。
端末装置２は、この端末装置２全体の動作を制御するマ
イクロプロセッサ等の中央処理装置（ＣＰＵ ）２１と
、このＣＰＵ ２１によって駆動されるマダイ・ノドコ
ンダクタ２２（２２Ｉ、・・）を具備し、主操作盤１か
らの制御指令に従ってマクネットコンダクタ２２をオン
またはオフする。この各マグネットコンダクタ２２は一
方の端子が商用電源等の電力線５に接続され、他方の端
子には照明装置４ｆｆ：構成する照明ユニノｌ−４１（
４１８，・・・＋ ４１１１ ）が１個ずつ接ｒ売され
ている１、）このため、各照明ユニｙ ｔ・４１ 、・
・・、４１は、主操作盤１がらの指令によって各個独立
に制御され点灯または消灯されテ、選択スイッチ１３に
より選択された照明パターンでの照明がｊ″Ｊなわ九る
。
イクロプロセッサ等の中央処理装置（ＣＰＵ ）２１と
、このＣＰＵ ２１によって駆動されるマダイ・ノドコ
ンダクタ２２（２２Ｉ、・・）を具備し、主操作盤１か
らの制御指令に従ってマクネットコンダクタ２２をオン
またはオフする。この各マグネットコンダクタ２２は一
方の端子が商用電源等の電力線５に接続され、他方の端
子には照明装置４ｆｆ：構成する照明ユニノｌ−４１（
４１８，・・・＋ ４１１１ ）が１個ずつ接ｒ売され
ている１、）このため、各照明ユニｙ ｔ・４１ 、・
・・、４１は、主操作盤１がらの指令によって各個独立
に制御され点灯または消灯されテ、選択スイッチ１３に
より選択された照明パターンでの照明がｊ″Ｊなわ九る
。
ところて、このような照明パターン制御が行なわれるア
リーナ照明等の照明装置においては各照明ユニットまた
は照明灯群ごとに使用頻度が異なり、このため各照明ユ
ニットまたは照明灯Ｈ羊ごとにノ」命または光束低下が
アンバランスとなり照明効果か損なわれたり、寿命の来
た照明灯を常時チェックしなければならないという不都
合があった。
リーナ照明等の照明装置においては各照明ユニットまた
は照明灯群ごとに使用頻度が異なり、このため各照明ユ
ニットまたは照明灯Ｈ羊ごとにノ」命または光束低下が
アンバランスとなり照明効果か損なわれたり、寿命の来
た照明灯を常時チェックしなければならないという不都
合があった。
本発明の目的は、上述の従来形における問題点に鑑み、
所望の照明バターノＶｃ月応してこの照明パターンを重
複使用しない照明灯で補正するような照明パターンすな
わちコンプリメンタリな予備照明パターンを設は所望の
照明パターンすなわち主照明パターンと予備照明パター
ンの使用時間とを同じにするという構想に２１（づき、
各照明灯ユニットまたは照明灯８１間の寿命ｔ６よび光
束低下のアンバランスを低威し、より効果的なパターン
照明を得ることにある。
所望の照明バターノＶｃ月応してこの照明パターンを重
複使用しない照明灯で補正するような照明パターンすな
わちコンプリメンタリな予備照明パターンを設は所望の
照明パターンすなわち主照明パターンと予備照明パター
ンの使用時間とを同じにするという構想に２１（づき、
各照明灯ユニットまたは照明灯８１間の寿命ｔ６よび光
束低下のアンバランスを低威し、より効果的なパターン
照明を得ることにある。
上記目的を達成するために本発明では、多数の照明ユニ
ットからなる照明装置上、これらの照明ユニットを独立
にオンオフするスイッチと、複数の照明パターンが格納
されたメモリ手段と、これらの照明パターンのうち所望
のものを選択する選択手段と、前記スイッチをこの選Ｉ
Ｒさ八た照明パターンに７．ｊ＜づく組み合わせでオン
オフ制御する制御卸装置とを具備し、前記照明装置を種
々の照明パターンで点灯せしめる照明パターン制ｉｆｆ
＋＋装置において、前記メモリ手段に前記選択手段によ
り同時に選択される山数の照明パターンを記ＩＱさせる
とともに、同時に選択された複数の照明パターンそれぞ
れの使几ｊ時間を均等に切り換えて１つの照明パターン
のみを前記制御装置ＶｃＪｊえるタイマ手段とを設けた
ことを特徴とする。
ットからなる照明装置上、これらの照明ユニットを独立
にオンオフするスイッチと、複数の照明パターンが格納
されたメモリ手段と、これらの照明パターンのうち所望
のものを選択する選択手段と、前記スイッチをこの選Ｉ
Ｒさ八た照明パターンに７．ｊ＜づく組み合わせでオン
オフ制御する制御卸装置とを具備し、前記照明装置を種
々の照明パターンで点灯せしめる照明パターン制ｉｆｆ
＋＋装置において、前記メモリ手段に前記選択手段によ
り同時に選択される山数の照明パターンを記ＩＱさせる
とともに、同時に選択された複数の照明パターンそれぞ
れの使几ｊ時間を均等に切り換えて１つの照明パターン
のみを前記制御装置ＶｃＪｊえるタイマ手段とを設けた
ことを特徴とする。
以下図面を用いて本発明の詳細な説明する。
第２図は本発明の１実施例に係る照明バターノ制韻ｊ装
置の構成を示す。同図の装置は第１図の照明パターン制
御卸装置に対し、選択スイッチ１３の各スイッチＰ１．
・・＋Ｐｎに１対１に対応する主照明パターンのそれぞ
れについて後に例示するようなコンプリメンタリな１ま
たは２以上のＴ−θ１′１）照明パターンが格納される
第２のメモリ手段６１と、主照明パターンおよび各予備
照明パターンの使用時間を計時し、これらの各照明パタ
ーンの使用時間か均雪化されるように切り換えるタイマ
６２とをイ・］加したものである。
置の構成を示す。同図の装置は第１図の照明パターン制
御卸装置に対し、選択スイッチ１３の各スイッチＰ１．
・・＋Ｐｎに１対１に対応する主照明パターンのそれぞ
れについて後に例示するようなコンプリメンタリな１ま
たは２以上のＴ−θ１′１）照明パターンが格納される
第２のメモリ手段６１と、主照明パターンおよび各予備
照明パターンの使用時間を計時し、これらの各照明パタ
ーンの使用時間か均雪化されるように切り換えるタイマ
６２とをイ・］加したものである。
上述の予（１：：ｉ照明バター７とは例えは主照明パタ
ーンか第３１スに示すように、■印の照明ユニットで構
成さえしる用台はＸ印の照明ユニットで構成照トリ］パ
ターンである。また、同図において主照明パターンを○
印の照明ユニットのいずれかを組み合わせて構成した場
合は例、えは主照明バター／に用いられた（つ印の照明
、ユニットに−ｒ接するＸ印の照明ユニットを組み合わ
せて主照明パターンと同様の照明効果を有するものを予
備照明パターンとする。
ーンか第３１スに示すように、■印の照明ユニットで構
成さえしる用台はＸ印の照明ユニットで構成照トリ］パ
ターンである。また、同図において主照明パターンを○
印の照明ユニットのいずれかを組み合わせて構成した場
合は例、えは主照明バター／に用いられた（つ印の照明
、ユニットに−ｒ接するＸ印の照明ユニットを組み合わ
せて主照明パターンと同様の照明効果を有するものを予
備照明パターンとする。
また、第４図のように４つの照明灯群についての主照明
バター７と予備照明バターノとの関係は例えばＦ表のよ
うに設定することができる。
バター７と予備照明バターノとの関係は例えばＦ表のよ
うに設定することができる。
また、第５図においてＥｌが主照明バター７を構成する
照明ユニットであるときは予０１１１照明バター７とし
てはＥ２を用いればよく、またＥＩＥ２か主照明バター
７要素であればＡ２Ｉ＋、Ｂ１１（２、Ｂ ２１−１
、、Ｃ＋ Ｇ ２、Ｄ２１ｉ”、等を予備照明パターン
に用いるとよい。
照明ユニットであるときは予０１１１照明バター７とし
てはＥ２を用いればよく、またＥＩＥ２か主照明バター
７要素であればＡ２Ｉ＋、Ｂ１１（２、Ｂ ２１−１
、、Ｃ＋ Ｇ ２、Ｄ２１ｉ”、等を予備照明パターン
に用いるとよい。
なお、予備］照明バターノとしては上述の例に限定され
ることなく、照明効果を考慮し、または被照明の配置を
例えば体育館の１／４面を練習に用いる場合はこの使用
する曲を一定［］時ごとに移動させるなどの方法と組み
合わせて適宜選択することができる。
ることなく、照明効果を考慮し、または被照明の配置を
例えば体育館の１／４面を練習に用いる場合はこの使用
する曲を一定［］時ごとに移動させるなどの方法と組み
合わせて適宜選択することができる。
第６図は第２図の照明バター７制御装置におけるメモリ
１２および６１の構成を示す。メモリ１２および６１は
例えば１つの４ビｙ トＲＡＭで構成され、第６図に示
すように、第１のアドレスには選択スイッチ番号Ｐ１＋
・・ｌＰＦ％第２のアドレスの上位３ビツトには主照
明バター／および第１〜６のｒ・備照明バター７のいず
れであるかを示すノζターノ番弓″０〜７、この第２の
アドレスの下位１ヒ゛７トには当該パターン番号で示さ
れる照明バター７の使用時間が同一のスイッチ番号を有
する照明パターンのうちで最も短い場合にセットされる
フラグが、第３のアドレスには当該照明ノくターノの使
用時間、そして第４のアドレス以下にはそれぞれの端１
〈装置２．、・＋ ２ｎに送出する点灯または消灯情報
が各端末装置の４つの負荷に対応するヒ゛ノドの１ 、
Ｏで格納されている。なお、このメモリ構成は端東装
置がそれぞれ４つの照明ユニットをオフオフする場合で
ＲＪｖＪとして４ビツトのものを用いた場合の１例であ
り、当業者の知識をもってすれば如何ようにも設定しう
るものである。
１２および６１の構成を示す。メモリ１２および６１は
例えば１つの４ビｙ トＲＡＭで構成され、第６図に示
すように、第１のアドレスには選択スイッチ番号Ｐ１＋
・・ｌＰＦ％第２のアドレスの上位３ビツトには主照
明バター／および第１〜６のｒ・備照明バター７のいず
れであるかを示すノζターノ番弓″０〜７、この第２の
アドレスの下位１ヒ゛７トには当該パターン番号で示さ
れる照明バター７の使用時間が同一のスイッチ番号を有
する照明パターンのうちで最も短い場合にセットされる
フラグが、第３のアドレスには当該照明ノくターノの使
用時間、そして第４のアドレス以下にはそれぞれの端１
〈装置２．、・＋ ２ｎに送出する点灯または消灯情報
が各端末装置の４つの負荷に対応するヒ゛ノドの１ 、
Ｏで格納されている。なお、このメモリ構成は端東装
置がそれぞれ４つの照明ユニットをオフオフする場合で
ＲＪｖＪとして４ビツトのものを用いた場合の１例であ
り、当業者の知識をもってすれば如何ようにも設定しう
るものである。
次に第２図の照明パターン制御装置の作用を説明する。
主操作盤１において図示しない点灯スイッチか１−人」
になると、ＣＰＵ １１は選択スイッチ１３により設定
されている選択スイッチ番号に対応するメモリエリアを
検索し、第２のアドレスのフラグを検音してこのフラグ
か′１″である照明ノくターノ番□弓を選択する。以後
は、割込等により他の情報か入力されるまで当該バター
７番号の第４〜Ｉ〕＋３のアドレスの情報を順次読み収
っては対応する端末装′ｌ′！ｔ、に送出する。各端末
装置２は主操作盤１からの情報に従って各マグネットコ
ンダクタ２２をオフまたはオフし照明ユ、ニット４１を
点灯または消灯して照明装置４をバター７照明する。
になると、ＣＰＵ １１は選択スイッチ１３により設定
されている選択スイッチ番号に対応するメモリエリアを
検索し、第２のアドレスのフラグを検音してこのフラグ
か′１″である照明ノくターノ番□弓を選択する。以後
は、割込等により他の情報か入力されるまで当該バター
７番号の第４〜Ｉ〕＋３のアドレスの情報を順次読み収
っては対応する端末装′ｌ′！ｔ、に送出する。各端末
装置２は主操作盤１からの情報に従って各マグネットコ
ンダクタ２２をオフまたはオフし照明ユ、ニット４１を
点灯または消灯して照明装置４をバター７照明する。
次に主操作盤ｌにおいて前記点灯スイッチを［９ｊにす
ると、ＣＰＵ １１は各端末装置２に消灯指令を送した
後、タイマ６２かも経過時間を読み収り、直前まで読み
収りを繰り返していた）くターノ番−じ−の時間エリア
にこの経過時間を累計し、このパターン番号と同一選択
スイッチ番号のもののうち記録されている時間の最も短
い照明パターンを検出してそのフラグをセットするとと
もに他のフラグをリセットする。各端末装置２において
は前記消灯指令に栽づきマグネットコンダクタをオフし
て照明装置４をオフする。
ると、ＣＰＵ １１は各端末装置２に消灯指令を送した
後、タイマ６２かも経過時間を読み収り、直前まで読み
収りを繰り返していた）くターノ番−じ−の時間エリア
にこの経過時間を累計し、このパターン番号と同一選択
スイッチ番号のもののうち記録されている時間の最も短
い照明パターンを検出してそのフラグをセットするとと
もに他のフラグをリセットする。各端末装置２において
は前記消灯指令に栽づきマグネットコンダクタをオフし
て照明装置４をオフする。
前記屯灯スイッチが「人」の状態すなわち点灯状態にお
いて選択スイッチ１３が押下されると、ＣＰＵ１ｌ内の
レジスタにわまたな選択スイッチ情報が設定される。次
いで前述の消灯時と同様に経過時間の読み収り、累計、
最短使ｊ［１時間フラグのセット等を行なった後、前述
の点灯時と同様にして新だに選択された照明パターンで
照明装置を点灯する。
いて選択スイッチ１３が押下されると、ＣＰＵ１ｌ内の
レジスタにわまたな選択スイッチ情報が設定される。次
いで前述の消灯時と同様に経過時間の読み収り、累計、
最短使ｊ［１時間フラグのセット等を行なった後、前述
の点灯時と同様にして新だに選択された照明パターンで
照明装置を点灯する。
以上のように本発明Ｖこよると、１つの選択に対して複
数の照明バター７が用意され、これらの複数の照明パタ
ーンを均等に使用するようにしたため、これらの複数の
照明パターンを相互にコンプリメンタリに選定すること
により各照明ユニットの寿命および光束低下が均一化さ
れ、照明効果が損なわれることが少なくなる。また、寿
命が均一化される結果、ランプ交換をまとめて行なうこ
とができるため、メインテナンスが容易になる。
数の照明バター７が用意され、これらの複数の照明パタ
ーンを均等に使用するようにしたため、これらの複数の
照明パターンを相互にコンプリメンタリに選定すること
により各照明ユニットの寿命および光束低下が均一化さ
れ、照明効果が損なわれることが少なくなる。また、寿
命が均一化される結果、ランプ交換をまとめて行なうこ
とができるため、メインテナンスが容易になる。
第１図は従来の照明パターン制御装置の概略を示すブ０
７り構成図、第２図は本発明の１実施例に係る照明パタ
ーン制御装置の概略を示すブロック構成図、第３〜５図
は本発明におけるコンプリメンタリな予備パターンを説
明するだめの照明ユニットもしくは照明灯群の配置図、
そして第６図は第２図におけるメモリの構成図である。 １・・主操作盤、 ２・・端末装置、 ３・・伝送
線、４・・照明装置、１２・・メモリ、 １３・・照明パターン選択スイッチ ２２・・・マグネットコンダクタ、４１・・照明ユニッ
ト６１・・メモリ、 ６２・・タイマ。 ｓ３図 喰４ｒｙＪ ）１６しＩ 第 ５ ｉｔ１
７り構成図、第２図は本発明の１実施例に係る照明パタ
ーン制御装置の概略を示すブロック構成図、第３〜５図
は本発明におけるコンプリメンタリな予備パターンを説
明するだめの照明ユニットもしくは照明灯群の配置図、
そして第６図は第２図におけるメモリの構成図である。 １・・主操作盤、 ２・・端末装置、 ３・・伝送
線、４・・照明装置、１２・・メモリ、 １３・・照明パターン選択スイッチ ２２・・・マグネットコンダクタ、４１・・照明ユニッ
ト６１・・メモリ、 ６２・・タイマ。 ｓ３図 喰４ｒｙＪ ）１６しＩ 第 ５ ｉｔ１
Claims (1)
- 【特許請求の範囲】 １ 多数の照明ユニットからなる照明装置と、４れらの
照明ユニットを独立にオンオフするスイッチと、複数の
照明パターンが格納されたメモリ手段と、これらの照明
バター／のうち所望のものを選択する選択手段と、前記
スイツチヤこの選択された照明パターンに基づく組み合
わせてオ／メ゛フ制御する制御装置とを具備し、前記照
明装置を種々の照明パターンで点灯せしめる照明パター
ン制御装置において、 前記メモリ手段に前記選択手段により同時に選択ちれる
複数の照明パターンを記憶させるとともに、同時に選択
された複数の照明パターンそれぞれの使用１１Ｊｊ間を
均等にすＪり換えて１つの照明パターンのみを前記制御
装置に与えるタイマ手段とを設けたことを特徴とする照
明パターン制御装置。 ２ 前記複数の照明パターンは相Ｉ′ｆｉにほぼ同一の
照明効果を有するとともに重複使用されない照明ユニッ
トを相捕的に含んでいる特許請求の範囲第１項記載の照
明パターン制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57172249A JPS5960991A (ja) | 1982-09-30 | 1982-09-30 | 照明パタ−ン制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57172249A JPS5960991A (ja) | 1982-09-30 | 1982-09-30 | 照明パタ−ン制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5960991A true JPS5960991A (ja) | 1984-04-07 |
| JPH024119B2 JPH024119B2 (ja) | 1990-01-26 |
Family
ID=15938383
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57172249A Granted JPS5960991A (ja) | 1982-09-30 | 1982-09-30 | 照明パタ−ン制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5960991A (ja) |
-
1982
- 1982-09-30 JP JP57172249A patent/JPS5960991A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPH024119B2 (ja) | 1990-01-26 |
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