JPS5963926A - 半導体集積回路の電源制御装置 - Google Patents
半導体集積回路の電源制御装置Info
- Publication number
- JPS5963926A JPS5963926A JP57174915A JP17491582A JPS5963926A JP S5963926 A JPS5963926 A JP S5963926A JP 57174915 A JP57174915 A JP 57174915A JP 17491582 A JP17491582 A JP 17491582A JP S5963926 A JPS5963926 A JP S5963926A
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- Japan
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- control device
- power
- turned
- control
- voltage
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明の半導体集積回路の電源制御装置はシステムに電
源を投入する際および電源を遮断する際に起こるシステ
ムの異常動作を防止するだめのシステム電源投入遮断方
法に関するものである〇従来例の構成とその問題点 従来は第１図に示すように、マイクロコンピュータなど
の制御素子１からの制御信号によシ作動するシステムで
は、主電源スイッチ２をＯＮ動作した場合、整流器、平
滑用コンデンサなどより成る整流平滑回路３を介して直
流電源ライン４は第２図のように徐々に立ち上がシ、所
定の電圧ｖ１（ｖ）となる。そして時間ｔ１以内に制御
素子１が初期設定を終え、処理部５に命令信号を与える
０処理部５はその信号にしたがって出力するわけである
が、時間ｔ１以前は処理部２は非制御の状態となる。そ
の間、処理部２の出力はＨ状態であるかＬ状態であるか
未決定の状態となっている。つまわ、制御素子１がまた
初期設定されていないからであるＯＨ状態であれば、イ
ンバータ６を通して、リレーコイル７が動作してモータ
などよ構成る負荷部分８が駆動してしまう。すなわち、
時間食、内は予期される動作とは違なった異常動作が起
こシ得るわけである。また、主電源スイッチ２を第３図
の時間ｔ２でＯＦＦ動作した場合、直流電圧ライン４は
図のように徐々に立ち下がってくる０制御部１の最低動
作電圧がＶ２（Ｖ）であれば、時間ｔ３以降は処理部６
は非制御の状態であシ、電源投入時と同様に異常動作が
起こシ得るわけである。またシステムが機能の異なる処
理部を複数個持つような複雑なものであればあるほど異
常動作は起こシやすくなるわけである。
源を投入する際および電源を遮断する際に起こるシステ
ムの異常動作を防止するだめのシステム電源投入遮断方
法に関するものである〇従来例の構成とその問題点 従来は第１図に示すように、マイクロコンピュータなど
の制御素子１からの制御信号によシ作動するシステムで
は、主電源スイッチ２をＯＮ動作した場合、整流器、平
滑用コンデンサなどより成る整流平滑回路３を介して直
流電源ライン４は第２図のように徐々に立ち上がシ、所
定の電圧ｖ１（ｖ）となる。そして時間ｔ１以内に制御
素子１が初期設定を終え、処理部５に命令信号を与える
０処理部５はその信号にしたがって出力するわけである
が、時間ｔ１以前は処理部２は非制御の状態となる。そ
の間、処理部２の出力はＨ状態であるかＬ状態であるか
未決定の状態となっている。つまわ、制御素子１がまた
初期設定されていないからであるＯＨ状態であれば、イ
ンバータ６を通して、リレーコイル７が動作してモータ
などよ構成る負荷部分８が駆動してしまう。すなわち、
時間食、内は予期される動作とは違なった異常動作が起
こシ得るわけである。また、主電源スイッチ２を第３図
の時間ｔ２でＯＦＦ動作した場合、直流電圧ライン４は
図のように徐々に立ち下がってくる０制御部１の最低動
作電圧がＶ２（Ｖ）であれば、時間ｔ３以降は処理部６
は非制御の状態であシ、電源投入時と同様に異常動作が
起こシ得るわけである。またシステムが機能の異なる処
理部を複数個持つような複雑なものであればあるほど異
常動作は起こシやすくなるわけである。
発明の目的
本発明は上記の欠点を解消するためになされたもので、
電源投入時は制御素子が初期設定を終えた後に制御部に
直流電圧を印加し、電源遮断時は制御素子が制御機能を
失う前に制御部への電圧印加を遮断することによってシ
ステムの異常動作を解消するものである。
電源投入時は制御素子が初期設定を終えた後に制御部に
直流電圧を印加し、電源遮断時は制御素子が制御機能を
失う前に制御部への電圧印加を遮断することによってシ
ステムの異常動作を解消するものである。
発明の構成
本発明の半導体集積回路の電源制御装置は、マイクロコ
ンピュータ等の制御素子からの信号によシ直流電源ライ
ンを開閉する償イッチ素子およびリレーなどの制御装置
と、この制御装置によシ制御される負荷部分とよシなシ
、電源投入時に前記制御素子が初期設定を終えた後に制
御部に直流電圧を面加し、また電源遮断時には制御素子
が制御機能を失う前に制御部への電圧印加を遮断するよ
うにしたものである。
ンピュータ等の制御素子からの信号によシ直流電源ライ
ンを開閉する償イッチ素子およびリレーなどの制御装置
と、この制御装置によシ制御される負荷部分とよシなシ
、電源投入時に前記制御素子が初期設定を終えた後に制
御部に直流電圧を面加し、また電源遮断時には制御素子
が制御機能を失う前に制御部への電圧印加を遮断するよ
うにしたものである。
実施例の説明
以下、本発明をその一実施例を示す添付図面の第４図、
第５図を参考に説明する。第４図において、１は主電源
スイッチ、２は整流平滑回路、３は主電源スイッチ１に
連動して動作するＤＣ電源スイッチ、４は回路動作を制
御する制御素子、６は制御素子４からの命令信号を受け
、その信号に応じて出力信号を出す処理部で不揮発メモ
リを内蔵している。６は制御素子４からの信号によって
開閉動作する制御スイッチ、ｆは処理部６の出力に応じ
てＯＮ 、ＯＦＦ動作するリレーコイル、８は直流電源
ライン、９はリレーコイル７のＯＮ動作によって駆動す
るモータなどの負荷部である。
第５図を参考に説明する。第４図において、１は主電源
スイッチ、２は整流平滑回路、３は主電源スイッチ１に
連動して動作するＤＣ電源スイッチ、４は回路動作を制
御する制御素子、６は制御素子４からの命令信号を受け
、その信号に応じて出力信号を出す処理部で不揮発メモ
リを内蔵している。６は制御素子４からの信号によって
開閉動作する制御スイッチ、ｆは処理部６の出力に応じ
てＯＮ 、ＯＦＦ動作するリレーコイル、８は直流電源
ライン、９はリレーコイル７のＯＮ動作によって駆動す
るモータなどの負荷部である。
上記構成において、次にその動作について説明する。主
電源スイッチ１をＯＮ動作すると、それに連動してＤＣ
電源スイッチ３が投入される。すると、制御素子４と処
理部５には整流平滑回路２を通して直流電圧が加わり動
作を開始する。制御御素子４の命令信号によシ、処理部
５の不揮発メモリよシデータが制御素子４に転送され、
それが終った時、制御素子４が初期状態となシ、処理部
６に回路の一連の動作命令信号を出せる状態となる。
電源スイッチ１をＯＮ動作すると、それに連動してＤＣ
電源スイッチ３が投入される。すると、制御素子４と処
理部５には整流平滑回路２を通して直流電圧が加わり動
作を開始する。制御御素子４の命令信号によシ、処理部
５の不揮発メモリよシデータが制御素子４に転送され、
それが終った時、制御素子４が初期状態となシ、処理部
６に回路の一連の動作命令信号を出せる状態となる。
そして制御スイッチ６に信号を与え、制御スイッチ６は
その信号によってＯＮ動作し、ここでようやく直流電源
ライン８に電圧が加わシ、処理部５の出力によシリレー
コイル７が動作し、負荷部９が駆動するわけである。次
に主電源スイッチ１をＯＦＦ動作すると、それに連動し
てＤＣ電源スイッチ３がＯＦＦ動作し、直流電源ライン
８の電圧が０（ｖ）となるため、リレーコイル７は即座
にＯＦＦ状態となる。次に上記の内容を第５図によシ説
明する。第５図において、時間ｔ１は主電源スイッチ１
を投入した時刻であシ、時間ｔ２は制御素子４が初期設
定を終えて制御動作を開始する時刻であり、時間ｔ３は
主電源スイッチ１をＯＦＦ動作した時の時刻である。図
は直流電源ライン８の電圧変化を示している。第６図ａ
はＤＣ電源スイッチ３と制御スイッチ６がなく、電源ラ
インが短絡状態になっている′□場合で、電源投入時は
時間ｔ２以前に直流電圧ライン８に電圧が加わるため、
処理部６の出力状態によってはリレーコイル７がＯＮ動
作することがあシ得る。また、電源遮断後も直流電源ラ
イン８に電圧がかかるため、リレーコイル７がＯＮ動作
することがあシ得る。第５図すは制御スイッチ６のみが
ついている場合で、時間ｔ２以前は０（Ｖ）であるが、
時間ｔ３以後は電圧がかかる。第６図ＣはＤＣ電源スイ
ッチ３のみがついている場合で時間ｔ３以後は０（ｖ）
となるが、時間ｔ２以前は電圧がかかる。第５図ｄはＤ
Ｃ電源スイッチ３と制御スイッチ６両方ともついている
場合で、時間ｔ２以前＋ １．以後とも０（ｖ）となシ
、制御素子４が制御可能な時間ｔ２〜ｔ３の間のみ直流
電源ライン８に電圧がかかり、異常動作は起こシ得ない
。
その信号によってＯＮ動作し、ここでようやく直流電源
ライン８に電圧が加わシ、処理部５の出力によシリレー
コイル７が動作し、負荷部９が駆動するわけである。次
に主電源スイッチ１をＯＦＦ動作すると、それに連動し
てＤＣ電源スイッチ３がＯＦＦ動作し、直流電源ライン
８の電圧が０（ｖ）となるため、リレーコイル７は即座
にＯＦＦ状態となる。次に上記の内容を第５図によシ説
明する。第５図において、時間ｔ１は主電源スイッチ１
を投入した時刻であシ、時間ｔ２は制御素子４が初期設
定を終えて制御動作を開始する時刻であり、時間ｔ３は
主電源スイッチ１をＯＦＦ動作した時の時刻である。図
は直流電源ライン８の電圧変化を示している。第６図ａ
はＤＣ電源スイッチ３と制御スイッチ６がなく、電源ラ
インが短絡状態になっている′□場合で、電源投入時は
時間ｔ２以前に直流電圧ライン８に電圧が加わるため、
処理部６の出力状態によってはリレーコイル７がＯＮ動
作することがあシ得る。また、電源遮断後も直流電源ラ
イン８に電圧がかかるため、リレーコイル７がＯＮ動作
することがあシ得る。第５図すは制御スイッチ６のみが
ついている場合で、時間ｔ２以前は０（Ｖ）であるが、
時間ｔ３以後は電圧がかかる。第６図ＣはＤＣ電源スイ
ッチ３のみがついている場合で時間ｔ３以後は０（ｖ）
となるが、時間ｔ２以前は電圧がかかる。第５図ｄはＤ
Ｃ電源スイッチ３と制御スイッチ６両方ともついている
場合で、時間ｔ２以前＋ １．以後とも０（ｖ）となシ
、制御素子４が制御可能な時間ｔ２〜ｔ３の間のみ直流
電源ライン８に電圧がかかり、異常動作は起こシ得ない
。
発明の効果
上記実施例よシ明らかなように、本発明の半導体集積回
路の電源制御装置は交流を整流平滑して与えられた直流
を電源とするマイクロコンピュータなどの制御素子と、
この制御素子からの信号により直流電殊ラインを開閉す
るスイッチ素子およびリレーなどの制御装置と、この制
御装置によシ制御されるモータなどの負荷部分よフ構成
され、電源投入時に前記制御素子が動作可能となる初期
状態となった後にスイッチ素子をＯＮ動作させるもので
あるから、電源投入時の負荷部分の異常動作を防ぐこと
ができる。また電源遮断時には制御素子が制御機能を失
う前に、制御装置への電圧供給を遮断させるものである
から、電源遮断時に起こシ得る負荷部分の異常動作を防
ぐことができるなど種々の利点を有するものである。
路の電源制御装置は交流を整流平滑して与えられた直流
を電源とするマイクロコンピュータなどの制御素子と、
この制御素子からの信号により直流電殊ラインを開閉す
るスイッチ素子およびリレーなどの制御装置と、この制
御装置によシ制御されるモータなどの負荷部分よフ構成
され、電源投入時に前記制御素子が動作可能となる初期
状態となった後にスイッチ素子をＯＮ動作させるもので
あるから、電源投入時の負荷部分の異常動作を防ぐこと
ができる。また電源遮断時には制御素子が制御機能を失
う前に、制御装置への電圧供給を遮断させるものである
から、電源遮断時に起こシ得る負荷部分の異常動作を防
ぐことができるなど種々の利点を有するものである。
第１図は従来のシステムの電気ブロック図、第２図、第
３図は直流電源ラインの変化図、第４図は本発明の一実
施例における電源制御装置の電気ブロック図、第６図ａ
、ｂ、ｃ、ｄは種々の場合の直流電源ラインの変化図で
ある。 ２・・・・・・整流平滑回路、４・・・・・・制御素子
、５・・・・・・処理部、６・・・・・・制御スイッチ
、７・・・・・・リレーコイル、８・・・・・・直流電
源ライン、９・・・・・・負荷部。
３図は直流電源ラインの変化図、第４図は本発明の一実
施例における電源制御装置の電気ブロック図、第６図ａ
、ｂ、ｃ、ｄは種々の場合の直流電源ラインの変化図で
ある。 ２・・・・・・整流平滑回路、４・・・・・・制御素子
、５・・・・・・処理部、６・・・・・・制御スイッチ
、７・・・・・・リレーコイル、８・・・・・・直流電
源ライン、９・・・・・・負荷部。
Claims (1)
- 交流を整流平滑して与えられた直流を電源とするマイク
ロコンピュータなどの制御素子と、この制御素子からの
信号によ如直流電源ラインを開閉スルスイッチ素子およ
びリレーなどの制御装置と、この制御装置によシ制御さ
れるモータなどの負荷部分よシ構成され、電源投入時に
前記制御素子が動作可能となる初期状態となった後にス
イッチ素子をＯＮ動作させて、前記制御装置へ電圧を供
給させるシステム電源制御装置を設けた半導体集積回路
の電源制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57174915A JPS5963926A (ja) | 1982-10-04 | 1982-10-04 | 半導体集積回路の電源制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57174915A JPS5963926A (ja) | 1982-10-04 | 1982-10-04 | 半導体集積回路の電源制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5963926A true JPS5963926A (ja) | 1984-04-11 |
Family
ID=15986924
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57174915A Pending JPS5963926A (ja) | 1982-10-04 | 1982-10-04 | 半導体集積回路の電源制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5963926A (ja) |
-
1982
- 1982-10-04 JP JP57174915A patent/JPS5963926A/ja active Pending
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