JPS62138902A - マイクロコンピユ−タ - Google Patents
マイクロコンピユ−タInfo
- Publication number
- JPS62138902A JPS62138902A JP60279525A JP27952585A JPS62138902A JP S62138902 A JPS62138902 A JP S62138902A JP 60279525 A JP60279525 A JP 60279525A JP 27952585 A JP27952585 A JP 27952585A JP S62138902 A JPS62138902 A JP S62138902A
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- JP
- Japan
- Prior art keywords
- microcomputer
- output transistor
- voltage
- output
- power
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は機器制御用のマイクロコンピュータに関する。
従来の技術
近年様々の機器にマイクロコンピュータが応用されてい
るが、マイクロコンピュータを応用することによって生
じる特有の問題が存在する。即ち、マイクロコンピュー
タは電源電圧が所定のレベルに達するまでは動作が確定
せず、電源投入時に誤動作する可能性がある。
るが、マイクロコンピュータを応用することによって生
じる特有の問題が存在する。即ち、マイクロコンピュー
タは電源電圧が所定のレベルに達するまでは動作が確定
せず、電源投入時に誤動作する可能性がある。
従来この誤動作を防止するために、マイクロコンピュー
タが確実に動作する電圧に電源電圧が達するまで、マイ
クロコンピュータに接続される外部負荷駆動部を動作さ
せないようにするとともに、外部リセット端子を制御す
るための電源投入時誤動作防止回路が必要でめった。
タが確実に動作する電圧に電源電圧が達するまで、マイ
クロコンピュータに接続される外部負荷駆動部を動作さ
せないようにするとともに、外部リセット端子を制御す
るための電源投入時誤動作防止回路が必要でめった。
また、最近、パワーオンリセット回路がマイクロコンピ
ュータに内蔵されたものが開発されているが、この場合
マイクロコンピュータのシーケンスはリセットされて確
実に動作が開始されるが、電源電圧がクロック発振開始
電圧以下でパワーオンリセットが確定する以前は出力端
子の状態が不確定であるため、やけシ同様の対策が必要
となる。
ュータに内蔵されたものが開発されているが、この場合
マイクロコンピュータのシーケンスはリセットされて確
実に動作が開始されるが、電源電圧がクロック発振開始
電圧以下でパワーオンリセットが確定する以前は出力端
子の状態が不確定であるため、やけシ同様の対策が必要
となる。
発明が解決しようとする問題点
このような電源投入時における誤動作を防止するために
は前述のような電源投入時誤動作防止回路が必要であシ
、一般的にその回路構成は複雑なものになる。またこの
ような回路構成の場合、マィクロコンピュータによって
負荷を直接駆動することができず、何らかのバッファを
介しかつこのバッファを電源投入時誤動作防止回路によ
って制御するという構成になる。
は前述のような電源投入時誤動作防止回路が必要であシ
、一般的にその回路構成は複雑なものになる。またこの
ような回路構成の場合、マィクロコンピュータによって
負荷を直接駆動することができず、何らかのバッファを
介しかつこのバッファを電源投入時誤動作防止回路によ
って制御するという構成になる。
このように従来の技術では部品点数の増加およびそれに
よる回路全体のスペースファクタの低下による不経済性
が問題となっている。
よる回路全体のスペースファクタの低下による不経済性
が問題となっている。
本発明は上記のような問題点を解消し、マイクロコンピ
ュータ内部で電源投入時の誤動作防止を行うようにした
ものである。
ュータ内部で電源投入時の誤動作防止を行うようにした
ものである。
問題点を解決するための手段
そこで本発明は、マイクロコンピュータ内部において、
外部出力端子に接続される出力トランジスタと、この出
力トランジスタのゲートと電源ラインの正側または負側
との間に抵抗を設けて接続し、マイクロコンピータの電
源電圧がクロック発振開始電圧以下であってその動作が
確定されない状態であっても出力トランジスタの導通ま
たは非導通を確定させ、電源投入時においても誤動作し
ないマイクロコンピュータを提供するものである。
外部出力端子に接続される出力トランジスタと、この出
力トランジスタのゲートと電源ラインの正側または負側
との間に抵抗を設けて接続し、マイクロコンピータの電
源電圧がクロック発振開始電圧以下であってその動作が
確定されない状態であっても出力トランジスタの導通ま
たは非導通を確定させ、電源投入時においても誤動作し
ないマイクロコンピュータを提供するものである。
作 用
上記抵抗を設けることにより、出力トランジスタ前段の
出力信号制御部がクロック発振電圧以下で誤動作したと
しても、この抵抗があるために出力トランジスタのゲー
トには出力信号制御部の信号がその出力インピーダンス
とこの抵抗とで分圧された電圧しか印加されなくなる。
出力信号制御部がクロック発振電圧以下で誤動作したと
しても、この抵抗があるために出力トランジスタのゲー
トには出力信号制御部の信号がその出力インピーダンス
とこの抵抗とで分圧された電圧しか印加されなくなる。
従ってこの分圧された電圧が出力トランジスタのスレシ
ョウルド電圧以上または以下とするために必要なマイク
ロコンピュータの電源電圧がクロック発振開始電圧以上
、即ちマイクロコンピュータの動作が確定する電圧以上
となるように抵抗および出力信号制御部の出力インピー
ダンスの値を設計すれば、電源投入時における出力トラ
ンジスタの導通および非導通を確実に制御することがで
きる。
ョウルド電圧以上または以下とするために必要なマイク
ロコンピュータの電源電圧がクロック発振開始電圧以上
、即ちマイクロコンピュータの動作が確定する電圧以上
となるように抵抗および出力信号制御部の出力インピー
ダンスの値を設計すれば、電源投入時における出力トラ
ンジスタの導通および非導通を確実に制御することがで
きる。
実施例
第１図に本発明の第１の実施例を示す。本実施例は電源
投入時においても出力トランジスタが非導通となる場合
の例である。１はマイクロコンピュータから外部負荷へ
接続される外部出力端子、２は外部出力端子１に接続さ
れる出力トランジスタ、３は出力トランジスタ２のゲー
トと電源ラインの負荷との間に接続される半導体によシ
構成された抵抗、４は出力トランジスタ２のゲート電位
を制御する出力信号制御部で、等価回路的には図に示す
ように信号源５と出力インピーダンス６の直列接続によ
ってあられされる。
投入時においても出力トランジスタが非導通となる場合
の例である。１はマイクロコンピュータから外部負荷へ
接続される外部出力端子、２は外部出力端子１に接続さ
れる出力トランジスタ、３は出力トランジスタ２のゲー
トと電源ラインの負荷との間に接続される半導体によシ
構成された抵抗、４は出力トランジスタ２のゲート電位
を制御する出力信号制御部で、等価回路的には図に示す
ように信号源５と出力インピーダンス６の直列接続によ
ってあられされる。
今、出力トランジスタ２のゲート・ソース間の電圧を図
に示すようにｖＧｓｌ とすると、電源投入時におけ
るこの電圧の動きは第２図のようになる。
に示すようにｖＧｓｌ とすると、電源投入時におけ
るこの電圧の動きは第２図のようになる。
第２図において、ｖＭはマイクロコンピータの電源電圧
、ｖｘはクロック発振開始電圧、’ＴＨハ出力トランジ
スタ２のスレショウルド電圧、■ＤＤは電源安１定時の
電圧を示す。
、ｖｘはクロック発振開始電圧、’ＴＨハ出力トランジ
スタ２のスレショウルド電圧、■ＤＤは電源安１定時の
電圧を示す。
第２図において、ｖＧｓｌは出力信号制御部４がクロッ
ク発振開始電圧以前に誤動作して出力トランジスタ２を
導通させるようハイレベルの信号を出力している場合を
示す。第１図に示すように、ｖＧｓｌは出力信号制御部
４の出力インピーダンス６と抵抗３とによって分圧され
る電圧にしかならないため、第２図のように非常に小さ
い値となｌ”ｒａを越えることはなく、従って出力トラ
ンジスタ２は導通しない。また、ｖＭがＶｘを越えると
マイクロコンピュータの動作が確定するので、出力信号
制御部４の出力は、出力トランジスタ２を非導通とする
ためにロウレベルの信号を出力するので、出力トランジ
スタ２は導通することはない。
ク発振開始電圧以前に誤動作して出力トランジスタ２を
導通させるようハイレベルの信号を出力している場合を
示す。第１図に示すように、ｖＧｓｌは出力信号制御部
４の出力インピーダンス６と抵抗３とによって分圧され
る電圧にしかならないため、第２図のように非常に小さ
い値となｌ”ｒａを越えることはなく、従って出力トラ
ンジスタ２は導通しない。また、ｖＭがＶｘを越えると
マイクロコンピュータの動作が確定するので、出力信号
制御部４の出力は、出力トランジスタ２を非導通とする
ためにロウレベルの信号を出力するので、出力トランジ
スタ２は導通することはない。
このように本実施例ではたとえ出力トランジスタ２前段
の出力信号制御部４がクロック発振開始電圧に誤動作し
ても外部出力端子１の信号レベルはロウレベルになるこ
とはない。
の出力信号制御部４がクロック発振開始電圧に誤動作し
ても外部出力端子１の信号レベルはロウレベルになるこ
とはない。
また通常の動作中に出力トランジスタ２を導通させたい
場合はプログラムによって出力信号制御部４よシハイレ
ベルの信号が出力されるが、この場合、マイクロコンピ
ュータの電源電圧は充分ｖＧｓ１をＶｎμ上にできるよ
う高くなっている（第２図のｖＧｓ１破線延長部分）の
で必要なときには確実に出力トランジスタ２を導通させ
て外部出力端子１の信号レベルをロウレベルにすること
ができる。
場合はプログラムによって出力信号制御部４よシハイレ
ベルの信号が出力されるが、この場合、マイクロコンピ
ュータの電源電圧は充分ｖＧｓ１をＶｎμ上にできるよ
う高くなっている（第２図のｖＧｓ１破線延長部分）の
で必要なときには確実に出力トランジスタ２を導通させ
て外部出力端子１の信号レベルをロウレベルにすること
ができる。
第３図に本発明の第２の実施例を示す。この第２の実施
例は電源投入時においても出力トランジスタ２を導通さ
せるためのもので、第１図の第１の実施例と異なる点は
抵抗７が出力トランジスタ２のゲートと電源ラインの正
側に接続されていることである。また第」図の例とは逆
に電源投入直後に出力トランジスタ２を導通状態にする
ため、電源電圧がクロック発振開始電圧に達してからは
出力信号制御部４はハイレベルを出力する。また本実施
例における出力トランジスタ２のゲート・ソース間の電
圧をｖＧｓ２とあられす。
例は電源投入時においても出力トランジスタ２を導通さ
せるためのもので、第１図の第１の実施例と異なる点は
抵抗７が出力トランジスタ２のゲートと電源ラインの正
側に接続されていることである。また第」図の例とは逆
に電源投入直後に出力トランジスタ２を導通状態にする
ため、電源電圧がクロック発振開始電圧に達してからは
出力信号制御部４はハイレベルを出力する。また本実施
例における出力トランジスタ２のゲート・ソース間の電
圧をｖＧｓ２とあられす。
今、クロック発振開始電圧以前に出力信号制御部４が誤
動作してロウレベルを出力したと仮定したときの電源投
入時のｖＧｓ２の動きを第４図に示ヨウルド電圧である
。第３図に示すようにｖＧｓ２は抵抗７と出力信号制御
部４の出力インピーダンス６とで分圧されるので、ｖＧ
ｓ２はＶＭがｖＴＨをわずかに越えた時点からｖＴＨを
上回って出力トランジスタ２を導通させる。ｖＭがＶｘ
に達するとマイクロコンピュータの動作が確定するので
、出力信号制御部４は出力トランジスタ２を導通するた
めにハイレベルを出力する。このため出力トランジスタ
２は導通し続ける。
動作してロウレベルを出力したと仮定したときの電源投
入時のｖＧｓ２の動きを第４図に示ヨウルド電圧である
。第３図に示すようにｖＧｓ２は抵抗７と出力信号制御
部４の出力インピーダンス６とで分圧されるので、ｖＧ
ｓ２はＶＭがｖＴＨをわずかに越えた時点からｖＴＨを
上回って出力トランジスタ２を導通させる。ｖＭがＶｘ
に達するとマイクロコンピュータの動作が確定するので
、出力信号制御部４は出力トランジスタ２を導通するた
めにハイレベルを出力する。このため出力トランジスタ
２は導通し続ける。
このように本実施例では出力信号制御部４がたとえ誤動
作したとしても電源電圧がｖＴＨをわずかに上回った時
点で出力トランジスタ２が導通し、外部出力端子１の信
号レベルをロウレベルに固定することができる。
作したとしても電源電圧がｖＴＨをわずかに上回った時
点で出力トランジスタ２が導通し、外部出力端子１の信
号レベルをロウレベルに固定することができる。
この実施例では電源電圧がｖＴＨを越えるまではロウレ
ベルは出力しないが、この電圧は０．７〜１、ｏｖで１
、トライアック等の外部負荷が動作するには低すぎるの
で、システム全体としては電源投入時の誤動作は防止で
きる。
ベルは出力しないが、この電圧は０．７〜１、ｏｖで１
、トライアック等の外部負荷が動作するには低すぎるの
で、システム全体としては電源投入時の誤動作は防止で
きる。
また、出力信号制御部４の出力インピーダンス６は一般
的に非線形で電源電圧が高くなると低くなる。従って電
源電圧が充分高くなった時点で出力トランジスタ２を非
導通にさせるために出力信号制御部４がロウレベルを出
力したとすると、出力インピータンス６が低くなってい
るためｖＧｓ２はｖＴＨよシも充分小さくなシ（第４図
のｖＧｓ２破線延長部分）、確実に出力トランジスタ２
を非導通とさせ、外部出力端子１をハイインピーダンス
状態とさせることができる。
的に非線形で電源電圧が高くなると低くなる。従って電
源電圧が充分高くなった時点で出力トランジスタ２を非
導通にさせるために出力信号制御部４がロウレベルを出
力したとすると、出力インピータンス６が低くなってい
るためｖＧｓ２はｖＴＨよシも充分小さくなシ（第４図
のｖＧｓ２破線延長部分）、確実に出力トランジスタ２
を非導通とさせ、外部出力端子１をハイインピーダンス
状態とさせることができる。
第５図に第１図に示す第１の実施例を利用した応用例を
示す。８は本実施例に示すマイクロコンピュータ、９は
商用電源、１ｏは商用電源９からＤＣｓＶの電源を作る
電源回路、１１はトライアック、１２はトライアック１
１によって動作が制御される負荷、１３はトライアック
１１のゲート回路の電流制限用抵抗で、マイクロコンピ
ュータ８の外部出力端子１に接続されている。１４は電
源スィッチで、商用電源９よシ回路全体への電源の供給
を制御している。
示す。８は本実施例に示すマイクロコンピュータ、９は
商用電源、１ｏは商用電源９からＤＣｓＶの電源を作る
電源回路、１１はトライアック、１２はトライアック１
１によって動作が制御される負荷、１３はトライアック
１１のゲート回路の電流制限用抵抗で、マイクロコンピ
ュータ８の外部出力端子１に接続されている。１４は電
源スィッチで、商用電源９よシ回路全体への電源の供給
を制御している。
トライアック１１はマイクロコンピュータ８の外部出力
端子１がロウレベルになったときのみゲート電流が流れ
て導通し、負荷１２が駆動される。
端子１がロウレベルになったときのみゲート電流が流れ
て導通し、負荷１２が駆動される。
今、電源投入時にこの負荷１２を駆動させたくない場合
は、本発明の第１の実施例を用いることによシ、電源投
入時の誤動作を防止することができる。即ち、電源スィ
ッチ１４を閉じると、その瞬間、トライアック１１と負
荷１２には商用電圧が印加され、トライアック１１にゲ
ート電流が流れると負荷１２が動作する。一方、電源回
路１゜は一定の時定数に従ってマイクロコンピュータ８
用の電源を生成させるが、本実施例を用いるとマイクロ
コンピュータ８の電源がクロック発振開始電圧に達して
確実に動作するまでは外部出力端子１はハイインピーダ
ンスのままでトライアック１１にゲート電流を流すこと
はない。
は、本発明の第１の実施例を用いることによシ、電源投
入時の誤動作を防止することができる。即ち、電源スィ
ッチ１４を閉じると、その瞬間、トライアック１１と負
荷１２には商用電圧が印加され、トライアック１１にゲ
ート電流が流れると負荷１２が動作する。一方、電源回
路１゜は一定の時定数に従ってマイクロコンピュータ８
用の電源を生成させるが、本実施例を用いるとマイクロ
コンピュータ８の電源がクロック発振開始電圧に達して
確実に動作するまでは外部出力端子１はハイインピーダ
ンスのままでトライアック１１にゲート電流を流すこと
はない。
発明の効果
以上述べてきたように、本発明によればマイクロコンピ
ータ内部で確実に電源投入時の誤動作防止を行うことが
でき、非常に有用である。特に負荷がモータやパルプの
ように電気＝機械力変換装置である場合、電源投入時の
誤動作は非常に顕著な現象として現われるのでその効果
は大きい。
ータ内部で確実に電源投入時の誤動作防止を行うことが
でき、非常に有用である。特に負荷がモータやパルプの
ように電気＝機械力変換装置である場合、電源投入時の
誤動作は非常に顕著な現象として現われるのでその効果
は大きい。
また、トライアック等の外部負荷を直接駆動することが
でき、外部に電源投入時の誤動作防止回路も必要としな
いので、経済的効果は大きく、部品点数の削減によるコ
ストメリットやスペースファクタの増大に非常に良い効
果をもたらす。
でき、外部に電源投入時の誤動作防止回路も必要としな
いので、経済的効果は大きく、部品点数の削減によるコ
ストメリットやスペースファクタの増大に非常に良い効
果をもたらす。
第１図は本発明の第１の実施例を示す図、第２図は第１
の実施例における電圧変化特性図、第３図は本発明の第
２の実施例を示す図、第４図は第２の実施例における電
圧変化特性図、第６図は第１の実施例の一応用例を示す
回路図である。 １・・・・・・外部出力端子、２・・・・・・出力トラ
ンジスタ、３．７・・・・・・抵抗、４・・・・・・出
力信号制御部。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名／−
−− クト舒出ｎ巧−す ２−−〜 ま７ｎトランシ′人り 第１図 、３−ｉ１扼 ４−！７アづｇ５＊コ＊ｐｎコ ６−−一う各々ｙ、＃、 第２図 端間 ４−一一出ηづ各号シＨ叶舒 σ−−−傷う系 第４図 Ｍ 間 δ−−−マイクロコンビエータ ゾーーー尚用電バ東 １０−一一電湧、ｔａ路 ／３−−− ′ｆＩＪた例策椙！＆Ｊｌ）／４−−一寛
；來スイ７＋
の実施例における電圧変化特性図、第３図は本発明の第
２の実施例を示す図、第４図は第２の実施例における電
圧変化特性図、第６図は第１の実施例の一応用例を示す
回路図である。 １・・・・・・外部出力端子、２・・・・・・出力トラ
ンジスタ、３．７・・・・・・抵抗、４・・・・・・出
力信号制御部。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名／−
−− クト舒出ｎ巧−す ２−−〜 ま７ｎトランシ′人り 第１図 、３−ｉ１扼 ４−！７アづｇ５＊コ＊ｐｎコ ６−−一う各々ｙ、＃、 第２図 端間 ４−一一出ηづ各号シＨ叶舒 σ−−−傷う系 第４図 Ｍ 間 δ−−−マイクロコンビエータ ゾーーー尚用電バ東 １０−一一電湧、ｔａ路 ／３−−− ′ｆＩＪた例策椙！＆Ｊｌ）／４−−一寛
；來スイ７＋
Claims (1)
- 外部出力端子に接続される出力トランジスタと、この出
力トランジスタのゲートと電源ラインの正側または負側
との間に接続される抵抗とを有し、電源電圧がクロック
発振開始電圧以下で動作が開始されない状態であつても
前記出力トランジスタの導通または非導通が確定される
マイクロコンピュータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60279525A JPS62138902A (ja) | 1985-12-12 | 1985-12-12 | マイクロコンピユ−タ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60279525A JPS62138902A (ja) | 1985-12-12 | 1985-12-12 | マイクロコンピユ−タ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62138902A true JPS62138902A (ja) | 1987-06-22 |
Family
ID=17612235
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60279525A Pending JPS62138902A (ja) | 1985-12-12 | 1985-12-12 | マイクロコンピユ−タ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62138902A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01113704U (ja) * | 1988-01-26 | 1989-07-31 | ||
| JPH03123566A (ja) * | 1989-10-07 | 1991-05-27 | Tokyo Electric Co Ltd | 低周波治療器 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS55118579A (en) * | 1979-03-02 | 1980-09-11 | Toho Gas Kk | Metal melting furnace |
-
1985
- 1985-12-12 JP JP60279525A patent/JPS62138902A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS55118579A (en) * | 1979-03-02 | 1980-09-11 | Toho Gas Kk | Metal melting furnace |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01113704U (ja) * | 1988-01-26 | 1989-07-31 | ||
| JPH03123566A (ja) * | 1989-10-07 | 1991-05-27 | Tokyo Electric Co Ltd | 低周波治療器 |
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