JPS5965382A - 座標入力装置 - Google Patents
座標入力装置Info
- Publication number
- JPS5965382A JPS5965382A JP57173960A JP17396082A JPS5965382A JP S5965382 A JPS5965382 A JP S5965382A JP 57173960 A JP57173960 A JP 57173960A JP 17396082 A JP17396082 A JP 17396082A JP S5965382 A JPS5965382 A JP S5965382A
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- JP
- Japan
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- film
- resistance
- resistive
- resistive film
- input device
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-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/01—Input arrangements or combined input and output arrangements for interaction between user and computer
- G06F3/03—Arrangements for converting the position or the displacement of a member into a coded form
- G06F3/041—Digitisers, e.g. for touch screens or touch pads, characterised by the transducing means
- G06F3/045—Digitisers, e.g. for touch screens or touch pads, characterised by the transducing means using resistive elements, e.g. a single continuous surface or two parallel surfaces put in contact
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- Engineering & Computer Science (AREA)
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- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（技術分野）
本発明は筆記具等の加圧により、加圧位置の座標情報を
検出する座標入力装置に関するものである。
検出する座標入力装置に関するものである。
（背景技術）
文字や図形を電子計算機等に入力する装置、例えば、手
書文字入力装置においてペン位置の座標を検出する装置
として従来から入力板を用いた座標入力装置が用いられ
ている。
書文字入力装置においてペン位置の座標を検出する装置
として従来から入力板を用いた座標入力装置が用いられ
ている。
′第１図と第２図は、従来の座標入力装置の入力盤の１
例を示す断面図とブロック図である。第１図は入力盤の
構成を示す断面図であり１は絶縁膜、２は導体膜、３は
感圧ゴム、４は抵抗膜、５は抵抗膜４より充分小さな抵
抗値をもつ抵抗体で構成される抵抗端子板、６は絶縁基
板の如（構成されている。なお絶縁膜１、導体膜２は可
撓性のあ、る材質で構成されている。
例を示す断面図とブロック図である。第１図は入力盤の
構成を示す断面図であり１は絶縁膜、２は導体膜、３は
感圧ゴム、４は抵抗膜、５は抵抗膜４より充分小さな抵
抗値をもつ抵抗体で構成される抵抗端子板、６は絶縁基
板の如（構成されている。なお絶縁膜１、導体膜２は可
撓性のあ、る材質で構成されている。
第２図は抵抗膜４を中心としたブロック図セあす７〜１
０は抵抗端子板５上に設けられる端子群であり、このう
ち端子７ａ、８ａは端子群７，８の左端の端子、７ｂ、
８ｂは端子群７，８の右端の端子である。
０は抵抗端子板５上に設けられる端子群であり、このう
ち端子７ａ、８ａは端子群７，８の左端の端子、７ｂ、
８ｂは端子群７，８の右端の端子である。
（なお前記各端子群の端子は相隣る端子とほぼ同一間隔
で設けられる。）１１〜１８はスイッチで抵抗端子板５
上の各端子等に第２図の如（接続される。
で設けられる。）１１〜１８はスイッチで抵抗端子板５
上の各端子等に第２図の如（接続される。
１９は直流電源、２０は筆記具、２０ａは筆記具２０で
絶縁膜１を通して加圧される加圧点を示す。第２図に示
すように抵抗膜４の周囲にこの抵抗膜４より充分小さな
抵抗値をもつ抵抗体で構成される抵抗端子板５が電気的
に接続されて配置される。
絶縁膜１を通して加圧される加圧点を示す。第２図に示
すように抵抗膜４の周囲にこの抵抗膜４より充分小さな
抵抗値をもつ抵抗体で構成される抵抗端子板５が電気的
に接続されて配置される。
ここで縦方向の座標を得ようとする場合、あるタイミン
グで各スイッチ１１〜１８の各接点が実線の接続状態に
なった場合、端子群７には端子７ａ及び７ｂも含めて電
圧Ｅ （ＶＥが印加され端子群８には端子８ａ及び８ｂ
も含めて０（Ｖｌに接続され、端子群９及び端子群１０
は開放状態となり、抵抗膜４及び抵抗端子板５の両方共
、上下方向の電位勾配が得られる。
グで各スイッチ１１〜１８の各接点が実線の接続状態に
なった場合、端子群７には端子７ａ及び７ｂも含めて電
圧Ｅ （ＶＥが印加され端子群８には端子８ａ及び８ｂ
も含めて０（Ｖｌに接続され、端子群９及び端子群１０
は開放状態となり、抵抗膜４及び抵抗端子板５の両方共
、上下方向の電位勾配が得られる。
この時の電位差はＥ （ｖｌである。
次のタイミングで各スイッチ１１〜１８の各接点が点線
の接続状態になった場合、端子７ｂ、８ｂ及び端子群１
０には電圧Ｅ （Ｖ）が印加され、端子７ａ、８ａ及び
端子群９にはｏ（Ｑに接続され端子７ａ 、７ｂを除い
た端子群７と端子８ａ、８ｂを除いた端子群８は開放状
態となり抵抗膜４及び抵抗端子板５０両方共右から左へ
の電位勾配が得られる。
の接続状態になった場合、端子７ｂ、８ｂ及び端子群１
０には電圧Ｅ （Ｖ）が印加され、端子７ａ、８ａ及び
端子群９にはｏ（Ｑに接続され端子７ａ 、７ｂを除い
た端子群７と端子８ａ、８ｂを除いた端子群８は開放状
態となり抵抗膜４及び抵抗端子板５０両方共右から左へ
の電位勾配が得られる。
かくして筆記具２０による加圧点２１の縦横方向の座標
は感圧ゴム３を介して導体膜２により電位として得られ
ることとなる。従って、加圧点２１の座標情報を正確に
検出するためには例えば、縦方向すなわち端子群７にＥ
ＣＶＩを、端子群８に。〔■を印加した場合、端子群
７がら端子群８までＥ（Ｖ）がらｏ （ｖｌまでの直線
的な電位勾配が横方向のすべての点で得られなげればな
らない。これは横方向に電圧を加えた場合も同様である
。すなわち、端子板５と抵抗膜４が均一な抵抗値を持つ
ことが要求される。これは抵抗膜の大きさが小さい場合
、比較的問題にならないが抵抗膜が太き（なってくるに
従い、均一な抵抗値を得るのは製造上困難となってくる
。特に幅のせまい端子板よりも全体にぬられる抵抗膜の
方が膜厚管理等製造上の問題で均一な抵抗膜が得られに
くく、更に抵抗膜の部分的な抵抗値のバラツキが膜全体
の電位勾配に影響を及ぼし正確な位置情報が得られな（
なる欠点があった。
は感圧ゴム３を介して導体膜２により電位として得られ
ることとなる。従って、加圧点２１の座標情報を正確に
検出するためには例えば、縦方向すなわち端子群７にＥ
ＣＶＩを、端子群８に。〔■を印加した場合、端子群
７がら端子群８までＥ（Ｖ）がらｏ （ｖｌまでの直線
的な電位勾配が横方向のすべての点で得られなげればな
らない。これは横方向に電圧を加えた場合も同様である
。すなわち、端子板５と抵抗膜４が均一な抵抗値を持つ
ことが要求される。これは抵抗膜の大きさが小さい場合
、比較的問題にならないが抵抗膜が太き（なってくるに
従い、均一な抵抗値を得るのは製造上困難となってくる
。特に幅のせまい端子板よりも全体にぬられる抵抗膜の
方が膜厚管理等製造上の問題で均一な抵抗膜が得られに
くく、更に抵抗膜の部分的な抵抗値のバラツキが膜全体
の電位勾配に影響を及ぼし正確な位置情報が得られな（
なる欠点があった。
（発明の課題）
本発明はこの欠点を除去して電位補正を行った座標入力
装置を提供することを目的とし、その特徴は、面状の抵
抗膜に縦方向および横方向に交互に切替えて通電して抵
抗膜上に位置によって異なる電位面を形成し、感圧ゴム
膜または空隙を介して抵抗膜上に積層された導体膜を加
圧することにより、加圧点に対応する電位を導体膜に導
出する座標入力装置において、前記抵抗膜に比べ又充分
に低い抵抗値であって細長い形吠の抵抗片を、抵抗膜に
接触するようにして縦方向および横方向に格子状に間隔
をあけて配設し、抵抗片の交差部を電気的に接続するこ
とにより抵抗膜の電位勾配を均一にした座標入力装置に
ある。
装置を提供することを目的とし、その特徴は、面状の抵
抗膜に縦方向および横方向に交互に切替えて通電して抵
抗膜上に位置によって異なる電位面を形成し、感圧ゴム
膜または空隙を介して抵抗膜上に積層された導体膜を加
圧することにより、加圧点に対応する電位を導体膜に導
出する座標入力装置において、前記抵抗膜に比べ又充分
に低い抵抗値であって細長い形吠の抵抗片を、抵抗膜に
接触するようにして縦方向および横方向に格子状に間隔
をあけて配設し、抵抗片の交差部を電気的に接続するこ
とにより抵抗膜の電位勾配を均一にした座標入力装置に
ある。
（発明の構成および作用）
第３図は本発明の一実施例を示す入力盤の構成図であり
、第４図で示すような入力盤をＡ、−Ａ’部で切断した
断面図を示す。抵抗膜４には、第４図で示すように端子
板５と同じ程度で抵抗膜４よりは充分低い抵抗値をもつ
細長い抵抗片２１〜２４が格子状に埋め込まれている。
、第４図で示すような入力盤をＡ、−Ａ’部で切断した
断面図を示す。抵抗膜４には、第４図で示すように端子
板５と同じ程度で抵抗膜４よりは充分低い抵抗値をもつ
細長い抵抗片２１〜２４が格子状に埋め込まれている。
又、抵抗膜４と端子板５と抵抗片２１〜２４は互いに接
触する部分では電気的に接続されている。
触する部分では電気的に接続されている。
第４図は本発明の動作をより明確に示すための入力盤部
の平面図であり、感圧ゴム３、絶縁膜１、導体膜２及び
抵抗膜周辺回路結線は簡単のため省略されている。まず
縦方向に電圧を印加する場合、すなわち端子群７にＥ
ＥＶ）、端子群８にｏ（ｖｌを印加した場合、端子板５
と抵抗膜４の縦方向及び抵抗片２１ 、２２にＥＣＶＩ
からＯ（Ｖ）までの電位勾配が生ずる。
の平面図であり、感圧ゴム３、絶縁膜１、導体膜２及び
抵抗膜周辺回路結線は簡単のため省略されている。まず
縦方向に電圧を印加する場合、すなわち端子群７にＥ
ＥＶ）、端子群８にｏ（ｖｌを印加した場合、端子板５
と抵抗膜４の縦方向及び抵抗片２１ 、２２にＥＣＶＩ
からＯ（Ｖ）までの電位勾配が生ずる。
ここで、幅のせまぐ低抵抗な端子板及び抵抗片２１〜２
４は全体に均一な抵抗値にすることは比較的容易である
ので、直線的な電位勾配が得られる。従って縦方向抵抗
片２１ 、２２の電位勾配は同じとなるので抵抗片の横
方向線分２３ 、２４はそれぞれ等電位となる。又抵抗
膜４の抵抗値に対して、端子板５及び抵抗片２１〜２４
は抵抗値が十分低いので抵抗膜４に対し端子板５及び抵
抗片２１〜２４は導体とみなせる。従って、抵抗膜４の
抵抗値不均一による電位の乱れの影響は端子板５及び抵
抗片２１〜２４で決まる電位勾配に殆んど影響しない。
４は全体に均一な抵抗値にすることは比較的容易である
ので、直線的な電位勾配が得られる。従って縦方向抵抗
片２１ 、２２の電位勾配は同じとなるので抵抗片の横
方向線分２３ 、２４はそれぞれ等電位となる。又抵抗
膜４の抵抗値に対して、端子板５及び抵抗片２１〜２４
は抵抗値が十分低いので抵抗膜４に対し端子板５及び抵
抗片２１〜２４は導体とみなせる。従って、抵抗膜４の
抵抗値不均一による電位の乱れの影響は端子板５及び抵
抗片２１〜２４で決まる電位勾配に殆んど影響しない。
例えば抵抗膜４において、斜線部４ａのブロックで抵抗
値が不均一である場合ブロック４ａ内での電位勾配は乱
れて直線的でなくなるが、この乱れは前述の如く、相対
的に導体とみなせる。抵抗片２１〜２４で押えられて他
のブロックの抵抗膜へは影響を及ぼさない。
値が不均一である場合ブロック４ａ内での電位勾配は乱
れて直線的でなくなるが、この乱れは前述の如く、相対
的に導体とみなせる。抵抗片２１〜２４で押えられて他
のブロックの抵抗膜へは影響を及ぼさない。
すなわち抵抗片２１〜２４で分割される抵抗膜４の各ブ
ロック内の電位勾配は、そのブロックに接する抵抗片２
１〜２４の電位とブロック内の抵抗値のバラツキで規定
され、他のブロックの影響を受けない。
ロック内の電位勾配は、そのブロックに接する抵抗片２
１〜２４の電位とブロック内の抵抗値のバラツキで規定
され、他のブロックの影響を受けない。
従って抵抗片２１〜２４の本数を多（とっていくことに
より抵抗膜不均一による電位の誤差は、全体の電位勾配
に対して軽減させることができる。
より抵抗膜不均一による電位の誤差は、全体の電位勾配
に対して軽減させることができる。
次に横方向に電圧を印加した場合、すなわち端子群１０
と７ｂ、８ａにＥ （Ｖ）を印加し端子群９ ｒ ７ａ
＋８ａにＯＣＶＩを印加した場合も同様に抵抗膜４の抵
抗値不均一による電位誤差を軽減させることができる。
と７ｂ、８ａにＥ （Ｖ）を印加し端子群９ ｒ ７ａ
＋８ａにＯＣＶＩを印加した場合も同様に抵抗膜４の抵
抗値不均一による電位誤差を軽減させることができる。
前記実施例において、格子状抵抗体は端子板と同じ抵抗
材料として端子板と一体物として作成してもよいし、０
．１Ω／ｃｍ〜１０Ω／ｃｍ程度の適当な抵抗値を持つ
細い金属線等を抵抗膜に埋め込んでもよい。細いパター
ンが必要な場合は金属線の方が均一な抵抗が得やすい利
点がある。又抵抗膜は普通数十μＩｎと薄いので抵抗片
と電気的に接続されていれば抵抗膜の中に埋め込まな（
ても良く、例えば抵抗片の上に抵抗膜を塗布しても抵抗
膜の上に血抗片を形成しても同様の効果は得られる。更
に抵抗膜が太きくローラー等の形状により、１回の塗布
又は印刷で形成出来ない場合、継ぎ目を抵抗片の上にな
るようにすれは継ぎ足して塗布し大きくすることも簡単
に出来る。
材料として端子板と一体物として作成してもよいし、０
．１Ω／ｃｍ〜１０Ω／ｃｍ程度の適当な抵抗値を持つ
細い金属線等を抵抗膜に埋め込んでもよい。細いパター
ンが必要な場合は金属線の方が均一な抵抗が得やすい利
点がある。又抵抗膜は普通数十μＩｎと薄いので抵抗片
と電気的に接続されていれば抵抗膜の中に埋め込まな（
ても良く、例えば抵抗片の上に抵抗膜を塗布しても抵抗
膜の上に血抗片を形成しても同様の効果は得られる。更
に抵抗膜が太きくローラー等の形状により、１回の塗布
又は印刷で形成出来ない場合、継ぎ目を抵抗片の上にな
るようにすれは継ぎ足して塗布し大きくすることも簡単
に出来る。
（発明の効果）
以上説明したように実施例では、抵抗膜に埋め込んだ抵
抗片を電位勾配としては抵抗片として使用し、抵抗膜に
対しては導体として使用することにより抵抗膜の抵抗値
不均一の影響を軽減せしめるので抵抗膜の製造上非常に
有利となるばかりでな（形の大きな抵抗膜の提供を可能
ならしめるものである。
抗片を電位勾配としては抵抗片として使用し、抵抗膜に
対しては導体として使用することにより抵抗膜の抵抗値
不均一の影響を軽減せしめるので抵抗膜の製造上非常に
有利となるばかりでな（形の大きな抵抗膜の提供を可能
ならしめるものである。
なお、端子群７〜１０の各端子は少な（とも抵抗片２１
〜２４の延長線上に設け、さらに抵抗端子板５０４辺と
に設けることが望ましい。
〜２４の延長線上に設け、さらに抵抗端子板５０４辺と
に設けることが望ましい。
第１図は従来の座標入力装置の入力盤の一例を示す構成
図、第２図は従来の座標入力装置の一例を示すブロック
図、第３図は本発明の一実施例の構成図、第４図は本発
明の一実施例の抵抗膜の詳細図である。 １・・・絶縁膜、 ２・・・導体膜、３・・・
感圧ゴム、 ４・・・抵抗膜、５・・・抵抗端子
板、 ６・・・絶縁基板、７〜１０・・・端子群、
７ａ・・・端子群７の左端の端子、７ｂ・・・端子群７
の右端の端子、 ８ａ・・・端子群８の左端の端子、 ８ｂ・・・端子群８の右端の端子、 １１〜１８・・・スイッチ、 １９・・・直流電源、２
０・・・筆記具、 ２０ａ・・・加圧点、２１〜
２４・・・抵抗片、 Ａ−Ａ’・・・断面箇所。
図、第２図は従来の座標入力装置の一例を示すブロック
図、第３図は本発明の一実施例の構成図、第４図は本発
明の一実施例の抵抗膜の詳細図である。 １・・・絶縁膜、 ２・・・導体膜、３・・・
感圧ゴム、 ４・・・抵抗膜、５・・・抵抗端子
板、 ６・・・絶縁基板、７〜１０・・・端子群、
７ａ・・・端子群７の左端の端子、７ｂ・・・端子群７
の右端の端子、 ８ａ・・・端子群８の左端の端子、 ８ｂ・・・端子群８の右端の端子、 １１〜１８・・・スイッチ、 １９・・・直流電源、２
０・・・筆記具、 ２０ａ・・・加圧点、２１〜
２４・・・抵抗片、 Ａ−Ａ’・・・断面箇所。
Claims (1)
- 面状の抵抗膜に縦方向および横方向に交互に切替えて通
電して抵抗膜上に位置によって異なる電位面を形成し、
感圧ゴム膜または空隙を介して抵抗膜上に積層された導
体膜を加圧することにより、加圧点に対応する電位を導
体膜に導出する座標入力装置において、前記抵抗膜に比
べて十分に低い抵抗値であって細長い形状の抵抗片を、
抵抗膜に接触するようにして縦方向および横方向に格子
状に間隔をあけて配設し、抵抗片の交差部を電気的に接
続することにより抵抗膜の電位勾配を均一にしたことを
特徴とする座標入力装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57173960A JPS5965382A (ja) | 1982-10-05 | 1982-10-05 | 座標入力装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57173960A JPS5965382A (ja) | 1982-10-05 | 1982-10-05 | 座標入力装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5965382A true JPS5965382A (ja) | 1984-04-13 |
| JPH0327936B2 JPH0327936B2 (ja) | 1991-04-17 |
Family
ID=15970233
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57173960A Granted JPS5965382A (ja) | 1982-10-05 | 1982-10-05 | 座標入力装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5965382A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63118921A (ja) * | 1986-11-07 | 1988-05-23 | Nichibei Denshi Kk | 補助電極追加による電気抵抗膜上の電位補償方法 |
-
1982
- 1982-10-05 JP JP57173960A patent/JPS5965382A/ja active Granted
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63118921A (ja) * | 1986-11-07 | 1988-05-23 | Nichibei Denshi Kk | 補助電極追加による電気抵抗膜上の電位補償方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0327936B2 (ja) | 1991-04-17 |
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