JPS5972060U - エラステイツクメモリ - Google Patents

エラステイツクメモリ

Info

Publication number
JPS5972060U
JPS5972060U JP16764082U JP16764082U JPS5972060U JP S5972060 U JPS5972060 U JP S5972060U JP 16764082 U JP16764082 U JP 16764082U JP 16764082 U JP16764082 U JP 16764082U JP S5972060 U JPS5972060 U JP S5972060U
Authority
JP
Japan
Prior art keywords
data
holding
predetermined speed
flip
elastic memory
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP16764082U
Other languages
English (en)
Inventor
須藤 忠之
和夫 山本
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Toshiba Corp
Original Assignee
Toshiba Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Toshiba Corp filed Critical Toshiba Corp
Priority to JP16764082U priority Critical patent/JPS5972060U/ja
Publication of JPS5972060U publication Critical patent/JPS5972060U/ja
Pending legal-status Critical Current

Links

Landscapes

  • Communication Control (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図は従来のエラスティックメモリのブロック図、第
2図はあるデータがエラスティックメモリにより速度変
換された例を示す図、第3図は本考案の実施例を示すブ
ロック図、第4図は第3図の保持手段を示すブロック図
、第5図は第4図を説明するためのタイミングチャート
、第6図は第3図の取出手段を示すブロック図、第7図
は第3図を説明するためのタイミングチャートである。 201・・・保持手段、205・・・取出手段、206
゜211.213,217・・・ゲート回路、207・
・・分周回路、210,212,214,215゜21
6・・・遅延回路。

Claims (3)

    【実用新案登録請求の範囲】
  1. (1)第1の所定速度で伝送されたデータを保持する保
    持手段と、該保持手段からデータを第2の所定速度でn
    ビット毎にブロック化して取り出す取出手段と、該取出
    手段から出力されるデータを入力しこのデータの各ブロ
    ック間に存在するスペース時間分遅延させたデータを作
    り出す遅延手段と、前記取出手段と前記遅延手段との出
    力データから一定の間隔で交互にデータを選択する選択
    手段とを具備したことを特徴とするエラスティックメモ
    リ。
  2. (2)保持手段は、データ保持用のm個のフリップフロ
    ップと、該フリップフロップに動作タイミングを指示す
    るクロックを与える他のフリップフロップとからなるこ
    とを特徴とする実用新案登録請求の範囲第(1)項記載
    のエラスティックメモリ。
  3. (3)取出手段は、ゲート回路と、該ゲート回路の開閉
    を第2の所定速度のクロックに基づいて行なわせる分周
    回路とからなることを特徴とする実用新案登録請求の範
    囲第(1)項又は第(2)項記載のエラスティックメモ
    リ。
JP16764082U 1982-11-04 1982-11-04 エラステイツクメモリ Pending JPS5972060U (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP16764082U JPS5972060U (ja) 1982-11-04 1982-11-04 エラステイツクメモリ

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP16764082U JPS5972060U (ja) 1982-11-04 1982-11-04 エラステイツクメモリ

Publications (1)

Publication Number Publication Date
JPS5972060U true JPS5972060U (ja) 1984-05-16

Family

ID=30366709

Family Applications (1)

Application Number Title Priority Date Filing Date
JP16764082U Pending JPS5972060U (ja) 1982-11-04 1982-11-04 エラステイツクメモリ

Country Status (1)

Country Link
JP (1) JPS5972060U (ja)

Similar Documents

Publication Publication Date Title
JPS5972060U (ja) エラステイツクメモリ
JPS59129249U (ja) 位相連続fs変調回路
JPS60131051U (ja) ウオツチドツグ回路
JPS5957033U (ja) 規定数パルス発生回路
JPS6025241U (ja) ノイズ除去回路
JPS6142155U (ja) 時分割多重信号伝送装置
JPH02116151U (ja)
JPS6144333B2 (ja)
JPS6095737U (ja) クロツク周波数てい倍回路
JPH0377543U (ja)
JPS6068723U (ja) パルス幅フイルタ
JPS59177235U (ja) パルス幅遅延回路
JPH07121019B2 (ja) データ通信方式
JPS5928863U (ja) 磁気デイスク装置のレデイ回路
JPS5857176U (ja) 周波数差の弁別回路
JPS60139342U (ja) 奇数分周回路
JPS58123393U (ja) 電子式タイムスイツチ
JPS5811357U (ja) 出力回路
JPS58169732U (ja) ノイズ防止回路
JPS60103940U (ja) 分周回路
JPS6034628U (ja) 初期設定回路
JPS58178739U (ja) モノステ−ブルマルチバイブレ−タ
JPS5977096U (ja) 振り子付電子報時時計
JPS5991061U (ja) ト−ン検出回路
JPS58191770U (ja) 同期信号発生回路