JPS5980929A - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法

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Publication number
JPS5980929A
JPS5980929A JP57191558A JP19155882A JPS5980929A JP S5980929 A JPS5980929 A JP S5980929A JP 57191558 A JP57191558 A JP 57191558A JP 19155882 A JP19155882 A JP 19155882A JP S5980929 A JPS5980929 A JP S5980929A
Authority
JP
Japan
Prior art keywords
film
aluminum
layer
wiring layer
semiconductor device
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP57191558A
Other languages
English (en)
Inventor
Masahiro Kuwagata
桑形 正博
Hirotsugu Hattori
服部 裕嗣
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electronics Corp
Matsushita Electric Industrial Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Matsushita Electronics Corp, Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electronics Corp
Priority to JP57191558A priority Critical patent/JPS5980929A/ja
Publication of JPS5980929A publication Critical patent/JPS5980929A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10DINORGANIC ELECTRIC SEMICONDUCTOR DEVICES
    • H10D64/00Electrodes of devices having potential barriers
    • H10D64/01Manufacture or treatment
    • H10D64/011Manufacture or treatment of electrodes ohmically coupled to a semiconductor

Landscapes

  • Electrodes Of Semiconductors (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 この発明は半導体装置の製造方法、とくに、半導体基板
上に設けられるアルミニウム膜電極配線層の処理工程を
含む製造方法に関するものである。
従来例の構成とその問題点 半導体基板内に所望の機能素子をそなえた半導体装置は
、配線用電極を設けたのち、これらを被覆するパシベー
ション膜を付設する構造がしばしば用いられる。このパ
シベーション膜は、通常、酸化シリコン膜や窒化シリコ
ン膜が気相蒸着法(以下、CvDと略称する)で形成さ
れるが、製造工程の最終の段階で設けられるので、この
被膜にクラックなどの欠陥が存在すると、以降の工程で
復修することがほとんどできず、経時不良の要因になる
第1図示の従来例半導体装置で詳しくみると、半導体基
板1の表面に選択拡散用の絶縁膜として酸化シリコン膜
2を設け、これに所定の開孔部を形成し、ついでぐこの
開孔部を通じて、基板1とは反対導電型の拡散領域3を
形成し、これにオーミックコンタクトをなすアルミニウ
ム金属配線層4を設けたのち、これらを被覆して、全面
に酸化シリコン膜によるパシベーション膜5を形成した
ものでは、アルミニウム金属配線層4の端部、すなわち
、パターン加工の食刻面と平坦な表面との交差先端6が
鋭くとがっており、これを覆う部分にクラック7が入り
易い。また、り′ラックが入らない首でも、その部分の
厚さが薄くなり、パシベーション膜5はその先端部分に
欠陥ができ易く、信頼性を損なう原因をもっているとも
言える。
発明の目的 この発明は、上述のような半導体装置でパシベーション
膜に欠陥の生じないような処理方法を提供するものであ
り、これによって(半導体装置の信頼性の向上をはかる
ことを主たる目的としたものである。
発明の構成 この発明は、半導体基板上に形成されたアルミニウム膜
を所定電極形状に食刻したのち、真空または不活性ガス
中で高速加熱法によシ熱処理する工程を有する半導体装
置の製造方法を与えるものであり、これによシ、アルミ
ニウム膜は最表面層を瞬間的に溶融状態にし、とがった
先端部分をなだらかな曲面状にすることができ、したが
って、この電極層上にパシベーション膜を形成したとき
に、同パシベーション膜を一様な厚みで付設することが
できる。
実施例の説明 以下に、この発明を実施例により詳しくのべる。
第2図は、この発明の実施例を工程順に示した半導体装
置要部の断面図である。まず、第2図(a)のように、
シリコン基板1の表面に、通常の熱酸化法によって、厚
さ約8ooO入の二酸化シリコン膜2を形成する。そし
て、この二酸化シリコン膜2に周知のホトリソグラフィ
技術で所定の開孔部を設け、ついで、この開孔部を通じ
て、シリコン基板1に対してPN接合を形成するような
不純物を拡散導入し、拡散領域3を形成する。この後、
拡散領域3上にアルミニウム膜の電極配線層4を形成す
る。この段階では、アルミニウム膜電極配線層4は食刻
加工直後で端部6がほぼ直角であり、鋭くとがったまま
の状態である。そこで、次に、このアルミニウム膜に対
して高速加熱法による熱処理を施す。この熱処理として
は、真空中あるいは窒素、アルゴンなどび不活性ガス中
で、カーボン発熱体あるいはキセノンランプから赤外線
(熱線)を発生させ、この熱源で、10秒〜30秒間加
熱する方式が有効である。真空中ないしは不活性ガス中
であれば、アルミニウムの酸化が防止でき、また、短時
間の急速加熱により、半導体基板1内での不純物拡散面
の変動もほとんど起らない。
この熱処理を施すと、第2図(b)のように、アルミニ
ウム膜電極配線層4は溶融によりなだらかな曲面形状に
なる。第2図(C)は、その上にパシベーション膜の二
酸化シリコン膜6を周知のCVD技術によって被設した
ものであシ、このパシベーション膜は、クラワクなどの
欠陥が発生せず、はぼ均一な厚みのものになっている。
第3図および第4図はこの発明の実施によって得られた
他の半導体装置例を示す電極形状の平面図およびそのA
−A’断面図である。この場合、電極配線層が下地層8
と上層のアルミニウム電極層4とで構成されたものであ
る。たとえば、高密度集積回路のように、電極配線層の
間隔Wが小さいと、隣接する両電極線層間で短絡の不良
を起すことがある。そのような不良発生を避ける手段と
して、配線層を二層構造になし、下地層8には食刻加工
性のよい金属を用い、この上にアルミニウム膜電極層4
を形成すると、好適な配線層が形成できる。この場合、
下地層8には、タングステン、チタン、モリブデン、白
金、あるいはタングステン−チタン合金が選ばれる。そ
して、この下地層8に対してアルミニウム膜を積ねて形
成し、これを上述の実施例のように高速加熱法で熱処理
すると、上層のアルミニウム膜のみが溶融し、下地層8
とよくなじみ、また、アルミニウム膜4による配線層間
の短絡不良も起りにくい。しかも、配線層の上層側アル
ミニウム膜表面は急速な加熱処理によってなだらかな曲
面形状になるので、これらの表面にパシベーション膜を
形成したとき、同パシベーション膜の段切れは起らない
発明の効果 以上に詳しくのべたように、この発明によれば、半導体
基板上に形成されたアルジニウム膜を所定電極形状に食
刻したのち、真空または不活性ガス中で高速加熱法によ
り熱処理する工程で、アルミニウム膜電極配線層の表面
がなだらかな曲面形状[;l)、この上にパシベーショ
ン膜を設けたとき、同パシベーション膜はその配線端部
でクラ・ンク等の欠陥が発生せず、半導体装置の信頼性
は顕著に向上する。
【図面の簡単な説明】
第1図は従来例半導体装置の要部断面図、第2図(a)
〜(C)はこの発明の実施例を示す工程順断面図、第3
図および第4図はこの発明の他の実施例で得られる半導
体装置の要部平面図およびそのA−A’断面図である。 1・・・・・・半導体基板、2・・・・・・絶縁膜、3
・・・・・・拡散領域、4・・・・・・アルミニウム膜
電極層、5・・・・・パシベーション膜、6・・・・・
・電極層端部、7・・・・・・クラック、8・・・・・
・下地層。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名第1
図 第3図 第4図

Claims (2)

    【特許請求の範囲】
  1. (1)半導体基板上に形成されたアルミニウム膜を所定
    電極形状に食刻したのち、真空または不活性ガス中で高
    速加熱法によシ熱処理する工程を有する半導体装置の製
    造方法。
  2. (2)アルミニウム膜が半導体基板上に絶縁膜を介して
    設けられたタングステン、チタン、モリブデン、白金か
    ら選ばれた金属層上に形成される特許請求の範囲第1項
    に記載の半導体装置の製造方法。
JP57191558A 1982-10-29 1982-10-29 半導体装置の製造方法 Pending JPS5980929A (ja)

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JPS5980929A true JPS5980929A (ja) 1984-05-10

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7811160B2 (en) 2003-09-24 2010-10-12 Kabushiki Kaisha Tokai Rika Denki Seisakusho Operating device of vehicle air conditioner

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* Cited by examiner, † Cited by third party
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US7811160B2 (en) 2003-09-24 2010-10-12 Kabushiki Kaisha Tokai Rika Denki Seisakusho Operating device of vehicle air conditioner

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