JPS5994964A - クロツク回路 - Google Patents

クロツク回路

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JPS5994964A
JPS5994964A JP58189438A JP18943883A JPS5994964A JP S5994964 A JPS5994964 A JP S5994964A JP 58189438 A JP58189438 A JP 58189438A JP 18943883 A JP18943883 A JP 18943883A JP S5994964 A JPS5994964 A JP S5994964A
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JP
Japan
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signal
address
controlled oscillator
addressable memory
voltage controlled
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JP58189438A
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English (en)
Inventor
デビツド・ヤコブ・スク−ン
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3M Co
Original Assignee
Minnesota Mining and Manufacturing Co
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Publication date
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    • G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
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    • G06K15/12—Arrangements for producing a permanent visual presentation of the output data, e.g. computer output printers using printers by photographic printing, e.g. by laser printers
    • G06K15/1204—Arrangements for producing a permanent visual presentation of the output data, e.g. computer output printers using printers by photographic printing, e.g. by laser printers involving the fast moving of an optical beam in the main scanning direction
    • G06K15/1219—Detection, control or error compensation of scanning velocity or position, e.g. synchronisation

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 技術分野 本発明は、予めプログラムされたシーケンスのレートに
従ってクロック信号を提供するためのクロック回路に関
し、特に予めプログラムされたシーケンスのレートが、
レーザの出力が向けられるミラーの既知の繰返し動作に
、一部は、基づいているような上記の回路に関する。
レーザプリンタは、一様な電荷を受けた光導体にル−プ
からの光を当てることによって、光導体上に静電潜像を
生成する。レーザからの光は、イメージを定義するデー
タ信号に従ってレーザがオンおよびオフしながら、走査
処理のように光導体に当てられる。ある走査線内とその
直前の走査線内の同一点においてレーザのオン／オフが
制御搭れる点は重要である。この動作が精度よく制御さ
れないと、イメージは一様なものでなく、垂直線のため
の像は正しい垂直線とならない。−走査線を作るために
、レーザからの光を光導体に反射する可動ミラーにレー
ザからの光が向けられるような配置が採用されている。
光導体は走査線を横切るような動作をするようにされて
いて各走査に対して光導体の異った部分に光が当るよう
になっている。自己共振走査ミラーは、その高いＱ値の
ために各線走査での再現性が高いのでレーザプリンタの
走査部のための可動ミラーを提供するのには望ましい装
置である。自己共振走査ミラーの固有な安定性は、レー
デに与えられたデータ信号の線間の同期が高精度である
場合には、レーデプリンタの走査装置に使用できる。
共振走査ミラーの、ミラーに与えられる動きの再現性が
良い一方、その動きの速度は正弦波状であり、走査線内
のイメージ領域に一様な空きが必要な場合には、ミラー
の正弦波状速度に一致したレーザの動作のためのイメー
ジ定銭データ信号のクロック処理が必要である。この問
題を解決する従来の方法は、別の光ビームの使用とりｐ
ツク信号を発生するための規則またはグレーティングを
含んでいる。これは煩しい高価な方法である。所望の精
度を得ることができなかった他の方法では、クロックの
レートを制御するために走査ミラーのタコメータ出力を
使用する。このような方法は、タコメータ出力に存在す
る固有の電気的騒音成分およびマイクロフォンの騒音成
分に対する解決を必要とする。
発明の開示 可動ミラーの可変速度に一致するレートのクロック信号
を提供するという問題に対する新しい解決が、本発明に
よって提供される。一部は、ミラーの既知の繰返し動作
に基づく予めデルグラムされたシーケンスのレートを定
翰するデータを記憶するためのアドレス可能メモリを含
むクロック回路が提供される。この回路は、電圧制御発
振器（ＷＯＯ）の動作の周波数を決定するアドレス可能
メモリから得られるデータに基づいて、信号を受信する
ためにアドレス可能メモリに動作上接続された前記ＶＯ
ａも含んでいる。ＶＯＯの出力は、ｖＯａの動作周波数
でりｐツク信号を提供する。ＶＯＯからのり四ツク信号
を受信するために動作上接続されているアドレス生成装
置が備えられ、受信した各クロック信号に対してアドレ
ス信号を提供するために動作する。このアドレス生成装
置は、ｖＣＯの制御のため、アドレス可能メモリからデ
ータを得るため、アドレス可能メモリにアドレス信号を
提供するために動作上接続されている。
本発明の上記の考え方を更に拡張すれば、これらの考え
方は、ミラーがその動作中に予定の点に達したことを示
すスタート信号の生成に続いて起り、ミラーがその動作
中に別の予定の点に到着したことを示すエンド信号が生
成されるまで続く既知のミラーの繰返し動作に、一部は
、基づく、予めプログラムされたシーケンスのレートに
従って連続アドレス信号を生成するための制御回路内で
使用できる。このような回路はアドレス生成装置がリセ
ット入力を有し、ｖＣＯが禁止入力を有する本発明に従
ったクロック回路によって提供される。
電子スイッチ回路が備えられ、ｖｏｏの禁止入力端子と
アドレス生成装置のリセット入力端子に動作上接続され
る。この電子スイッチ回路は、２個の入力端子を有し、
一方はスタート信号を受信し、他方はエンド信号を受信
する。電子スイッチ回路は、エンド信号の受信に応答し
て信号を提供し、この信号はｖＣｏつ禁止入力端子に禁
止信号として印加され、更に、アドレス生成装置に対す
るリセット信号として印加される。この信号は、電子ス
イッチ回路によってスタート信号が受信されると終了す
る。
本発明の更に深い理解は、その新しい機能や利点を含め
て、以降の発明の詳述および添付の図面を考察すること
で得られる。
第１図を参照すれば、これは、レーザプリンタの走査部
分の平面図で、レーデダイオードタイプでもよいレーデ
１とレンズ装置２と、自己共振走査ミラー３と、ミラー
４及び５と光導体６とを備えている。これらの要素は、
第１図の装置の側面図である第２図にも示されている。
光導体６は部分的にのみ示される。しかし、光導体は、
ベルト、ドラムまたは柔軟性のあるシートの形を取り得
るものとする。
レーザ１からの光はレンズ装置２によって共振走査ミラ
ー３上に焦点を合わせられ、この共振走査ミラー３は、
ミラー４に光を当てるように振動し、光がミラー４の縦
方向の走査を行うように動かす。ミラー４に与えられた
光は、ミラー５に向って反射される。このミラー５は、
光導体６上に線走査を提供するために、上述の光を光導
体６に当てるように位置される。光導体６に線単位の走
査を提供するように与えられた光走査を横切るよう光導
体６は動く。光導体６の動きは矢印７で示される。
第１図および第２図の装置においては、レーザは、ある
走査線内と以前の走査線内とでは同一点において、出力
のオン操作またはオフ操作が行われるように制御される
必要がある。この動作での高い精度の制御ができなけれ
ば、光導体で生成さ１ れるイメージは不均一なものとして現われ、垂直線を示
すためのイメージは正確な垂直線とならない。この問題
の解決は、共振走査ミラー３の使用で、部分的に与えら
れる。これは、ミラー３のＱ値が高いために１各線走査
において、ミラー３の動作の再現性が高いからである。
しかし、走査ミラー３の動作速度は正弦波的であるので
、走査線の各端部分での走査は、走査線の中央部分での
走査よりも低い速度で行われる。イメージを定義するデ
ータ信号のレーザ１への供給は、レーザ１に対するオン
／オフ条件を決定するが、この供給は、レーザ１のオン
／オフ制御およびそれ故に、イメージ領域が走査線内で
一様な間隔となるように、走査ミラー３の正弦波状速度
に一致していなければならない。第６図に示すクロック
信号回路は、本発明において、上記のような所望の方法
で、レーザ１のオン／オフ制御のためのイメージ定義デ
ータ信号を提供できるようにするために備えられている
。
第３図のりｐツク回路は、電圧制御発振器８と２ カウンタ９として示されているアドレス生成装置と、フ
リップフロップ回路１０として示されている電子スイッ
チ回路と、アドレス可能メモリ１１と、ディジタル／ア
ナログ変換器１２として示されている信号変換装置とを
含んでいる。
電圧制御発振器（ｖａｏ　）　８は、ＶａＯを、レーザ
１からの光が走査位置のスタートに来た時点から、その
光が走査位置の終りに到着するまで動作させるようにす
るために使用される禁止人力１３のオン／オフを受信す
る。ｖａｏ８は、ｖａｏ８の動作の周波数を制御するた
めの電圧信号を受信するために信号制御入力端子１４も
有している。ＶａＯ８は、１４に入力される信号によっ
て制御される周波数で出力端子１５にクロック信号を提
供する。
カウンタ９はアドレス生成装置として働き、レーザ１か
らの光が走査位置のスタートに来て、ｖｏｏ　Ｂのクロ
ック信号出力１５に接続されたクロック入力端子１７で
クロック信号が受信されるまでカウンタをリセットする
ために使用されるリセット入力端子１６を有している。
カウンタ９の出力端子は、クロック信号が、ｖａｏ８か
らカウンタ９に受信される都度、新しいアドレス信号を
供給するためにアドレスライン１８に接続する。
メモリ１１はアドレス可能メモリであって、共振走査ミ
ラー３の動作周波数と振幅に反映される、共振走査ミラ
ー３の動作速度によって、一部は、決定される、予めデ
四グラムされたシーケンスのレートを定義するデータと
、走査線がスタートする時刻と、ｖａｏ８の転送特性と
、光導体上にイメージとして得られるプリント文字のピ
ッチとが記憶される。メモリ１１はアドレスライン１８
を介し【カウンタ９に接続され、メモリ１１内に記憶さ
れた予めプログラムされたレートがメモリ１１から、出
力ライン１９上に順々に現われるようＫする。
メモリ１１からの出力はディジタル形式なのでメモリ１
１からライン９上への出力は信号変換装置の入力に印加
される。この信号変換装置は第３図内に、ディジタル／
アナログ（Ｄ／Ａ）変換器１２として与えられている。
Ｄ／Ａ変換器１２の出尖端子２０はｖａｏＢの信号制御
入力端子に接続され、メモリ１１内に記憶されたデルグ
ラムに従って種々のレベルで電圧信号を提供するために
働く。
典型的には、メモリ１１に記憶されたデルグラムはｖｏ
ｏ８に対する動作のレートを設定する。このレートは、
走査ミラー３の正弦波状動作に従って、典型的には、走
査線のスタートから増加し、走査線の中央で最大になり
、走査線の終りに近づくにつれて減少する。
第６図ではフリップフリップ１０として示される電子ス
イッチ回路は２個の入力端子２１と２２および１出力端
子２３を有している。出力端子２３はｖｏｏ８の禁止入
力端子１３とカウンタ９のリセット入力端子１６に接続
されている。入力端子２２はフリップフロップ１０のセ
ット入力端子であり、走査信号のスタートを受信するた
めに接続される。即ち、レーザ１からの光が走査位置の
スタートに来たときに提供される信号を受信するために
接続される。この信号はフリップ７０ツブ１０をセット
するように働く。フリップ７０ツブ５ １０をセットすると出力端子２３からの信号が除かれる
が、この出力端子２３はｖｏｏ８の動作を禁止し、カウ
ンタ９をリセットして、ｖｏｏＢおよびカウンタ９の動
作を許可する信号に代えるのに有効である。入力端子２
１はフリップフリップ１０のリセット入力端子であって
、走査信号の終了を受信するために接続される。即ち、
レーザ１からの光が走査位置の終りに達した時に提供さ
れる信号を受信するために接続される。走査終了信号が
７リツプフロツデ１０で受信されると、フリップフロッ
プは出力端子２３に信号を提供するようにリセットされ
るが、この出力端子２３は、カウンタ９のリセットおよ
びｖｏｏ　Ｂの動作の禁止に有効である。この後のクロ
ック信号は７リツプフロツデ１０の出力端子２３からの
禁止信号が除かれるまで生成されない。
メモリ１１にアドレス信号を提供するほかに、カウンタ
９からライン１８へのアドレス信号は、ｖａｏＢによっ
てりｐツク信号が生成される都度レーザ１に対するオン
／オフ条件を設定するイメー６ ジ定義データ信号を得るためにも使用される。カウンタ
９からのアドレス信号のこのような用法は、レーデダイ
オ−Ｐｌに出力が示されているイメージデータメモリ２
４ヘアドレスライン１８を接続することで示される。
走査線信号の終りと走査線信号の始りが提供される方法
は、後者が各走査線に対して同一点で提供されねばなら
ないということを除いては重要でない。第１＠に、走査
線信号の始まりと走査線信号の終りを提供するための便
利な方法を示す。光電変換器２５は光導体６のすぐ上方
で、光導体６０線走査端の始りの内側１．６副の所で、
走査線と一致して位置づけられていて、走査ミラー３が
書込みまたは走査動作を始めて、レーザ１からの光が提
供された時に、レーザ１からの光をミラー５を介して受
信するようにされている。このようにして光が光電変換
器２５に提供されると、走査スタート信号が生成される
。同様に１光電変換装置２７は、光導体のすぐ上方で、
光導体６０線走査端の終りの内側１．３ｃｎ１の所で、
走査線と一致して位置づけられ、走査ミラーが書込みま
たは走査動作の終りに近づいて、レーデ１からの光が提
供された時にレーザ１からの光をミラー５を介して受信
するようにされている。このようにして光が光電変換器
２７に提供されると、走査エンド信号が生成される。走
査ミラーの戻り動作は書込みまたは走査動作としては使
用されないので、レーザ１は適当な回路（図示されてい
ない）によるそのような戻り動作の期間中オフ状態に保
持されるように配置されている。光電変換器２５および
２７は、すぐに利用できる光検出装置でよい。小型の光
検出器を使用した場合、この光検出器はレーデ１からの
シャープな光ビームによって、走査線エンｒ信号および
走査線スタート信号が、各走査線の同一点において高精
度で発生されるようにする。
これまでの記述の明細は説明のためにのみ提供されたも
のであって、本明細書に開示する新しい教示から離れる
ことなく、十分な変更範囲を有しているものである。例
えば、レーデを光源として記述したが、本発明は、変調
可能ないかなる光源とでも使用できる。従って、本発明
の範囲は、特許請求の範囲の定銭にのみ限定されるもの
である。
尚、特許請求の範囲は、本明細書に矛盾しない解釈の範
囲に一致するものである。
【図面の簡単な説明】
第１図はレーザプリンタ装置の走査部分の概略を示した
平面図である。 第２図は第１図に示したレーザプリンタ装置の走査部分
の側面図である。 第３図は第１図および第２図に示したレーザプリンタの
走査部分と共に使用可能な、本発明の実施例であるりｐ
ツク回路の電気的デルツク図である。 符号の説明 １・・・レーザ、３・・・共振走査ミラー、６・・・光
導体、８・・・電圧制御発振器、９・・・アドレス生成
装置、１０・・・電子スイッチ回路、１１・・・アドレ
ス可能メモリ、１３・・・禁止信号入力端子、１６・・
・リセット入力端子、２１．２２・・・入力端子、２４
−・・メモリ。 代理人　浅　村　　　皓 ９

Claims (3)

    【特許請求の範囲】
  1. （１）　　クロック信号を予めプログラムされたシーケ
    ンスのレートに従って提供するためのクロック回路にお
    いて： 前記予めプログラムされたシーケンスのレートを定義す
    るデータを記憶するためのアドレス可能メモリ（１１）
    と； 電圧制御発振器において、該発振器の動作の周波数を決
    定するための前記アドレス可能メモリから得たデータに
    基づいた信号を受信するために前記アドレス可能メモリ
    に動作上接続された前記電圧制御発振器であって、該発
    振器の動作の周波数でりｐツク信号を提供する出力（１
    ５）を有する前記電圧制御発振器（８）と； アドレス生成装置において、前記電圧制御発振器によっ
    て供給される各クロック信号に対してアドレス信号を提
    供するために前記電圧制御発振器の前記出力に動作上接
    続された前記アドレス生成装置であって、該アドレス生
    成装置は前記電圧制御発振器の制御のための前記アドレ
    ス可能メモリからデータを得るために前記アドレス信号
    によって前記メモリ全アドレスするために１前記アＦレ
    ス可能メモリに動作上接続された前記アドレス生成装置
    （９）とを備えた前記りｐツク回路。
  2. （２）可動ミラーと関係して使用される制御回路であっ
    て、前記可動ミラーは予めプログラムされたシーケンス
    のレートに従って連続アドレス信号を生成するために繰
    返し動作を行い、前記予めプログラムされたシーケンス
    のレートは、前記ミラーが前記動作中に予定の点に達し
    たことを示すスタート信号に続いて起り、エンド信号が
    生成されるまで続く前記ミラーの既知の繰返し動作に、
    一部は、基づいているものである制御回路において：前
    記予めプログラムされたシーケンスのレートを定義する
    データを記憶するためのアドレス可能メモリ（１１）と
    ； 電圧制御発振器であって、該発振器の動作の周波数を定
    義するための前記アドレス可能メモリから得たデータに
    基づいた信号を受信するために前記アドレス可能メモリ
    に動作上接続されて且つ禁止信号入力端子（１３）およ
    びり四ツク信号出カ端子（１５）を有する前記電圧制御
    発振器（８）と； アドレス生成装置において、前記電圧制御発振器によっ
    て提供される各クロック信号に対してアドレス信号を提
    供するため前記電圧制御発振器の前記クロック信号出力
    端子（１５）Ｋ動作上接続された前記アドレス生成装置
    であって、前記アドレス生成装置は、前記電圧制御発振
    器の制御のための前記アげレス可能メモリからデータを
    得るために前記アドレス信号によって前記メモリをアド
    レスするために前記アドレス可能メモリに動作的に接続
    されていて、前記アドレス生成装置はリセット入力端子
    （１６）を有している前記アドレス生成装置（９）と； 電子スイッチ回路において、前記電圧制御装置の前記禁
    止信号入力端子と、前記アドレス生成装置の前記リセッ
    ト入力端子とに動作上接続された前記電子スイッチ回路
    であって、該スイッチ回路は前記スタート信号を受信す
    るための入力端子（２２）と、前記エンド信号を受信す
    るための別の入力端子（２１）とを有し、前記電圧制御
    装置と前記アドレス生成装置との動作を禁止するために
    エンド信号の受信に応答して禁止用およびリセット用信
    号を提供し、スタート信号の受信に応答して前記禁止用
    およびリセット用信号を停止する前記電子スイッチ回路
    （１０）とを備えている前記制御回路。
  3. （３）　　レーザ（１）と、既知の繰返し動作を提供す
    るための共振走査ミラーであって前記レーずがらの光が
    更に光導体（６）に伝送されるために自体に向けられる
    前記走査ミラー（３）と、データ信号を定義するイメー
    ジが記憶され前記レーザの制御のため該記憶された信号
    を提供するためにアドレスされるメモリ（２４）とを備
    えたレーザプリンタ装置のためのクロック回路であって
    ニアｒレス可能メモリにおいて、一部は、前記走査ミラ
    ーの前記既知の繰返し動作に基づいて前記予めプログラ
    ムされたシーケンスのレートを定義するデータを記憶す
    る前記アドレス可能メモリ（１１）と； 電圧制御発振器において、該発振器の動作の周波数を決
    定するための前記アドレス可能メモリから得られるデー
    タに基づいて信号を受信するために前記アドレス可能メ
    モリに動作上接続されて、前記電圧制御発振器の前記動
    作周波数でクロック信号を提供する出力端子（１５）を
    有する前記電圧制御発振器（８）と； アドレス生成装置において、前記電圧制御発振器によっ
    て提供される各クロック信号に対してアドレス信号を提
    供するために、前記電圧制御発振器の前記出力に動作上
    接続された前記アドレス生成装置であって、前記電圧制
    御発振器の制御のための前記アドレス可能メモリからデ
    ータを得るために前記アドレス信号によって前記メモリ
    をアドレスするために、前記アドレス可能メモリに動作
    上接続されていて、且つ前記アドレス信号にょって前記
    メモリをアドレスするためにイメージ定義データ信号が
    記憶された前記メモリに動作上接続された前記アドレス
    生成装置（９）とを備えた前記クロック回路。
JP58189438A 1982-10-13 1983-10-12 クロツク回路 Pending JPS5994964A (ja)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US434189 1982-10-13
US06/434,189 US4541061A (en) 1982-10-13 1982-10-13 Data clocking circuitry for a scanning apparatus

Publications (1)

Publication Number Publication Date
JPS5994964A true JPS5994964A (ja) 1984-05-31

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ID=23723177

Family Applications (1)

Application Number Title Priority Date Filing Date
JP58189438A Pending JPS5994964A (ja) 1982-10-13 1983-10-12 クロツク回路

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US (1) US4541061A (ja)
EP (1) EP0106592A3 (ja)
JP (1) JPS5994964A (ja)
CA (1) CA1204147A (ja)

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