JPS599713A - Position detecting system - Google Patents

Position detecting system

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JPS599713A
JPS599713A JP11960682A JP11960682A JPS599713A JP S599713 A JPS599713 A JP S599713A JP 11960682 A JP11960682 A JP 11960682A JP 11960682 A JP11960682 A JP 11960682A JP S599713 A JPS599713 A JP S599713A
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Masao Tsunekawa
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    • GPHYSICS
    • G01MEASURING; TESTING
    • G01DMEASURING NOT SPECIALLY ADAPTED FOR A SPECIFIC VARIABLE; ARRANGEMENTS FOR MEASURING TWO OR MORE VARIABLES NOT COVERED IN A SINGLE OTHER SUBCLASS; TARIFF METERING APPARATUS; MEASURING OR TESTING NOT OTHERWISE PROVIDED FOR
    • G01D3/00Indicating or recording apparatus with provision for the special purposes referred to in the subgroups

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  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Transmission And Conversion Of Sensor Element Output (AREA)
  • Control Of Position Or Direction (AREA)

Abstract

PURPOSE:To obtain a position signal which is precise and having scarcely a ripple, by detecting a detecting level of two signals different in 1/4 period phase generated in accordance with movement of an object which moves or rotates in two directions, by subdividing it as to its position. CONSTITUTION:A motor 1 rotates and a rotary encoder 2 generates signals A, B of two phases different in 1/4 phase each other. A clock oscillator 17 generates a clock pulse of high frequency from the signals A, B, it is counted by counters 18, 24, and a digital value is outputted from ROMs 19, 25 in accordance with a count value. An amplitude value of a position which divides equally one period of the signals A, B into 16 is stored in the ROMs 19, 25, its read-out data is analogized by D/A converters 20, 26, respectively, is compared with the signals A, B by comparators 21, 27, and in accordance with its result, the counters 18, 24 are added and subtracted, and follow the signals A, B. A signal being near an amplitude center level is selected by a selecting circuit 23, a multiplexer is controlled, a direction is detected by a direction detecting circuit 49, and a position signal is outputted from a counter 45.

Description

【発明の詳細な説明】 (a)  発明の技術分野 本発明は2方向eζ移動又は沖1転する物体の刈j!j
、I)に応じて検出器より発生される周期的な一輩の1
d刊により1吻休の角質を検出する方式に係り、41に
モータやモータにより駆!初される4勿イ本の(υ11
−す1古号をリップルの少ない惰号で得る位置検出方式
にl&fする。
DETAILED DESCRIPTION OF THE INVENTION (a) Technical Field of the Invention The present invention is directed to the mowing of an object that moves in two directions or turns in one direction. j
, I) of the periodic single generated by the detector in response to
According to the D publication, it is related to the method of detecting keratin after 1 h, and it is driven by a motor or a motor in 41! The first 4 books (υ11)
- Change the old number to the position detection method obtained by the inertia number with less ripple.

(b)  従来技術と問題点 モータやモータによシ駆動される物体の位置を検出する
方式として、ロータリ主ンコーダやり=ヤエンコーダ等
を使用する方式が知られている。
(b) Prior Art and Problems As a method for detecting the position of a motor or an object driven by a motor, a method using a rotary main encoder or the like is known.

例工kJ’ロータリエンコーダはモータの回転l1jI
lに数句けられ、該回転11QI!のIU転に応じて互
に牙の位相差を竹するA、Hの2相の擬似正弦波(i4
号を発生するもので、該(4(似正弦波信号の周波数輻
モータの回転速度に比例している。この2相の信号A。
Example kJ' rotary encoder is motor rotation l1jI
A few words were asked by l, and the rotation 11 QI! A two-phase pseudo sine wave (i4
This two-phase signal A has a frequency similar to a sine wave signal and is proportional to the rotational speed of the motor.

Bの卦′)1似正弦ンノ’;I言号から物体の(i′f
:泣信号(1,[通常下、)12の4111 (、f:
’、、−、出される。
B's trigram') 1 like sine n'; From the I word to the object's (i'f
: crying signal (1, [normally lower,) 12 no 4111 (, f:
',,−,is issued.

7、% 1図16し前Nj擬似正弦波信号から位1.′
イ化号を発生する101略図である。第2図は第1図会
部の波形1シ1である。−ε−メタ1回転しロータリエ
ンコーダ2は2相の互にオの1)1相身を有する信号A
と111号I3とを発生し信号Aυ比較器3へ+ kf
 −′f3’ Bは比較器4へ入る。比・1・・S3は
信号AがOボルトより大ならば°1“、小ならは”01
の信号を発少し、モノステーブル5は孔中ノ器3の出力
の立上り―でパルスを発生し、(ニノステーブル6は比
較器3の出力゛のきl下りてパルスを発生する。比較器
4に信号Bが0 +Mシルトり太ならは“11.小なら
は°O1の信号を発生し、モノステーブル7け比11ヅ
器4の出力の立上すでパルス全発生し、モノステーフル
8は比較器4の出力の立下りでパルスを発生する。モノ
ステーフル5,6の出力はOR回路10で論理和すれ、
モノステーブル7.8の出力はOR回路11で論理和さ
れ、更にOR回路12により論理オロされてカウンタ1
4に入り、該パルスの立下りでカウンタ14?7+、i
1丸Qさオlる。加Aすか混−Rかd排他的OR回1烙
9汲び13の出力(・7.てモータ1の回転力向がij
マ出さI]て行なわノする。リセットパルス発生器16
を・:、11作させるとカウンタ14(ハ)1リヒノト
される。−ぞの後モータ1が右回+1iiな・開始した
とするとイ1τ=h、nが0ボルトを]Jへ切るごとに
比戊i:s3.4の出力が変化してモノステーフル5.
li。
7.% 1 Figure 16 and the previous Nj pseudo sine wave signal to 1. ′
101 is a schematic diagram of generating a symbol. FIG. 2 shows waveform 1 of the first diagram. -ε-Meta rotates once and the rotary encoder 2 generates a signal A having 2 phases, 1) and 1 phase.
and No. 111 I3 are generated and sent to the signal Aυ comparator 3 +kf
-'f3' B enters comparator 4. Ratio 1...S3 is °1" if signal A is greater than O volts, and 01 if it is smaller.
The monostable 5 generates a pulse at the rising edge of the output of the comparator 3, and the monostable 6 generates a pulse at the rising edge of the output of the comparator 3. If the signal B is 0 +M silt, it will generate a signal of "11. If it is small, a signal of °O1 will be generated, and all the pulses will be generated at the rise of the output of the monostable 7 ratio 11 ratio generator 4, and the monostable 8 generates a pulse at the falling edge of the output of the comparator 4.The outputs of the monostaffles 5 and 6 are logically summed by the OR circuit 10, and
The outputs of the monostable 7.8 are logically summed by an OR circuit 11, further logically ORed by an OR circuit 12, and output to a counter 1.
4, and at the falling edge of the pulse, the counter 14?7+, i
1 round Q saoluru. Add A, Mix, R, or d Exclusive OR times 1, 9, 13 output (・7. Then, the rotational force direction of motor 1 is ij
I will do it. Reset pulse generator 16
If you make 11 works, the counter will be 14 (c) 1 rehinote. If motor 1 starts turning +1ii clockwise after -, the output of ratio i:s3.4 will change every time 1τ=h, n cuts 0 volts to ]J, and the output of monostaffle 5.
li.

7.8にてパルスが弁、生する。Afハルス&J、前G
Lの如くカラ/り14に入力し、υ;他的ORl+、4
i路13の出力相111となるためカウンタ14は加重
゛され続ける。カウンタ14の出力はブ”イジタル・ア
ナログ変換器15により階段状の′1ル圧波形として出
力される。又モータ1の回転方向が反転し左回転となる
と、排他的□ R回路13の出力が101となりカウン
タ14 i、i it nされる。以上説明した・f[
1<ディジタル・アナログ変換器15の出力(・しりセ
ットパルス発生器16を動作させた段のモータ1の回転
部を示す位置信号である。
At 7.8, a pulse is generated. Af Hals & J, former G
Input color like L to 14, υ; other ORl+, 4
Since it becomes the output phase 111 of the i-path 13, the counter 14 continues to be weighted. The output of the counter 14 is outputted as a stepped pressure waveform by the digital-to-analog converter 15. Also, when the rotation direction of the motor 1 is reversed and rotates counterclockwise, the output of the exclusive R circuit 13 is 101 and is counted by the counter 14 i, i it n.・f[
1<Output of the digital-to-analog converter 15 (・This is a position signal indicating the rotating part of the motor 1 at the stage where the set pulse generator 16 is operated.

このような従来技術によれば位置信号は信号A。According to such conventional technology, the position signal is signal A.

13のに周期を単位とする階段状の上圧波形しか741
られ々い。従って4#密なモータの回転位置を測定スリ
ット数をil:itlかくj−ることか考えられる。し
かし、これ(・;10−タリ」−ンコータの1重積を高
1間にすることと、史に偵構的には;−リット数をハd
加するにも限界がある等の欠点がある。
The upper pressure waveform has a step-like shape with a period unit of 13.741
It's rare. Therefore, it is conceivable that the number of slits for measuring the rotational position of the motor in 4# density can be expressed as il:itl. However, this (・;10-Tari''-Nkota's single stack is made into a high one, and from a historical perspective;--Lit number is
There are drawbacks such as there are limits to how much it can be added to.

(C)発明の目1」ジ 本発明の目11ツは上LL欠点を除くため機構的な手段
によらず、ロータリエンコーダ〃・らの擬似正弦仮の一
周期分を苛間隔で;tljl勿し、対応する振幅値を記
憶回路に格納しておき、それを使用し1変化する擬似正
弦仮に追従させることにより、11分化した等間隔を最
小単位としてディジタル回路で計数し、該追従回路の比
軟回路の出力が2クロック周期にわたって理#e して
同−輪理領奮とる時に限9、前記ディジタル回路の開数
I11をj着火又は訊少さぜることによυ位置信号のり
ノノルを減少させる位M検出方式を提供することにある
(C) Aspect 1 of the invention In order to eliminate the above LL defect, one period of the pseudo sine of the rotary encoder is fixed at regular intervals; Then, by storing the corresponding amplitude value in a memory circuit and using it to track a pseudo sine that changes by 1, a digital circuit counts the equal intervals divided into 11 as the minimum unit, and calculates the ratio of the tracking circuit. Only when the output of the soft circuit is active for two clock cycles and is the same, the υ position signal can be increased by increasing or decreasing the numerical aperture I11 of the digital circuit. An object of the present invention is to provide a method for detecting M that reduces the amount of M.

(d)  発明の構成 本発明の構成は2方向に移if;’4又は回転する物体
の運動に応じで1・・フ出器より発生される互にX周期
の位相差をイjする2相のiG号A又LIBの一周ルj
を:1III分し/こ位置に対する振幅値を記憶する手
段と、該記’1.G一手段の出力全ディジタル・アナロ
グ震換し該イ巴!、”A又はBの振幅と比吸する手段と
、該比IIズ手段の出力に尾、じて−J?、周jv]の
クロックパルスを加↓゛−0又は・1表りし、13fJ
 1:l: f!121−・」・段にプクヒスするdI
数手段とから1える追従回11・1iA及びBと、該ノ
1」従回路A及びBの出力と、該市従1iJ路A、Bの
自前、杷対する11位を比較する手段A及びBの出力と
から前記物体の運動方向を決定する手段と、該物体のて
陥畦1か論理Oかを出力した場合のみ前記運動計を開数
する手段をi−1数可能とするようにしたものである。
(d) Structure of the Invention The structure of the present invention moves in two directions if; One round of phase iG A or LIB
means for storing the amplitude value for the position; G-1's output is completely digital/analog convertible! , ``A means for absorbing the amplitude of A or B, and a clock pulse of -J?, period jv] is applied to the output of the ratio means, and ↓゛-0 or -1 is expressed, 13fJ
1:l:f! 121-・dI that makes a pukhiss on the “・” stage
Means A and B for comparing the following circuits 11 and 1iA and B obtained from several means, and the outputs of the following circuits A and B, and the 11th positions corresponding to the own and loquats of the circuits A and B. A means for determining the direction of movement of the object from the output of the object, and a means for calculating the number of the motion meter only when the object outputs a recess 1 or a logical O are capable of making i-1 numbers. It is something.

(e)  発明の実施例 第3図は本発明の一実Mfi (611を示す回路図で
、第4図は第3図のji11作説、四回である。モータ
1は回転し、ロータリエンコーダ2け2相の互に2の位
相差を有する伯”77 Aと信号Bとを発生する。クロ
ック発jh号器17は信号A、Bの変化に対し十分周波
妃Zのに4+いクロックパルスを発生させる。メモリ1
9及び25には例えばlLOMを用いて第5図に示す如
く、信号A又jd Bの一周期を16(1分した位IJ
: 1 o o〜115に対する振帖−値MO−M15
を2進デイジタル(tMで記1獣さぜる。メモリ19の
出力を1)/A変換器20でディジタル・アナログ変換
すると、カウンタ18の目数値にハ5、じた信号Aの振
幅値MO〜M15の内のどれかがDACAとして宿られ
る。比較器21に於てロータリエンコーダ2より送出さ
れた信号Aの振幅値と該メモリ19より読出された振幅
値DACAと比11・(される。比較器21の出力1d
情号A75KDACAよシ大ならはI 11となりカウ
ンタ18の4数値を加>iさせる。即ちクロック発振器
17よりのクロックにより加請、する。
(e) Embodiment of the invention FIG. 3 is a circuit diagram showing one example of the present invention Mfi (611), and FIG. The clock generator 17 generates 4+ clock pulses with a frequency Z that is sufficient for changes in the signals A and B. Generates.Memory 1
For example, lLOM is used for 9 and 25, and as shown in FIG.
: Shake-value MO-M15 for 1 o ~ 115
When the output of the memory 19 is converted from digital to analog by the /A converter 20, the amplitude value of the signal A obtained by multiplying the value of the counter 18 by 5 is obtained. ~ Any one of M15 will be housed as a DACA. In the comparator 21, the amplitude value of the signal A sent from the rotary encoder 2 and the amplitude value DACA read from the memory 19 are compared by 11.
If the information is greater than A75KDACA, it becomes I11, and the four values of counter 18 are added>i. That is, addition is performed using the clock from the clock oscillator 17.

信号Aが1)ACAよシ小ならば比軟器21の出力は1
 () eと7ンリカウンタ18は?欠のクロックパル
スにより減9される。カウンター8の目数1′]醪′こ
、しりメモリー9のMO−M15の振幅値が′WJr、
111さ)]Z)ためDACAはMO−M15のいずれ
かの1111をとりながら信号Aの波形に追従する。即
ちカウンター8.メモリー9.I)/A俊換器20.比
IK没i21はil、f従回路A47を構成する。同も
pにカウンタタ4.メモリ25,1)/A唆換器26.
しヒ較器27は追従回路B4N3を構成する。追従回路
B48は追従回路A47と動作+j比較する信号波形が
信号Bである点を除けば同様である。即ちD / A 
f換器27の出力L)ACBは11号Bの波形に追従す
る。従って信号AとI)ACA、信号Bと])ACBと
の13−j係は第4図に示す如くになり、比較器21と
27の出力も第4図に示す如く変化する。比較器22の
出力は信号Aの波形が0ボルトより犬ならばWll、小
ならば0°となる。同様に比較外28の出力も信号I3
の波形が0ボルトより犬ならば11@、小々らはlOf
となる。
If the signal A is smaller than 1) ACA, the output of the ratio softener 21 is 1
() What about e and 7-recounter 18? Decreased by 9 due to missing clock pulses. Counter 8 number 1'] Moromi'ko, the amplitude value of MO-M15 of Shiri memory 9 is 'WJr,
111sa)]Z) Therefore, DACA follows the waveform of signal A while taking any 1111 of MO-M15. That is, counter 8. Memory 9. I)/A Shunshuki 20. The ratio IK i21 constitutes an il, f slave circuit A47. The same goes to the counter 4. Memory 25, 1)/A inducer 26.
The comparator 27 constitutes a follow-up circuit B4N3. The follow-up circuit B48 is similar to the follow-up circuit A47 except that the signal waveform to be compared with the operation +j is the signal B. i.e. D/A
The output L)ACB of the f converter 27 follows the waveform of No. 11B. Therefore, the relationships 13-j between the signals A and I)ACA and between the signals B and ])ACB become as shown in FIG. 4, and the outputs of the comparators 21 and 27 also change as shown in FIG. The output of the comparator 22 is Wll if the waveform of the signal A is more than 0 volts, and 0° if it is less than 0 volts. Similarly, the output of the non-comparison 28 is also the signal I3.
If the waveform of is more than 0 volts, then 11@, small is lOf
becomes.

第6図はA、  B選択回路23の詳細回路図である。FIG. 6 is a detailed circuit diagram of the A, B selection circuit 23.

カウンタ18の出力がM4(f、5図)で、且つ比φを
器21の1.Ll力が111であるか、χはカウンタ1
8の出力がMllで、目、つ比−咬器21の出力が10
1の時、選択信号USFjAがヒツトされる。カウンタ
18の出力がM3で、目つ比較器21の出力が101で
イhるか、又はhftンタ18の出力がM12で比φ′
(器21の出力が111の時、選択16号USEAはリ
セットされ、る。即ちカウンタ18の出力がM4の時、
デコーダ5011−1:端子104を111とする。化
物・器21の出力が°11のためAND回1路52は1
11となり、OR回路56を経てJKフリップフロップ
58をセットする。カウンタ18の出力がMllの時、
デコータ゛50の端子111は111となり、比較器2
1の出力が101のためNOT回路51は111となり
、AND回路53&まWllとなって前記同様にフリノ
ブフロラフ”58をセットする。カウンタ18の出力が
M3の”f 、デコーダ50の端子103が111とな
り、比較器21の出力が101であるからNOT回路5
1の出力は”1’fAND回路541d’l’となり、
OR回M&57を経てフリラグフロップ58在リセット
〕る。カウンタj8の出力がM120時、テコータ50
の端子112にtJ@となり、比較器21の出力力内1
のためA N D IIE回路55に°11となり、1
111記同イ・jクリップフロップ58をりセットする
。こね、は第5図の矢印で示す範囲を用いて1H号A又
は信号BOVpt自う位置に対する・6圧レベル差が比
較的大きく行f度良く振幅差を:1・雪11出米る中心
レベル近い範囲の情報を採用するために用いら牙するも
のである。
The output of the counter 18 is M4 (f, Figure 5), and the ratio φ is 1. Ll force is 111, χ is counter 1
The output of 8 is Mll, and the output of the eye-to-articulator 21 is 10.
When it is 1, the selection signal USFjA is hit. Either the output of the counter 18 is M3 and the output of the comparator 21 is 101, or the output of the hft counter 18 is M12, and the ratio φ'
(When the output of the counter 21 is 111, the selection number 16 USEA is reset. That is, when the output of the counter 18 is M4,
Decoder 5011-1: Terminal 104 is set to 111. Since the output of the compound/container 21 is 11 degrees, the AND circuit 1 circuit 52 is 1
11, and the JK flip-flop 58 is set via the OR circuit 56. When the output of the counter 18 is Mll,
The terminal 111 of the decoder 50 becomes 111, and the comparator 2
Since the output of 1 is 101, the NOT circuit 51 becomes 111, which becomes an AND circuit 53&Wll, and sets the frinobuflrough ``58'' in the same manner as above.The output of the counter 18 becomes ``f'' of M3, and the terminal 103 of the decoder 50 becomes 111. , since the output of the comparator 21 is 101, the NOT circuit 5
The output of 1 becomes "1'fAND circuit 541d'l',
After the OR operation M&57, the free lag flop 58 is reset. When the output of counter j8 is M120, Tekota 50
becomes tJ@ at the terminal 112 of , and the output power of the comparator 21 becomes 1
Therefore, the A N D IIE circuit 55 becomes °11, and 1
111. A.j Set the clip flop 58. For kneading, use the range shown by the arrow in Figure 5 to find the center level of the 1H A or signal BOVpt where the pressure level difference is relatively large and the amplitude difference is good: 1. It is used to adopt information in a close range.

比lL器21の出力、即ち追従回路471:・出力はD
フリップフロップ29に入りクロック周期の2期間にわ
たって連続して比較器21の出力が′11の時、AND
回路35は111とな9、逆に、プ1」続して比÷ゾ器
21の出力がtheの時、比較器21の出力とDクリッ
プフロップ29の出力は101となってNOT回I烙、
31と32によりAND回路36t’、1”、!=fる
。fe ツテOFt III 路39 (7) 出力r
、i、’ J:lZ i、11!器21の出力がクロッ
ク周期の2興間にわたって11 mか°01かであった
場合111となり、比較外21の出力・がクロック周期
ごとに11Z701を繰り返ず」が合は101となって
マルチプレクサ43に入る。比較器27の出力、即ち追
従回1路48の出力けDフリップフロップ30に入り、
AND回路37、:38、N0Tl路33.34及びO
R回路40とにより上記比較器21の出力と同桶にクロ
ック周期の2期間にわたり連続して“11かl□fかで
あった場合論理111をマルチプレクサ43に入力し、
クロック周期ごとに′1”、°01を礎シ返す場合“0
1を入力する。A、Bbi択回路23の出力USgA&
−Jマルチプレクザ43を切替えてOR回路39と40
の出力のどちらかを送出する。この出力は前記の如く、
信号A又はBの中心レベルに近い範囲のiH報が選択さ
れ、カウンタ45にカウントイネーブル信号として送出
される。カウンタ45は該カウントイネーブル信号が1
11の時に限りクロックパルスを加算又は減算する。即
ち、選択信号USEAで選択された信号A又−Bの変化
が小さく追従回路47又は48のカウンタ18又は24
が加算、減算を繰)返j場合はカウンタ45の計舷値は
変化しない。
The output of the comparator 21, that is, the follow-up circuit 471: The output is D
When the output of the comparator 21 is '11' continuously in the flip-flop 29 for two periods of the clock period, the AND
The circuit 35 becomes 111, and conversely, when the output of the ratio divider 21 is the, the output of the comparator 21 and the output of the D clip-flop 29 become 101, and the output of the circuit 35 becomes 111. ,
31 and 32, AND circuit 36t', 1'',!=f.
,i,' J:lZ i,11! If the output of the multiplexer 21 is 11 m or 01 for two clock periods, it becomes 111, and if the output of the non-comparison 21 does not repeat 11 Z 701 every clock period, then it becomes 101 and the multiplexer Enter 43. The output of the comparator 27, that is, the output of the follow-up circuit 48 enters the D flip-flop 30,
AND circuits 37, :38, N0Tl paths 33, 34 and O
The R circuit 40 inputs logic 111 to the multiplexer 43 if the same output from the comparator 21 is "11 or l□f" continuously for two periods of the clock cycle.
'1' every clock cycle, '0' when returning °01
Enter 1. A, Bbi selection circuit 23 output USgA&
- OR circuits 39 and 40 by switching J multiplexer 43
Send either of the outputs. This output is as above,
An iH signal in a range close to the center level of signal A or B is selected and sent to counter 45 as a count enable signal. The counter 45 has a count enable signal of 1.
Clock pulses are added or subtracted only when the clock pulse is 11. That is, the change in the signal A or -B selected by the selection signal USEA is small and the counter 18 or 24 of the follow-up circuit 47 or 48
(j) repeats addition and subtraction, the egress value of the counter 45 does not change.

AND回路35の出力と比も’器2 gの出力は排他的
OR回路41に入り、AND回路38の出力と比較器2
2の出力は排他的OR回路42に入シ、選択信号USE
Aが信号A側の情報を選択した場合マルチプレクサ44
を制御して排他的OR回路41の出力を信号B側を4貸
択した場合は排他的OR回路42の出力をカウンタ45
に送出する。抽°他的OR回路41.42とマルチプレ
クサ44は物体の運動方間を検出する方向検出1目1路
49を構成する。即ち、比較器22.28の出力、AN
D回路35.38の出力及び選択信号USEAからモー
タ1の回転方向を検出し、カウンタ45を加2両−する
か減算するか制御する。
The output of the AND circuit 35 and the output of the comparator 2g enter the exclusive OR circuit 41, and the output of the AND circuit 38 and the comparator 2
The output of 2 is input to the exclusive OR circuit 42, and the selection signal USE
If A selects the information on the signal A side, the multiplexer 44
When the output of the exclusive OR circuit 41 is selected by 4 on the signal B side by controlling the output of the exclusive OR circuit 42, the output of the exclusive OR circuit 42 is
Send to. The abstract OR circuits 41, 42 and the multiplexer 44 form a direction detection path 49 for detecting the direction of motion of the object. That is, the output of comparator 22.28, AN
The rotational direction of the motor 1 is detected from the outputs of the D circuits 35 and 38 and the selection signal USEA, and the counter 45 is controlled to add or subtract.

カウンタ45はリセットパルス発生器16のリセットパ
フシスによりリセットされた後のh′I数値をD/A変
換器46に送出し、第4図位置信号に示す如くモータ1
の位1ξ信号をリップルの少い1区圧値で送出する。
The counter 45 sends the h'I value after being reset by the reset puff of the reset pulse generator 16 to the D/A converter 46, and outputs the h'I value to the D/A converter 46, as shown in the position signal of FIG.
The digit 1ξ signal is sent at a 1-section pressure value with less ripple.

尚、通常ロータリエンゴーダ2の回転軸に対する偏心な
どの原因で信号A、Bの振幅極太値がモータ1の一回転
の周期で微増減する。この影響が無視出来ない時は、該
極太値を検出して保持する回路を11.1加し、追従回
路47.48のD/A変換器20.’26の出力を、と
の極大値の大きさで変調する。即ち、第7図に示すピー
ク検出保持回路59と乗算器60を第3図の回路に11
4加することにより、更に精密な位置信号が得られる。
It should be noted that normally, due to eccentricity of the rotary engoder 2 with respect to the rotating shaft, the extremely large amplitude values of the signals A and B slightly increase or decrease in the cycle of one revolution of the motor 1. When this influence cannot be ignored, a circuit 11.1 for detecting and holding the extremely thick value is added to the D/A converter 20.1 of the follow-up circuit 47.48. '26 output is modulated with the magnitude of the local maximum value. That is, the peak detection and holding circuit 59 and multiplier 60 shown in FIG. 7 are added to the circuit shown in FIG.
By adding 4, a more precise position signal can be obtained.

本実施例では、第5図に示す信号A又はBの一周期を1
6等分したが、該等分数は多い程位置信号が精密となる
。従って必要に応じて分割数を決定すれば良い。
In this embodiment, one period of signal A or B shown in FIG.
It was divided into six equal parts, and the more the number of equal parts, the more precise the position signal becomes. Therefore, the number of divisions can be determined as necessary.

(f)  発明の詳細 な説明した如く本発明Qよ、ロータリエンコーダより発
生する擬似正弦波信号の変化の検出レベルを位置に対し
て細分して検出しているので、精否VCしかもリップル
のないモータの回転位置を検出する位置信号を得ること
が出来る。史に擬似正弦波信号の波形が異なるようなロ
ータリエンコーダに対しても記憶回路(メモリ)の内容
の書替え又は父換で対処し得る柔軟性を有し、高密度磁
気記録装置のテープ送り用キャプスクンモータの回転位
置を精密に検出するような場合、すぐ汁、た効果が得ら
れる。
(f) As described in detail, the present invention Q detects the change in the pseudo sine wave signal generated by the rotary encoder by subdividing the detection level with respect to the position, so that it is possible to achieve precise VC and ripple-free detection. It is possible to obtain a position signal that detects the rotational position of the motor. It has the flexibility to rewrite or replace the contents of the memory circuit (memory) even for rotary encoders whose pseudo sine wave signals have different waveforms. In cases where the rotational position of a motor is to be detected precisely, a very effective effect can be obtained.

【図面の簡単な説明】[Brief explanation of drawings]

第1図に従来の擬似正弦波1B号より位置イ[;チを発
生する回路図、第2図は第1図の各1411の波形図、
第3図は・11:発明の一実施H勿示す回路図、第4図
はt′M 3図の動作説明図、第5図はメモリの記録内
容を説明する図、第6図はA、B選択回路の詳細図、第
7図は回転i+11の偏心等の影響を除去する回路図で
ある。 1σモータ、2−:ロータリエンコーダ、3,4は比較
器、5〜8はモノステーブル、14はカウンタ、15は
D/A変換器、16はりセントパルス発生器、17はク
ロック発生器、18,24゜45−カウンタ、19.2
5はメモリ、20,26゜46はD/A変19き器、2
1,22,27.28は比較器、43.44はマルチプ
レクサ、5oはデコーダ、59Fiピ一ク検出保持回路
、6oは乗算器である。
Fig. 1 is a circuit diagram for generating position I [;
Fig. 3 is a circuit diagram of one embodiment of the invention (H), Fig. 4 is an explanatory diagram of the operation of t'M Fig. 3, Fig. 5 is a diagram explaining the recorded contents of the memory, Fig. 6 is A, A detailed diagram of the B selection circuit, FIG. 7, is a circuit diagram for eliminating the influence of eccentricity, etc. of rotation i+11. 1σ motor, 2-: rotary encoder, 3 and 4 are comparators, 5 to 8 are monostables, 14 is a counter, 15 is a D/A converter, 16 is a cent pulse generator, 17 is a clock generator, 18, 24°45-counter, 19.2
5 is memory, 20,26°46 is D/A converter, 2
1, 22, 27 and 28 are comparators, 43 and 44 are multiplexers, 5o is a decoder, 59Fi peak detection and holding circuit, and 6o is a multiplier.

Claims (1)

【特許請求の範囲】[Claims] 2方向に移動又は回転する物体の運動に応じで検出器よ
シ発生される互にオ周期の位相差を有す出力をディジタ
ル・アナ゛ログ変換し該信号A又はBの振幅と比較する
手段と、該比較手段の出力に応じて一定周期のクロック
パルスを加算又は減算し、前記記憶手段にアクセスする
割数手段とから成る追従回路A及びBと、該追従回路A
及びBの出力と、該j貝従回路A、Bの内前記信号A又
はBの振幅中心レベルに近い方を選択する選択信号と、
該信号A及びBの各振幅の零電位に対する電位を比較す
る手段A及びBの出力とから前記物体の運動方向を決定
する手段と、該物体の運動量を計数する手段とを設け、
前記追従回路A又はBが前記クロックパルスの21期間
にわたシ連続して論理1か話1理Oかチυ1力した場合
のみ前1j「2運動皐・をHI−数する手段を組数可能
とすることを特徴としたイ☆俗検出方式。
Means for digital-to-analog conversion of outputs generated by the detector in response to the motion of an object moving or rotating in two directions, each having a phase difference of 0 period, and comparing it with the amplitude of the signal A or B. and a divisor means for adding or subtracting clock pulses of a constant period according to the output of the comparing means and accessing the storage means; and the following circuit A;
and a selection signal for selecting the one of the slave circuits A and B that is closer to the amplitude center level of the signal A or B;
means for determining the direction of movement of the object from the outputs of the means A and B for comparing the potential of each amplitude of the signals A and B with respect to a zero potential, and means for counting the amount of momentum of the object,
Only when the follow-up circuit A or B continuously outputs logic 1, logic 1, or logic 1 over 21 periods of the clock pulse, it is possible to provide a number of sets of means for calculating the HI-number of the previous 1j'2 motions. This is an I☆vulgarity detection method that is characterized by the following.
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