JPS60109344A - ストップビット長調整方式 - Google Patents
ストップビット長調整方式Info
- Publication number
- JPS60109344A JPS60109344A JP58216588A JP21658883A JPS60109344A JP S60109344 A JPS60109344 A JP S60109344A JP 58216588 A JP58216588 A JP 58216588A JP 21658883 A JP21658883 A JP 21658883A JP S60109344 A JPS60109344 A JP S60109344A
- Authority
- JP
- Japan
- Prior art keywords
- data
- bit
- pulse
- sampling
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- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L25/00—Baseband systems
- H04L25/02—Details ; arrangements for supplying electrical power along data transmission lines
- H04L25/20—Repeater circuits; Relay circuits
- H04L25/24—Relay circuits using discharge tubes or semiconductor devices
- H04L25/242—Relay circuits using discharge tubes or semiconductor devices with retiming
- H04L25/245—Relay circuits using discharge tubes or semiconductor devices with retiming for start-stop signals
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Time-Division Multiplex Systems (AREA)
- Dc Digital Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
（ａｌ 発明の技術分野
本発明は時分割多重分離化装置食用い非同期式データ通
信を行なうシステムで、送信側に入力する非同期式デー
タの速度が受信側で出力する非同期式データの速度より
若干早い場合、出力する非同期式データのストップビッ
トのパルス巾に短くし入出力のスタートビット及びスト
ップビット奮含む一文字の時間長音等しくずへストップ
ビット長調整方式に関する。 （ｂ） 従来技術と問題点 時分割多重分離化装置を用い非同期式データの通信を行
なうシステムに付き第１図を用いて説明する。 第１図は時分割多重分離化装置を用い非同期式データの
通信を行なうシステムの片方向を示すブロック図である
。 図中１１は時分割多重化装置、１２は時分割分離化装置
、１３は伝送路を示す。 第１図において時分割多重化装置１１では入力するスタ
ートビット及びストップビットを持つ非同期式データの
文字データ全時分割多重化して伝送路１３會介して時分
割分離化装置１２に送り時分割分離化装置１２では多重
化さｎたものを分離しスタートビット及びストップビッ
ト會付して非同期データとして出力している。勿論逆方
向も同る非同期式データの速度より若干早くなる場合が
ある。この場合従来例の入力及び出力する非同期式デー
タの長さく時間幅）全比較して表わしたものが第２図で
ある。 第２図（５）の１〜８は入力側のスタートビット及びス
トップピッｉｆ含む非同期式データの順番を示しくＢ）
の１〜４，６〜８は入力側の非同期式データの順番に対
応して出力するスタートビット及びストップビットを含
む非同期式データの順番を示し・ている。Ｂは入力側の
１文字を伝送する時間ｌ〕會示しＢ′は出力側の１文字
を伝送する時間巾會示しＢ’＞Ｂである。 第２図では入力側の非同期式データの速度が出力側の非
同期式データの速度より若干早いので第２図（４）に示
す入力する４番目のデータを出力側で出力している途中
で既に６番目のデータが入力しているので出力側では５
番目のデータは送出せず４番目のデータの次に６番目の
データ金出力するようになる。この為５番目のデータは
欠落する。 このように送信側に入力する非同期式データの速度が受
信側で出力する非同期式データの速度より若干早い場合
、従来の方式で受信側で出力するデータが欠落すること
がある欠点があった。 ｆｃｌ 発明の目的 本発明の目的は上記の欠点に鑑み、送信側に入力する非
同期式データの速度が受信側で出力する非同期式データ
の速度より若干早い場合、出力する非同期式データの一
文字の時間中を、該入力する非同期式データの一文字の
時間巾に等しくなるようストップビットの時間巾’ｃ？
Ａ整するストップビット長調整方式の提供にある。 ＣＩＡと称す）のサンプリングパルス発生器のサンプリ
ングパルスの周期音可変可能にし、又サンフ゛りングパ
ルスｔカウントするカウンタ及び該カウンタのカウント
値をスタートビットよりデータビットの最後迄のサンプ
リングパルス数と比較し、この値になｎばパルスを出力
する比較器及び該比較器の出力パルスをトリガとしパル
ス奮発しこのパルスを該サンプリングパルス発生器に送
る単安定マルチバイブレーク（以下ＭＭと称す）及び該
ＡＣＩＡの出力にスタートビットの先端ｋｍ出１゜該カ
ウンタをクリアするスタートビット検出器を設け、該Ｍ
Ｍの出力パルスｌＪＴを送イＢ側Ｖに入力するスタート
ビット及びストップビラトラ陰む】文字の時間巾より受
信側のスタートビット及びデータビットの時間巾ヲ橙引
いた残りの時間巾となるようにし、該サンプリングパル
ス発生器で（ま該パルス巾Ｔのパルスが入力している間
サンプリングパルスの周期音このパルスＩｔ］Ｔの間に
所定のパルス数を発するように短くシ、この周期の短く
なったサジプリングパルスでストップビットを形成する
ようにしたことを特徴とする。 （ｅｌ 発明の実施例 以下本発明の一実施例につき図に従って説明する。 第３図は本発明の実施例のＡＣＩＡｋ中心とじたストッ
プビット長調整回路のブロック図、第４図は非同期式デ
ータの１文字の時間巾を示す図、で（５）入力側（Ｂ）
は従来の場合（Ｃ）は本発明の場合の出力側を示す。 図中１４はＡＣＩＡ、１５はカウンタ、１６は比較器、
１７はＭＭ、１８はサンプリングパルス発生器、１９は
スタートビット検出器、２０，２σはスタートビット、
２１ 、２１’はデータビット、２２．２２’、２２”
はストップビット、２３．２３’。 ２ｆは一文字の時間中を示す。 先づ第４図音用いて入力する非同期データの一文字の時
間巾及び従来方式の場合及び本発明の場合の出力する一
文字の時間巾について説明すると、第４図囚に示す入力
する非同期データの一文字の時間巾２３は第４図（Ｂ）
に示す従来方式の場合に出力する非同期データの一文字
の時間巾２３′より短い。従って先に説明する如くデー
タ抜けが生ずる。 本発明の場合は、第４図（ｃ）に示す如く出力する非同
期データの一文字の時間巾２３”ｋ、ストップピッ）
２２’６）時間巾を短くすることにより第４図囚に示す
入力す４−文字の時間１１ｊ２３に等しくするものであ
り、この方法に付き第３図ヶ用いて説明する。 第３図において、ＡＣＩＡ１４は入力する並列データを
直列データとし其のデータの前後に１ビツトの スタ
−トビット及びストップビットを付し非同期式データと
して出力する。仁の時データケサンプリングするサンプ
リング周期’ｋＥＴＪ変可能にしであるサンプリングパ
ルス発生器１８よりのサンプリングパルスは、通常は例
えば１ビツトの間に１６個発するようになっておりスト
ップビットは１６個のパルス分の時間巾で形成するよう
になっている。 スタートピント検出器１９はスタートビットの先頭を検
出した時パルス奮発し、カウンタ１５？１１−クリアし
、カウンタ１５（まサンプリングパルス発生器１８より
のサンプリングパルス数音カウントしカウント数
信を行なうシステムで、送信側に入力する非同期式デー
タの速度が受信側で出力する非同期式データの速度より
若干早い場合、出力する非同期式データのストップビッ
トのパルス巾に短くし入出力のスタートビット及びスト
ップビット奮含む一文字の時間長音等しくずへストップ
ビット長調整方式に関する。 （ｂ） 従来技術と問題点 時分割多重分離化装置を用い非同期式データの通信を行
なうシステムに付き第１図を用いて説明する。 第１図は時分割多重分離化装置を用い非同期式データの
通信を行なうシステムの片方向を示すブロック図である
。 図中１１は時分割多重化装置、１２は時分割分離化装置
、１３は伝送路を示す。 第１図において時分割多重化装置１１では入力するスタ
ートビット及びストップビットを持つ非同期式データの
文字データ全時分割多重化して伝送路１３會介して時分
割分離化装置１２に送り時分割分離化装置１２では多重
化さｎたものを分離しスタートビット及びストップビッ
ト會付して非同期データとして出力している。勿論逆方
向も同る非同期式データの速度より若干早くなる場合が
ある。この場合従来例の入力及び出力する非同期式デー
タの長さく時間幅）全比較して表わしたものが第２図で
ある。 第２図（５）の１〜８は入力側のスタートビット及びス
トップピッｉｆ含む非同期式データの順番を示しくＢ）
の１〜４，６〜８は入力側の非同期式データの順番に対
応して出力するスタートビット及びストップビットを含
む非同期式データの順番を示し・ている。Ｂは入力側の
１文字を伝送する時間ｌ〕會示しＢ′は出力側の１文字
を伝送する時間巾會示しＢ’＞Ｂである。 第２図では入力側の非同期式データの速度が出力側の非
同期式データの速度より若干早いので第２図（４）に示
す入力する４番目のデータを出力側で出力している途中
で既に６番目のデータが入力しているので出力側では５
番目のデータは送出せず４番目のデータの次に６番目の
データ金出力するようになる。この為５番目のデータは
欠落する。 このように送信側に入力する非同期式データの速度が受
信側で出力する非同期式データの速度より若干早い場合
、従来の方式で受信側で出力するデータが欠落すること
がある欠点があった。 ｆｃｌ 発明の目的 本発明の目的は上記の欠点に鑑み、送信側に入力する非
同期式データの速度が受信側で出力する非同期式データ
の速度より若干早い場合、出力する非同期式データの一
文字の時間中を、該入力する非同期式データの一文字の
時間巾に等しくなるようストップビットの時間巾’ｃ？
Ａ整するストップビット長調整方式の提供にある。 ＣＩＡと称す）のサンプリングパルス発生器のサンプリ
ングパルスの周期音可変可能にし、又サンフ゛りングパ
ルスｔカウントするカウンタ及び該カウンタのカウント
値をスタートビットよりデータビットの最後迄のサンプ
リングパルス数と比較し、この値になｎばパルスを出力
する比較器及び該比較器の出力パルスをトリガとしパル
ス奮発しこのパルスを該サンプリングパルス発生器に送
る単安定マルチバイブレーク（以下ＭＭと称す）及び該
ＡＣＩＡの出力にスタートビットの先端ｋｍ出１゜該カ
ウンタをクリアするスタートビット検出器を設け、該Ｍ
Ｍの出力パルスｌＪＴを送イＢ側Ｖに入力するスタート
ビット及びストップビラトラ陰む】文字の時間巾より受
信側のスタートビット及びデータビットの時間巾ヲ橙引
いた残りの時間巾となるようにし、該サンプリングパル
ス発生器で（ま該パルス巾Ｔのパルスが入力している間
サンプリングパルスの周期音このパルスＩｔ］Ｔの間に
所定のパルス数を発するように短くシ、この周期の短く
なったサジプリングパルスでストップビットを形成する
ようにしたことを特徴とする。 （ｅｌ 発明の実施例 以下本発明の一実施例につき図に従って説明する。 第３図は本発明の実施例のＡＣＩＡｋ中心とじたストッ
プビット長調整回路のブロック図、第４図は非同期式デ
ータの１文字の時間巾を示す図、で（５）入力側（Ｂ）
は従来の場合（Ｃ）は本発明の場合の出力側を示す。 図中１４はＡＣＩＡ、１５はカウンタ、１６は比較器、
１７はＭＭ、１８はサンプリングパルス発生器、１９は
スタートビット検出器、２０，２σはスタートビット、
２１ 、２１’はデータビット、２２．２２’、２２”
はストップビット、２３．２３’。 ２ｆは一文字の時間中を示す。 先づ第４図音用いて入力する非同期データの一文字の時
間巾及び従来方式の場合及び本発明の場合の出力する一
文字の時間巾について説明すると、第４図囚に示す入力
する非同期データの一文字の時間巾２３は第４図（Ｂ）
に示す従来方式の場合に出力する非同期データの一文字
の時間巾２３′より短い。従って先に説明する如くデー
タ抜けが生ずる。 本発明の場合は、第４図（ｃ）に示す如く出力する非同
期データの一文字の時間巾２３”ｋ、ストップピッ）
２２’６）時間巾を短くすることにより第４図囚に示す
入力す４−文字の時間１１ｊ２３に等しくするものであ
り、この方法に付き第３図ヶ用いて説明する。 第３図において、ＡＣＩＡ１４は入力する並列データを
直列データとし其のデータの前後に１ビツトの スタ
−トビット及びストップビットを付し非同期式データと
して出力する。仁の時データケサンプリングするサンプ
リング周期’ｋＥＴＪ変可能にしであるサンプリングパ
ルス発生器１８よりのサンプリングパルスは、通常は例
えば１ビツトの間に１６個発するようになっておりスト
ップビットは１６個のパルス分の時間巾で形成するよう
になっている。 スタートピント検出器１９はスタートビットの先頭を検
出した時パルス奮発し、カウンタ１５？１１−クリアし
、カウンタ１５（まサンプリングパルス発生器１８より
のサンプリングパルス数音カウントしカウント数
【比較
器１６に送る。比較器１６のＤで示す入力には、第４図
（ｃｌのデータビット２１′のビット数音Ｎとすれば、
スタートビット２０’の１ビツト分との合計のサンプリ
ングパルス数（１千Ｎ）Ｘ１６の数を入力しており、比
較器】６ではカウンタ！５よりのカウント値が（１＋Ｎ
）Ｘ１６になったことでストップビット２ ｆ’のスタ
ート点全検出し、パルス奮発しこのパルス’（ｒＭＭ１
７に送る。ＭＭＩ７では入力したこのパルスヲトリガと
しパルス巾Ｔのパルスを発しサンプリングパルス発生器
１８に送出する。このパルス巾Ｔは、第４図囚に示す入
力する非同期データの一文字の時間巾２３より第４図（
ｃ）に示す出方する非同期データのスタートビット２０
′データビツト２１′の時間巾を差引いた残りの時間巾
と等しくなるようにしである。又サンプリングパルス発
生器１８は、ＭＭ１７よりパルス巾Ｔのパルスが入力し
ている間このパルス巾Ｔの間に１６個のパルスを発する
ようサンプリングパルスの周期を短くするようにしであ
る。従ってストップビット２ｚ′の時間巾はＴとなり出
力する非同期データの一文時の時間巾２ｇ′は入力する
非同期データの一文字の時間巾２３に等しくなりデータ
抜けｔ生ずることはなくなる。 （ｆ） 発明の効果 以上詳細に説明せる如く本発明によｎば出力する非同期
データの一文字の時間巾は入力する非同期データの一文
字の時間巾と等しくなるのでデータ抜けを生ずることが
無くなる効果がある。
器１６に送る。比較器１６のＤで示す入力には、第４図
（ｃｌのデータビット２１′のビット数音Ｎとすれば、
スタートビット２０’の１ビツト分との合計のサンプリ
ングパルス数（１千Ｎ）Ｘ１６の数を入力しており、比
較器】６ではカウンタ！５よりのカウント値が（１＋Ｎ
）Ｘ１６になったことでストップビット２ ｆ’のスタ
ート点全検出し、パルス奮発しこのパルス’（ｒＭＭ１
７に送る。ＭＭＩ７では入力したこのパルスヲトリガと
しパルス巾Ｔのパルスを発しサンプリングパルス発生器
１８に送出する。このパルス巾Ｔは、第４図囚に示す入
力する非同期データの一文字の時間巾２３より第４図（
ｃ）に示す出方する非同期データのスタートビット２０
′データビツト２１′の時間巾を差引いた残りの時間巾
と等しくなるようにしである。又サンプリングパルス発
生器１８は、ＭＭ１７よりパルス巾Ｔのパルスが入力し
ている間このパルス巾Ｔの間に１６個のパルスを発する
ようサンプリングパルスの周期を短くするようにしであ
る。従ってストップビット２ｚ′の時間巾はＴとなり出
力する非同期データの一文時の時間巾２ｇ′は入力する
非同期データの一文字の時間巾２３に等しくなりデータ
抜けｔ生ずることはなくなる。 （ｆ） 発明の効果 以上詳細に説明せる如く本発明によｎば出力する非同期
データの一文字の時間巾は入力する非同期データの一文
字の時間巾と等しくなるのでデータ抜けを生ずることが
無くなる効果がある。
第１図は時分割多重分離化装置を用い非同期式データの
通信を行うシステムのブロック図、第２図は従来例の入
力及び出力する非同期式データの速度を比較したタイム
チャー１・、第３図（ま本発明の実施例の非同期通信イ
ンクフェイスアダプタ會中心としたストップビット長調
枝回路のブロック図、第４図は非同期式データの一文字
の時間巾７示す図である。 図中１〜８は非同期式データの順番、１１は時分割多重
化装置、１２は時分割分離化−＃ｅ置、１３は伝送路、
１４は非同期通信インタフェイスアダプタ、１５はカウ
ンタ、１６は比較器、１７は単安定マルチバイブレータ
、１８はサンプリングパルス発生器、１９はスタートビ
ット検出器、２０゜２０′はスタートビット、２１ 、
２１’はデータビット、２２．２２’、２２’はストッ
プビット、２３．２３’。 ２１は一文字の時間巾？示す。 察３ 口 牟 ４ 日 −ｉ Ｔ ’ｒｗ
通信を行うシステムのブロック図、第２図は従来例の入
力及び出力する非同期式データの速度を比較したタイム
チャー１・、第３図（ま本発明の実施例の非同期通信イ
ンクフェイスアダプタ會中心としたストップビット長調
枝回路のブロック図、第４図は非同期式データの一文字
の時間巾７示す図である。 図中１〜８は非同期式データの順番、１１は時分割多重
化装置、１２は時分割分離化−＃ｅ置、１３は伝送路、
１４は非同期通信インタフェイスアダプタ、１５はカウ
ンタ、１６は比較器、１７は単安定マルチバイブレータ
、１８はサンプリングパルス発生器、１９はスタートビ
ット検出器、２０゜２０′はスタートビット、２１ 、
２１’はデータビット、２２．２２’、２２’はストッ
プビット、２３．２３’。 ２１は一文字の時間巾？示す。 察３ 口 牟 ４ 日 −ｉ Ｔ ’ｒｗ
Claims (1)
- 時分割多重分離化装置を用い非同期式データの通信を行
うシステムで、送信側に入力する非同期式データの速度
が受信側で出力する非同期式データの速度より若干早い
場合、受信側の時分割分離化装置の並列信号を直列信号
に変換して出力する非同期通信インタフェイスアダプタ
のサンプリングパルス発生器のサンプリングパルスの周
期を可変可能にし又サンプリングパルスをカウントする
カウンタ及び該カウンタのカウント値をスタートヒツト
よりデータビットの最後迄のサンプリングパルス数と比
較しこの値になｎばパルス會出力する比較器及び該比較
器の出力パルスヲトリガとしパルスを発し、このパルス
を該サンプリングパルス発生器に送るＸ単安定マルチバ
イブレーク及び該非同期通信インクフェイスアダプタの
出力にスタートビットの先端を検出し、該カウンタ上ク
リアするスタートビット検出器を設け、該単安定マルチ
バイブレークの出力パルス巾Ｔｔ＝送信側に入力するス
タートビット及びストップビットを含む１文字の時間巾
より受信側のスタートビット及びデータビットの時間山
留差引いた残りの時間巾となるようにし、該サンプリン
グパルス発生器では該パルス巾Ｔのパルスが入力してい
る間サンプリングパルスの周期をこのパルスＩｔ］Ｔの
間に所定のパルス数を発するように短くシ、この周期の
短くなったサンプリングパルスでストップビットを形成
するようにしたことを特徴とするストップビット長調整
方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58216588A JPS60109344A (ja) | 1983-11-17 | 1983-11-17 | ストップビット長調整方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58216588A JPS60109344A (ja) | 1983-11-17 | 1983-11-17 | ストップビット長調整方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60109344A true JPS60109344A (ja) | 1985-06-14 |
Family
ID=16690769
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58216588A Pending JPS60109344A (ja) | 1983-11-17 | 1983-11-17 | ストップビット長調整方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60109344A (ja) |
-
1983
- 1983-11-17 JP JP58216588A patent/JPS60109344A/ja active Pending
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