JPS60167018A - リセツト装置 - Google Patents

リセツト装置

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Publication number
JPS60167018A
JPS60167018A JP60001615A JP161585A JPS60167018A JP S60167018 A JPS60167018 A JP S60167018A JP 60001615 A JP60001615 A JP 60001615A JP 161585 A JP161585 A JP 161585A JP S60167018 A JPS60167018 A JP S60167018A
Authority
JP
Japan
Prior art keywords
reset
switches
microcomputer
command
switch
Prior art date
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Granted
Application number
JP60001615A
Other languages
English (en)
Other versions
JPS6253848B2 (ja
Inventor
Noriyuki Sakamoto
坂本 徳行
Fuminori Hirose
文則 広瀬
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Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
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Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
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Publication of JPS60167018A publication Critical patent/JPS60167018A/ja
Publication of JPS6253848B2 publication Critical patent/JPS6253848B2/ja
Granted legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明はマイクロコンピュータ等の電子回路を初期状態
に設定するためのリセット装置に関するものである。
マイクロコンピータを用いる機器においては、動作を開
始する前にマイクロコンピュータをリセットし、プログ
ラムを初期状態に戻す必要がある。
このため、従来より、第1図に示すようにマイクロコン
ピュータ1のリセット端子1&を電源ライ/2とアース
問に接続され抵抗RとコンデンサCの接続点に接続し、
電源投入時、電源ライン2の電位が第2図aに示すよう
に瞬時に立上るのに対して゛、リセット端子1aの電位
を第2図すに示すように抵抗RとコンデンサCで決まる
時定数にしたがってゆるやかに立上らせ、両電位a、b
の立上り時間差を利用してリセット端子1aを瞬間的に
L”レベルにしてマイクロコンピュータ1をリセットす
るようにしている。ところが、この場合に′は電源の立
上り時に一度電圧が下がったりするいわゆるチャタリン
グによる誤動作が生じ、確実にリセットできない場合が
ある。
これを防止するためには、手動で操作されるリセット釦
を設け、このリセット釦によってリセットスイッチを閉
じ、マイクロコンピュータ1のリセット端子1aを所定
の電位点(たとえばアース)に接続するようにしてもよ
いが、特にメモリー機能をもつ場合には、誤ってリセッ
ト釦を操作するとメモリーされた内容自体が消されてし
まうおそれもあり、そのためリセット釦を機器の裏側な
ど操作しにくい場所に設ける必要があり、その結果リセ
ット操作自体を忘れてし1うという不都合がある。
もちろん、第3図に示すようにマイクロコンピュータ1
に3つのリセット端子1a、1b、1cを設け、これら
3つのリセット端子1a 、1b、1cに3個のリセッ
トスイッチ3,4.5を接続し、これら3つのスイッチ
を同時に閉じたときのみリセットがかかるようにするこ
とも考えられる。このようにすればスイッチ3,4.5
のリセット釦を機器の前面に配置しても誤操作のおそれ
はなく、またリセットのかけ忘れも防止できるが、この
ときKはマイクロコンピュータ1内にスイッチ3゜4.
6の開閉状態を識別する特別なプログラムを組込まなけ
ればならないという新たな問題が発生する。
本発明はこのような問題を解決するリセット装置を提供
するものである。
以下本発明の一実施例を第4図とともに説明する。
第4図において、81〜S5はマイクロコンビ、−夕1
にデータの書き込み、読み出し等の所定の指令を与える
ための指令スイッチであり、このうちスイッチS1 、
S3 、S6は互に連動する2回路のスイッチ5SS 1−11 1−2+3−11 3−2 lチS2.S4
と同様に所定の指令を与えるためのスイッチとして動作
し、他方のスイッチ”1−2゜53−2 、”5−2は
、マイクロコンピュータ1のリセット端子1aとアース
間に直列に接続されている。
」二記構成において、スイッチ81 〜S6 をそれぞ
れ単独に閉じれば、マイクロコンビ、−plに所定の指
令を与えることができ、スイッチS1゜S3.S6を同
時に閉じたときのみリセット端子1aがアースに接続さ
れ、マイクロコンピュータ1がリセットされる。
このように゛本発明によれば、 (1)スイッチの手動操作によってリセットをかけるこ
とができるから、電源の立上りを利用するものに比べて
リセット動作を確実にすることができる。
(2)電子回路のり七ノドポイントを直接所定の電位点
に接続してリセットをかけるものであるから、複数のス
イッチの開閉状態を識別するためのプログラムも不要に
なる。
(3)複数のスイッチが同時に閉じたときだけリセット
がかかるから、リセット釦を機器の前面等に設けても誤
ってリセットしたり、リセットし忘れたりするおそれが
なくなる。
(4) リセット用のスイッチが指令スイッチと連動し
ているから、リセット釦を指令釦で兼用することができ
、したがって部品の取付スペースの点でも有利になる。
という優れた効果が得られる。
【図面の簡単な説明】
第1図は従来例の回路図、第2図はその動作説明図、第
3図は他の従来例の回路図、第4図は本発明の一実施例
の回路図である。 1・旧・・マイクロコンピュータ、1a・・印・リセッ
ト端子、2・・・・・・電源ライン、S、5s1−12
’3−II 84185−1 ”””指令スイッチ、5s1−213
−21 85−2・山・・リセットスイッチ。 代理人の氏名 弁理士 中 尾 敏 男 はが1名第1
図 ? 第2図 α □を 第3図 第4図

Claims (1)

    【特許請求の範囲】
  1. 回路網中のりセントポイントを所定の電位点に接続した
    とき、この回路網を初期状態にリセットするように構成
    した電子回路と、上記電子回路に所定の動作を指令する
    複数の指令スイッチと、上記複数の指令スイッチに連動
    する複数のリセットスイッチとを備え、上記複数のリセ
    ットスイッチを、上記回路網中のリセットポイントと上
    記所定の電位点との間に直列に接続したリセット装置。
JP60001615A 1985-01-09 1985-01-09 リセツト装置 Granted JPS60167018A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP60001615A JPS60167018A (ja) 1985-01-09 1985-01-09 リセツト装置

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JP60001615A JPS60167018A (ja) 1985-01-09 1985-01-09 リセツト装置

Publications (2)

Publication Number Publication Date
JPS60167018A true JPS60167018A (ja) 1985-08-30
JPS6253848B2 JPS6253848B2 (ja) 1987-11-12

Family

ID=11506417

Family Applications (1)

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JP60001615A Granted JPS60167018A (ja) 1985-01-09 1985-01-09 リセツト装置

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JP (1) JPS60167018A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH03127937U (ja) * 1990-03-31 1991-12-24

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH03127937U (ja) * 1990-03-31 1991-12-24

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JPS6253848B2 (ja) 1987-11-12

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