JPS60183854A - 変調方式 - Google Patents
変調方式Info
- Publication number
- JPS60183854A JPS60183854A JP3872184A JP3872184A JPS60183854A JP S60183854 A JPS60183854 A JP S60183854A JP 3872184 A JP3872184 A JP 3872184A JP 3872184 A JP3872184 A JP 3872184A JP S60183854 A JPS60183854 A JP S60183854A
- Authority
- JP
- Japan
- Prior art keywords
- data
- clock
- output
- circuit
- input data
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L7/00—Arrangements for synchronising receiver with transmitter
- H04L7/02—Speed or phase control by the received code signals, the signals containing no special synchronisation information
- H04L7/033—Speed or phase control by the received code signals, the signals containing no special synchronisation information using the transitions of the received signal to control the phase of the synchronising-signal-generating means, e.g. using a phase-locked loop
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Dc Digital Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
この発明は、クロック成分を安定に抽出できる様にした
ＰＣＭ信号の変調方式に関する。
ＰＣＭ信号の変調方式に関する。
従来、ＰＣＭデータの伝送方式では、第１図の様なＮＲ
Ｚ方式が良く知られている。この方式は伝送効率が良く
、変復調回路の偶成及び信号処理が簡単で検出窓幅が広
くとれる等の利点を有するが、その反面最大反転間隔（
パルスの立ち上りと立ち下がりの最大間隔）が無限に長
くなる可能性があｐピット同期がとりにくい、直流成分
が多い等の欠点があった。上記欠点を改良すべく数多く
の変調方式が提案されているが、回路構成が複雑になる
という問題があった。そのためＰＣＭデータを変調する
際、変調方式の有する性能と変復調回路の規模とのトレ
ードオフが変調方式選定の問題点となっていた。
Ｚ方式が良く知られている。この方式は伝送効率が良く
、変復調回路の偶成及び信号処理が簡単で検出窓幅が広
くとれる等の利点を有するが、その反面最大反転間隔（
パルスの立ち上りと立ち下がりの最大間隔）が無限に長
くなる可能性があｐピット同期がとりにくい、直流成分
が多い等の欠点があった。上記欠点を改良すべく数多く
の変調方式が提案されているが、回路構成が複雑になる
という問題があった。そのためＰＣＭデータを変調する
際、変調方式の有する性能と変復調回路の規模とのトレ
ードオフが変調方式選定の問題点となっていた。
本発明は、上述した従来方式であるＮＲＺ方式の欠点を
改良したもので気１〃或いは囁０〃のデータが長期に渡
って連続した場合でも安定にクロック成分を抽出するこ
とができ直流成分も少なくＮＲＺ方式が有する利点をそ
のまま保持する様な変調方式を提供することを目的とす
る。
改良したもので気１〃或いは囁０〃のデータが長期に渡
って連続した場合でも安定にクロック成分を抽出するこ
とができ直流成分も少なくＮＲＺ方式が有する利点をそ
のまま保持する様な変調方式を提供することを目的とす
る。
本発明は２値打号の入力データを伝送用クロックと同Ｊ
ＩＪコさせるための同期装置と前記入力データと前記伝
送用クロックの状態に応じていくつかの状態を出力する
データ変換装置とを具備し、前記入力データの値がＳＳ
Ｏ／／の時釦は前記伝送用クロックと同様の繰り返し
周波数で、しかも前記伝送用クロックの状態に無関係に
成る一定振幅でＸ高い状態〃と入低い状態“を縁り返す
様に前記データ変換装置を操作し、前記入力データの値
が９１〃の時で前記データ変換装置の出力が前記気高い
状態〃である場合にはさらに高い状態を出力する様に前
記データ変換装置を操作し、前記入力データの値が東１
〃の時で前記データ変換装置の出力が前記囁低い状態〃
である場合にはさらに低い状態を出力する様に前記デー
タ変換装置を操作することを特徴とする変調方式を提供
するものである。
ＩＪコさせるための同期装置と前記入力データと前記伝
送用クロックの状態に応じていくつかの状態を出力する
データ変換装置とを具備し、前記入力データの値がＳＳ
Ｏ／／の時釦は前記伝送用クロックと同様の繰り返し
周波数で、しかも前記伝送用クロックの状態に無関係に
成る一定振幅でＸ高い状態〃と入低い状態“を縁り返す
様に前記データ変換装置を操作し、前記入力データの値
が９１〃の時で前記データ変換装置の出力が前記気高い
状態〃である場合にはさらに高い状態を出力する様に前
記データ変換装置を操作し、前記入力データの値が東１
〃の時で前記データ変換装置の出力が前記囁低い状態〃
である場合にはさらに低い状態を出力する様に前記デー
タ変換装置を操作することを特徴とする変調方式を提供
するものである。
本発明によれば常に安定したクロック成分を抽出できる
という効果がある。即ち、上述した様に出力波形振幅の
中心電圧を閾値として持つコンパレータを用いれば、こ
の波形は中心電圧を必ずクロックと同じ周期で横切るの
で安定した周波数成分が（るられる。そして他の変調方
式の様に復調回路が複雑にならず、記録密度もＮＲＺと
同様１で比較的良い等の効果を有する。
という効果がある。即ち、上述した様に出力波形振幅の
中心電圧を閾値として持つコンパレータを用いれば、こ
の波形は中心電圧を必ずクロックと同じ周期で横切るの
で安定した周波数成分が（るられる。そして他の変調方
式の様に復調回路が複雑にならず、記録密度もＮＲＺと
同様１で比較的良い等の効果を有する。
本発明の原理図を第２図に、実現回路の一実施例を８１
３図に示す。第２図におりて（ａ）はＮＲＺ方式の入力
データ波形、（ｂ）はデータＳＳ □ ／／が連続した
時の出力変調波形、（Ｃ）は（ａ）のデータが入力され
た時の出力変調波形である。原理は、例えば入力データ
がＮＯ〃の連続であったとする。この時の変調されたデ
ータは第２図（ｂ）の様な小さい振幅のパルス列が出力
される。次にデータ気１〃が入力された場合には、出力
データが２通υになる。まず−１〃が入力されたときに
第２図（ｂ）の小さなＪ膜幅のパルス列の状態が低いレ
ベルの時、出力データはＶｔ、の状態まで落ちる。次に
、蟻１〃が人力された時の小振幅パルス列の状態が高い
レベルの場合出力データはＶＨの状態まで上昇する。第
２図（Ｃ）は第２図（ａ）の様なデータが入力された時
の出力データである。
３図に示す。第２図におりて（ａ）はＮＲＺ方式の入力
データ波形、（ｂ）はデータＳＳ □ ／／が連続した
時の出力変調波形、（Ｃ）は（ａ）のデータが入力され
た時の出力変調波形である。原理は、例えば入力データ
がＮＯ〃の連続であったとする。この時の変調されたデ
ータは第２図（ｂ）の様な小さい振幅のパルス列が出力
される。次にデータ気１〃が入力された場合には、出力
データが２通υになる。まず−１〃が入力されたときに
第２図（ｂ）の小さなＪ膜幅のパルス列の状態が低いレ
ベルの時、出力データはＶｔ、の状態まで落ちる。次に
、蟻１〃が人力された時の小振幅パルス列の状態が高い
レベルの場合出力データはＶＨの状態まで上昇する。第
２図（Ｃ）は第２図（ａ）の様なデータが入力された時
の出力データである。
上述した原理を実現する回路の一実施例を第３図に示す
。ここで１は入力データ、２は伝送用クロック、３．３
′はＤ７リツプフロ、ツブ回路、４は排他論理和回路、
５は反転回路、６は入力に応じて４段階の状態を出力す
る回路、例えば２ビツト入力のＤ／Ａ変換器、７は出力
伝送信号である。５に接続されているＶｉｉ 、 ＶＬ
は夫々Ｄ／Ａ変換器６の最大出力振幅の最大電圧、最小
電圧である。この時Ｄ／Ａ変換器６は、ＤＡＴＡ 、
ＣＬＯＣＫ ２つの入力に対して第１表、第４図に示す
ような動作をする。
。ここで１は入力データ、２は伝送用クロック、３．３
′はＤ７リツプフロ、ツブ回路、４は排他論理和回路、
５は反転回路、６は入力に応じて４段階の状態を出力す
る回路、例えば２ビツト入力のＤ／Ａ変換器、７は出力
伝送信号である。５に接続されているＶｉｉ 、 ＶＬ
は夫々Ｄ／Ａ変換器６の最大出力振幅の最大電圧、最小
電圧である。この時Ｄ／Ａ変換器６は、ＤＡＴＡ 、
ＣＬＯＣＫ ２つの入力に対して第１表、第４図に示す
ような動作をする。
以下（臼
第１表
第３図の回路動作は、まずＤノリツブフロラプ回路３で
入力データ１を伝送用クロック２と同期させ、クロック
と同期した入力データと伝送用クロックの排他論理和を
とる。次にその出力を反転回路５により反転し、更に４
．５の回路を通過した際の遅延によるクロックとの位相
のずれを除去するためにＤフリップフロップ回路３′に
よって再度クロックと同期をとり、その出力をクロック
とともにＤ／Ａ変換器に入力すれば第２図（ｃｌの様な
出力波形が得られる。
入力データ１を伝送用クロック２と同期させ、クロック
と同期した入力データと伝送用クロックの排他論理和を
とる。次にその出力を反転回路５により反転し、更に４
．５の回路を通過した際の遅延によるクロックとの位相
のずれを除去するためにＤフリップフロップ回路３′に
よって再度クロックと同期をとり、その出力をクロック
とともにＤ／Ａ変換器に入力すれば第２図（ｃｌの様な
出力波形が得られる。
復調は、第２図（Ｃ）の波形におけるＶＴＣを閾値に持
つコンパレータに第２図（Ｃ）の波形を入力すればクロ
ックが抽出できるし、ＶＴＨ、ＶＴＬを閾値とする様な
２つのコンパレータに第２図（Ｃ）の波形を入力しその
出力を加え合わせればデータの抽出ができる。
つコンパレータに第２図（Ｃ）の波形を入力すればクロ
ックが抽出できるし、ＶＴＨ、ＶＴＬを閾値とする様な
２つのコンパレータに第２図（Ｃ）の波形を入力しその
出力を加え合わせればデータの抽出ができる。
本発明は１例えばテレビジョン放送における音声の高品
位化に応用できる。現在のテレビシロン放送の音声は、
副搬送波を用いて画像信号と周波数多重して伝送される
。そのため色副搬送波と音声副搬送波によるビート妨害
が生ずる。またＳハ比があまり高くないためこれ以上の
音声の品質向上は、現行の方式では望めない。そこで将
来有望な方法の１つとして音声信号をＰＣＭ化し、時分
割多重して記録する方法がおる。ＰＣＭ音声信号を時分
割多重で画像信号と記録する際、１水平走査期間に音声
信号を記録できる期間は充分確保できない。そのため空
いている期間を有効に使用しなければならない、その時
、ＰＣＭ音声データから簡単に色副搬送波の周波数成分
子ｓｃが抽出できればカラーバーストが記録されている
期間もＰＣＭ音声の記録に使用することができ情＠量が
相当ふやせる。
位化に応用できる。現在のテレビシロン放送の音声は、
副搬送波を用いて画像信号と周波数多重して伝送される
。そのため色副搬送波と音声副搬送波によるビート妨害
が生ずる。またＳハ比があまり高くないためこれ以上の
音声の品質向上は、現行の方式では望めない。そこで将
来有望な方法の１つとして音声信号をＰＣＭ化し、時分
割多重して記録する方法がおる。ＰＣＭ音声信号を時分
割多重で画像信号と記録する際、１水平走査期間に音声
信号を記録できる期間は充分確保できない。そのため空
いている期間を有効に使用しなければならない、その時
、ＰＣＭ音声データから簡単に色副搬送波の周波数成分
子ｓｃが抽出できればカラーバーストが記録されている
期間もＰＣＭ音声の記録に使用することができ情＠量が
相当ふやせる。
本発明はこのような場合に特に有効である。即ち、第５
図の様にテレビジョン信号においてバックポーチ８０期
間に第２図（Ｃ）の様な波形を記録するのである。セし
てＰＣＭ音声信号が記録されている期間だけ、ＶＴＨＶ
’ｒｃ ＶＴＬという閾値を持ったコンパレータで検出
すればｆｓｃとＰＣＭ音声データの抽出が可能である。
図の様にテレビジョン信号においてバックポーチ８０期
間に第２図（Ｃ）の様な波形を記録するのである。セし
てＰＣＭ音声信号が記録されている期間だけ、ＶＴＨＶ
’ｒｃ ＶＴＬという閾値を持ったコンパレータで検出
すればｆｓｃとＰＣＭ音声データの抽出が可能である。
また、本発明の応用は、２値データの伝送だけに限定さ
れるものではない。データ入力段とＤ／Ａ変換器の若干
の変更で多値データ伝送へも応用可能である。
れるものではない。データ入力段とＤ／Ａ変換器の若干
の変更で多値データ伝送へも応用可能である。
第１図は、ＮＲＺ方式説明のための一例、第２図は本発
明の原理図、第３図は本発明の実現回路の一例、第４図
はＤ／Ａ変換器の出カバターン図、第５図は一実施例の
原理図である。 １は入力データ、２は伝送用クロック、３，３′はＤフ
リップフロップ回路、４は排他論理和回路、５は反転回
路、６はシ傷、変換器、７は出力データ、８はテレビジ
ラン信号中のＰＣＭ音声信号記録期間、９はテレビジラ
ン信号中の画像信号である。 第 １ 図 第 ２ 図 ＶＨ−一一一〜−−−−− 第 ３ 図 第 ４ 図 （ｆ／、Ｂ） （Ｄ、／） （１０） （０，Ｄン （
／、ｌ〕第 ５ 図
明の原理図、第３図は本発明の実現回路の一例、第４図
はＤ／Ａ変換器の出カバターン図、第５図は一実施例の
原理図である。 １は入力データ、２は伝送用クロック、３，３′はＤフ
リップフロップ回路、４は排他論理和回路、５は反転回
路、６はシ傷、変換器、７は出力データ、８はテレビジ
ラン信号中のＰＣＭ音声信号記録期間、９はテレビジラ
ン信号中の画像信号である。 第 １ 図 第 ２ 図 ＶＨ−一一一〜−−−−− 第 ３ 図 第 ４ 図 （ｆ／、Ｂ） （Ｄ、／） （１０） （０，Ｄン （
／、ｌ〕第 ５ 図
Claims (1)
- ２値打号の入力データを伝送用クロックと同期させるだ
めの同期装置と前記入力データと前記伝送用クロックの
状態に応じていくつかの状態を出力するデータ変換装置
とを具備し、前記入力データの値がゝ＼０〃の時には前
記伝送用クロックと同様の繰り返し周波数で、しかも前
記伝送用クロックの状態に無関係に成る一定振幅でＮ高
い状態〃とＮ低い状態〃を繰シ返す様に前記データ変換
装置を操作し、前記入力データの値がＩＸｌ ／／の時
で前記データ変換装置の出力が前記Ｎ高い状態〃である
場合にはさらに高い状態を出力する様に前記データ変換
装置を操作し、前記入力データの値が１１“の時で前記
データ変換装置の出力が前記気低い状態〃である場合に
はさらに低い状態を出力する様に前記データ変換装置を
操作することを特徴とする変調方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3872184A JPS60183854A (ja) | 1984-03-02 | 1984-03-02 | 変調方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3872184A JPS60183854A (ja) | 1984-03-02 | 1984-03-02 | 変調方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60183854A true JPS60183854A (ja) | 1985-09-19 |
Family
ID=12533185
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3872184A Pending JPS60183854A (ja) | 1984-03-02 | 1984-03-02 | 変調方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60183854A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6959061B1 (en) | 1998-10-07 | 2005-10-25 | Fujitsu Limited | Phase comparator circuit |
-
1984
- 1984-03-02 JP JP3872184A patent/JPS60183854A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6959061B1 (en) | 1998-10-07 | 2005-10-25 | Fujitsu Limited | Phase comparator circuit |
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